KR101913172B1 - 트랜스포머 및 이를 포함하는 전원공급장치 - Google Patents

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Abstract

본 발명의 일 실시 형태의 트랜스포머는 내부 공간을 갖는 자성체 코어; 자성체 코어 내에 배치되고, 도체 패턴이 형성된 레이어가 적층된 1차 코일 및 2차 코일을 포함하는 코일부; 및 자성체 코어와 코일부를 수용하는 베이스;를 포함하고, 베이스의 일부는, 2차 코일에 연결되는 출력단과 자성체 코어 사이에 개재되도록 코일부에 삽입 배치되는 개재될 수 있다.

Description

트랜스포머 및 이를 포함하는 전원공급장치{Transformer and power supply unit including the same}
본 기술은 트랜스포머 및 이를 포함하는 전원공급장치에 관한 것이다.
전원공급장치 내에는 전원부가 구비되며, 상기 전원부 내의 트랜스포머는 상기 전원부 전체의 거의 1/3에 해당할 정도의 크기를 가지고 있다.
트랜스포머는 전원공급장치에 사용되어 교류 전압을 조절하는데 널리 사용되는 전자부품으로, 보빈에 1차 코일과 2차 코일을 감고 중심에 코어가 일체로 결합되는 구조이다.
트랜스포머는 1차 코일에 인가된 전원에 의해 2차 코일에 유도기전력이 발생하는데, 2차 코일의 유도기전력은 1차 코일에 인가된 전압과 1차 코일과 2차 코일의 권선비에 따라 크기가 조정될 수 있다.
통상적인 트랜스포머는 제조시 코어 또는 보빈 주위에 코일을 권선해야 하는 작업 부담이 있고, 부품 소형화에 한계가 있었다.
또한, 트랜스포머는 코일과 코어 사이에 필요한 연면 거리를 위한 공간 확보나 안전규격을 만족시키기 위한 문제로 제조 공정이 복잡한 문제가 있었다.
본 발명의 일 실시 형태의 목적은 소형화를 구형할 수 있고, 조립성 및 생산성을 향상시킬 수 있는 트랜스포머 및 이를 포함하는 전원공급장치를 제공하는 것이다.
본 발명의 일 실시예에 따른 트랜스포머는 코일부와 베이스의 삽입 결합 구조를 포함하여 자성체 코어와 코일 간 우수한 절연 성능이 발휘되며, 자성체 코어와 출력단 사이의 연면 거리를 충분히 확보하면서 소형화를 이룰 수 있고, 간편한 조립에 의해 트랜스포머의 제작이 가능한 트랜스포머를 제공하는 것을 그 목적으로 한다.
본 발명의 일 실시 형태의 트랜스포머는 내부 공간을 갖는 자성체 코어; 상기 자성체 코어 내에 배치되고, 도체 패턴이 형성된 레이어가 적층된 1차 코일 및 2차 코일을 포함하는 코일부; 및 상기 자성체 코어와 상기 코일부를 수용하는 베이스;를 포함하고, 베이스의 일부는, 상기 2차 코일에 연결되는 출력단과 상기 자성체 코어 사이에 개재되도록 상기 코일부에 삽입 배치되는 것을 특징으로 한다.
상기 코일부는, 상기 출력단을 포함하는 제1 파트; 상기 도체 패턴이 형성되는 패턴부와 상기 1차 코일에 연결되는 입력단을 포함하는 제2 파트; 및 상기 제1 파트와 상기 제2 파트를 이격시키는 슬릿을 포함할 수 있다.
상기 베이스는, 상기 자성체 코어와 상기 코일부가 안착되는 안착부와, 상기 안착부에서 돌출되어 형성되는 적어도 하나의 측벽을 포함하고, 상기 측벽은 상기 슬릿에 삽입 결합되는 삽입부를 포함할 수 있다.
상기 삽입부의 높이는, 상기 자성체 코어의 높이보다 높게 형성될 수 있다.
상기 삽입부는 상기 출력단과 상기 자성체 코어 간의 기 설정된 연면 거리를 형성할 수 있다.
상기 슬릿은, 상기 제1 파트 방향으로 굴곡 형성될 수 있다.
상기 삽입부는 상기 측벽의 일부로 형성될 수 있다.
상기 코일부는, 상기 슬릿과 이격 형성되는 홈을 더 포함할 수 있다.
상기 측벽은, 상기 홈에 끼움 결합하는 결합부를 더 포함할 수 있다.
상기 코일부는, 유도 전류 형성을 위한 보조 코일;을 더 포함할 수 있다.
상기 1차 코일의 도체 패턴은, 상기 2차 코일의 도체 패턴의 상측 및 하측에 배치될 수 있다.
본 발명의 일 실시예에 따른 전원공급장치는 내부 공간을 갖는 자성체 코어; 상기 자성체 코어 내에 배치되고, 도체 패턴이 형성되는 레이어가 적층된 1차 코일 및 2차 코일을 포함하는 코일부; 및 상기 자성체 코어와 상기 코일부를 수용하는 베이스;를 포함하고, 베이스의 일부는, 상기 2차 코일에 연결되는 출력단과 상기 자성체 코어 사이에 개재되도록 상기 코일부에 삽입 배치되는,트랜스포머; 및 상기 트랜스포머가 실장되는 메인 기판;을 포함할 수 있다.
본 발명의 일 실시 형태의 트랜스포머 및 이를 포함하는 전원공급장치에 따르면, 자성체 코어와 출력단 사이의 연면거리를 충분히 확보할 수 있다.
또한, 베이스와 코일부의 삽입 결합 구조를 통해 제조공정을 단순화할 수 있고, 트랜스포머의 소형화 및 제조비용을 절감할 수 있다.
도 1은 본 발명의 일 실시예에 따른 트랜스포머의 사시도이다.
도 2는 본 발명의 일 실시예에 따른 트랜스포머의 분해사시도이다.
도 3은 본 발명의 일 실시예에 따른 코일부의 적층된 레이어를 나타내는 분해사시도이다.
도 4는 본 발명의 일 실시예에 따른 트랜스포머의 평면도이다.
도 5는 본 발명의 전원공급장치 내의 회로 기판에 실장된 트랜스포머의 모습을 도시한 개략 사시도이다.
이하에서는 도면을 참조하여 본 발명의 구체적인 실시예를 상세하게 설명한다. 다만, 본 발명의 사상은 제시되는 실시예에 제한되지 아니하고, 본 발명의 사상을 이해하는 당업자는 동일한 사상의 범위 내에서 다른 구성요소를 추가, 변경, 삭제 등을 통하여, 퇴보적인 다른 기술이나 본 발명의 사상의 범위 내에 포함되는 다른 실시예를 용이하게 제안할 수 있을 것이나, 이 또한 본 발명의 사상의 범위 내에 포함된다고 할 것이다.
또한, 각 실시예의 도면에 나타나는 동일한 사상의 범위 내의 기능이 동일한 구성요소는 동일한 참조부호를 사용하여 설명한다.
도 1 및 도 2는 본 발명의 일실시예에 따른 트랜스포머의 사시도 및 분해사시도이다. 도 3은 본 발명의 일 실시예에 따른 코일부의 적층된 레이어를 나타내는 분해사시도이다.
도 1 내지 도 3을 참조하면, 본 발명의 일 실시예에 따른 트랜스포머(100)는 전원공급장치에 탑재되는 대전력, 대전류용 트랜스포머일 수 있으며, 자성체 코어(110), 코일부(120), 베이스(150)를 포함하여 구성될 수 있다.
자성체 코어(110)는 내부에 코일부(120)를 배치하여 코일부(120)와 전자기 결합하는 자로를 형성한다.
자성체 코어(110)는 중족(111a)과 외족(111b) 사이에 공간이 형성되는 상측 코어(111) 와 상기 제1 코어부(112)와 대응되는 중족(112a)과 외족(112b)을 가지는 하측 코어(112)를 구비할 수 있다.상측 코어(111)와 하측 코어(112) 사이의 내부 공간에는 후술하는 코일부(120)를 배치된다. 코일부(120)의 중앙에 형성되는 관통공(129)에 자성체 코어(110)의 중족이 삽입되어 상측 코어(111) 및 하측 코어(112)는 서로 마주 접하도록 결합될 수 있다. 상측 코어(111)와 하측 코어(112)가 결합되어 하나의 자성체 코어(110)를 형성한다.
기 단면 형상이 E 자 형상의 E형 코어로 도시되어 있지만, 특별히 여기에 한정되는 것은 아니다. 예를 들어, 자성체 코어(110)는 E-I 형 자성체 코어, I-I 형 자성체 코어 등으로 이루어질 수 있다.
자성체 코어(110)는 다른 재질에 비해 고투자율, 저손실, 높은 포화자속밀도, 안정성 및 낮은 생산 비용을 갖는 Mn-Zn계 페라이트(ferrite)로 형성될 수 있다. 그러나, 본 발명의 실시예에서 자성체 코어(110)의 형태나 재질에 대해서 한정하는 것은 아니다.
코일부(120)는 트랜스포머(100)의 1차 또는 2차 코일을 이루는 것으로서, 자성체 코어(110)에 조립되어 외부 전원에 연결된 1차 코일에 전원이 가해지면, 2차 코일에 의해 유도된 전원이 트랜스포머(100)와 연결된 회로에 공급되어, 전원공급장치(1)와 같이 상용전원을 변경하여 공급하여야 하는 곳에 사용된다.
코일부(120)는 도체 패턴(22`, 23`, 24`)이 형성되는 복수의 레이어(22-1, 22-2, 23-1, 23-2, 24-1, 24-2)가 적층된 1차 코일(21) 및 2차 코일(24)을 포함한다. 1차 코일(21)은 도체 패턴(22`, 23`)이 형성되는 얇은 레이어(22-1, 22-2, 23-1, 23-2)가 복수로 적층되어 소정의 턴수를 가지는 인덕터 패턴을 포함하는 적층기판으로 이루어질 수 있다.
2차 코일(24)은 도체 패턴(24`)이 형성되는 얇은 레이어(24-1, 24-2)가 복수로 적층되어 소정의 턴수를 가지는 인덕터 패턴을 포함하는 적층기판으로 이루어질 수 있다.
1차 코일(21)과 2차 코일(24)은 일체로 형성되어 하나의 다층 인쇄회로기판으로 형성된다. 상기 인쇄회로기판 내의 레이어의 형성모습은 상세히 후술하기로 한다.
본 발명의 일 실시예에 따른 트랜스포머(100)는 대량 생산이 용이한 인쇄회로기판으로 코일부(120)를 형성함으로써 제조 효율을 비약적으로 향상시킬 수 있다.
또한, 다층 인쇄회로기판은 코일 패턴을 갖는 레이어가 복수 개로 적층되고, 적층된 레이어들의 코일 패턴들이 비아(via) 전극 등에 의해 접속된 구조로 이루어진다. 이러한 코일 패턴으로 형성된 1차 코일과 2차 코일을 포함하는 인쇄회로기판은 높이가 낮은 형태로 이루어질 수 있다.
코일부(120)는 소정 두께를 갖는 인쇄회로기판으로 이루어지며, 코일부(120)는 사각 판상으로 이루어질 수 있다. 코일부(120)의 내부에는 자성체 코어(110)가 삽입되는 관통공(129)이 형성된다.
코일부(120)는 관통공(129)을 중심으로 형성된 1차 코일(21)과 2차 코일(24)의 도체 패턴(24`)이 배치되는 패턴부를 포함한다. 즉, 패턴부는 코일부(120)의 중앙 영역을 나타낸다.
1차 코일(21)을 외부와 전기적으로 연결하는 입력단(135)은 패턴부의 일측에 형성되고, 2차 코일(24)을 외부와 전기적으로 연결하는 출력단(131)은 패턴부의 타측에 형성될 수 있다.
코일부(120)를 이루는 인쇄회로기판은 전후 방향 길이가 자성체 코어(110)의 전후 방향 길이보다 크게 형성된다. 이에 따라, 자성체 코어(110)의 전방으로 인출된 코일부(120)의 일단에는 출력단(131)이 형성되고, 자성체 코어(110)의 후방으로 인출된 코일부(120)의 타단에는 입력단(135)이 형성된다.
출력단(131)과 입력단(135)은 1차 코일(21)과 2차 코일(24)을 외부 회로와 전기적으로 연결하는 구성으로, 내벽면이 도전체로 코팅되어 기판을 관통하는 비아 전극(132, 136)과 비아 전극(132, 136)에 삽입되는 단자 핀(133, 137)을 포함한다. 입력단(135) 및 출력단(131)은 이에 한정되지 않으며, 패드나 솔더 범프, 솔더 볼, 커넥터 등 코일부(120)와 메인 기판(10)을 전기적으로 연결할 수 있는 구성이라면 다양한 형태로 변형될 수 있다.
비아 전극(132, 136)은 상호 연결되지 않은 1차 코일의 도체 패턴(22`, 23`)과 2차 코일의 도체 패턴(24`)의 시작점과 종료점에 형성되고, 상기 비아 전극(132, 136)에 단자핀(133, 137)이 삽입되어 전기적으로 연결된다.
출력단(131)과 입력단(135)은 일정 거리 이격된 위치에 형성될 수 있으며, 본 실시예에서는 출력단(131)은 입력단(135)과 반대 측면에 형성된다.
코일부(120)는 출력단(131)을 포함하는 제1 파트(120a)와 나머지 부분으로 이루어진 제2 파트(120b)로 구분될 수 있다. 코일부(120)는 제1 파트(120a)와 제2 파트(120b) 사이에 슬릿(121)을 포함한다.
제1 파트(120a)는 2차 코일(24)이 연결된 출력단(131)을 포함하며, 자성체 코어(110)의 전방으로 인출되는 코일부(120)의 부분을 의미한다.
제2 파트(120b)는 제1 파트(120a)를 제외한 코일부(120)의 나머지 부분이다. 구체적으로, 제2 파트(120b)는 1차 코일(21) 및 2차 코일(24)의 도체 패턴(22`, 23`, 24`)이 형성된 패턴부와, 1차 코일(21)이 연결된 입력단(135)을 포함한다.
슬릿(121)은 제1 파트(120a)와 제2 파트(120b)를 이격시키기 위해 형성되며, 슬릿(121)에 후술하는 베이스(150)의 일부가 삽입 배치되도록 일정한 폭을 가지도록 형성될 수 있다.
상기 슬릿(121)에 삽입된 베이스(150)의 일부는 제1 파트(120a)와 제2 파트(120b) 사이에 삽입 배치된다. 삽입된 베이스(150)의 일부는 자성체 코어(110)와 출력단(131) 사이에 개재되어 자성체 코어(110)와 출력단(131)을 격리할 수 있다. 코일부(120)의 슬릿(121)과 베이스(150)의 일부가 삽입 결합되는 구조에 따라, 격리된 자성체 코어(110)와 출력단(131) 간의 절연 거리 및 연면 거리를 확보할 수 있다.
베이스(150)는 내부에 자성체 코어(110)와 코일부(120)가 결합된 코일 조립체를 포함하도록 형성되는 것으로 트랜스포머(100)의 전체적인 몸체를 형성한다.
베이스(150)는 상방 개구를 통해 자성체 코어(110)와 코일부(120)를 내부 공간(151)에 수용할 수 있다. 베이스(150)의 내부 공간(151)은 자성체 코어(110)와 코일부(120)가 조립된 코일 조립체가 안착되는 안착부(153), 그리고 코일 조립체를 감싸는 형태로 형성되는 적어도 하나의 측벽(155)을 포함할 수 있다.
안착부(153)는 저면이 편평한 플레이트일 수 있다. 그러나 이에 한정되지 않으며 원활한 열 방출을 위해 내부에 적어도 하나의 구멍이 형성되거나, 격자나 방사형의 프레임 형태로 형성하는 등 다양한 변형이 가능하다.
측벽(155)은 베이스(150)의 외주면을 따라 형성되며, 안착부(153)에서 상부로 돌출되는 형태로 형성될 수 있다. 안착부(153)와 측벽(155)에 의해 내부 공간(151)은 용기 형태로 자성체 코어(110)와 코일부(120)의 조립체를 수용하는 공간으로 구성될 수 있다.
측벽(155)은 베이스(150)의 전방, 후방이 개방되도록 배치된다. 베이스(150)는 전, 후방 개구(152, 153)를 통해 코일부(120)의 전방, 후방 부위를 인출시킬 수 있다. 인출된 코일부(120)의 전방 부위에, 2차 코일(24)이 연결되는 출력단(131)이 배치되고, 인출된 코일부(120)의 후방 부위에 1차 코일(21)이 연결되는 입력단(135)이 배치될 수 있다.
여기서, 베이스(150)의 전방 개구(152)를 통해 인출된 코일부(120)의 전방 부위가 제1 파트(120a)에 해당한다. 제1 파트(120a)에 배치된 출력단(131)은 베이스(150)의 내부 공간(151)에 배치되는 자성체 코어(110)와 측벽(155)에 의해 격리된다.
측벽(155)은 자성체 코어(110)와 코일부(120)가 조립된 코일 조립체를 보호함과 동시에, 코일 조립체와 메인 기판(10)에 실장되는 다른 전자 부품들 간의 절연을 확보하기 위해 구비될 수 있다.
따라서 인접한 위치에 전자 부품이 배치되지 않거나, 절연 확보가 필요 없는 경우, 해당 방향의 측벽(155)은 생략될 수 있다.
베이스(150)의 외주면을 이루는 측벽(155)에는 코일부(120)의 공간을 분할하는 적어도 하나의 삽입부(157)를 포함할 수 있다. 이때, 삽입부(157)에 의해 구분되는 공간에는 각각 출력단(131)이 배치되고, 자성체 코어(110)가 배치될 수 있다. 삽입부(157)는 출력단(131)과 자성체 코어(110) 사이에 개재되며, 상호 간의 절연 거리와 연면 거리를 확보한다. 삽입부(157)는 측벽(155)의 일부를 이루고, 측벽(155)과 일체로 형성될 수 있다.
삽입부(157)는 베이스(150)의 폭을 따라 연장 형성되며, 끝단에서 일정 거리 이격된 위치까지 연장된다. 이에 따라, 베이스(150)의 전방에는 전방 개구(152)가 형성될 수 있다. 전방 개구(152)를 통해 베이스(150)의 바깥쪽에 배치되는 제1 파트(120a)와 베이스(150)의 안쪽에 배치되는 제2 파트(120b)를 연결할 수 있다.
삽입부(157)는 베이스(150)의 내측에 배치되는 자성체 코어(110)의 높이보다 큰 폭(또는 높이)으로 형성된다.
삽입부(157)는 베이스(150)의 외측을 향해 굴곡지도록 형성될 수 있다. 삽입부(157)가 코일부(120)의 제1 파트(120a)를 향해 굴곡 형성되면, 코일부(120)의 제1 파트(120a)와 제2 파트(120b)가 연결되는 부분의 폭을 좀 더 넓게 형성할 수 있다. 이에 따라, 제1 파트(120a)와 제2 파트(120b)의 연결 부위가 파손되는 것을 방지할 수 있다. 제1 파트(120a)와 제2 파트(120b)가 안정적으로 연결됨에 따라, 코일부(120)가 베이스(150)와 안정적으로 결합할 수 있다.
삽입부(157)는 슬릿(121)에 용이하게 삽입됨과 동시에, 베이스(150)와 코일부(120)가 결합된 후 쉽게 분리되는 것을 방지하기 위한 크기와 형상을 갖도록 형성될 수 있다.
삽입부(157)는 코일부(120)의 슬릿(121)을 관통하여 배치된다. 삽입부(157)의 상부는 코일부(120)를 통과하여 외부로 노출되도록 배치된다. 베이스(150)에 자성체 코어(110)와 코일부(120)의 조립체를 결합함과 동시에, 삽입부(157)가 출력단(131)과 자성체 코어(110) 사이에 삽입 배치되기 때문에 출력단(131)과 자성체 코어(110) 간의 절연 거리 및 연면 거리를 용이하게 확보할 수 있다.
베이스(150)는 사출 성형에 의해 용이하게 제조될 수 있으나, 이에 한정되지 않는다. 삽입부(157)는 베이스(150)와 일체로 형성되는 경우를 예로 들고 있으나, 이에 한정되지 않으며, 삽입부(157)는 독립적인 별도의 부재로 형성하여 베이스(150)에 결합되도록 구성할 수 있다. 또한, 본 실시예에 따른 베이스(150)는 절연 수지로 이루어지는 것이 바람직하며, 고내열성과 고내전압성을 갖는 재질로 이루어질 수 있다.
코일부(120)는 슬릿(121)과 이격되는 홈(123)을 더 포함한다. 베이스(150)의 측벽(155)은 상기 홈(123)에 끼움 결합되는 결합부(159)를 더 포함한다. 코일부(120)와 베이스(150)의 결합 시에, 결합부(159)가 홈(123)에 끼워져 코일부(120)와 베이스(150)를 안정되게 결합할 수 있다.
도 3은 본 발명의 일 실시예에 따른 코일부의 적층된 레이어를 나타내는 분해사시도이다.
도 3을 참조하면, 코일부(120)는 1차 코일을 이루는 도체 패턴(22`, 23`)이 형성된 복수의 레이어(22-1, 22-2, 23-1, 23-2)와 2차 코일을 이루는 도체 패턴(24`)이 형성된 복수의 레이어(24-1, 24-2)가 적층 결합된 인쇄회로기판으로 형성된다. 코일부(120)는 적어도 하나 이상의 레이어로 형성된 도체 패턴으로 이루어질 수 있다. 레이어들은 박형의 폴리머 플라스틱 기판으로 절연 특성을 가지면 특별히 재료에 한정되지 않는다.
1차 코일(21)은 도체 패턴(22`, 23`)이 형성되는 레이어(22-1, 22-2, 23-1, 23-2)들이 순차적으로 적층 결합하여 이루어질 수 있다. 여기서, 도체 패턴(22`, 23`)은 1차 코일을 형성하는 것으로, 도체 패턴(22`, 23`)들은 비아 전극 등을 이용하여 전기적으로 접속되며, 적층에 의해 코일 형상의 인덕터 패턴을 형성할 수 있다.
1차 코일(21)의 도체 패턴(22`, 23`)들은 전자기유도를 발생시키는 자기 경로를 생성한다. 자기 경로의 형성을 위해 제1 코일 패턴(22`, 23`)은 도전성 재질로 이루어진다.
1차 코일(21)은 2차 코일(24)을 기준으로 상측에 배치되는 상측 1차 코일(22)과 하측에 배치되는 하측 1차 코일(23)을 포함한다. 본 발명의 일 실시예에 따른 1차 코일은 상측 및 하측 1차 코일로 형성되는 것으로 설명하였지만, 이에 한정하지 않고, 1차 코일은 2차 코일의 일면에 대응되는 일 영역에 형성될 수 있다.
상측 1차 코일(22)은 도체 패턴(22`)을 갖는 적어도 하나의 레이어(22-1, 22-2)들이 복수개로 적층되어 형성된다. 적층된 레이어들(22-1, 22-2)에 형성된 도체 패턴(22`)들은 비아 전극등에 의해 전기적으로 접속된다. 도체 패턴(22`)은 도전성 금속 등으로 형성된다.
하측 1차 코일(23)은 상측 1차 코일(22)의 하측에 마주하게 자성체 코어(110) 내에 배치된다. 하측 1차 코일(23)은 상측 1차 코일(22)과 마찬가지로, 도체 패턴(23`)을 갖는 레이어(23-1, 23-2)들이 복수개로 적층되어 형성된다.
상측 1차 코일(22)과 하측 1차 코일(23)은 비아 전극을 통해 전기적으로 접속된다. 상측 1차 코일(22)의 도체 패턴(22`)과 하측 1차 코일(23)의 도체 패턴(23`)은 비아 전극에 의해 하나의 곡선으로 이루어질 수 있다.
상측 1차 코일(22)과 하측 1차 코일(23)로 형성된 1차 코일(21)은 입력단()에 의해 전원에 연결되어 1차 전압을 인가 받는다.
입력단(135)의 단자 핀(137)들은 상측 1차 코일(22)과 하측 1차 코일(23)을 형성하는 레이어(22-1, 22-2, 23-1, 23-2)에 끼워져 상측 1차 코일(22)의 도체 패턴(22`)과 하측 1차 코일(23)의 도체 패턴(23`)에 접속된다. 단자 핀(137)은 도전성 금속 등으로 이루어진다.
상측 1차 코일(22)에 형성된 도체 패턴(22`)과 하측 1차 코일(23)에 형성된 도체 패턴(23`)을 연결함으로써 1차 코일의 권선 수 비율을 증가시킬 수 있다.
2차 코일(24)은 1차 코일(21)의 도체 패턴(22`, 23`)과 전기적으로 연결되는 복수의 레이어(24-1, 24-2)로 이루어지며, 레이어(24-1, 24-2) 각각에는 2차 코일을 이루는 도체 패턴(24`)이 형성된다.
2차 코일(24)은 상측 1차 코일(22)과 하측 1차 코일(23) 사이에 배치된 상태로 적층될 수 있다. 2차 코일(24)은 적어도 하나의 레이어(24-1, 24-2)에 도체 패턴(24`)을 구비한다. 적층된 레이어(24-1, 24-2)에 형성된 도체 패턴(24`)들은 비아 전극에 의해 전기적으로 접속되며, 적층에 의해 코일 형상의 인덕터 패턴을 형성할 수 있다.
2차 코일(24)은 출력단(131)에 의해 메인 기판(10)의 회로에 접속된다. 2차 코일(24)의 도체 패턴(24`)은 출력단(131)의 단자 핀(133)들에 의해 메인 기판(10)과 연결된다.
2차 코일(24)은 1차 코일(21)과 전자기 유도 작용에 의해 고전압의 저전류를 발생시킴으로써, 고전압의 저전류를 요구하는 전자부하장치로 제공할 수 있다. 2차 코일(24)의 도체 패턴(24`)은 도전성 금속 등으로 형성된다.
출력단(131)의 단자 핀(133)들은 2차 코일(24)을 이루는 레이어(24-1, 24-2)에 끼움 결합되어 2차 코일(24)의 도체 패턴(24`)에 접속된다. 단자 핀(133)들은 메인 기판(10)의 회로에 접속된다. 출력단(131)의 단자 핀(133)은 도전성 금속 등으로 형성된다
1차 코일(21)과 2차 코일(24)이 도체 패턴(22`, 23`, 24`)을 갖는 레이어(22-1, 22-2, 23-1, 23-2, 24-1, 24-2)들이 복수개로 적층되어 하나의 인쇄회로기판으로 형성되면, 코일부(120)의 두께가 얇아진다. 코일부(120)의 두께는 상하 방향에 따른 높이를 의미한다. 코일부(120)의 두께가 얇아지면, 트랜스포머(100)의 소형화 및 높이 저감화가 이루어질 수 있다.
또한, 코일부(120)의 1차 코일(21)과 2차 코일(24)은 도체 패턴을 가지는 레이어가 적층된 인쇄회로기판으로 형성된 것으로, 상, 하측 1차 코일의 도체 패턴(22`, 23`) 간의 결합계수가 일률적으로 구현될 수 있고, 2차 코일의 도체 패턴(24`)과 상, 하측 1차 코일의 도체 패턴(23`) 간의 결합계수가 일률적으로 구현될 수 있다. 게다가, 상, 하측 1차 코일(22, 23) 및 2차 코일(24)의 제조가 자동화될 수 있으므로, 와이어를 수작업으로 권선하고 절연 처리하는 것에 비해, 생산성 향상에 유리하다.
1차 코일(21)과 2차 코일(24)의 도체 패턴(22`, 23`, 24`)은 동박, 은박, 알루미늄박 등의 금속박이나 금속산화물이 분산된 잉크와 같은 도전성 페이스트로 이루어질 수 있다. 금속박을 이용할 경우, 포토 마스크와 에칭액을 이용한 포토리소그래피 공법으로 도체 패턴(22`, 23`, 24`)이 형성될 수 있고, 도전성 페이스트를 이용할 경우, 스크린 인쇄법과 같은 인쇄전자 방식을 이용하여 도체 패턴(22`, 23`, 24`)이 형성될 수 있다. 도체 패턴(22`, 23`, 24`)은 코일부(120)의 중앙에 형성된 관통공(129)을 중심으로 시작점과 종료점을 가지는 원형, 타원형, 다각형 중 어느 하나의 형태로 형성될 수 있다.
1차 코일(21)과 2차 코일(24)을 이루는 복수의 레이어(22-1, 22-2, 23-1, 23-2, 24-1, 24-2)에는 각각 나선 형상의 도체 패턴(22`, 23`, 24`)이 형성될 수 있다. 각 레이어(22-1, 22-2, 23-1, 23-2, 24-1, 24-2)에 형성되는 도체 패턴(22`, 23`, 24`)의 권선수(또는 턴 수)는 모두 동일할 수 있다. 그러나 도체 패턴(22`, 23`, 24`)의 권선 수가 반드시 동일해야 하는 것은 아니다. 예를 들어, 1차 코일(21)의 도체 패턴(22`, 23`, 24`) 중 적어도 하나는 1차 코일의 전체 권선 수를 설정된 값으로 일치시키기 위해 권선 수가 조절될 수 있다.
본 발명의 일 실시예에 따른 코일부(120)는 인쇄회로기판에 1차 코일 및 2차 코일 패턴을 형성함으로써 코일 권선 작업이 필요 없고, 평면 상에 인쇄되는 코일패턴으로 인해 소자의 크기 및 부피를 줄일 수 있는 장점이 있다.
코일부(120)를 형성하는 각각의 레이어들은 자성체 코어(110)의 중족이 삽입되기 위한 관통공(129)이 형성될 수 있다.
본 발명의 코일부(120)는 1차 코일(21)의 도체 패턴(22`, 23`)과 2차 코일(24)의 도체 패턴(24`)이 적층되어 서로 연결되어 형성됨에 따라, 기판 면적의 증가 없이 1차 코일(21)과 2차 코일(24)을 순차적으로 적층할 수 있어 자성체 코어(110)를 감싸는 코일의 권선비를 증가시킬 수 있다.
1차 코일(21)과 2차 코일(24)을 형성하는 레이어(22-1, 22-2, 23-1, 23-2, 24-1, 24-2)들은 적층되어 하나의 적층기판을 이룰 수 있다. 1차 코일(21)과 2차 코일(24) 사이의 거리가 가까워지면, 리키지 인덕턴스(Leakage inductance)는 감소한다.
이와 같이 본 발명의 실시예들에 따른 트랜스포머(100)는 코일을 감는 것을 대신하여 인쇄회로기판의 패턴 설계를 이용함으로써 코일을 감기 위한 보빈과 트랜스포머를 안정되게 결합하기 위한 핀 배열이 필요 없이, 코일이 인쇄회로기판과 일체로서 제작됨으로써 소형화가 가능하고 제작 공정을 줄일 수 있다.
본 발명의 일 실시예에 따른 코일부(120)는 1차 코일(21)과 2차 코일(24) 및 차폐 패턴(25`)이 형성된 차폐 레이어(25)를 더 포함할 수 있다. 차폐 레이어(25)는 1차 코일(21), 2차 코일(24)과 함께 적층되어 적층기판을 이룰 수 있다.
차폐 레이어(25)는 상측 1차 코일(22)와 2차 코일(24) 사이 및 하측 1차 코일(23)와 2차 코일(24) 사이에 형성될 수 있다. 차폐 레이어(25)가 2차 코일(24)의 적층 방향의 상부 및 하부에 형성되는 것으로 도시하였으나, 이에 한정되지 않고 복수의 레이어(22, 23, 24) 각각의 사이에 배치될 수도 있다.
본 발명의 일 실시예에 따른 코일부(120)는 1차 코일(21)과 2차 코일(24) 및 전자기 유도 작용에 의해 유도 전압을 발생시켜 출력하는 보조 코일(26)을 더 포함할 수 있다. 보조 코일(26)은 코일 패턴들과 동일한 형태로, 적어도 하나 이상의 레이어에 형성되어 적층될 수 있다.
보조 코일(26)로부터 출력된 유도 전압은 메인 기판(10)에 장착되는 IC 소자 등을 구동하는데 이용될 수 있다. 보조 코일(26)은 코일부(120)와 비아 전극을 통해 접속될 수 있다. 입력단(135)를 통해 보조 코일(26)은 메인 기판(10)에 연결된다.
코일부(120)는 1차 코일(21)의 도체 패턴(22`, 23`)이 형성되는 레이어들(22-1, 22-2, 23-1, 23-2), 2차 코일(24)의 도체 패턴(24`)이 형성되는 레이어(24-1, 24-2)들 및 및 유도 전류 형성을 위한 보조 코일 패턴(26`)이 형성되는 레이어(26)를 구비할 수 있다.
보조 코일 패턴(26`)이 형성되는 레이어(26)는 2차 코일(24)과 가까운 방향에 배치될 수 있다. 다만, 보조 코일(26)의 적층 방법은 이에 한정되는 것이 아니라 선택에 따라 1차 코일(21)의 상부나 하부 또는 그 각각의 사이에 배치될 수도 있다.
도 4는 본 발명의 일 실시예에 따른 트랜스포머의 평면도이다.
도 4를 참조하면, 본 발명의 일 실시예에 따른 트랜스포머(100)는 베이스(150)가 코일부(120)에 삽입 결합되는 구조에 따라 코일부(120)의 일단에 형성된 출력단(131)과 자성체 코어(110) 간의 연면 거리를 확보할 수 있다. 구체적으로, 베이스(150)는 삽입부(157)가 자성체 코어(110)의 상부로 돌출되는 형태로 코일부(120)에 결합될 수 있다. 이에 따라, 자성체 코어(110)와 출력단(131) 간에 절연거리와 연면 거리를 확보할 수 있다.
트랜스포머의 1차 코일과 2차 코일은 각각 절연체인 기판에 형성되는 데 안전 규격에 따라 트랜스포머의 1차, 2차 코일과 코어(Core)간의 절연을 유지하기 위해 일정 거리로 이격된 연면 거리(Deepage Distance)가 확보되어야 한다.
여기서, 연면 거리는 두 도전 부분 사이의 최단 거리를 뜻하며 최단 거리는 두 도전 부분 사이에 위치하는 절연물의 표면 또는 그 잇는 부분을 따라서 계측된 거리를 의미한다.
본 발명의 일 실시예에 따른 트랜스포머(100)의 자성체 코어(110)와 출력단(131)의 연면 거리는 자성체 코어(110)와 출력단(131) 사이에 위치하는 베이스(150)의 삽입부(157)에 의해 확보되므로 트랜스포머(100)의 소형화가 가능하다.
코일부(120)의 슬릿(121)에 삽입된 베이스(150)의 삽입부(157)에 의해 자성체 코어(110)와 출력단(131)은 격리되도록 형성된다. 이에 따라, 자성체 코어(110)와 출력단(131)의 최단거리는 삽입부(157)의 표면을 따라 계측된다. 코일부(120)는 전, 후방 폭을 크게 형성하지 않고도 연면 거리를 확보할 수 있다. 또한, 베이스(150)와 코일부(120)의 결합에 의해서 자성체 코어(110)와 출력단(131) 이 격리될 수 있어, 연면 거리 확보가 용이하다. 코일부(120)와 베이스(150)의 삽입 결합 구조에 따라 자성체 코어(110)와 코일 간 우수한 절연 성능이 발휘된다.
트랜스포머(100)는 코일부(120)의 슬릿(121)에 베이스(150)의 삽입부(157)가 끼워지도록 형성되기 때문에, 베이스(150)와 자성체 코어(110) 및 코일부(120) 조립체 간의 간편한 조립이 가능하여 조립성이 향상된다.
베이스(150)와 코일부(120)의 결합에 의해 코일부(120)의 홈(123)에 베이스(150)의 결합부(159)가 끼움 결합되므로 베이스(150)와 자성체 코어(110) 및 코일부(120) 조립체 간의 결합 안정성도 확보된다.
삽입부(157)에 의해 1차 코일(21) 및 2차 코일(24)의 도체 패턴(22`, 23`, 24`)이 형성되는 패턴부와 출력단(131)도 격리된다. 이에 따라, 2차 코일(24)에 유도되는 전압이 출력단(131)를 통해 출력되는 출력 전압에 영향을 주는 것을 삽입부(157)를 통해 차단할 수 있다.
도 5는 본 발명의 전원공급장치 내의 회로 기판에 실장된 트랜스포머의 모습을 도시한 개략 사시도이다.
도 5를 참조하면, 전원공급장치(1)의 메인 기판(10) 상에 트랜스포머(100)가 실장된다. 자성체 코어(110)의 전방으로 인출되는 코일부(120)에는 출력단(131)이 형성되며, 코일부(120)가 메인 기판(10)에 실장되도록 출력단(131)은 단자 핀(133)을 포함한다. 단자 핀(133)을 통해 메인 기판(10)과 코일부(120)의 1차 코일(21) 및 2차 코일(24)을 연결할 수 있다. 코일부(120) 내의 인덕터 패턴은 단자 핀(133, 137)에 의해 전기적으로 연결될 수 있다. 다만, 단자핀을 이용한 결합뿐만 아니라, 솔더링 결합을 이용하여 메인 기판(10)과 코일부(120)를 연결할 수 있다.
트랜스포머(100)가 메인 기판(10)에 수평으로 실장되는 것으로 도시하였지만, 이에 한정하지 않고, 트랜스포머(100)는 메인 기판(10)에 수직으로 실장될 수도 있다.
본 발명은 이상에서 설명되는 실시 예에만 한정되는 것은 아니며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자라면 이하의 특허청구범위에 기재된 본 발명의 기술적 사상의 요지를 벗어나지 않는 범위에서 얼마든지 다양하게 변경하여 실시할 수 있을 것이다.
1: 전원공급장치
10: 메인 기판
21: 1차 코일
24: 2차 코일
100: 트랜스포머
110: 자성체 코어
120: 코일부
131: 출력단
150: 베이스

Claims (12)

  1. 내부 공간을 갖는 자성체 코어;
    상기 자성체 코어 내에 배치되고, 도체 패턴이 형성된 레이어가 적층된 1차 코일 및 2차 코일을 포함하는 코일부; 및
    상기 자성체 코어와 상기 코일부를 수용하는 베이스;를 포함하고,
    베이스의 일부는,
    상기 2차 코일에 연결되는 출력단과 상기 자성체 코어 사이에 개재되도록 상기 코일부에 삽입 배치되고,
    상기 코일부는,
    상기 출력단을 포함하는 제1 파트;
    상기 도체 패턴이 형성되는 패턴부와 상기 1차 코일에 연결되는 입력단을 포함하는 제2 파트; 및
    상기 제1 파트와 상기 제2 파트를 이격시키는 슬릿을 포함하는, 트랜스포머.
  2. 삭제
  3. 제1항에 있어서,
    상기 베이스는,
    상기 자성체 코어와 상기 코일부가 안착되는 안착부와, 상기 안착부에서 돌출되어 형성되는 적어도 하나의 측벽을 포함하고,
    상기 측벽은 상기 슬릿에 삽입 결합되는 삽입부를 포함하는, 트랜스포머.
  4. 제3항에 있어서,
    상기 삽입부의 높이는,
    상기 자성체 코어의 높이보다 높게 형성된, 트랜스포머.
  5. 제3항에 있어서,
    상기 삽입부는 상기 출력단과 상기 자성체 코어 간의 기 설정된 연면 거리를 형성하는, 트랜스포머.
  6. 제1항에 있어서,
    상기 슬릿은,
    상기 제1 파트 방향으로 굴곡 형성되는, 트랜스포머.
  7. 제3항에 있어서,
    상기 삽입부는 상기 측벽의 일부로 형성되는, 트랜스포머.
  8. 제3항에 있어서,
    상기 코일부는,
    상기 슬릿과 이격 형성되는 홈을 더 포함하는, 트랜스포머.
  9. 제8항에 있어서,
    상기 측벽은,
    상기 홈에 끼움 결합하는 결합부를 더 포함하는, 트랜스포머.
  10. 제1항에 있어서,
    상기 코일부는,
    유도 전류 형성을 위한 보조 코일;을 더 포함하는, 트랜스포머.
  11. 제1항에 있어서,
    상기 1차 코일의 도체 패턴은,
    상기 2차 코일의 도체 패턴의 상측 및 하측에 배치되는, 트랜스포머.
  12. 내부 공간을 갖는 자성체 코어; 상기 자성체 코어 내에 배치되고, 도체 패턴이 형성되는 레이어가 적층된 1차 코일 및 2차 코일을 포함하는 코일부; 및 상기 자성체 코어와 상기 코일부를 수용하는 베이스;를 포함하고, 베이스의 일부는, 상기 2차 코일에 연결되는 출력단과 상기 자성체 코어 사이에 개재되도록 상기 코일부에 삽입 배치되며, 상기 코일부는 상기 출력단을 포함하는 제1 파트, 상기 도체 패턴이 형성되는 패턴부와 상기 1차 코일에 연결되는 입력단을 포함하는 제2 파트 및 상기 제1 파트와 상기 제2 파트를 이격시키는 슬릿을 포함하는 트랜스포머; 및
    상기 트랜스포머가 실장되는 메인 기판;을 포함하는, 전원공급장치.
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