KR101521815B1 - 플러그/잭 접속부에서의 공통 모드 신호 생성 감소를 위한 방법 및 시스템 - Google Patents

플러그/잭 접속부에서의 공통 모드 신호 생성 감소를 위한 방법 및 시스템 Download PDF

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Abstract

플러그 및 이러한 플러그가 삽입된 잭을 포함하는 통신 커넥터가 기술되어 있다. 플러그는 긴 트위스트 페어 통신 케이블을 단말처리한다. 잭은 케이블내의 와이어에 접속하기 위한 인터페이스 콘택트를 지지하는 슬레드, 이러한 콘택트에 접속하는 리지드 회로 보드, 및 플러그 인터페이스 콘택트에 접촉하는 플렉스 보드를 포함한다. 잭은 또한, 와이어 페이로부터의 신호를 전달하는 트레이스 사이에, 슬레드, 리지드 회로 보드 및/또는 플렉스 보드내에 커패시턴스 값을 더하여, 이상 신호 사이의 플러그에 의해 생성된 크로스토크를 상쇄하는 동상 신호를 갖고, 각 트레이스 사이에 더해진 커패시턴스 값이 거의 동일하도록 함으로써, 케이블의 와이어 페어 사이의 크로스토크를 보상하는 회로를 포함한다. 이러한 보상은 차동-공통 모드 신호 변환을 최소화하도록 실행된다.

Description

플러그/잭 접속부에서의 공통 모드 신호 생성 감소를 위한 방법 및 시스템{METHOD AND SYSTEM FOR REDUCING COMMON MODE SIGNAL GENERATION WITHIN A PLUG/JACK CONNECTION}
본 발명은 2007년 3월 20일에 출원된 미국 특허 가출원 60/895,853호를 언급하여 여기에 통합하고 있다.
본 발명은 일반적으로 전기 커넥터에 관한 것이고, 보다 상세하게는, 잭/플러그내의 커넥터 사이에 존재하는 크로스토크를 억제하는 크로스토크 보상을 갖는 모듈러 통신 잭 설계에 관한 것이다.
전기 통신 시스템에서, 단일 와이어보다는 한 쌍의 와이어를 통해 차동 신호의 형태로 정보(비디오, 오디오, 데이터)를 전송하는 것이 유익하다. 이렇게 전송된 신호는 절대 전압에 관계없이 와이어간에 전압차를 포함하고 있다. 와이어 페어의 각 와이어는 외측 소스, 예를 들어, 이웃하는 데이터 라인으로부터 전기 노이즈를 픽업할 수 있다. 차동 신호는 이러한 외측 소스에 덜 취약하다는 사실로 인해 사용에 유리하다.
차동 신호를 사용할 때, 공통 모드 신호의 생성을 피하는 것이 바람직하다는 것은 잘 알려져 있다. 공통 모드 신호는 전송 라인의 평형과 관련되어 있다. 평형은 와이어와 그라운드의 개별적인 도체 사이의 와이어 페어에서의 임피던스 대칭의 척도이다. 하나의 도체를 위한 그라운드에 대한 임피던스가 또 다른 도체를 위한 그라운드에 대한 임피던스와 상이할 때, 차동 모드 신호가 공통 모드 신호로 변환되는 것은 바람직하지 않다.
차동 신호에 대한 또 다른 관심은 각 와이어 페어의 개별적인 도체가 이웃하는 와이어 페어에 노이즈를 추가하는 동일하지 않은 방식으로 (유도성 또는 용량성) 결합되는, 이웃 차동 와이어 페어에 의해 유발된 전기 노이즈이다. 이것은 크로스토크로 불린다. 크로스토크는 전송 라인의 니어엔드(NEXT) 및 파엔드(FEXT)에서 발생할 수 있다. 이것은 또한 채널내의 차동 와이어 페어 (내부 NEXT 및 내부 FEXT로 부른다)사이에 내부적으로 일어날 수 있거나 이웃하는 채널내의 차동 와이어 페어 (에일리언 NEXT 및 에일리언 FEXT로 부른다)에 결합할 수 있다. 일반적으로, 동일한 노이즈 신호가 와이어 페어내의 각 와이어에 추가되는 한, 와이어간의 전압차는 거의 동일하게 남을 것이고 크로스토크는 최소화된다.
통신 산업에서, 데이터 전송 속도가 꾸준히 증가됨에 따라, 잭 및/또는 플러그내의 조밀하게 이격된 병렬 도체간의 바람직하지 않은 용량성 및 유도성 결합으로 인한 크로스토크가 점차 문제가 되어가고 있다. 향상된 크로스토크 성능을 가진 모듈러 커넥터는 점차 요구되는 규격을 충족시키도록 설계되었다. 예를 들어, 최근의 커넥터는 공격적인 NEXT를 상쇄시키기 위해 사전결정된 양의 크로스토크 보상을 도입하였다. 2개 이상 스테이지의 보상이 시스템에 증가된 대역폭을 주는, 보상 존과 플러그/잭 인터페이스간의 거리로부터 유발되는 전파 지연으로부터의 위상 변이를 고려하도록 사용되고 있다. 또한, 새로운 규격이 특히 에일리언 크로스토크의 영역에서 요구되고 있다. 공통 모드 신호가 차동 신호보다 많이 방출되는 것으로 알려져 있고, 따라서, 에일리언 크로스토크의 주요 소스가 되고 있다. 따라서, 임의의 종류의 공통 모드 신호를 최소화시키는 것이 바람직하고, 이로 인해 새로운 커넥터 설계가 필요하게 되었다.
250MHz를 초과하는 대역폭을 필요로 하는 것을 포함하는 최근 전송 속도는 양측 내부 NEXT 및 에일리언 NEXT에 대한 종래 기술의 능력을 초과하였다. 따라서, 향상된 보상 기술이 필요하다.
아래에 개시된 실시예에서, 플러그 및 이러한 플러그가 삽입되는 잭을 포함하는 통신 커넥터가 기술되어 있다. 이러한 플러그는 소정의 길이의 트위스트 페어 통신 케이블을 단말처리한다. 이러한 잭은 트위스트 페어 통신 케이블내의 와이어에 접속하기 위한 인터페이스 콘택트를 지지하도록 배열된 슬레드, 이러한 인터페이스 콘택트에 접속하는 리지드 회로 보드, 및 플러그 인터페이스 콘택트에 접촉하는 플렉스 보드를 포함한다.
플러그의 구조는 잭에 의해 보상되는 크로스토크를 생성한다. 또한, 이러한 플러그의 언밸런싱된 구조는 에일리언 크로스토크 성능에 해로울 수 있는 공통 모드 신호를 생성할 수 있다. 크로스토크는 플러그로부터의 크로스토크를 보상하기 위해 플렉스 보드(flex board) 및 리지드 보드(rigid board)에 의해 추가될 수 있다. 이러한 크로스토크에 의해 내부 NEXT 및 FEXT가 500MHz를 초과하는 주파수에서 통과할 수 있고, 동시에 공통 모드 신호의 생성을 최소화하여, 궁극적으로 에일러언 크로스토크 성능을 향상시키는 방법으로 추가될 수 있다.
이러한 특징 및 다른 특징은 첨부된 도면을 참조하여 다음의 상세한 설명을 읽음으로써 당업자에게 명백할 것이다. 또한, 여기에 설명된 실시예는 본 발명의 범위를 제한하려는 것이 아님을 이해해야 한다.
도 1은 케이블링 상의 전기 신호의 형태로 정보(비디오, 오디오, 데이터)를 전송하는데 사용된 전송 채널의 하나의 예를 도시하는 도면,
도 2는 와이어가 플러그내에서 밖으로 놓여지는 방식으로 도시된 와이어 1-8을 포함하는 구상된 케이블의 하나의 예를 도시하는 도면,
도 3은 플러그 및 이러한 플러그가 삽입될 수 있는 잭을 포함하는 통신 커넥터의 예의 분해 사시도,
도 4는 인터페이스 콘택트 및 IDC를 포함하는 슬레드 및 PCB 리지드 보드 구성의 하나의 예의 측면도,
도 5는 잭의 인터페이스 콘택트에 접촉하는 플러그의 하나의 예의 일부를 도시한 도면,
도 6은 PCB 리지드 보드상의 와이어 넘버 핀아웃에 상응하도록 넘버 부여된 IDC를 가진 잭의 하나의 예의 후면도,
도 7a는 와이어 페어(12, 36)를 따라 전송된 차동 신호의 예를 도시한 도면,
도 7b는 와이어 페어(36, 78)를 따라 전송된 차동 신호의 예를 도시한 도면,
도 8은 플러그/잭 접속으로 인한 공통 모드 생성이 어떻게 채널에 보여지는 에일리언 크로스토크를 생성하는지를 도시하는 도면,
도 9는 블레이드로 종료하는 와이어의 넘버에 따라 넘버 부여된 블레이드를 가진 플러그 블레이드 레이아웃의 하나의 예를 도시한 도면,
도 10은 내부 NEXT, FEXT를 최적화하고 와이어 페어 조합(36-12, 36-78)에 대한 공통 모드 생성을 감소시키도록 설계된 플러그/잭의 와이어 페어(36, 12, 78) 사이의 커패시턴스를 도시하는 개략도,
도 11은 와이어 페어 조합부(45-36) 사이에 추가된 커패시턴스를 도시하는 개략도,
도 12는 내부 NEXT를 최적화하고 와이어 페어(12, 78)상의 공통 모드 생성을 감소시키도록 설계된 잭의 플렉스 보드의 레이아웃의 예를 도시한 도면,
도 13은 도 3의 리지드 보드의 확대도,
도 14는 상층, 제1 내층, 제2 내층 및 하층을 도시하는 리지드 보드의 레이아웃의 예를 도시한 도면,
도 15a-f는 리지드 보드의 상이한 층의 예시도,
도 16a-b는 본원의 유익을 설명하도록 실행된 표준 실험 테스트의 예를 도시한 도면.
본원은 플러그 및 이러한 플러그가 삽입되는 잭을 포함하는 통신 커넥터를 설명하고 있다. 이러한 잭은 와이어 페어의 와이어간의 상호 인덕터스 및 커패시턴스를 추가함으로써 플러그의 와이어 페어간의 크로스토크를 보상하기 위한 회로를 포함하고 있다.
도면을 참조하면, 도 1은 와이어상에 전기 신호의 형태로 정보(비디오, 오디오, 데이터)를 전송하도록 사용된 전송 채널(100)을 도시하고 있다. 이러한 시스템은 패치 케이블(104)이 패치 패널(110)에서 플러그(106)/잭(108) 접속부와 접속하는 스위치(102)를 포함하는 것으로 도시되어 있다. 패치 패널(110)에서, 정보는 예를 들어, 제2 패치(118)에서 다른 플러그(114)/잭(116) 접속부에 패치 케이블(112)을 통해 라우팅될 수 있다. 거기로부터, 정보는 예를 들어, 패치 패널에 존재하는 플러그(122)/잭(124) 접속부에 와이어(120)를 통해 긴 거리, 예를 들어, 85m에 라우팅될 수 있다. 패치 패널로부터, 정보는 패치 케이블(126)을 통해 플러그(128)/잭(130)으로 라우팅된다. 도 1의 플러그/잭 접속부는 통신 장비 또는 컴퓨터 네트워킹 장비를 접속하기 위한 레지스터드 잭(RJ) 규격화된 물리적 인터페이스일 수 있다. 예를 들어, 플러그/잭 접속부는 모듈러 또는 펀치다운 커넥터 타입의 RJ45 접속부일 수 있다.
도 1에 도시된 접속부는 카테고리 6, 카테고리 5/5e, 및 카테고리 3 케이블 스탠더드와 호환가능한 10 기가비트 이더넷 및 다른 네트워크 프로토콜에 대한 케이블 스탠더드인, 보통 Cat 6A로 불리는, 카테고리 6A 케이블과 호환가능하다. 카테고리 6A는 특히 UTP 솔루션이 통과하기 힘들 수 있는, 크로스토크 및 시스템 노이즈에 대한 보다 많은 엄격한 사양을 갖고 있다. 케이블 규격은 500MHz에 이르는 성능을 제공하고 10BASE-T/100BASE-TX, 1000BASE-T(기가비트 이더넷) 및 10GBASE-T(10-기가비트 이더넷)에 적합하다.
따라서, 도 1에 도시된 케이블은 표준 RJ45 플러그에 배치된 바와 같은 4개의 트위스트 구리 와이어 페어를 각각 포함할 수 있다. 도 2는 와이어(1-8)를 포함하는 케이블(200)을 도시하고 있다. 도 2에 도시된 구성에서, 와이어(1,2)가 트위스트 페어이고, 와이어(4,5)가 트위스트 페어이고, 와이어(3,6)가 트위스트 페어이고, 와이어(7,8)가 트위스트 페어이다. 따라서, 페어(4,5)와 페어(3,6) 사이에 중첩이 존재하고, 이것은 페어 조합(45-36)에 상당한 크로스토크를 더한다. 와이어(1-8)는 플러그(202)에서 종료하고, 이러한 포인트에서 와이어는 꼬임해제된다.
케이블(200)은 외부 소스로부터 전자파(EMI)를, 비차폐된 트위스트 페어(UTP) 케이블로부터 전자기 방사를, 그리고 이웃하는 페어 사이의 크로스토크를 최소할 시킬 목적을 위해 트위스트 페어를 포함한다.
도 3은 플러그(302) 및 이러한 플러그(302)가 삽입될 수 있는 잭(304)을 포함하는 통신 커넥터(300)의 분해 사시도이다. 플러그(302)는 일정 길이의 트위스트 페어 통신 케이블(도시되지 않음)을 단말처리하고, 잭(304)은 또 다른 트위스트 페어 통신 케이블(도 3에 도시되지 않음)에 접속될 수 있다.
좌측으로부터 우측으로 도시된 바와 같이, 잭(304)은 메인 하우징(306) 및 하부 프론트 슬레드(308) 및, 8개의 플러그 인터페이스 콘택트(312)를 지지하도록 배치된 상부 프론트 슬레드(310)를 포함한다. 이러한 플러그 인터페이스 콘택트(312)는 PCB(314)내의 스루홀을 통해 전방으로부터 PCB(인쇄회로기판; 314)와 맞물린다. 도시된 바와 같이, IDC(Insulation Displacement Contact) 서포트(315)에 의해 8개의 IDC(316)는 후방으로부터 PCB(314)의 추가 스루홀을 통해 PCB(314)와 맞물릴 수 있다. IDC(316)에 대한 통로를 갖는 리어 하우징(318)은 트위스트 페어 통신 케이블에 인터페이스를 제공하는 기능을 한다.
도 4는 플러그 인터페이스 콘택트(312) 및 IDC(316)를 포함하는 슬레드(310) 및 PCB 리지드 보드(314) 구성의 측면도를 도시하고 있다. 도 4에서 슬레드(310)는 또한 인터페이스 콘택트(312)와 접촉하고 회로를 포함하여 크로스토크를 보상하는 플렉스 보드(320)를 포함한다. 플렉스 보드(320)는 크로스토크를 보상하기 위해 커패시턴스 및 인덕턴스를 포함하는 플렉시블 PCB일 수 있다. 도 5는 인터페이스 콘택트(312)와 접촉하는 플러그(302)의 일부를 도시하고 있다. 도 6은 PCB 리지드 보드(314)상의 와이어 넘버 핀아웃에 상응하도록 넘버 부여된 IDC를 가진 잭의 후면도를 도시한다(PCB 리지드 보드(314)는 숨겨져 있다).
도 1의 전송 시스템(100)에서, 데이터는 2개의 별개의 와이어로 전송되는 2개의 보완 신호에 의해 정보를 전기적으로 전송하는 방법인 차동 시그널링을 사용하여 와이어로 전송될 수 있다. 도 2에 도시된 케이블을 사용하여, 2개의 보충 신호는 와이어 페어, 예를 들어, 1 내지 2 상("12페어")을 통해 전송된다. 와이어의 접속부의 단부에서, 수신장치는 이러한 2개의 보충 신호 사이의 차이를 판독한다. 따라서, 이러한 2개의 와이어에 동일하게 영향을 주는 임의의 노이즈는 상쇄될 것인데, 그 이유는 이러한 2개의 와이어가 유사한 양의 전자파를 가지고 있기 때문이다. 차동 모드 전송은 공통 모드 전송보다 적게 방사한다.
전형적인 전송 시스템에서, 케이블링은 다른 케이블로부터의 차동 모드 크로스토크보다 공통 모드 크로스토크에 보다 취약하다. 공통 모드 신호는 국소 커몬 또는 그라운드에 대하여 2-와이어 케이블의 양측 라인에서 동위상 그리고 동일한 진폭으로 나타나는 신호이다. 이러한 신호는 예를 들어, 양측 라인에 동일하게 결합하는 방상 신호, 구동 회로의 오프셋, 전송 및 수신 위치간 그라운드 전위차, 또는 2개의 차동 페어 사이의 불평형 결합으로부터 나타날 수 있다.
여기에 기술된 케이블의 구성을 사용하여, 하나의 케이블내의 와이어 페어로부터 또 다른 케이블내의 와이어 페어로의 에일리언 크로스토크(예를 들어, 인접한 채널로부터의 신호 결합)에 의해 시스템은 CAT6A(EIA/TIA-568 또는 ISO)에 대한 필요조건에 실패할 수 있다. 인접한 채널은 잭 사이의 프론트엔드상에 위치된 UTP 케이블에 나타날 상당한 공통 모드 에일리언 커플링을 가질 수 있다는 것이 가능하다. 공통 모드 신호는 플러그-잭 조합에 의해 생성될 수 있다. 현 플러그 또는 잭에 대한 T6A 컴포넌트 필요조건은 플러그/잭 접속부에서 생성될 수 있는 공통 모드 신호를 감소시키는데 충분하지 않을 수 있다. 따라서, CAT6A 규격에 맞는 플러그/잭은 여전히 에일리언 크로스토크 필요조건에 실패할 채널 또는 영구 링크를 생성할 수 있다.
표준 RJ45 플러그는 잭에 의해 보상될 필요가 있는 크로스토크를 신호에 더한다. 와이어 페어(36-78)에서, 크로스토크 신호가 주로 와이어(3)에 결합하는 와이어(2) 및 와이어(7)에 결합하는 와이어(6)에 의해 플러그에 의해 더해진다. 이것은 와이어(2) 다음에 와이어(3)를, 그리고 와이어(7) 다음에 와이어(6)를 갖는 플러그의 레이어아웃 때문이다(예를 들어, 도 2를 보라).
도 7a는 와이어 페어(12, 36)를 따라 전송되는 차동 신호를 도시하고 있다. 도시된 바와 같이, 차동 시그널링을 사용하여 와이어(1)를 따라 전송된 신호는 와이어(2)를 따라 전송된 신호와 180도 위상차가 있다. 동일한 현상이 와이어(3,6)을 통해 전송된 신호에 나타난다. 케이블내의 와이어의 레이아웃으로 인해, 하나의 위상의 신호를 갖는 (예를 들어, 와이어(1,3) 및 와이어(2,6)) 각 페어의 와이어 사이에, 그리고 반대 위상의 신호를 갖는 (예를 들어, 와이어(1,6) 및 와이어(2,3)) 각 페어의 와이어 사이에 플러그에 의해 유발된 크로스토크가 존재한다. 플러그에 의해 유발된 크로스토크를 보상하기 위해, 플러그에 의해 유발된 크로스토크와 반대의 극성의 보상이 가해져 동상 신호를 갖는 각 페어의 와이어 사이에 플러그에 의해 유발된 크로스토크가 이상 신호를 갖는 각 페어의 와이어 사이에 플러그에 의해 유발된 크로스토크와 상쇄한다. 따라서, 플러그 및 잭이 함께 와이어 페어(36-12)에 대해, 다음의 관계를 갖는 상황을 산출하는 것이 바람직하다.
Figure 112010040993336-pct00001
(식 1)
여기에서, X 13 은 와이어(1 및 3) 사이에 더해진 보상 크로스토크이고, X 26 은 와이어(2 및 6) 사이이에 더해진 보상 크로스토크이고, X 23 은 와이어(2 및 3) 사이의 플러그에 의한 크로스토크이고, X 16 은 와이어(1 및 6) 사이의 크로스토크이다.
또한, 동일한 상황이 도 7b에 도시된 바와 같이, 와이어 페어(36-78)에 대해 일어나고, 따라서, 플러그 및 잭은 함께 다음의 관계를 산출하는 것이 바람직하다.
Figure 112010040993336-pct00002
(식2)
X68 은 와이어(6,8) 사이에 더해진 보상 크로스토크이고, X37 은 와이어(3,7) 사이에 더해진 보상 크로스토크이고, X67 은 와이어(6,7) 사이의 크로스토크이고, X38 은 와이어(3,8) 사이의 크로스토크이다. X는 용량성 및/또는 유도성 크로스토크를 가리킬 수 있음에 주목해야 한다. 모든 식이 거의 0인 것으로 기록된 이유는 정확히 0인 것이 바람직하지만, 대부분 실제값이 시험 장비의 동적 범위, 어셈블리 프로세스에서의 불완전성 및 상이한 타입의 플러그의 사용으로 인해 10MHz 아래의 주파수에서 -75dB 아래의 크기 근방에 있기 때문이다.
CAT6 및 CAT6T 사양에서, 추가적인 크로스토크는 제1 스테이지 보상 커패시터(X 13 , X 26 및 X 68 , X 37 )에 대하여 일반적으로 시간 지연되어 있다. 이러한 크로스토크는 플러그에 대해 동일한 극성을 갖는다(X 23 , X 16 및 X 67 , X 38 ). 제2 크로스토크는 일반적으로 시스템의 대역폭을 증가시키는 널을 추가시킨다. 식 1과 2는 여전히 이것을 위해 만족된다. 시간 지연 신호 보상에 관한 보다 많은 정보에 대해, 독자는 여기에 제시된 바와 같이, 여기에 내용이 전체가 언급되어 통합된 미국 특허 제5,997,358호를 참조할 수 있다.
크로스토크의 추가 소스는 에일리언 크로스토크이다(예를 드어, 인접 채널로부터의 신호 결합). 플러그/잭 인터페이스는 궁극적으로 에일리언 크로스토크를 유발하는 신호의 소스이다. 예를 들어, 와이어 페어(36-12 및 36-78)에 대한 플러그 블레이드 레이아웃내의 불평형은 공통 모드 신호를 생성한다. 와이어(3,2)가 서로 가깝고, 와이어(6,7)가 서로 가깝고, 따라서, 페어(36)상의 차동 신호는 와이어 페어(12, 78)에 강한 공통 모드 신호를 발생시킨다. 와이어 페어(12, 78)의 공통 모드 신호는 인접 채널상의 인접 케이블 사이에 결합되어 있다. 그다음 인접 채널의 와이어 페어(12, 78)의 이러한 공통 모드 신호는 에일리언 크로스토크인 와이어 페어(36)에서의 차동 신호로 다시 변환된다.
통신 산업회(TIA)/전자 산업 연합(EIA)CAT6A 사양 및 ISO 규격을 맞추기 위해, 플러그는 각 페어 조합에 대해 특정 범위내의 포함되지 않는 크로스토크 값을 가져야만 한다. 예를 들어, 페어 조합(12 내지 36 및 36 내지 78)에 대하여, 값은 다음과 같다.
Figure 112010040993336-pct00003
(식 3)
여기에서, TotalXtalk는 dB 단위의 페어 조합(12 내지 36 및 36 내지 78)에 대하여 포함되지 않은 크로스토크이고, f는 MHz 단위의 주파수이다.
식 3내의 TotalXtalk 로서 정의된 디임베디드 값을 생성하는 페어 조합(12 내지 36 및 36 내지 78)에 대한 전체 크로스토크는 상술된 식 1-2에서와 같이 나타낼 수 있다. 2 및 3에 대한 블레이드가 서로 다음에 있고 6 및 7은 서로 다음에 있는 플러그의 레이아웃 때문에,
Figure 112010040993336-pct00004
(식 4)
및
Figure 112010040993336-pct00005
(식 5)
와이어 페어(12, 78)에 강한 공통 모드 신호를 생성하는 것은 X12-36 및 X36-78 에 대한 불평형이다.
도 8은 플러그/잭 접속부에서 생성된 공통 모드 신호가 어떻게 에일리언 크로스토크를 생성하는지를 설명하고 있다. 처음에, 차동 신호가 채널 A(예를 들어, 제1 케이블)에 주입된다. 채널 A에서의 플러그/잭 조합은 차동 신호를 공통 모드 신호로 변환시킬 것이다. 이러한 "모드 변환"(예를 들어, 차동 신호로부터 공통 모드 신호로 또는 공통 모드 신호로부터 차동 신호로의 변환)은 주로 플러그/잭에 대한 블레이드의 구성 및/또는 플러그에 대한 보상이 잭에서 실행되는 방법으로 발생한다.
또한, 공통 모드 신호는 에일리언 크로스토크 신호로서 채널 B의 패치 케이블에 결합한다. 케이블에서의 공통 모드 신호의 결합은 CAT6A 규격으로 커버되지 않고, 따라서, 보통 차동 커플링 보다 훨씬 더 강한 레벨에 있게 된다. 채널 B에서, 플러그-잭 조합은 공통 모드 신호를, 채널 B에서의 에일리언 크로스토크를 유발하는 차동 신호로 다시 변환시킨다.
따라서, 플러그/잭 접속에 의한 공통 모드 신호의 생성 및 이러한 신호의 케이블링에서의 결합의 2개의 문제가 존재한다. 따라서, 플러그/잭 모드 변환에 의해 유발된 에일리언 크로스토크의 전체 양에 영향을 주는 인자는 차동으로부터 공통 모드로 그리고 공통 모드로부터 다시 차동으로의 모드 변환, 그리고 공통 모드 신호에 대한 인접 케이블 사이의 결합의 레벨을 포함한다. 플러그/잭 접속에서의 모드 변환의 양을 감소시키는 것이 바람직하다.
하나의 실시예에서, 상술된 식 1 및 2의 조건을 충족시키는 것에 더해, 새로운 조건이 모든 변환을 감소시키기 위해 필요하다. 그래서, 플러그/잭 조합내의 더해진 크로스토크의 값(커패시턴스 및 인덕턴스 값)은 보통 다음과 같다.
Figure 112010040993336-pct00006
(식 6)
Figure 112010040993336-pct00007
(식 7)
Figure 112010040993336-pct00008
(식 8)
Figure 112010040993336-pct00009
(식 9)
여기에서, C는 전체 용량성 결합을 나타내고 M은 결합된 플러그/잭 조합의 전체 상호 유도성 결합을 나타낸다. 식 6-9가 충족되면, 36개의 차동 신호로부터 12/78 공통 모드 신호를 생성하는 모드 변환의 전체 양은 최소화된다. 식 6,7,8 및 9을 충족시키는 것에 가까운 잭을 생성하는 것은 잭 자체의 구조가 측량 곤란한 유도성 및 용량성 성분을 더하고 있다는 사실로 인해 어려울 수 있다. 이러한 식이 페어 조합(36-12 및 36-78)에 필요한 평형화된 결합으로 보이고 있지만, 이러한 밸런싱된 필요조건은 모든 페어(45-36, 45-12, 45-78 및 12-78)에 대해 필요하다는 것에 주목해야 한다.
본원의 도 3 내지 5에서, 용량성 크로스토크는 잭(304)의 PCB 리지드 보드(314) 및 플렉스 보드(320) 모두에 더해질 수 있다. 모든 변환을 최적화하기 위해, 커패시턴스 보상이 페어 조합(12-36)의 플러그 크로스토크를 보상하기 위해 와이어(1,3 및 2,6) 사이에 더해지고, 페어 조합(36-78)의 플러그 크로스토크를 보상하기 위해 와이어(3-7 및 6-8) 사이에 더해질 수 있어서, 플러그/잭은 내부 NEXT 사양에 부합될 수 있다. 예를 들어, 동일한 커패시턴스가 와이어(1-3 및 2-6) 사이에 그리고 와이어(3-7 및 6-8)사이에 더해질 수 있어서 식 6-7을 충족시킬 수 있다. 도 9는 블레이드가 블레이드로 종료하는 와이어의 수에 따라 블레이드에 넘버가 부여된 플러그 블레이드 레이아웃을 도시하고 있다.
잭내의 내부 NEXT 및 모드 변환을 동시에 튜닝하기 위해, 커패시턴스(C 13 , C 26 , C 68 , C 37 )는 크기가 실질상 동일하도록 만들어져 있다. 마찬가지로, 커패시턴스(C 68 ,C 37 )는 크기가 실질상 동일하도록 만들어져 있다. 커패시턴스에 대하여 시간 지연된, 플러그로부터의 크로스토크와 동일한 극성의 커패시턴스가 C 16 및 C 38 의 형태로 더해진다.
따라서, 와이어 페어 조합(36-12 및 36-78)에 대한 모드 변환 및 내부 NEXT를 튜닝하기 위한 플러그/잭 보상은 도 10에 도시된 것일 수 있다. 도시된 바와 같이, 플러그는 그 기하학적 이유로 인해, 주로, 값이 동일한 커패시턴스(C 23 , C 67 )를 공급한다. 플러그는 또한 값이 동일한 커패시턴스(C 13 , C 68 )를 공급한다. 플러그는 또한 값이 동일한 C 37 , C 38 , C 26 , C 16 을 포함하는 것으로 도시되었지만, 이러한 커패시턴스는 플러그의 설계로 인해 존재할 수 있다는 것을 설명하기 위해 도시되었다기 보다는 플러그에 물리적으로 더해지지 않는 이론적 값이라는 것에 주목해야 한다.
잭의 노즈(예를 들어, 하부 프론트 슬레드(308), 상부 프론트 슬레드(310) 및 인터페이스 콘택트(312) 모두)는 커패시턴스 C67 및 C23 은 물론 그 기하학적인 이유로 인해 커패시턴스 C13 및 C68 을 공급한다. 커패시턴스 C26, C37, C16, C38 은 노즈내에 이론적으로 존재하고 완성을 위해 도시되어 있다. 플렉스 보드는 값이 동일한 커패시턴스 C26, C37 를 더한다. 리지드 보드는 커패시턴스 C16, C38 및 커패시턴스 C68, C13 을 더한다. 커패시턴스 C67, C37, C26, C23 은 완성을 위해 도시된 이론적인 커패시턴스이다. IDCSO의 도 10에 도시된 바와 같은 리지드 보드의 우측으로, 커패시턴스 C67, C68, C13 및 C23 이 더해진다. 도 10은 각 커패시턴스에 대한 예시된 값을 나타내지만, 다른 값 역시 사용될 수 있다. 또한, 도 10에 도시된 값은 약 0.1pF 내에서 식 6 및 7을 충족시킨다.
도 11은 와이어 페어(34, 35, 46, 56)에 대한 와이어 페어 커패시턴스를 도시하고 있다. 상기와 같은 방법을 사용하여, 다음의 상황을 생성하는 것이 바람직하다.
Figure 112010040993336-pct00010
(식10)
여기에서, X 34 는 와이어 3과 4 사이에 추가된 보상 크로스토크이고, X56은 와이어 5와 6 사이에 추가된 보상 크로스토크이고, X 46 은 와이어 4와 6 사이의 크로스토이고, X 35 는 와이어 3과 5 사이의 크로스토크이다.
도 11에 도시된 바와 같이, 플러그는 커패시턴스 C 34 , C 56 , C 35 , C 46 을 가지고 있다. 잭의 노즈는 플러그에 의해 유발된 순 크로스토크를 보상하기 위해 추가된 커패시턴스 C 34 , C 56 , C 35 , C 46 을 가지고 있다. 플렉스 보드는 크로스토크를 보상하기 위해 추가된 커패시턴스 C 35 및 C 46 을 갖고 있다. 리지드 보드는 크로스토크를 보상하기 위해 추가된 C 34 , C 56 , C 35 , C 46 을 갖고 있다. 따라서, 페어 조합 45 및 36에 대한 임의의 모드 변환이 역시 최소화된다.
도 12는 1-8로 넘버 부여된 와이어에 대한 콘택트의 포인트를 갖는 플렉스 보드(320)의 레이아웃의 예를 도시하고 있다. 플렉스 보드(320)는 2개의 층 사이에 1mil 코어를 갖는 2층 보드일 수 있다. 플렉스 보드(320)는 커패시턴스 C 26 , C 35 , C 46 , C 37 을 포함하는 것으로 도시되어 있다. 이러한 커패시턴스는 물리적으로 2층의 금속이고, C 26 및 C 37 의 상층의 크기는 28×33mil일 수 있고, C 26 및 C 37 의 하층의 크기는 38×43 mil일 수 있다. 또한, C 35 및 C 46 의 상층의 크기는 30×44mil일 수 있고, C 35 및 C 46 의 하층의 크기는 40×54mil일 수 있다. 상이한 크기의 커패시터가 제조 공정에 의한 층간 변형이 플렉스 보드의 전체 커패시턴스 값에 영향을 주지 않도록 사용되었다.
본원에서, 플렉스 보드는 플러그 에어리어에 추가된 크로스토크의 반대 극성을 갖는 와이어(26, 37, 35, 46) 사이의 보상 용량성 크로스토크만을 더한다. 플렉스 보드는 임의의 의도적인 유도성 크로스토크를 더하지 않는다. 플렉스 보드상의 플러그내의 커플링에 반대 극성의 플렉스 보드상의 커패시터를 둠으로써, 이러한 커패시터는 플러그에 보다 가깝게 배치되어, 내부 NEXT 성능을 향상시킨다.
도 12에 도시된 플렉스 보드 설계는 와이어 콘택트(322, 324)로부터의 커패시터 C35까지의 거리를 최소화하고 와이어 콘택트(326, 328)로부터 커패시터 C46까지의 거리를 최소화하여 타임 딜레이 모델을 통해 내부 NEXT 성능을 향상시킨다. 또한, 이러한 플렉스 보드는 와이어 페어(13, 68) 사이의 플렉스 보드상의 커패시턴스를 생략함으로써 36-12 및 36-78 와이어 페어의 평형화를 도움으로써 채널에서 측정될 때 에일리언 크로스토크를 향상시킨다.
도 13은 도 3의 리지드 보드(314)의 확대도이고, 도 14는 리지드 보드의 레이아웃의 예를 도시한 도면이다. 도 13에 도시된 바와 같이, 리지드 보드(314)은 상층, 제1 내층, 제2 내층 및 하층을 포함하고 있다. 도 14는 모든 4개의 층상의 도전성 트레이스를 도시하는 상면도이다. IDC 콘택트(도 6에 도시됨)는 부재 번호 322-336으로 라벨링되어 여기에 도시되어 있다. IDC 콘택트(322-336)의 각각은 인터페이스 콘택트(312)로부터 (1-8로 넘버 부여된) 리지드 보드(314)상의 상응하는 와이어의 핀아웃에 접속되어 있다. 따라서, IDC 콘택트는 1-8의 넘버가 부여되어 도시되어 있는데, 이중 와이어 에 상응하는 수 1,2,4,5는 리지드 보드의 일단부에 있고, 3,6,7,8은 리지드 보드의 타단부에 있다. 인터페이스 콘택트의 핀아웃은 리지드 보드의 중간에 도시되어 있다. 중요한 커패시턴스 C 38 및 C 16 가 또한 도 14에 도시되어 있다.
도 15a-f는 리지드 보드(314)의 도전성 트레이스의 상이한 층을 도시한다. 예를 들어, 도 15a는 리지드 보드(314)의 상층을 도시하고 있다. 도시된 바와 같이, 상층은 와이어 1, 2, 6의 핀아웃을 그 상응하는 와이어에 대한 IDC 콘택트에 접속하는 트레이스를 포함한다. 도 15b는 리지드 보드(314)의 하층을 도시한다. 도시된 바와 같이, 하층은 와이어 3, 4, 5, 7, 8의 핀아웃을 그 상응하는 와이어에 대한 IDC 콘택트에 접속하는 트레이스를 포함한다. 도 15c는 핀아웃과 IDC 콘택트 사이의 모든 접속을 도시하기 위해 상하층 모두를 예로서 도시하였다.
도 15d는 리지드 보드(314)의 제1 내층의 예를 도시한 도면이고, 도 15e는 리지드 보드(314)의 제2 내층의 예를 도시한 도면이다. 제1 및 제2 내층은 커패시턴스 C56, C38, C46, C16, C35, C34 를 포함하는 플레이트를 포함한다. 예를 들어, 제1 내층은 C56, C38, C46, C16, C35, C34 의 각각에 대한 제1 플레이트를 포함하고, 제2 내층은 C56, C38, C46, C16, C35, C34 의 각각에 대한 제2 플레이트를 포함하여, 함께 도 15f에 도시된 바와 같이 언급된 커패시터를 형성한다.
도 16a-b는 본원의 유익을 설명하도록 실행된 시뮬레이션의 예를 설명하고 있다. 이러한 시뮬레이션은 6-어라운드-1 전력 합 에일리언 NEXT 테스트를 설명하기 위해 실행되었다. 이러한 테스트는 6개의 둘러싸는 케이블로 인한 케이블상에 보여지는 크로스토크를 설명한다. 도 16a에서, 시뮬레이션은 식 1 및 2가 참이고 식 6-9가 참이 아닌 구성으로 여기에 설명된 플러그/잭 조합을 사용하여 실행되었다. 도시된 바와 같이, 이러한 구성(예를 들어, 불평형화된 구조)을 사용하면, 시스템은 약 450 MHz에서 에일리언 크로스토크에 대한 규격 허용치와 맞지 않는다. 도 16b는 식 1-2 및 6-9가 참이 되는 구성을 가진 (예로서 도 10에 도시된 커패시턴스 값을 가진) 여기에 설명된 플러그/잭 조합으로 실행되는 시뮬레이션의 예이다. 도시된 바와 같이, 이러한 구성(예를 들어, 평형화된 구조)를 사용하면, 시스템은 500 MHz에 이르는 크로스토크에 대한 표준 허용치와 부합하게 된다.
표준 8-와이어 트위스트 페어 케이블 및 RJ45 플러그/잭 접속부를 갖는 여기에 기술된 방법을 사용하여, 잭에서 생성된 공통 모드 신호 및 케이블간의 에일리언 크로스토크가 감소될 수 있다. 플러그에 의해 유발된 크로스토크를 보상하기 위해, 잭의 순 크로스토크는 플러그의 극과 반대인 극성을 가져서 함께 플러그 및 잭은 서로 상쇄시키는 크로스토크를 갖게 된다(예를 들어, 식 1, 2). 또한, 추가된 크로스토크의 값(커패시턴스 및 인덕턴스 값)은 일반적으로 등가이어서 크로스토크는 상쇄될 것이다.
또한, 본원의 예가 커패시턴스를 사용하여 크로스토크를 보상하는데 촛점을 맞추고 있지만, 크로스토크는 또한 또는 대안으로 평형화된 인덕턴스 값을 사용함으로써 보상될 수 있다.
물론, (치수, 크기, 형상, 방위등을 포함하지만 이에 제한되지 않는) 많은 변화 및 수정이 상술된 실시예에 가능하다. 실시예가 플러그/잭 접속부의 구체적인 구성 및 설계에 대하여 상술되었지만, 크로스토크 상쇄를 위한 본원의 방법 및 기술은 또한 다른 설계에 적용가능하다는 것에 주목하는 것이 중요하다. 예를 들어, 크로스토크 상쇄를 위한 방법은 RJ-45 플러그 및 잭을 채용하지 않는 다른 전기 통신망에서 사용되도록 설계된 다른 타입의 케이블 및 플러그/잭 접속에 사용될 수 있다.
여기에 기술된 구성은 예일 뿐이라는 것을 이해해야 한다. 당업자는 다른 배열 및 다른 구성요소가 대신 사용될 수 있다는 것과 일부 구성요소는 원하는 결과에 따라 함께 생략될 수 있다는 것을 이해해야 할 것이다. 또한, 이러한 기술된 구성요소의 다수는 임의의 적합한 조합 및 위치에서, 분리되거나 분산된 구성요소 또는 다른 구성요소와 함께 구현될 수 있는 기능적인 엔티티이다.
상기 상세한 설명은 제한보다는 예로서 제시된 것이고 모든 등가물을 포함하는 다음의 청구범위가 본 발명의 범위를 한정하는 것으로 이해되어야 한다.

Claims (28)

  1. 긴 트위스트 페어 통신 케이블을 단말처리한 플러그; 및
    상기 플러그가 삽입되는 잭;을 포함하고,
    상기 잭은 상기 트위스트 페어 통신 케이블내의 와이어에 접속하기 위한 인터페이스 콘택트를 지지하고, 상기 잭은 상기 트위스트 페어 통신 케이블내의 와이어 사이의 내부 니어엔드(near end) 크로스토크 및 내부 파엔드(far end) 크로스토크를 최소화하고 결합된 플러그/잭 콤비네이션내의 차동 모드-공통 모드 및 공통 모드-차동 모드 신호 변환을 최소화하는 회로를 포함하고,
    상기 트위스트 페어 통신 케이블은 1-8 넘버가 부여된 8개의 와이어를 포함하고, 와이어 페어 12, 45, 36 및 78의 넘버가 부여된 4개의 트위스트 와이어 페어로서 배열되어 있어서, 트위스트 페어 구성에서는, 1 및 2 넘버 부여된 와이어가 꼬이고, 와이어 4 및 5가 꼬이고, 와이어 3 및 6이 꼬이고, 와이어 7 및 8이 꼬이고, 상기 플러그의 종점에서, 상기 와이어들은 꼬임해제되고 와이어 1 내지 와이어 8의 순서로 서로 인접하여 위치되고,
    상기 와이어 1과 3의 신호를 전달하는 트레이스 사이의 커패시턴스, 와이어 2와 6의 신호를 전달하는 트레이스 사이의 커패시턴스, 와이어 2와 3의 신호를 전달하는 트레이스 사이의 커패시턴스 및 와이어 1과 6의 신호를 전달하는 트레이스 사이의 커패시턴스는 모두 서로 동일한 것을 특징으로 하는 통신 커넥터.
  2. 제1항에 있어서, 상기 잭은 상기 트위스트 페어 통신 케이블내의 와이어에 접속하기 위한 인터페이스 콘택트를 지지하도록 배열된 슬레드를 포함하는 것을 특징으로 하는 통신 커넥터.
  3. 제1항에 있어서, 상기 잭은 상기 인터페이스 콘택트에 접속하는 리지드 보드 및 상기 인터페이스 콘택트에 접촉하는 플렉스 보드를 포함하는 것을 특징으로 하는 통신 커넥터.
  4. 제3항에 있어서, 상기 회로가 상기 리지드 보드에 포함되어 있는 것을 특징으로 하는 통신 커넥터.
  5. 제3항에 있어서, 상기 회로가 상기 플렉스 보드 및 리지드 보드에 포함되어 있는 것을 특징으로 하는 통신 커넥터.
  6. 제1항에 있어서, 상기 트위스트 페어 통신 케이블은 카테고리 6A 케이블링과 호환가능한 것을 특징으로 하는 통신 커넥터.
  7. 제1항에 있어서, 상기 트위스트 페어 통신 케이블은 카테고리 6 또는 카테고리 5E 케이블링과 호환가능한 것을 특징으로 하는 통신 커넥터.
  8. 삭제
  9. 삭제
  10. 삭제
  11. 삭제
  12. 제1항에 있어서, 상기 회로는 와이어 1과 3의 신호를 전달하는 트레이스 사이의 상호 인덕턴스, 와이어 2와 6의 신호를 전달하는 트레이스 사이의 상호 인덕턴스, 와이어 2와 3의 신호를 전달하는 트레이스 사이의 상호 인덕턴스 및 와이어 1과 6의 신호를 전달하는 트레이스 사이의 상호 인덕턴스를 모두 서로 동일하도록 평형화하는 것을 특징으로 하는 통신 커넥터.
  13. 삭제
  14. 제1항에 있어서, 상기 6과 8의 신호를 전달하는 트레이스 사이의 커패시턴스, 와이어 3과 7의 신호를 전달하는 트레이스 사이의 커패시턴스, 와이어 6과 7의 신호를 전달하는 트레이스 사이의 커패시턴스 및 와이어 3과 8의 신호를 전달하는 트레이스 사이의 커패시턴스는 모두 서로 동일한 것을 특징으로 하는 통신 커넥터.
  15. 제14항에 있어서, 상기 회로는 와이어 6과 8의 신호를 전달하는 트레이스 사이의 상호 인덕턴스, 와이어 3과 7의 신호를 전달하는 트레이스 사이의 상호 인덕턴스, 와이어 6과 7의 신호를 전달하는 트레이스 사이의 상호 인덕턴스 및 와이어 3과 8의 신호를 전달하는 트레이스 사이의 상호 인덕턴스를 모두 서로 동일하도록 평형화하는 것을 특징으로 하는 통신 커넥터.
  16. 제1항에 있어서, 상기 회로는 와이어 페어의 신호를 전달하는 트레이스 사이에 커패시턴스를 포함하여 와이어 3과 4 사이의 크로스토크 및 와이어 5와 6 사이의 크로스토크가 와이어 4와 6 사이의 크로스토크 및 와이어 3과 5 사이의 크로스토크와 동일한 것을 특징으로 하는 통신 커넥터.
  17. 제3항에 있어서, 상기 플렉스 보드는 와이어 2와 6의 신호를 전달하는 트레이스 사이에, 와이어 3과 7의 신호를 전달하는 트레이스 사이에, 와이어 3과 5의 신호를 전달하는 트레이스 사이에, 그리고 와이어 4와 6의 신호를 전달하는 트레이스 사이에 추가된 커패시턴스를 포함하는 것을 특징으로 하는 통신 커넥터.
  18. 제3항에 있어서, 상기 리지드 보드는 와이어 1과 6의 신호를 전달하는 트레이스 사이에, 와이어 3과 8의 신호를 전달하는 트레이스 사이에, 와이어 6과 8의 신호를 전달하는 트레이스 사이에, 와이어 1과 3의 신호를 전달하는 트레이스 사이에, 와이어 3과 4의 신호를 전달하는 트레이스 사이에, 와이어 5와 6의 신호를 전달하는 트레이스 사이에, 와이어 3과 5의 신호를 전달하는 트레이스 사이에, 그리고 와이어 4와 6의 신호를 전달하는 트레이스 사이에 추가된 커패시턴스를 포함하는 것을 특징으로 하는 통신 커넥터.
  19. 트위스트 페어 통신 케이블내의 와이어에 접속하기 위한 콘택트를 포함하는 결합된 플러그/잭 콤비네이션으로서, 상기 트위스트 페어 통신 케이블은 1-8 넘버가 부여된 8개의 와이어를 포함하고, 와이어 페어 12, 45, 36 및 78의 넘버가 부여된 4개의 트위스트 와이어 페어로서 배열되어 있어서, 트위스트 페어 구성에서는, 1 및 2 넘버 부여된 와이어가 꼬이고, 와이어 4 및 5가 꼬이고, 와이어 3 및 6이 꼬이고, 와이어 7 및 8이 꼬이고, 플러그의 종점에서, 상기 와이어들은 꼬임해제되고 와이어 1 내지 와이어 8의 순서로 서로 인접하여 위치되고, 상기 결합된 플러그/잭 콤비네이션은 와이어 1과 3의 콘택트 사이의 커패시턴스(C13), 와이어 2와 6의 콘택트 사이의 커패시턴스(C26), 와이어 2와 3의 콘택트 사이의 커패시턴스(C23), 및 와이어1과 6의 콘택트 사이의 커패시턴스(C16)를 포함하고, 상기 커패시턴스 모두는 동일한 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  20. 제19항에 있어서, 상기 와이어 2와 3의 콘택트 사이의 커패시턴스는 상기 플러그내에 포함되어 있는 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  21. 제19항에 있어서, 상기 와이어 1과 3의 콘택트 사이의 커패시턴스 및 와이어 2와 6의 콘택트 사이의 커패시턴스는 상기 잭내에 포함되어 있는 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  22. 제19항에 있어서, 상기 커패시턴스는 (C23), (C13), (C26), 및 (C16)의 순서로 와이어의 콘택트 사이에 포함되어 있는 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  23. 제19항에 있어서, 상기 커패시턴스는 (C23), (C16), (C13), 및 (C26)의 순서로 와이어의 콘택트 사이에 포함되어 있는 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  24. 제19항에 있어서, 상기 와이어 6과 8의 콘택트 사이의 커패시턴스, 와이어 3과 7의 콘택트 사이의 커패시턴스, 와이어 6과 7의 콘택트 사이의 커패시턴스 및 와이어 3과 8의 콘택트 사이의 커패시턴스는 모두 동일한 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  25. 제19항에 있어서, 와이어 1과 3의 콘택트 사이의 상호 인덕턴스(M13), 와이어 2와 6의 콘택트 사이의 상호 인덕턴스(M26), 와이어 2와 3의 콘택트 사이의 상호 인덕턴스(M23) 및 와이어 1과 6의 콘택트 사이의 상호 인덕턴스(M16)를 더 포함하고, 상기 모든 상호 인덕턴스는 동일한 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  26. 제25항에 있어서, 와이어 6과 8의 콘택트 사이의 상호 인덕턴스, 와이어 3과 7의 콘택트 사이의 상호 인덕턴스, 와이어 6과 7의 콘택트 사이의 상호 인덕턴스 및 와이어 3과 8의 콘택트 사이의 상호 인덕턴스 모두는 동일한 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  27. 제25항에 있어서, 상기 상호 인덕턴스는 M67이 상기 플러그내에 포함되고, M68 및 M37이 상기 잭내에 포함되고, M38이 M68 및 M37에 대해 시간 지연되도록 와이어의 콘택트 사이에 포함되는 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
  28. 제25항에 있어서, 상기 상호 인덕턴스는 M67이 상기 플러그내에 포함되고 M38이 상기 잭내에 포함되고 이어서 M68 및 M37이 있도록 와이어의 콘택트 사이에 포함되는 것을 특징으로 하는 결합된 플러그/잭 콤비네이션.
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