KR101165638B1 - Method For Providing Interleaver, Method For Interleaving, Both With Continuous Length, And Turbo Encoder Using The Same - Google Patents

Method For Providing Interleaver, Method For Interleaving, Both With Continuous Length, And Turbo Encoder Using The Same Download PDF

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Abstract

본 발명은 연속적인 길이를 제공하는 인터리버 제공 방법, 인터리빙 방법 및 이에 의한 터보 인코더에 대한 것이다. 본 발명에 따르면 ARP 변동 벡터 주기의 배수 길이를 가지도록 미리 설정된 기본 인터리버 세트 중 적절한 길이의 기본 인터리버를 선택하고, 이 기본 인터리버 길이를 요구되는 길이를 가지도록 더미 삽입 및 가지치기 등을 수행하여 조절함으로써 연속적인 길이를 가지는 ARP 인터리버를 제공할 수 있다.The present invention relates to an interleaver providing method for providing a continuous length, an interleaving method and a turbo encoder thereby. According to the present invention, a basic interleaver of an appropriate length is selected from a set of basic interleavers preset to have multiples of the ARP variation vector period, and the basic interleaver length is adjusted by performing dummy insertion and pruning to have a required length. By doing so, it is possible to provide an ARP interleaver having a continuous length.

터보 코드, 인터리버, ARP Turbo code, interleaver, ARP

Description

연속적인 길이를 제공하는 인터리버 제공 방법, 인터리빙 방법 및 이에 의한 터보 인코더{Method For Providing Interleaver, Method For Interleaving, Both With Continuous Length, And Turbo Encoder Using The Same}Method for Providing Interleaver, Method For Interleaving, Both With Continuous Length, And Turbo Encoder Using The Same}

도 1은 터보 인코더(Turbo Encoder)의 기본적인 구조를 도시한 도면.1 shows the basic structure of a turbo encoder.

도 2는 RP(Regular Permutation)를 행하는 방법의 구체적 일례를 도시한 도면.Fig. 2 is a diagram showing a specific example of a method for performing regular permutation (RP).

도 3a 내지 도 3c는 가중치 2, 가중치 3, 그리고 가중치 6 및 9인 RTZ(Return-To-Zero) 시퀀스의 경우의 예를 도시한 도면.3A-3C show examples of the case of a Return-To-Zero (RTZ) sequence with weights 2, 3, and 6 and 9;

도 4는 변동 벡터(fluctuation vector)를 이용한 ARP(Almost Regular Permutation)를 행하는 개념을 설명하기 위한 도면.4 is a diagram for explaining a concept of performing ARP (Almost Regular Permutation) using a fluctuation vector.

도 5는 도 4에 도시된 ARP를 행하는 구체적 일례를 도시한 도면.FIG. 5 is a diagram showing a specific example of performing the ARP shown in FIG. 4; FIG.

도 6은 본 발명의 일 실시형태에 따라 기본 인터리버(Basic Interleaver) 개념을 이용하여 연속적인 길이를 가지는 인터리버를 제공하는 방법을 설명하기 위한 순서도.FIG. 6 is a flow chart illustrating a method of providing an interleaver having a continuous length using a basic interleaver concept according to an embodiment of the present invention. FIG.

도 7은 본 발명의 일 실시형태에 따른 인터리빙 방법을 설명하기 위한 순서도. 7 is a flowchart illustrating an interleaving method according to an embodiment of the present invention.

도 8은 본 발명의 다른 일 실시형태에 따른 인터리빙 방법을 설명하기 위한 순서도. 8 is a flowchart for explaining an interleaving method according to another embodiment of the present invention.

도 9는 본 발명의 일 실시형태에 따른 인터리버를 포함하는 터보 인코더의 특징 구성을 도시한 도면.9 shows a characteristic configuration of a turbo encoder including an interleaver according to an embodiment of the present invention.

본 발명은 무선 통신 기술에 대한 것으로서, 특히 연속적인 길이를 제공하는 인터리버 제공 방법, 인터리빙 방법 및 이에 의한 터보 인코더에 관한 것이다.The present invention relates to wireless communication technology, and more particularly, to an interleaver providing method, an interleaving method, and a turbo encoder thereby providing a continuous length.

도 1은 터보 인코더(Turbo Encoder)의 기본적인 구조를 도시한 도면이다.FIG. 1 is a diagram illustrating a basic structure of a turbo encoder.

터보 코드(Turbo Code; 이하 "TC"라 함)는 2 개의 회귀 대칭 길쌈(Recursive Symetric Convolutional; 이하 "RSC"라 함) 코드를 인터리버(Interleaver)를 이용하여 병렬 연접한 부호이다. 이러한 TC는 도 1에 도시된 바와 같은 터보 인코더의 입력 데이터(X)를 제 1 구성 인코더(ENC1; 101)에 의해 인코딩된 패리티 비트(Y1), 및 입력 데이터를 인터리버(102)에 의해 인터리빙한 후, 제 2 구성 인코더(ENC2; 103)에 의해 인코딩된 패리티 비트(Y2)와의 조합을 통해 생성될 수 있다.The Turbo Code (hereinafter referred to as "TC") is a code obtained by parallel concatenating two Recursive Symetric Convolutional codes (hereinafter referred to as "RSC") codes using an interleaver. This TC uses the interleaver 102 to input the input data X of the turbo encoder as shown in FIG. 1 by parity bits Y 1 encoded by the first configuration encoder EN 1 101, and the input data by the interleaver 102. After interleaving, it may be generated through a combination with parity bits Y 2 encoded by the second configuration encoder EN 2 103.

TC의 성능은 최소 해밍 거리(Minimum Hamming Distance: 이하 "MHD"라 함)가 클수록 좋은 성능을 보인다. 이러한 MHD는 각 시퀀스간에 대응하는 이웃 위치(neighbor position)에 서로 다른 정보를 가지는 비트 수로 나타낼 수 있으며, 일반적으로 000.. 으로 구성된 시퀀스를 기준 시퀀스로 할 경우, 이 기준 시퀀스와 차이를 가지는 비트 수로 나타낼 수 있어, 결국 각 시퀀스에 포함된 가중치(즉, "1")의 개수에 의해 나타낼 수 있다. 따라서, 이와 같은 MHD는 제 RSC 1 구성 인코더(101)와 제 RSC 2 구성 인코더(103)에 입력되는 시퀀스의 이웃 위치들간에 동일한 정보가 위치하는 것을 방지하는 것에 의해 영향을 받으며, 이와 같은 성능은 인터리버(102)에 의해 좌우될 수 있다. 도 1에서는 이와 같은 인터리버로서 길이 k 인 시퀀스를 적절한 순열을 취하여 M*N 비트의 사각 행렬의 행 방향으로 기록하고, 이를 열 방향으로 읽어 출력하는 정규 사각 순열(Regular Rectangular Permutation)을 이용한 인터리버를 예로서 도시하고 있으며, 그 구체적인 동작에 대해서는 도 2와 관련하여 이하에서 상세히 설명하도록 한다.The performance of TC is better when the minimum Hamming Distance ("MHD") is larger. Such MHD can be represented by the number of bits having different information in the neighbor position corresponding to each sequence.In general, when the sequence consisting of 000 .. is used as the reference sequence, the MHD is the number of bits having a difference from the reference sequence. It can be represented by the number of weights (ie, "1") included in each sequence. Therefore, such MHD is affected by preventing the same information from being located between neighboring positions of the sequence inputted to the RSC 1 configuration encoder 101 and the RSC 2 configuration encoder 103, and such performance is affected. It may be dictated by the interleaver 102. In FIG. 1, an interleaver using Regular Rectangular Permutation, which reads a sequence of length k in the row direction of a rectangular matrix of M * N bits and reads it in the column direction, is used as an interleaver. As shown in FIG. 2, a detailed operation thereof will be described below with reference to FIG. 2.

도 2는 RP(Regular Permutation)를 행하는 방법의 구체적 일례를 도시한 도면이다.FIG. 2 is a diagram showing a specific example of a method for performing regular permutation (RP). FIG.

도 2는 상술한 정규 사각 순열에 따라 행 방향으로 시퀀스를 입력하고, 이를 열 방향으로 판독하여 출력하는 것을 도시하고 있으며, 설명의 편의를 위하여 도 2의 행렬상에 표기된 수는 입력 시퀀스의 인덱스(i)와 동일한 것으로 나타내었다. FIG. 2 illustrates inputting a sequence in a row direction according to the above-described normal square permutation, and reading and outputting the sequence in a column direction. For convenience of description, the number indicated on the matrix of FIG. 2 is an index of the input sequence ( Same as i).

일반적으로, RP에서의 입력 시퀀스의 인덱스와 출력 시퀀스의 인덱스(j)사이에는 다음과 같은 관계에 의해 맵핑될 수 있다.In general, between the index of the input sequence in the RP and the index (j) of the output sequence can be mapped by the following relationship.

Figure 112006076869657-pat00001
Figure 112006076869657-pat00001

여기서, K는 인터리버의 크기이며, P는 K와 서로 소인 임의의 정수로서 도 2 의 행렬에서 열의 수에 해당하는 수이다. 도 2는 이와 같은 인덱스간의 맵핑에 따라 K=32, P=7인 경우,

Figure 112006076869657-pat00002
에 의해 인덱스 맵핑이 이루어지는 경우를 도시하고 있다. 이와 같이 길이 32 비트의 입력 시퀀스 I는 상술한 인덱스 맵핑관계에 따라 행 방향으로 기록된 후, 열 방향으로 판독되어 출력 시퀀스 I'으로 출력된다.Where K is the size of the interleaver, and P is a random integer that is prime with K and corresponds to the number of columns in the matrix of FIG. 2 is K = 32 and P = 7 according to the mapping between these indices,
Figure 112006076869657-pat00002
Shows the case where the index mapping is performed. In this way, the 32-bit length input sequence I is written in the row direction according to the above-described index mapping relation, and then read in the column direction and output in the output sequence I '.

한편, RSC에는 부호어의 가중치를 작게 만드는 RTZ(Return-To-Zero) 시퀀스가 존재한다. 이러한 RTZ 시퀀스는 구성 인코더의 출력을 0이 반복되는 시퀀스가 되도록 하여 출력 시퀀스의 가중치를 감소시킨다. On the other hand, there is a Return-To-Zero (RTZ) sequence in the RSC which makes the weight of the codeword small. This RTZ sequence reduces the weight of the output sequence by making the output of the constituent encoder a repeating sequence of zeros.

구체적으로 도 1의 예에서, 제 1 RSC 구성 부호기(101)의 입력 시퀀스를 시퀀스 I라 할 때, 만일 시퀀스 I에 소정 RTZ 시퀀스가 존재한다면 제 1 RSC 구성 부호기(101)가 생성하는 패리티 비트(Y1)의 가중치(예를 들어, "1"의 개수)가 작아진다. 또한, 제 2 RSC 구성 부호기(103)에는 시퀀스 I가 인터리버(102)에 의해 인터리빙된 시퀀스가 입력되며 이를 시퀀스 I'라 할 경우, 만일 인터리빙된 시퀀스 I'에도 RTZ가 존재한다면 제 2 RSC 구성 인코더(103)가 생성하는 패리티 비트(Y2)의 가중치도 작아지며 전체 부호어의 MHD가 작아진다. 따라서, 인터리버(102)는 제 2 RSC 구성 인코더(103)에 입력되는 시퀀스인 시퀀스 I'에 RTZ 시퀀스가 발생하지 않도록 설계되어야 한다.Specifically, in the example of FIG. 1, when the input sequence of the first RSC component encoder 101 is a sequence I, if a predetermined RTZ sequence exists in the sequence I, the parity bit generated by the first RSC component encoder 101 ( Y 1 ) becomes smaller (eg, the number of “1s”). In addition, when the sequence I interleaved by the interleaver 102 is input to the second RSC component encoder 103, and this is called sequence I ', the second RSC component encoder if RTZ is also present in the interleaved sequence I'. The weight of parity bit Y 2 generated by 103 is also reduced, and the MHD of all codewords is reduced. Therefore, the interleaver 102 should be designed so that the RTZ sequence does not occur in the sequence I 'which is the sequence input to the second RSC constituent encoder 103.

도 3a 내지 도 3c는 가중치 2, 가중치 3, 그리고 가중치 6 및 9인 RTZ(Return-To-Zero) 시퀀스의 경우의 예를 도시한 도면이다.3A to 3C are diagrams showing an example of a Return-To-Zero (RTZ) sequence having a weight of 2, a weight of 3, and a weight of 6 and 9.

구체적으로, 도 3a는 가중치가 2인 RTZ 시퀀스의 예로서, 입력 시퀀스 I에 '1'과 '1'사이가 7 비트만큼 떨어진 위치에 있는 RTZ 시퀀스를 포함하는 예를 도시하고 있다. 또한, 도 3a는 상술한 바와 같이 입력 시퀀스 I는 행 방향으로 기록된 후, 이를 열 방향으로 판독하여 출력하는 상술한 정규 사각 순열에 의한 인터리빙을 도시하고 있다. 도 3a에 도시된 바와 같이 가중치가 2 인 RTZ 시퀀스의 경우 MHD(dmin)는 대략 입력 시퀀스 I에서 '1'과 '1'사이의 거리인 7 비트에 M*N 행렬의 행의 수인 M을 곱한 7M을 각 시퀀스에서 동일한 최종 비트인 '1'의 수인 2로 나눈 값에 가까움을 알 수 있으며, 이는 다음과 같이 나타낼 수 있다.Specifically, FIG. 3A illustrates an example of an RTZ sequence having a weight of 2, including an RTZ sequence in a position between '1' and '1' by 7 bits. In addition, FIG. 3A illustrates interleaving by the above-described regular square permutation, in which the input sequence I is written in the row direction and then read and output in the column direction as described above. As shown in FIG. 3A, for an RTZ sequence having a weight of 2, MHD (d min ) represents M, the number of rows of the M * N matrix, at 7 bits, which is approximately a distance between '1' and '1' in the input sequence I. It can be seen that the multiplied 7M is close to the value obtained by dividing by 2, the number of the same final bits '1' in each sequence, which can be expressed as follows.

Figure 112006076869657-pat00003
Figure 112006076869657-pat00003

또한, 도 3b의 경우 가중치가 3인 RTZ 시퀀스의 예로서, 입력 시퀀스 I에 3개의 '1'이 ..1101..과 같이 배열된 RTZ 시퀀스를 포함하는 예를 도시하고 있다. 이 경우, MHD(dmin)는 최종 '1'사이의 거리에 해당하는 3 비트에 행렬의 행의 수인 M을 곱한 3M을 각 시퀀스에서 동일한 최종 비트인 '1'의 수인 2로 나눈 값에 가까움을 알 수 있으며, 이는 또한 다음과 같이 나타낼 수 있다. In addition, FIG. 3B shows an example in which an RTZ sequence having a weight of 3 includes an RTZ sequence in which three '1's are arranged as ..1101 .. in the input sequence I. In this case, MHD (d min ) is 3M multiplied by M, the number of rows in the matrix, corresponding to the distance between the final '1', which is 3M divided by 2, the number of '1' which is the same final bit in each sequence. It can be seen that this can also be expressed as:

Figure 112006076869657-pat00004
Figure 112006076869657-pat00004

이와 같이 도 3a 및 도 3b의 경우에는 RTZ 시퀀스에 대해서 정규 순 열(Regular Permutation: 이하 "RP"라 함)을 사용하면, dmin값은 전체 시퀀스의 길이인 K가 증가할수록 커짐을 알 수 있으며, 출력 시퀀스 I'에 RTZ 시퀀스가 포함되는 것을 방지할 수 있다.3A and 3B, when using a regular permutation (hereinafter referred to as "RP") for the RTZ sequence, it can be seen that the value of d min increases as K, the length of the entire sequence, increases. It is possible to prevent the RTZ sequence from being included in the output sequence I '.

한편, 도 3c는 가중치가 6 및 9인 RTZ 시퀀스의 예를 도시하고 있다. 이와 같이 가중치가 6 및 9와 같이 다수의 가중치를 포함하는 시퀀스의 경우 MHD는 일반적으로 규정될 수 없고, 해당 시퀀스의 특정 패턴에 따라 달라질 수밖에 없다. 또한, 도 3c에 도시된 입력 시퀀스 I의 경우, 그 시퀀스 I의 패턴상 행방향의 입력 시퀀스에서 ..1101.. 과 같은 RTZ 시퀀스를 포함하고, 열 방향의 출력 시퀀스에서 ..1000001.. 과 같은 RTZ 시퀀스를 포함하는 것을 도시하고 있어, 이와 같은 가중치 6 및 9인 시퀀스의 경우 상술한 RP를 이용한 인터리빙을 통해서는 입력 시퀀스 I에 RTZ 시퀀스가 포함된 경우, 출력 시퀀스 I'에 RTZ 시퀀스가 포함되지 않도록 하는 성능이 저하될 수 있음을 알 수 있다.3C shows an example of RTZ sequences having weights of 6 and 9. As described above, in the case of a sequence including a plurality of weights such as 6 and 9, the MHD cannot be generally defined and can only be changed according to a specific pattern of the sequence. In addition, in the case of the input sequence I shown in Fig. 3C, the pattern sequence of the sequence I includes an RTZ sequence such as ..1101 .. in the row direction input sequence, and the ..1000001 .. and The same RTZ sequence is shown. In the case of a sequence having weights 6 and 9, the RTZ sequence is included in the output sequence I 'when the input sequence I includes the RTZ sequence through interleaving using the aforementioned RP. It can be seen that performance may be degraded to prevent this from happening.

따라서, 상술한 바와 같이 도 3a 및 도 3b와 같은 RTZ 시퀀스에 대해서는 좋은 성능을 보이는 RP의 특성을 유지하면서 도 3c와 같은 RTZ 시퀀스를 회피하기 위해서 인터리버 메모리 행렬에서 열의 방향으로 판독할 때, 왜곡(disorder)을 주는 ARP(Almost Regular Permutation)이 현재 널리 이용되고 있다. Therefore, in order to avoid the RTZ sequence as shown in FIG. 3C while maintaining the characteristics of the RP showing good performance with respect to the RTZ sequence as shown in FIGS. 3A and 3B as described above, when reading in the direction of the column in the interleaver memory matrix, Almost Regular Permutation (ARP), which causes the disorder, is now widely used.

ARP는 인터리빙 과정에서 상술한 RP가 회피할 수 없는 가중치가 6 또는 9인 RTZ 시퀀스를 회피하기 위해 RP에 왜곡을 주기 위해 변동 벡터(fluctuation vector)들을 추가한 것으로서, 현재 DVB-RCS, DVB-RCT, 및 IEEE 802.16의 터보 코 드 인터리버로서 이용되고 있으며, 이와 같은 ARP의 응용에 대해서는 본 명세서에 참조로서 포함된 "ETSI EN 301 790 v1.2.2(2000-12)" 및 "Draft IEEE standard Local and Metropolitan area networks, Part 16"에 상세히 개시되어 있다.ARP adds fluctuation vectors to distort the RP in order to avoid the RTZ sequence having a weight of 6 or 9, which the RP cannot avoid in the interleaving process, and is currently DVB-RCS and DVB-RCT. , And is used as a turbo code interleaver of IEEE 802.16, and for such applications of ARP, "ETSI EN 301 790 v1.2.2 (2000-12)" and "Draft IEEE standard Local and Metropolitan", incorporated herein by reference. area networks, Part 16 ".

도 4는 변동 벡터(fluctuation vector)를 이용한 ARP(Almost Regular Permutation)를 행하는 개념을 설명하기 위한 도면이다. 4 is a diagram for explaining a concept of performing ARP (Almost Regular Permutation) using a fluctuation vector.

ARP는 도 2와 관련하여 상술한 바와 같은 RP에 변동 벡터를 추가하여 기록 및 판독 과정에서 왜곡을 주는 방식으로 다음과 같은 인덱스 맵핑 관계에 의해 나타낼 수 있다.The ARP can be represented by the following index mapping relationship in such a manner as to add a variation vector to the RP as described above with reference to FIG.

Figure 112006076869657-pat00005
Figure 112006076869657-pat00005

여기서, Q(j)는 변동 벡터를 나타내며, 구체적으로 다음과 같이 나타낼 수 있다.Here, Q (j) represents a variation vector, and specifically, it may be expressed as follows.

Figure 112006076869657-pat00006
Figure 112006076869657-pat00006

여기서, C는 왜곡 주기를 나타내며, A(j) 및 B(j)는 C를 주기로 가지는 주기함수로서 P 및 K/P의 20% 이하이다. 또한, Q(0) = 0으로 선택할 수 있으며, 이러한 ARP는 A(j) 및 B(j)를 규정하는 2(C-1) 개의 정수들 및 P에 의해 규정될 수 있다.Here, C represents a distortion period, and A (j) and B (j) are periodic functions having C as a period, which is 20% or less of P and K / P. It is also possible to select Q (0) = 0, and this ARP may be defined by 2 (C-1) integers and P defining A (j) and B (j).

도 4는 이와 같은 변동 벡터에 의해 시퀀스의 기록 및 판독에서 발생하는 과정을 도시하고 있으며, 구체적인 사항은 본 명세서에 참조로서 포함된 C. Berrou, Y. Saouter 등의 "Designing good permutations for turbo codes: towards a single model"에 상세히 개시되어 있다.FIG. 4 illustrates a process occurring in the recording and reading of a sequence by such a variation vector, and details are described in "Designing good permutations for turbo codes" by C. Berrou, Y. Saouter et al. towards a single model ".

이와 같은 ARP를 규정하기 위한 인터리버 파라미터의 수를 감소시키기 위해서는 다음과 같이 ARP를 규정할 수 있다.In order to reduce the number of interleaver parameters for defining such ARP, ARP can be defined as follows.

1) A(j)에 대해 오직 1 개의 0이 아닌 값만을 이용하고, 2) C의 배수인 A(j)' 및 B(j)'이 존재하도록 하며, 3) α(j) 및 β(j)는 0 내지 8 사이의 정수이며, C의 배수로 설정한다. 이와 같은 ARP를 적용하는 구체적인 일례는 다음과 같다.1) use only one non-zero value for A (j), 2) allow A (j) 'and B (j)' to be multiples of C, and 3) α (j) and β ( j) is an integer between 0 and 8, set to a multiple of C. A specific example of applying such an ARP is as follows.

도 5는 도 4에 도시된 ARP를 행하는 구체적 일례를 도시한 도면이다.FIG. 5 is a diagram showing a specific example of performing ARP shown in FIG. 4.

구체적으로, 도 5의 좌측은 도 2와 동일하게 P=7, K=32를 만족하는 RP에 의한 인덱스 맵핑 관계를 도시하고 있으며, 도 5의 우측은 이와 같은 RP에 의한 맵핑 관계가 변동 벡터(Q(j))에 의해 다음과 같이 나타내어지는 경우를 도시하고 있다.Specifically, the left side of FIG. 5 shows an index mapping relationship by RP satisfying P = 7 and K = 32, similarly to FIG. 2, and the right side of FIG. 5 shows that the mapping relationship by RP is a variation vector ( The case represented by Q (j)) is shown below.

Figure 112006076869657-pat00007
Figure 112006076869657-pat00007

여기서, Q(j)의 일례를 다음과 같이 나타낼 수 있다.Here, an example of Q (j) can be expressed as follows.

Figure 112006076869657-pat00008
Figure 112006076869657-pat00008

즉, 도 5의 좌측에 도시된 RP 인덱스 맵핑 관계에서 첫 번째 열방향 맵핑에서의 왜곡을 살펴보면, j= 0은 그대로 i=0에, j=1은 i=7이 아니라 4가 더해진 i=11에, j=2는 i=14가 아닌 i=22에, 그리고 j=3은 i=21이 아닌 i=1에 맵핑되는 것을 도 5의 우측에서 도시하고 있다.That is, in the RP index mapping relationship shown in the left side of FIG. 5, the distortion in the first column direction mapping is as follows: j = 0 is equal to i = 0 and j = 1 is not i = 7 but i = 11 5, j = 2 is mapped to i = 22 rather than i = 14 and j = 3 is mapped to i = 1 rather than i = 21.

그러나, 이와 같은 변동 벡터(Q(j))는 주기가 C인 함수이며, 이에 따라 인터리버 크기 K(즉, 인터리빙 정보의 길이 K)는 C의 배수이어야 하는 제약이 있다. 즉, 주기 C가 4 인 상술한 예에서 4의 배수 길이를 가지는 인터리버만을 제공할 수 있는바, ARP를 이용하면서도 연속적인 길이를 가지는 인터리버를 제공하기 위한 기술이 요구되고 있다. However, such a variation vector Q (j) is a function whose period is C. Accordingly, the interleaver size K (that is, the length K of interleaving information) has a constraint that it must be a multiple of C. That is, in the above example in which the period C is 4, only an interleaver having a multiple length of 4 can be provided. Therefore, a technique for providing an interleaver having a continuous length while using ARP is required.

상술한 바와 같은 문제점을 해결하기 위한 본 발명의 목적은 ARP를 이용하면서도 변동 벡터의 주기 C의 배수가 아닌 길이를 가지는 인터리버를 제공하는 방법을 제공하는 것이다.SUMMARY OF THE INVENTION An object of the present invention for solving the above problems is to provide a method of providing an interleaver having a length that is not a multiple of period C of a variation vector while using ARP.

또한, 이와 같은 인터리버를 제공하기 위하여 기본 인터리버(Basic Interleaver) 개념과 가지치기(pruning) 개념을 이용한 인터리빙 방법 및 이를 수행하는 인터리버를 포함하는 터보 인코더를 제공하고자 한다.In addition, to provide such an interleaver, an interleaving method using a basic interleaver concept and a pruning concept, and a turbo encoder including an interleaver performing the same, are provided.

상기 목적을 달성하기 위한 본 발명의 일 실시형태에 따른 인터리버 제공 방법은 ARP(Almost Regular Permutation)의 변동 벡터(fluctuation vector) 주기의 배수 길이를 가지도록 미리 설정된 기본 인터리버(Basic Interleaver) 세트 중 제 1 길이를 가지는 기본 인터리버를 선택하는 단계; 및 요구되는 인터리버 길이인 제 2 길이가 상기 제 1 길이보다 작은 경우, 상기 선택된 기본 인터리버를 상기 제 2 길이로 조절하는 단계를 포함한다. An interleaver providing method according to an embodiment of the present invention for achieving the above object is the first of the set of basic interleaver (Basic Interleaver) preset to have a multiple length of the fluctuation vector period of Almost Regular Permutation (ARP) Selecting a basic interleaver having a length; And adjusting the selected basic interleaver to the second length if the second length, which is the required interleaver length, is less than the first length.

이 경우, 상기 인터리버는 ARP 인터리버이며, 상기 제 1 길이는 상기 변동 벡터 주기의 배수 중 상기 제 2 길이 이상의 최소 배수일 수 있다.In this case, the interleaver is an ARP interleaver, and the first length may be a minimum multiple of the second length or more of multiples of the variation vector period.

또한, 상기 길이를 조절하는 단계에서 상기 가지치기는 상기 제 1 길이를 가지는 기본 인터리버에 입력되는 데이터의 인덱스들 중 상기 제 2 길이에 해당하는 수의 인덱스들만 수용함으로써 수행될 수 있다.In addition, in the adjusting of the length, the pruning may be performed by accommodating only the number of indices corresponding to the second length among the indices of data input to the basic interleaver having the first length.

본 발명의 다른 일 실시형태에 따른 인터리빙 방법은 원본 시퀀스의 길이와 ARP의 변동 벡터 주기의 배수 길이를 가지도록 미리 설정된 기본 인터리버 세트 중 선택된 기본 인터리버의 길이의 차이에 해당하는 길이의 원본 시퀀스 인덱스에 더미(dummy) 정보 삽입 단계; 상기 더미 정보가 삽입된 상기 선택된 기본 인터리버 길이의 시퀀스를 ARP 인터리빙하는 단계; 및 상기 인터리빙된 시퀀스 인덱스 중 상기 더미 정보가 삽입되지 않은 인덱스를 출력하는 단계를 포함한다.An interleaving method according to another embodiment of the present invention includes an original sequence index having a length corresponding to a difference between a length of an original sequence and a length of a basic interleaver selected from among a set of basic interleavers preset to have multiples of a variable vector period of ARP. Inserting dummy information; ARP interleaving a sequence of the selected basic interleaver length into which the dummy information is inserted; And outputting an index in which the dummy information is not inserted among the interleaved sequence indexes.

이 경우, 상기 선택된 기본 인터리버는 상기 변동 벡터 주기의 배수 중 상기 원본 시퀀스의 길이 이상의 최소 배수 길이를 가지는 것이 바람직하다.In this case, the selected basic interleaver preferably has a minimum multiple length greater than the length of the original sequence among multiples of the variation vector period.

또한, 상기 더미 정보 삽입 단계에서, 상기 더미 정보는 상기 원본 시퀀스의 인덱스 중 상기 선택된 기본 인터리버의 길이 이상의 인덱스에 삽입되며, 상기 인덱스 출력 단계에서, 출력되는 상기 인터리된 시퀀스 인덱스는 상기 선택된 기본 인터리버의 길이 이상의 원본 시퀀스 인덱스에 대응하는 인덱스를 제외한 인덱스일 수 있으며, 이와 달리 상기 더미 정보 삽입 단계에서, 상기 더미 정보는 상기 원본 시퀀스의 인덱스 중 상기 원본 시퀀스의 길이와 상기 선택된 기본 인터리버의 길이의 차이에 해당하는 길이만큼 임의로 선택된 인덱스에 삽입되며, 상기 인덱스 출력 단계에서, 출력되는 상기 인터리된 시퀀스 인덱스는 상기 더미 정보 삽입 단계에서 선택된 상기 원본 시퀀스 인덱스에 대응하는 인덱스를 제외한 인덱스이며, 상기 인덱스 출력 단계 이후, 상기 출력된 시퀀스의 인덱스를 상기 더미 정보 삽입 전 원본 시퀀스의 인덱스에 따라 맵핑하는 단계를 더 포함할 수도 있다.Further, in the dummy information insertion step, the dummy information is inserted into an index equal to or greater than the length of the selected basic interleaver among the indexes of the original sequence, and in the index output step, the interleaved sequence index output is the selected basic interleaver. The dummy information may be an index except for an index corresponding to an original sequence index of a length greater than or equal to, and in the dummy information insertion step, the dummy information is a difference between the length of the original sequence and the length of the selected basic interleaver among the indexes of the original sequence. The interleaved sequence index, which is inserted into a randomly selected index by a length corresponding to, and is output in the index output step, is an index except an index corresponding to the original sequence index selected in the dummy information insertion step, and outputs the index. only Then, the may further comprise the step of mapping in accordance with the index of the output sequence to the index of the dummy information insertion before the original sequence.

한편, 본 발명의 또 다른 일 실시형태에 따른 터보 인코더는 입력 시퀀스에 소정의 인코딩을 수행하여 출력하는 제 1 인코더; 상기 입력 시퀀스를 인터리빙하는 인터리버; 및 상기 인터리버에 의해 인터리빙된 시퀀스를 입력받아 인코딩을 수행하여 출력하는 제 2 인코더를 포함하는 터보 인코더로서, 상기 인터리버는, ARP의 변동 벡터 주기의 배수 길이를 가지도록 미리 설정된 기본 인터리버 세트 중 제 1 길이를 가지는 기본 인터리버를 선택하는 기본 인터리버 선택 모듈; 및 상기 입력 시퀀스의 길이인 제 2 길이가 상기 제 1 길이보다 작은 경우, 상기 선택된 기본 인터리버를 상기 제 2 길이로 조절하는 길이 조절 모듈을 포함하는 것을 특징으로 한다.On the other hand, a turbo encoder according to another embodiment of the present invention includes a first encoder for performing a predetermined encoding on the input sequence and outputs; An interleaver for interleaving the input sequence; And a second encoder configured to receive the encoding interleaved by the interleaver, perform encoding, and output the encoding, wherein the interleaver comprises: a first of a set of basic interleavers set to have a multiple length of a variable vector period of ARP; A basic interleaver selecting module for selecting a basic interleaver having a length; And a length adjusting module for adjusting the selected basic interleaver to the second length when the second length which is the length of the input sequence is smaller than the first length.

이하, 본 발명에 따른 바람직한 실시 형태를 첨부된 도면을 참조하여 상세하게 설명한다. 첨부된 도면과 함께 이하에 개시될 상세한 설명은 본 발명의 예시적인 실시형태를 설명하고자 하는 것이며, 본 발명이 실시될 수 있는 유일한 실시형태를 나타내고자 하는 것이 아니다. 이하의 상세한 설명은 본 발명의 완전한 이해 를 제공하기 위해서 구체적 세부사항을 포함한다. 그러나, 당업자는 본 발명이 이러한 구체적 세부사항 없이도 실시될 수 있음을 안다. 몇몇 경우, 본 발명의 개념이 모호해지는 것을 피하기 위하여 공지의 구조 및 장치는 생략되거나, 각 구조 및 장치의 핵심기능을 중심으로 한 블록도 형식으로 도시된다. 또한, 본 명세서 전체에서 동일한 구성요소에 대해서는 동일한 도면 부호를 사용하여 설명한다.Hereinafter, preferred embodiments according to the present invention will be described in detail with reference to the accompanying drawings. DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS The following detailed description, together with the accompanying drawings, is intended to illustrate exemplary embodiments of the invention and is not intended to represent the only embodiments in which the invention may be practiced. The following detailed description includes specific details in order to provide a thorough understanding of the present invention. However, those skilled in the art will appreciate that the present invention may be practiced without these specific details. In some instances, well-known structures and devices are omitted or shown in block diagram form, centering on the core functions of each structure and device, in order to avoid obscuring the concepts of the present invention. In addition, the same components will be described with the same reference numerals throughout the present specification.

본 발명은 상술한 바와 같이 기존의 ARP가 특정한 주기를 가지므로 연속적인 길이를 가지는 인터리버를 제공할 수 없는 문제를 해결하기 위하여 "기본 인터리버(Basic Interleaver)" 개념을 이용한다. 기본 인터리버는 요구되는 길이를 가지는 인터리버를 구현하기 위해 미리 설정된 길이를 가지는 인터리버로서, 일반적으로 필요에 따라 다양한 길이의 기본 인터리버 세트가 미리 설정되어 있는 것이 바람직하다.As described above, the conventional ARP uses a concept of a "basic interleaver" to solve a problem in that an interleaver having a continuous length cannot be provided because a conventional ARP has a specific period. The basic interleaver is an interleaver having a preset length to implement an interleaver having a required length. In general, it is preferable that a basic interleaver set having various lengths is preset as necessary.

도 6은 본 발명의 일 실시형태에 따라 기본 인터리버(Basic Interleaver) 개념을 이용하여 연속적인 길이를 가지는 인터리버를 제공하는 방법을 설명하기 위한 순서도이다.6 is a flowchart illustrating a method of providing an interleaver having a continuous length using a basic interleaver concept according to an embodiment of the present invention.

도 6에 도시된 본 발명의 일 실시형태에서는 K 길이를 가지는 인터리버를 제공하기 위하여 상술한 바와 같이 미리 설정된 기본 인터리버 세트 중 K' 길이를 가지는 인터리버를 선택한다(단계 S601). 여기서, K'은 도 5와 관련하여 상술한 바와 같이 ARP를 구현하기 위한 변동 벡터의 주기인 C의 배수이며, 또한 K≤K'인 최소 K' 길이를 가지는 기본 인터리버를 선택하는 것이 이후의 가지치기(pruning) 등의 과정을 더 용이하게 할 수 있다.In an embodiment of the present invention illustrated in FIG. 6, an interleaver having a length K ′ is selected from the set of basic interleavers set in advance as described above to provide an interleaver having a length of K (step S601). Here, K 'is a multiple of C, which is a period of the variation vector for implementing ARP, as described above with reference to FIG. 5, and it is later to select a basic interleaver having a minimum K' length of K≤K '. This can make the process of pruning and the like easier.

그 후, K≤K'인 경우, 단계 S601에서 선택된 K' 길이의 기본 인터리버는 K의 길이를 가지는 인터리버로 조절될 수 있다. 이러한 인터리버 길이 조절을 인터리빙 단계별로 구체적으로 설명하면 다음과 같다.Then, in the case of K≤K ', the basic interleaver of the length K' selected in step S601 may be adjusted to an interleaver having the length of K. The interleaver length adjustment will be described in detail for each interleaving step as follows.

단계 S602에서 인터리버의 입력 시퀀스에 K'-K 개의 더미(dummy) 정보를 삽입한다. 즉, 입력 시퀀스를 B=(b0, b1, ..., bk -1)이라 할 때, K'-K 개의 더미 비트를 삽입하여 B'=(b'0, b'1, ..., bk -1, bk, bk +1, ..., bk' -1)과 같이 형성한다. 본 발명의 일 실시형태에서는 상술한 바와 같이 입력 시퀀스에 더미 정보를 삽입하는 위치를 인덱스가 K 이상인 부분으로 하였으나, 본 발명의 다른 실시형태에서는 이와 달리 규정될 수 있으며, 이에 대해서는 후술하기로 한다. 이와 같이 입력 시퀀스에 삽입된 더미 정보는 입력 시퀀스의 길이를 K' 길이로 조절하여 이후 K' 길이를 가지는 기본 인터리버에 의한 ARP 인터리빙이 가능하게 한다(단계 S603).In step S602, K'-K dummy information is inserted into the input sequence of the interleaver. That is, when the input sequence is B = (b 0 , b 1 , ..., b k -1 ), K'-K dummy bits are inserted to insert B '= (b' 0 , b ' 1 ,. .., b k -1 , b k , b k +1 , ..., b k ' -1 ). In one embodiment of the present invention, as described above, the position at which the dummy information is inserted into the input sequence is a portion having an index of K or more. However, in another embodiment of the present invention, it may be defined differently, which will be described later. As described above, the dummy information inserted in the input sequence adjusts the length of the input sequence to the length K 'to enable ARP interleaving by the basic interleaver having the length K' (step S603).

단계 S603을 거쳐 ARP 인터리빙이 완료된 출력 시퀀스를 "O"라 할 경우, 이는 O=(o0, o1, ..., ok' -1)과 같이 나타낼 수 있다. 그 후, 단계 S604에서 더미 정보가 입력 시퀀스의 인덱스에 대응하는 출력 시퀀스의 인덱스를 제외한 인덱스(Non Dummy Index)를 출력한다. 구체적으로, 단계 S603에서 입력 시퀀스의 인덱스 i와 출력 시퀀스의 인덱스 j 사이에 i=Π(j)관계에 있는 경우, 상술한 예에서 i= k, k+1, ..., k'-1 에 대응하는 출력 인덱스 j를 제외한 인덱스를 출력하는 것을 의미한다. 따라서, 결과적으로 출력 시퀀스 O'은 이와 같이 인덱스가 제거된 위치의 정보만이 남게 된다. 아울러, 상술한 설명은 더미 정보가 삽입된 인덱스 자체를 제외 하고 출력하는 방식을 중심으로 설명하였으나, oj = bi =Π(j) 관계에 착안하여 출력 시퀀스 중 해당 인덱스의 정보 자체를 제거하고 출력하는 방식 역시 동일한 결과를 얻을 수 있다. When the ARP interleaving completed output sequence is referred to as "O" through step S603, this may be represented as O = (o 0 , o 1 , ..., o k ' -1 ). Thereafter, in step S604, an index (Non Dummy Index) excluding the index of the output sequence whose dummy information corresponds to the index of the input sequence is output. Specifically, in a case where there is i =? (J) relationship between the index i of the input sequence and the index j of the output sequence in step S603, i = k, k + 1, ..., k'-1 in the above example. This means outputting an index except for the output index j corresponding to. Therefore, as a result, the output sequence O 'remains only at the information where the index is removed. In addition, the above description has been mainly focused on the method of outputting the index except the dummy information itself. However, the information of the corresponding index is removed from the output sequence based on the relationship of j j = b i = Π (j) . You can get the same result by printing.

상술한 바와 같은 본 발명의 일 실시형태에 따른 인터리빙 방법을 보다 구체적인 예를 들어 설명하면 다음과 같다.Referring to the interleaving method according to an embodiment of the present invention as described above with a more specific example as follows.

도 7은 본 발명의 일 실시형태에 따른 인터리빙 방법을 설명하기 위한 순서도이다. 7 is a flowchart illustrating an interleaving method according to an embodiment of the present invention.

먼저, 도 7은 본 발명의 일 실시형태에 따라 더미 정보 삽입 시 입력 시퀀스의 말단부에 삽입하여, 인터리빙을 거쳐 출력된 시퀀스에서 더미 비트가 삽입된 위치의 인덱스를 제외한 인덱스를 출력하는 방법을 도시한다. 먼저, 단계 S701에서 입력 시퀀스의 인덱스 i를 0으로 초기화한다. 그 후, 단계 S702에서 i가 K 이상인지를 판정하고, i가 K보다 작은 경우 단계 S703으로 진행하여 입력 시퀀스 B의 각 정보를 더미 비트가 삽입되는 시퀀스 B'의 각 정보에 대응시킨다. 그러나, 만일 i가 K 이상으로 판정되는 경우 단계 S704로 진행되어 시퀀스 B'의 말단부 위치에 더미 비트를 삽입한다. 한편, 단계 S705에서는 입력 시퀀스의 인덱스 i를 순차적으로 증가시키고, 단계 S706에서 i가 K' 보다 작은 경우 단계 S702로 복귀하여 상술한 단계들을 반복한다. 구체적으로 예로서 K'=16, K=14 인 경우, i=14, 15인 b14, b15에는 더미 값이 입력된다.First, FIG. 7 illustrates a method of inserting an end portion of an input sequence when inserting dummy information and outputting an index except an index of a position where a dummy bit is inserted in a sequence output through interleaving according to one embodiment of the present invention. . First, in step S701, the index i of the input sequence is initialized to zero. Then, in step S702, it is determined whether i is greater than or equal to K, and if i is less than K, the flow advances to step S703 to correspond to each piece of information of the sequence B 'into which dummy bits are inserted. However, if i is determined to be K or more, the process proceeds to step S704 where a dummy bit is inserted at the end position of the sequence B '. On the other hand, in step S705, the index i of the input sequence is sequentially increased, and in step S706, when i is smaller than K ', the process returns to step S702 and the above-described steps are repeated. Specifically, when K '= 16 and K = 14, dummy values are input to b 14 and b 15 having i = 14 and 15.

한편, 단계 S706의 판정 결과 i가 K' 이상인 것으로 판정되는 경우, 단계 S707로 진행하여 ARP 인터리빙이 수행된다. 상술한 예에서와 같이 K'=16, K=14인 경우 ARP 인터리빙에 있어 인덱스 맵핑 관계식과 변동 벡터(Q(j))는 다음과 같이 나타낼 수 있다.On the other hand, when it is determined that i is equal to or greater than K ', the ARP interleaving is performed in step S707. As in the above example, in the case of K '= 16 and K = 14, the index mapping relation and the variation vector Q (j) in ARP interleaving can be expressed as follows.

Figure 112006076869657-pat00009
Figure 112006076869657-pat00009

여기서 변동 벡터 Q(j)는,Where the variation vector Q (j) is

Figure 112006076869657-pat00010
Figure 112006076869657-pat00010

와 같이 표현된다.It is expressed as

따라서, 상기 수학식 8 및 수학식 9와 같은 ARP 인터리빙에 의해 출력되는 시퀀스는 Πk'={0, 7, 6, 5, 12, 3, 2, 1, 8, 15, 14, 13, 4, 11, 10, 9}와 같이 표현될 수 있다. 여기서 출력 시퀀스를 구성하는 각 수는 편의를 위해 입력 시퀀스 상에서의 인덱스를 나타내는 것으로 한다. 그 후, 단계 S708에서 Π(j)=i의 관계를 이용하여 i>K-1인 인덱스와 매칭된 인덱스 j를 제외한 인덱스를 출력한다. 즉, 상술한 예에서 단계 S708의 결과 길이 K의 Πk={0, 7, 6, 5, 12, 3, 2, 1, 8, 13, 4, 11, 10, 9}으로 나타내어 질 수 있으며, 이는 i=14, 15에 대응하는 j 인덱스가 제외된 인덱스를 출력한 것을 나타낸다.Therefore, the sequence output by ARP interleaving such as Equation 8 and Equation 9 is π k ' = {0, 7, 6, 5, 12, 3, 2, 1, 8, 15, 14, 13, 4 , 11, 10, 9}. Here, each number constituting the output sequence is assumed to represent an index on the input sequence for convenience. Thereafter, in step S708, an index except for index j matched with an index of i> K-1 is output using a relationship of? (J) = i. That is, in the above example, the result length K of step S708 may be represented by π k = {0, 7, 6, 5, 12, 3, 2, 1, 8, 13, 4, 11, 10, 9}. , Which indicates that the j index corresponding to i = 14, 15 is outputted.

상술한 실시형태에서는 입력 시퀀스의 말단부에 더미 정보를 삽입하는 예를 설명하였으나, 더미 정보가 삽입되는 위치는 반드시 입력 시퀀스의 말단부에 한정될 필요는 없다. 따라서, 본 발명의 다른 일 실시형태에 따른 인터리빙 방법은 입력 시퀀스의 임의의 위치의 K'-K 개의 인덱스에 더미 정보를 삽입하여 ARP 인터리빙을 수행하는 방법을 제안한다. In the above-described embodiment, an example of inserting dummy information at the end of the input sequence has been described, but the position at which the dummy information is inserted is not necessarily limited to the end of the input sequence. Accordingly, an interleaving method according to another embodiment of the present invention proposes a method for performing ARP interleaving by inserting dummy information into K'-K indexes at arbitrary positions of an input sequence.

상기 본 발명의 실시형태에 따르면 상술한 도 6의 단계 S602에서 0과 K'-1 사이의 입력 시퀀스 인덱스 i 중 소정의 K'-K 개의 인덱스를 선택하여 더미 정보를 삽입하고, 단계 S604에서는 동일하게 i=Π(j)의 관계를 이용하여 입력 시퀀스에 더미 정보가 삽입된 인덱스에 대응하는 출력 시퀀스 인덱스를 제거한 인덱스를 출력한다. 이에 따라 출력 시퀀스를 입력 시퀀스의 인덱스 제거에 따라 원래 K 길이의 인덱스에 맞도록 인덱스를 맵핑하는 단계를 더 포함할 수 있다.According to the embodiment of the present invention, in step S602 of FIG. 6 described above, dummy information is inserted by selecting predetermined K'-K indexes among the input sequence indexes i between 0 and K'-1, and the dummy information is inserted in step S604. By using i =? (J), the index from which the output sequence index corresponding to the index into which dummy information is inserted into the input sequence is output. Accordingly, the method may further include mapping the index to match the index of the original K length according to the removal of the index of the input sequence.

이를 도 8과 관련하여 구체적으로 설명하면 다음과 같다.This will be described in detail with reference to FIG. 8 as follows.

도 8은 본 발명의 다른 일 실시형태에 따른 인터리빙 방법을 설명하기 위한 순서도이다.8 is a flowchart illustrating an interleaving method according to another embodiment of the present invention.

먼저, 단계 S801에서 0과 K'-1 사이의 입력 시퀀스 인덱스 i 중 K'-K 개의 인덱스를 선택하고, 단계 S802에서 해당 인덱스에 더미 정보를 삽입한다. 구체적으로, 상술한 바와 같이 K'=16, K=14인 예로서 설명하면, 0≤i≤15인 i 중 i=4, 10을 더미 정보 삽입 인덱스로 선택한다. 그 후, 단계 S803에서 상기 수학식 8 및 수학식 9에 따른 ARP 인터리빙이 수행되고, 이에 따라 상술한 예에서 출력되는 K' 길이 의 시퀀스는 Πk'={0, 7, 6, 5, 12, 3, 2, 1, 8, 15, 14, 13, 11, 9}와 같이 나타낼 수 있다.First, in step S801, K'-K indexes among the input sequence indexes i between 0 and K'-1 are selected, and dummy information is inserted into the corresponding index in step S802. Specifically, as described above as an example in which K '= 16 and K = 14, i = 4 and 10 are selected as dummy information insertion index among i with 0≤i≤15. Thereafter, in step S803, ARP interleaving according to Equations 8 and 9 is performed, and accordingly, the sequence of length K 'outputted in the above-described example is π k' = {0, 7, 6, 5, 12 , 3, 2, 1, 8, 15, 14, 13, 11, 9}.

이와 같은 K' 길이를 가지는 시퀀스 중 단계 S804에서는 더미 정보가 삽입된 입력 시퀀스의 인덱스를 제외한 인덱스를 출력한다. 예를 들어, o12=i4, 및 o14=i10 이 더미 정보인 경우, 출력 시퀀스의 인덱스 j 중 해당 인덱스를 제외한 인덱스만을 출력한다. 이에 따라 상술한 길이 K'의 출력 시퀀스는 길이 K인 Πpre - mapping k={0, 7, 6, 5, 12, 3, 2, 1, 8, 15, 14, 13, 11, 9}로 나타내어진다. 다만, 이러한 시퀀스는 길이 K인 입력 시퀀스와의 관계에 있어서 상호간에 인덱스 조정이 필요하며(예를 들어 길이 K의 입력 시퀀스에 존재하지 않는 인덱스 14, 15를 포함한다), 따라서, 단계 S805에서 원래의 입력 시퀀스의 인덱스에 맞도록 인덱스를 맵핑하는 단계를 더 포함한다. 구체적으로 상술한 예에서 입력 시퀀스의 인덱스 5는 4로, 6은 5로, 8은 7로, 9는 8로, 11은 9로, 12는 10으로, 13은 11로, 14는 12로, 15는 13으로 맵핑됨을 쉽게 알 수 있다. 이에 따라 최종적인 길이 K의 출력 시퀀스는 Πk={0, 6, 5, 4, 12, 3, 2, 1, 7, 13, 12, 11, 9, 8}와 같이 나타낼 수 있다.In step S804 of the sequence having the length K ', the index except for the index of the input sequence into which the dummy information is inserted is output. For example, when o 12 = i 4 and o 14 = i 10 are dummy information, only the index except for the corresponding index among the index j of the output sequence is output. Accordingly, the above-described output sequence of length K 'is π pre - mapping k = {0, 7, 6, 5, 12, 3, 2, 1, 8, 15, 14, 13, 11, 9} having a length K. Is represented. However, such a sequence requires index adjustments to each other in relation to an input sequence of length K (for example, includes indexes 14 and 15 that do not exist in the input sequence of length K). The method further includes mapping an index to fit the index of the input sequence. Specifically, in the above example, the index 5 of the input sequence is 4, 6 is 5, 8 is 7, 9 is 8, 11 is 9, 12 is 10, 13 is 11, 14 is 12, It is easy to see that 15 maps to 13. Accordingly, an output sequence of the final length K may be expressed as π k = {0, 6, 5, 4, 12, 3, 2, 1, 7, 13, 12, 11, 9, 8}.

이하에서는 이와 같이 연속적인 길이를 제공하는 인터리빙을 수행하는 인터리버를 포함한 터보 인코더의 장치적 특성에 대해 설명한다.Hereinafter, the device characteristics of a turbo encoder including an interleaver performing interleaving such as providing a continuous length will be described.

도 9는 본 발명의 일 실시형태에 따른 인터리버를 포함하는 터보 인코더의 특징 구성을 도시한 도면이다.9 is a diagram showing a feature configuration of a turbo encoder including an interleaver according to an embodiment of the present invention.

도 9에 도시된 본 발명의 일 실시형태에 따른 터보 인코더는 도 1과 같이 제 1 구성 인코더(901), 제 2 구성 인코더(902), 및 인터리버(903)를 포함한다. 다만, 인터리버(903)는 APR 인터리버(906)뿐만 아니라 도 1의 경우와 달리 미리 설정된 시본 인터리버 세트 중 적절한 길이를 가지는 기본 인터리버를 선택하는 기본 인터리버 선택 모듈(904), 더미 정보를 삽입할 인덱스를 선택하고, 더미 정보를 삽입하는 더미 삽입 모듈(905), 및 더미 정보가 삽입된 인덱스를 제외한고 출력하고 필요에 따라 인덱스 맵핑을 수행하는 모듈(907)을 포함한다. 이를 통해 인터리버(903)에서의 ARP 인터리빙에 있어 변동 벡터의 주기가 아닌 길이의 시퀀스를 더미 삽입과 더미가 삽입된 인덱스 제거를 통해 ARP 인터리빙하는 것이 가능하다.A turbo encoder according to an embodiment of the present invention illustrated in FIG. 9 includes a first configuration encoder 901, a second configuration encoder 902, and an interleaver 903 as shown in FIG. 1. However, the interleaver 903 may not only select the APR interleaver 906 but also the basic interleaver selection module 904 for selecting a basic interleaver having an appropriate length from among a set of preset interleavers, and an index to insert dummy information. A dummy insertion module 905 for selecting and inserting dummy information, and a module 907 for outputting an index except for an index into which dummy information is inserted and performing index mapping as necessary. In this way, in ARP interleaving in the interleaver 903, it is possible to interleave the sequence having a length rather than the period of the variation vector through dummy insertion and index insertion with dummy insertion.

이와 같이 기본 인터리버 선택 모듈(904), 더미 삽입 모듈(905) 및 인덱스 제거 모듈(907) 등의 길이 조절 모듈을 인터리버(903) 내부에 포함하는 경우, 제 1 인코더(901) 및 제 2 인코더(902)에 입력되는 시퀀스의 길이는 더미 정보 등을 포함하지 않는 완성된 시퀀스 길이를 가지도록 하여, 제 1 인코더(901) 및 제 2 인코더(902)에 의해 더미 정보까지 인코딩됨으로써 패리티 비트를 생성하여 추가적 오버헤드가 발생하는 것을 방지할 수 있다. As such, when the length adjusting module such as the basic interleaver selecting module 904, the dummy insertion module 905, and the index removing module 907 is included in the interleaver 903, the first encoder 901 and the second encoder ( The length of the sequence input to 902 has a completed sequence length that does not include dummy information, and the like is encoded by the first encoder 901 and the second encoder 902 to generate the parity bits. Additional overhead can be prevented from occurring.

상술한 바와 같이 개시된 본 발명의 바람직한 실시형태에 대한 상세한 설명은 당업자가 본 발명을 구현하고 실시할 수 있도록 제공되었다. 상기에서는 본 발명의 바람직한 실시 형태를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다. 따라서, 본 발명은 여기에 나타난 실시형태들에 제한되려는 것이 아니라, 여기서 개시된 원리들 및 신규한 특징들과 일치하는 최광의 범위를 부여하려는 것이다. The detailed description of the preferred embodiments of the invention disclosed as described above is provided to enable any person skilled in the art to make and practice the invention. Although the above has been described with reference to the preferred embodiments of the present invention, those skilled in the art will variously modify and change the present invention without departing from the spirit and scope of the invention as set forth in the claims below. I can understand that you can. Accordingly, the present invention is not intended to be limited to the embodiments shown herein but is to be accorded the widest scope consistent with the principles and novel features disclosed herein.

상기와 같은 본 발명의 일 실시형태에 따르면 ARP 변동 벡터의 주기의 배수 길이를 가지는 미리 설정된 기본 인터리버에 가지치기를 수행함으로써 상술한 변동 벡터 주기의 배수길이가 아니더라도 요구되는 연속적인 길이를 가지는 ARP 인터리버를 제공하는 것이 가능하다.According to one embodiment of the present invention as described above, by performing pruning to a preset basic interleaver having a multiple length of the period of the ARP variation vector, the ARP interleaver having the required continuous length even if not the multiple length of the variation vector cycle described above. It is possible to provide.

또한, 이와 같은 인터리버를 제공하기 위하여 기본 인터리버(Basic Interleaver) 개념과 가지치기(pruning) 개념을 이용한 인터리빙 방법 및 이를 수행하는 인터리버를 포함하는 터보 인코더를 제공함으로써 추가적 오버헤드 발생 없이 연속적인 길이의 ARP 수행이 가능하다.In addition, to provide such an interleaver, by providing an interleaving method using a basic interleaver concept and a pruning concept, and a turbo encoder including an interleaver performing the same, an ARP of continuous length without additional overhead is generated. It can be done.

Claims (8)

ARP(Almost Regular Permutation)의 변동 벡터(fluctuation vector) 주기의 배수 길이를 가지도록 미리 설정된 기본 인터리버(Basic Interleaver) 세트 중 제 1 길이를 가지는 기본 인터리버를 선택하는 단계; 및Selecting a basic interleaver having a first length from a set of basic interleavers preset to have a multiple length of a fluctuation vector period of Almost Regular Permutation (ARP); And 요구되는 인터리버 길이인 제 2 길이가 상기 제 1 길이보다 작은 경우, 상기 선택된 기본 인터리버를 상기 제 2 길이로 조절하는 단계를 포함하는, 인터리버 제공 방법.Adjusting the selected basic interleaver to the second length if the second length, which is the desired interleaver length, is less than the first length. 제 1 항에 있어서,The method of claim 1, 상기 인터리버는 ARP 인터리버이며,The interleaver is an ARP interleaver, 상기 제 1 길이는 상기 변동 벡터 주기의 배수 중 상기 제 2 길이 이상의 최소 배수인, 인터리버 제공 방법.And wherein the first length is a minimum multiple of the second length or more of multiples of the variation vector period. 제 1 항 또는 제 2 항에 있어서,3. The method according to claim 1 or 2, 상기 조절하는 단계는 상기 제 1 길이를 가지는 기본 인터리버에 입력되는 데이터의 인덱스들 중 상기 제 2 길이에 해당하는 수의 인덱스들만 수용함으로써 수행되는, 인터리버 제공 방법. The adjusting may be performed by accepting only the number of indices corresponding to the second length among the indices of data input to the basic interleaver having the first length. 원본 시퀀스의 길이와 ARP의 변동 벡터 주기의 배수 길이를 가지도록 미리 설정된 기본 인터리버 세트 중 선택된 기본 인터리버의 길이의 차이에 해당하는 길이의 원본 시퀀스 인덱스에 더미(dummy) 정보 삽입 단계;Inserting dummy information into an original sequence index having a length corresponding to a difference between a length of an original sequence and a length of a basic interleaver selected from among a set of basic interleavers preset to have multiples of a variation vector period of the ARP; 상기 더미 정보가 삽입된 상기 선택된 기본 인터리버 길이의 시퀀스를 ARP 인터리빙하는 단계; 및ARP interleaving a sequence of the selected basic interleaver length into which the dummy information is inserted; And 상기 인터리빙된 시퀀스 인덱스 중 상기 더미 정보가 삽입되지 않은 인덱스를 출력하는 단계를 포함하는, 인터리빙 방법.And outputting an index in which the dummy information is not inserted among the interleaved sequence indexes. 제 4 항에 있어서,The method of claim 4, wherein 상기 선택된 기본 인터리버는 상기 변동 벡터 주기의 배수 중 상기 원본 시퀀스의 길이 이상의 최소 배수 길이를 가지는, 인터리빙 방법.Wherein the selected basic interleaver has a minimum multiple length greater than the length of the original sequence among multiples of the variation vector period. 제 4 항 또는 제 5 항에 있어서,The method according to claim 4 or 5, 상기 더미 정보 삽입 단계에서, 상기 더미 정보는 상기 원본 시퀀스의 인덱스 중 상기 선택된 기본 인터리버의 길이 이상의 인덱스에 삽입되며,In the dummy information inserting step, the dummy information is inserted into an index equal to or greater than the length of the selected basic interleaver among the indices of the original sequence, 상기 인덱스 출력 단계에서, 출력되는 상기 인터리된 시퀀스 인덱스는 상기 선택된 기본 인터리버의 길이 이상의 원본 시퀀스 인덱스에 대응하는 인덱스를 제외한 인덱스인, 인터리빙 방법.And in the index outputting step, the interleaved sequence index to be output is an index excluding an index corresponding to an original sequence index equal to or greater than the length of the selected basic interleaver. 제 4 항 또는 제 5 항에 있어서,The method according to claim 4 or 5, 상기 더미 정보 삽입 단계에서, 상기 더미 정보는 상기 원본 시퀀스의 인덱 스 중 상기 원본 시퀀스의 길이와 상기 선택된 기본 인터리버의 길이의 차이에 해당하는 길이만큼 임의로 선택된 인덱스에 삽입되며,In the dummy information insertion step, the dummy information is inserted into a randomly selected index by a length corresponding to a difference between the length of the original sequence and the length of the selected basic interleaver among the indexes of the original sequence, 상기 인덱스 출력 단계에서, 출력되는 상기 인터리된 시퀀스 인덱스는 상기 더미 정보 삽입 단계에서 선택된 상기 원본 시퀀스 인덱스에 대응하는 인덱스를 제외한 인덱스이며,In the index output step, the interleaved sequence index output is an index except an index corresponding to the original sequence index selected in the dummy information insertion step, 상기 인덱스 출력 단계 이후, 상기 출력된 시퀀스의 인덱스를 상기 더미 정보 삽입 전 원본 시퀀스의 인데스에 따라 맵핑하는 단계를 더 포함하는, 인터리빙 방법.And after the index output step, mapping the index of the output sequence according to the indes of the original sequence before inserting the dummy information. 입력 시퀀스에 소정의 인코딩을 수행하여 출력하는 제 1 인코더;A first encoder performing predetermined encoding on the input sequence and outputting the predetermined encoder; 상기 입력 시퀀스를 인터리빙하는 인터리버; 및An interleaver for interleaving the input sequence; And 상기 인터리버에 의해 인터리빙된 시퀀스를 입력받아 인코딩을 수행하여 출력하는 제 2 인코더를 포함하는 터보 인코더에 있어서,A turbo encoder comprising a second encoder that receives an interleaved sequence by the interleaver, performs encoding, and outputs the encoded signal. 상기 인터리버는, The interleaver, ARP의 변동 벡터 주기의 배수 길이를 가지도록 미리 설정된 기본 인터리버 세트 중 제 1 길이를 가지는 기본 인터리버를 선택하는 기본 인터리버 선택 모듈; 및A basic interleaver selecting module for selecting a basic interleaver having a first length among a preset set of basic interleavers to have a multiple length of the variation vector period of the ARP; And 상기 입력 시퀀스의 길이인 제 2 길이가 상기 제 1 길이보다 작은 경우, 상기 선택된 기본 인터리버를 상기 제 2 길이로 조절하는 길이 조절 모듈을 포함하는 것을 특징으로 하는, 터보 인코더.And a length adjusting module for adjusting the selected basic interleaver to the second length when the second length, which is the length of the input sequence, is smaller than the first length.
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Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE60322971D1 (en) * 2003-04-23 2008-09-25 Telecom Italia Spa MOBILE RADIO NETWORK WITH MULTIPLE CARRIER PACKAGE DATA TRANSMISSION
US8032811B2 (en) * 2006-11-09 2011-10-04 Samsung Electronics Co., Ltd. Efficient almost regular permutation (ARP) interleaver and method
ES2562788T3 (en) * 2007-09-25 2016-03-08 Telefonaktiebolaget Lm Ericsson (Publ) Interference randomization of control channel elements
US7924763B2 (en) * 2007-12-11 2011-04-12 Motorola Mobility, Inc. Method and appratus for rate matching within a communication system
US20100235721A1 (en) * 2009-03-13 2010-09-16 Lsi Corporation Rate Matching and De-Rate Matching for an LTE Transport Channel
US10365686B2 (en) 2016-10-28 2019-07-30 Lenovo (Singapore) Pte. Ltd. Geared housing assembly
CN116318552B (en) * 2023-03-15 2023-09-22 归芯科技(深圳)有限公司 Interleaving or de-interleaving method for Turbo code, device, communication chip and device thereof

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11191757A (en) 1997-12-25 1999-07-13 Matsushita Electric Ind Co Ltd Method and device for transmitting digital signal
US6480475B1 (en) 1998-03-06 2002-11-12 Texas Instruments Incorporated Method and system for accomodating a wide range of user data rates in a multicarrier data transmission system
US20060153285A1 (en) 2005-01-12 2006-07-13 Texas Instruments Incorporaated Dynamic interleaver depth change for a general convolutional interleaver

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3453122B2 (en) 1998-08-17 2003-10-06 ヒューズ・エレクトロニクス・コーポレーション Turbo code interleaver close to optimum performance
US7770010B2 (en) * 2000-09-18 2010-08-03 Wideband Semiconductors Inc. Dynamically configurable interleaver scheme using at least one dynamically changeable interleaving parameter
US6772377B2 (en) * 2001-09-28 2004-08-03 Texas Instruments Incorporated Convolutional interleaving with interleave depth larger than codeword size
US7003703B2 (en) * 2002-06-21 2006-02-21 Sandbridge Technologies, Inc. Method of interleaving/deinterleaving in a communication system
US7398446B2 (en) * 2003-05-29 2008-07-08 Lucent Technologies Inc. Low power operation of an address interleaver
US7543197B2 (en) * 2004-12-22 2009-06-02 Qualcomm Incorporated Pruned bit-reversal interleaver
US20060282713A1 (en) * 2005-05-31 2006-12-14 Yi Weng Efficient interleaver/de-interleaver desigh for the turbo decoder in a 3g wcdma system
US8065587B2 (en) * 2006-10-10 2011-11-22 Broadcom Corporation Reduced complexity ARP (almost regular permutation) interleaves providing flexible granularity and parallelism adaptable to any possible turbo code block size
US7827473B2 (en) * 2006-10-10 2010-11-02 Broadcom Corporation Turbo decoder employing ARP (almost regular permutation) interleave and arbitrary number of decoding processors

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11191757A (en) 1997-12-25 1999-07-13 Matsushita Electric Ind Co Ltd Method and device for transmitting digital signal
US6480475B1 (en) 1998-03-06 2002-11-12 Texas Instruments Incorporated Method and system for accomodating a wide range of user data rates in a multicarrier data transmission system
US20060153285A1 (en) 2005-01-12 2006-07-13 Texas Instruments Incorporaated Dynamic interleaver depth change for a general convolutional interleaver

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