KR100961956B1 - Driving apparatus of display device - Google Patents
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Abstract
본 발명은 표시 장치의 구동 장치에 관한 것으로서, 특히 외부와의 연결 배선의 수효를 감소시킬 수 있는 표시 장치의 구동 장치에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a drive device for a display device, and more particularly to a drive device for a display device that can reduce the number of connection wirings to the outside.
복수의 화소, 외부로부터의 입력 신호에 기초하여 스위칭 제어 신호를 생성하는 스위칭 제어 신호 생성부, 데이터 전압을 출력하는 데이터 구동부, 상기 화소에 상기 데이터 전압을 전달하는 복수의 데이터선, 그리고 상기 스위칭 제어 신호에 따라 상기 데이터 전압을 상기 데이터선에 전달하는 복수의 전송 게이트를 포함한다.A plurality of pixels, a switching control signal generator for generating a switching control signal based on an input signal from the outside, a data driver for outputting a data voltage, a plurality of data lines for transmitting the data voltage to the pixel, and the switching control And a plurality of transfer gates configured to transfer the data voltage to the data line according to a signal.
이런 방식으로, 외부에서 입력되는 신호의 수효를 감소시킴으로써 신호를 전달하는 배선의 수효를 감소시켜 공정 비용 내지 원가를 절감할 수 있다.In this way, by reducing the number of signals input from the outside it is possible to reduce the number of wiring for transmitting the signal to reduce the process cost or cost.
전송게이트, 표시장치, 배선, 데이터선, 데이터구동부, 스위칭, 제어신호Transmission gate, display device, wiring, data line, data driver, switching, control signal
Description
도 1은 본 발명의 한 실시예에 따른 액정 표시 장치의 블록도이다.1 is a block diagram of a liquid crystal display according to an exemplary embodiment of the present invention.
도 2는 본 발명의 한 실시예에 따른 액정 표시 장치의 한 화소에 대한 등가 회로도이다.2 is an equivalent circuit diagram of one pixel of a liquid crystal display according to an exemplary embodiment of the present invention.
도 3은 본 발명의 한 실시예에 따른 데이터 구동부와 전송 게이트의 연결을 나타내는 도면이다.3 is a diagram illustrating a connection between a data driver and a transmission gate according to an exemplary embodiment of the present invention.
도 4는 본 발명의 한 실시예에 따른 스위칭 제어 신호 생성부의 회로도이다.4 is a circuit diagram of a switching control signal generator according to an exemplary embodiment of the present invention.
도 5는 도 4에 도시한 입력 신호의 타이밍도이다. FIG. 5 is a timing diagram of the input signal shown in FIG. 4.
도 6은 도 4에 도시한 출력 신호의 파형도이다.6 is a waveform diagram of an output signal shown in FIG. 4.
본 발명은 표시 장치의 구동 장치에 관한 것이다.The present invention relates to a driving device of a display device.
액정 표시 장치나 EL(electro luminescence) 표시 장치 등은 행렬의 형태로 배열된 복수의 화소를 포함한다. 각 화소는 화상 신호를 선택적으로 받아들이는 스위칭 소자를 포함하며, 스위칭 소자로는 MOS형 트랜지스터 등 주로 삼단자 소자가 사용된다. 이러한 표시 장치는 또한 스위칭 소자에 연결된 복수의 게이트선과 복수의 데이터선을 포함하며, 각 게이트선은 스위칭 소자를 각각 턴온시키는 게이트 온 전압을 전달하고, 각 데이터선은 턴온된 스위칭 소자를 통하여 각 화소에 화상 신호를 전달한다.A liquid crystal display, an EL (electro luminescence) display, or the like includes a plurality of pixels arranged in a matrix form. Each pixel includes a switching element that selectively receives an image signal, and a three-terminal element such as a MOS transistor is mainly used as the switching element. The display device also includes a plurality of gate lines and a plurality of data lines connected to the switching elements, each gate line delivering a gate-on voltage for turning on the switching elements, respectively, and each data line through each turned-on switching element for each pixel. Pass the image signal on.
이러한 표시 장치는 또한 게이트선에 게이트 온 전압을 인가하는 게이트 구동부와 데이터선에 화상 신호를 인가하는 데이터 구동부 및 이들을 제어하는 신호 제어부를 포함한다.The display device also includes a gate driver for applying a gate-on voltage to the gate line, a data driver for applying an image signal to the data line, and a signal controller for controlling the gate driver.
데이터 구동부는 복수의 데이터 구동 IC로 이루어지며, 하나의 데이터 구동 IC에는 여러 개의 데이터선이 연결되어 있다. The data driver consists of a plurality of data driver ICs, and several data lines are connected to one data driver IC.
이 때, 연결되는 데이터선의 수를 줄이기 위하여 데이터 구동 IC의 한 개 출력과 복수의 데이터선이 연결되는 1:n의 역다중화 방식을 이용하며, 이 연결부에는 스위칭 소자로서 통상 전송 게이트(transmission gate)를 사용하고, 전송 게이트를 제어하는 신호를 외부의 타이밍 생성부에서 인가하여 각 전송 게이트의 온/오프 시기를 조절한다.In this case, in order to reduce the number of data lines to be connected, a 1: n demultiplexing scheme in which one output and a plurality of data lines of the data driving IC are connected is used. In this connection, a transmission element is usually used as a switching element. And a signal for controlling the transfer gate is applied by an external timing generator to adjust the on / off timing of each transfer gate.
한편, 데이터선의 수효가 증가할수록 데이터 구동 IC에 연결되는 연결부의 스위칭 소자의 수효도 증가하게 되고, 이렇게 되면 외부에서 입력되는 제어 신호의 수효도 점차 늘어나 외부와의 연결을 위한 배선 면적이 증가한다. 이로 인해, 비용의 증가와 COG(chip on glass)를 구현하는데 어려움이 생길 수 있다.On the other hand, as the number of data lines increases, the number of switching elements connected to the data driving IC also increases. In this case, the number of control signals input from the outside gradually increases, thereby increasing the wiring area for connecting to the outside. As a result, there may be an increase in cost and difficulty in implementing a chip on glass (COG).
따라서, 본 발명이 이루고자 하는 기술적 과제는 외부와의 연결 배선을 감소시킬 수 있는 표시 장치의 구동 장치를 제공하는 것이다.Accordingly, an object of the present invention is to provide a driving device for a display device that can reduce connection wiring to the outside.
이러한 기술적 과제를 이루기 위한 본 발명의 한 실시예에 따른 표시 장치의 구동 장치는 복수의 화소를 포함하며, 외부로부터의 입력 신호에 기초하여 스위칭 제어 신호를 생성하는 스위칭 제어 신호 생성부, 데이터 전압을 출력하는 데이터 구동부, 상기 화소에 상기 데이터 전압을 전달하는 복수의 데이터선, 그리고 상기 스위칭 제어 신호에 따라 상기 데이터 전압을 상기 데이터선에 전달하는 복수의 전송 게이트를 포함한다.According to an aspect of the present invention, a driving device of a display device includes a plurality of pixels, and includes a switching control signal generator and a data voltage generating a switching control signal based on an input signal from an external source. And a plurality of data lines for transmitting the data voltages to the pixels, and a plurality of transfer gates for transmitting the data voltages to the data lines according to the switching control signal.
한편, 상기 입력 신호는 제1 내지 제4 제어 신호를 포함하고, 상기 스위칭 제어 신호 생성부는 상기 제1 내지 제4 제어 신호를 인가받는 복수의 논리 게이트, 그리고 상기 제4 제어 신호를 반전시키는 인버터를 포함할 수 있다. The input signal may include first to fourth control signals, and the switching control signal generator may include a plurality of logic gates to which the first to fourth control signals are applied, and an inverter to invert the fourth control signal. It may include.
또한, 상기 제1 내지 제3 제어 신호는 1 수평 주기(H)동안 2번씩 각각 발생되고, 상기 제4 제어 신호는 1/2 H의 주기로 반전될 수 있다.In addition, the first to third control signals may be generated twice each during one horizontal period H, and the fourth control signal may be inverted at a period of 1 / 2H.
여기서, 상기 논리 게이트는 제1 내지 제6 논리 게이트를 포함하고, 상기 제1 내지 제3 논리 게이트는 상기 제1 내지 제3 제어 신호 중 하나와 상기 제4 제어 신호를 각각 인가받으며, 상기 제4 내지 제6 논리 게이트는 상기 제1 내지 제3 제어 신호 중 하나와 상기 제4 제어 신호의 반전 신호를 각각 인가받는 것이 바람직하다.Here, the logic gate includes first to sixth logic gates, and the first to third logic gates receive one of the first to third control signals and the fourth control signal, respectively, and the fourth The sixth to sixth logic gates preferably receive one of the first to third control signals and an inverted signal of the fourth control signal.
한편, 상기 제1 내지 제3 논리 게이트는 전반 1/2 H 동안 제1 내지 제3 스위칭 제어 신호를 생성하고, 상기 제4 내지 제6 논리 게이트는 후반 1/2 H 동안 스위칭 제4 내지 제6 스위칭 제어 신호를 생성할 수 있다. Meanwhile, the first to third logic gates generate first to third switching control signals during the first half H, and the fourth to sixth logic gates switch to fourth through sixth h during the second half H. A switching control signal can be generated.
이 때, 상기 전송 게이트는 제1 내지 제6 전송 게이트를 포함하고, 상기 제1 내지 제6 전송 게이트는 순차적으로 상기 제1 내지 제6 스위칭 제어 신호를 인가받을 수 있다.In this case, the transfer gate may include first to sixth transfer gates, and the first to sixth transfer gates may be sequentially applied with the first to sixth switching control signals.
한편, 상기 논리 게이트는 논리곱 게이트일 수 있다.Meanwhile, the logic gate may be an AND gate.
첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. DETAILED DESCRIPTION Embodiments of the present invention will be described in detail with reference to the accompanying drawings so that those skilled in the art may easily implement the present invention.
이제 본 발명의 실시예에 따른 액정 표시 장치에 대하여 도면을 참고로 하여 상세하게 설명한다.A liquid crystal display according to an exemplary embodiment of the present invention will now be described in detail with reference to the accompanying drawings.
도 1은 본 발명의 한 실시예에 따른 액정 표시 장치의 블록도이고, 도 2는 본 발명의 한 실시예에 따른 액정 표시 장치의 한 화소에 대한 등가 회로도이다.FIG. 1 is a block diagram of a liquid crystal display device according to an embodiment of the present invention, and FIG. 2 is an equivalent circuit diagram of a pixel of a liquid crystal display device according to an embodiment of the present invention.
도 1에 도시한 바와 같이, 본 발명의 한 실시예에 따른 액정 표시 장치는 액정 표시판 조립체(liquid crystal panel assembly)(300) 및 이에 연결된 게이트 구동부(400), 데이터 구동부(500), 데이터 구동부(500)에 연결된 계조 전압 생성부(800) 그리고 이들을 제어하는 신호 제어부(600)를 포함한다.As shown in FIG. 1, a liquid crystal display according to an exemplary embodiment of the present invention includes a liquid
액정 표시판 조립체(300)는 등가 회로로 볼 때 복수의 표시 신호선(G1-Gn, D1-Dm)과 이에 연결되어 있으며 대략 행렬의 형태로 배열된 복수의 화소(pixel)를 포함한다.The liquid
표시 신호선(G1-Gn, D1-Dm)은 게이트 신호("주사 신호"라고도 함)를 전달하는 복수의 게이트선(G1-Gn)과 데이터 신호를 전달하는 데이터 신호선 또는 데이터선 (D1-Dm)을 포함한다. 게이트선(G1-Gn)은 대략 행 방향으로 뻗어 있으며 서로가 거의 평행하고 데이터선(D1-Dm)은 대략 열 방향으로 뻗어 있으며 서로가 거의 평행하다. The display signal lines G 1 -G n and D 1 -D m are a plurality of gate lines G 1 -G n for transmitting a gate signal (also called a “scan signal”) and a data signal line or data for transmitting a data signal. It includes the line (D 1 -D m ). The gate lines G 1 -G n extend substantially in the row direction and are substantially parallel to each other, and the data lines D 1 -D m extend substantially in the column direction and are substantially parallel to each other.
각 화소는 표시 신호선(G1-Gn, D1-Dm)에 연결된 스위칭 소자(Q)와 이에 연결된 액정 축전기(liquid crystal capacitor)(CLC) 및 유지 축전기(storage capacitor)(CST)를 포함한다. 유지 축전기(CST)는 필요에 따라 생략할 수 있다.Each pixel includes a switching element Q connected to a display signal line G 1 -G n , D 1 -D m , and a liquid crystal capacitor C LC and a storage capacitor C ST connected thereto. It includes. The holding capacitor C ST can be omitted as necessary.
스위칭 소자(Q)는 하부 표시판(100)에 구비되어 있으며, 삼단자 소자로서 그 제어 단자 및 입력 단자는 각각 게이트선(G1-Gn) 및 데이터선(D1-D
m)에 연결되어 있으며, 출력 단자는 액정 축전기(CLC) 및 유지 축전기(CST)에 연결되어 있다.The switching element Q is provided on the
액정 축전기(CLC)는 하부 표시판(100)의 화소 전극(190)과 상부 표시판(200)의 공통 전극(270)을 두 단자로 하며 두 전극(190, 270) 사이의 액정층(3)은 유전체로서 기능한다. 화소 전극(190)은 스위칭 소자(Q)에 연결되며 공통 전극(270)은 상부 표시판(200)의 전면에 형성되어 있고 공통 전압(Vcom)을 인가받는다. 도 2에서와는 달리 공통 전극(270)이 하부 표시판(100)에 구비되는 경우도 있으며 이때에는 두 전극(190, 270)이 모두 선형 또는 막대형으로 만들어진다.The liquid crystal capacitor C LC has two terminals, the
유지 축전기(CST)는 하부 표시판(100)에 구비된 별개의 신호선(도시하지 않음)과 화소 전극(190)이 중첩되어 이루어지며 이 별개의 신호선에는 공통 전압(Vcom) 따위의 정해진 전압이 인가된다. 그러나 유지 축전기(CST)는 화소 전극(190)이 절연체를 매개로 바로 위의 전단 게이트선과 중첩되어 이루어질 수 있다.The storage capacitor C ST is formed by overlapping a separate signal line (not shown) and the
한편, 색 표시를 구현하기 위해서는 각 화소가 색상을 표시할 수 있도록 하여야 하는데, 이는 화소 전극(190)에 대응하는 영역에 적색, 녹색, 또는 청색의 색 필터(230)를 구비함으로써 가능하다. 도 2에서 색 필터(230)는 상부 표시판(200)의 해당 영역에 형성되어 있지만 이와는 달리 하부 표시판(100)의 화소 전극(190) 위 또는 아래에 형성할 수도 있다.Meanwhile, in order to implement color display, each pixel must display color, which is possible by providing a red, green, or
액정 표시판 조립체(300)의 두 표시판(100, 200) 중 적어도 하나의 바깥 면에는 빛을 편광시키는 편광자(도시하지 않음)가 부착되어 있다.A polarizer (not shown) for polarizing light is attached to an outer surface of at least one of the two
계조 전압 생성부(800)는 화소의 투과율과 관련된 두 벌의 복수 계조 전압을 생성한다. 두 벌 중 한 벌은 공통 전압(Vcom)에 대하여 양의 값을 가지고 다른 한 벌은 음의 값을 가진다.The
게이트 구동부(400)는 액정 표시판 조립체(300)의 게이트선(G1-Gn)에 연결되어 외부로부터의 게이트 온 전압(Von)과 게이트 오프 전압(Voff)의 조합으로 이루어진 게이트 신호를 게이트선(G1-Gn)에 인가한다.The
데이터 구동부(500)는 액정 표시판 조립체(300)의 데이터선(D1-Dm)에 연결되어 계조 전압 생성부(800)로부터의 계조 전압을 선택하여 데이터 신호로서 화소에 인가하며 통상 복수의 집적 회로로 이루어진다. The
신호 제어부(600)는 게이트 구동부(400) 및 데이터 구동부(500) 등의 동작을 제어하는 제어 신호를 생성하여, 각 해당하는 제어 신호를 게이트 구동부(400) 및 데이터 구동부(500)에 제공한다.The
그러면 이러한 액정 표시 장치의 표시 동작에 대하여 좀더 상세하게 설명한다.Next, the display operation of the liquid crystal display will be described in more detail.
신호 제어부(600)는 외부의 그래픽 제어기(도시하지 않음)로부터 RGB 영상 신호(R, G, B) 및 이의 표시를 제어하는 입력 제어 신호, 예를 들면 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록(MCLK), 데이터 인에이블 신호(DE) 등을 제공받는다. 신호 제어부(600)는 입력 제어 신호를 기초로 게이트 제어 신호(CONT1) 및 데이터 제어 신호(CONT2) 등을 생성하고 영상 신호(R, G, B)를 액정 표시판 조립체(300)의 동작 조건에 맞게 적절히 처리한 후, 게이트 제어 신호(CONT1)를 게이트 구동부(400)로 내보내고 데이터 제어 신호(CONT2)와 처리한 영상 신호(R', G', B')는 데이터 구동부(500)로 내보낸다. The signal controller 600 inputs an input control signal for controlling the RGB image signals R, G, and B and their display from an external graphic controller (not shown), for example, a vertical sync signal V sync and a horizontal sync signal. (H sync ), a main clock (MCLK), a data enable signal (DE) is provided. The
또한 신호 제어부(600)의 스위칭 제어 신호 생성부(650)는 외부로부터의 타이밍 생성부(도시하지 않음)로부터의 입력 제어 신호(CONTSW)에 기초하여 전송 게이트(TG1-TG6)의 온/오프 시기를 제어하는 스위칭 제어 신호(CONT3)를 생성하여 내보내며, 이에 대하여 나중에 상세하게 설명한다.In addition, the switching
게이트 제어 신호(CONT1)는 게이트 온 펄스(게이트 온 전압 구간)의 출력 시 작을 지시하는 수직 동기 시작 신호(STV), 게이트 온 펄스의 출력 시기를 제어하는 게이트 클록 신호(CPV) 및 게이트 온 펄스의 폭을 한정하는 출력 인에이블 신호(OE) 등을 포함한다.The gate control signal CONT1 includes a vertical synchronization start signal STV for instructing the output of the gate on pulse (gate on voltage section), a gate clock signal CPV for controlling the output timing of the gate on pulse, and a gate on pulse. An output enable signal OE or the like that defines a width.
데이터 제어 신호(CONT2)는 영상 데이터(R', G', B')의 입력 시작을 지시하는 수평 동기 시작 신호(STH)와 데이터선(D1-Dm)에 해당 데이터 전압을 인가하라는 로드 신호(LOAD), 공통 전압(Vcom)에 대한 데이터 전압의 극성(이하 "공통 전압에 대한 데이터 전압의 극성"을 줄여 "데이터 전압의 극성"이라 함)을 반전시키는 반전 신호(RVS) 및 데이터 클록 신호(HCLK) 등을 포함한다.The data control signal CONT2 is a load for applying a corresponding data voltage to the horizontal synchronization start signal STH indicating the start of input of the image data R ', G', and B 'and the data lines D 1 -D m . Signal LOAD, inverted signal RVS and data that inverts the polarity of the data voltage with respect to common voltage V com (hereinafter referred to as " polarity of data voltage " by reducing " polarity of data voltage with respect to common voltage "). Clock signal HCLK and the like.
데이터 구동부(500)는 신호 제어부(600)로부터의 데이터 제어 신호(CONT2)에 따라 한 행의 화소에 대응하는 영상 데이터(R', G', B')를 차례로 입력받아 시프트시키고, 계조 전압 생성부(800)로부터의 계조 전압 중 각 영상 데이터(R', G', B')에 대응하는 계조 전압을 선택함으로써, 영상 데이터(R', G', B')를 해당 데이터 전압으로 변환하고, 이를 해당 데이터선(D1-Dm)에 인가한다.The
게이트 구동부(400)는 신호 제어부(600)로부터의 게이트 제어 신호(CONT1)에 따라 게이트 온 전압(Von)을 게이트선(G1-Gn)에 인가하여 이 게이트선(G
1-Gn)에 연결된 스위칭 소자(Q)를 턴온시키면 데이터선(D1-Dm)에 인가된 데이터 전압이 턴온된 스위칭 소자(Q)를 통하여 해당 화소에 인가된다.The
화소에 인가된 데이터 전압과 공통 전압(Vcom)의 차이는 액정 축전기(CLC)의 충전 전압, 즉 화소 전압으로서 나타난다. 액정 분자들은 화소 전압의 크기에 따라 그 배열을 달리한다. 이에 따라 액정층(3)을 통과하는 빛의 편광이 변화한다. 이러한 편광의 변화는 표시판(100, 200)에 부착된 편광자(도시하지 않음)에 의하여 빛의 투과율 변화로 나타난다.The difference between the data voltage applied to the pixel and the common voltage V com is shown as the charging voltage of the liquid crystal capacitor C LC , that is, the pixel voltage. The liquid crystal molecules vary in arrangement depending on the magnitude of the pixel voltage. As a result, the polarization of light passing through the liquid crystal layer 3 changes. The change in polarization is represented by a change in transmittance of light by a polarizer (not shown) attached to the
1 수평 주기(또는 "1H")[수평 동기 신호(Hsync), 데이터 인에이블 신호(DE), 게이트 클록(CPV)의 한 주기]가 지나면 데이터 구동부(500)와 게이트 구동부(400)는 다음 행의 화소에 대하여 동일한 동작을 반복한다. 이러한 방식으로, 한 프레임(frame) 동안 모든 게이트선(G1-Gn)에 대하여 차례로 게이트 온 전압(Von
)을 인가하여 모든 화소에 데이터 전압을 인가한다. 한 프레임이 끝나면 다음 프레임이 시작되고 각 화소에 인가되는 데이터 전압의 극성이 이전 프레임에서의 극성과 반대가 되도록 데이터 구동부(500)에 인가되는 반전 신호(RVS)의 상태가 제어된다("프레임 반전"). 이때, 한 프레임 내에서도 반전 신호(RVS)의 특성에 따라 한 데이터선을 통하여 흐르는 데이터 전압의 극성이 바뀌거나("컬럼 반전"), 한 화소행에 인가되는 데이터 전압의 극성도 서로 다를 수 있다("도트 반전")After one horizontal period (or “1H”) (one period of the horizontal sync signal H sync , the data enable signal DE, and the gate clock CPV), the
그러면 이러한 표시 장치의 구동 장치에 대하여 도 3 내지 도6을 참고하여 상세히 설명한다.Next, the driving device of the display device will be described in detail with reference to FIGS. 3 to 6.
도 3은 본 발명의 한 실시예에 따른 데이터 구동부와 전송 게이트의 연결을 나타내는 도면이며, 도 4는 본 발명의 한 실시예에 따른 스위칭 제어 신호 생성부의 회로도이다. 도 5는 도 4에 도시한 입력 신호의 타이밍도이며, 도 6은 도 4에 도시한 출력 신호의 파형도이다.3 is a diagram illustrating a connection between a data driver and a transmission gate according to an exemplary embodiment of the present invention, and FIG. 4 is a circuit diagram of a switching control signal generator according to an exemplary embodiment of the present invention. 5 is a timing diagram of the input signal shown in FIG. 4, and FIG. 6 is a waveform diagram of the output signal shown in FIG.
도 3에 도시한 바와 같이, 데이터 구동 IC에는 복수의 데이터선(D1-D12)이 전송 게이트(TG1-TG6)를 통하여 연결되어 있다. As shown in FIG. 3, a plurality of data lines D1-D12 are connected to the data driving IC through the transfer gates TG1-TG6.
전송 게이트(TG1-TG6)는 스위칭 제어 신호 생성부(650)에서 생성된 스위칭 제어 신호(SW1-SW6)에 따라 온/오프되며, 턴온된 전송 게이트(TG1-TG6)를 통하여 데이터 전압이 해당 화소에 인가된다.The transfer gates TG1-TG6 are turned on / off according to the switching control signals SW1-SW6 generated by the switching
그러면 스위칭 제어 신호 생성부(650)의 구조와 동작을 설명한 후에 전체적인 동작에 대하여 살펴보기로 한다.Then, after the structure and operation of the switching
도 4에 도시한 바와 같이, 본 발명의 한 실시예에 따른 스위칭 제어 신호 생성부(650)는 복수의 AND 게이트(AND1-AND6)와 인버터(INV)를 포함한다.As shown in FIG. 4, the switching
AND 게이트(AND1-AND3)는 외부의 타이밍 생성부(도시하지 않음)에서 생성된 입력 신호(S1-S3, CON)를 인가받으며, AND 게이트(AND4-AND6)는 입력 신호(S1-S3)와 반전된 입력 신호(CONB)를 인가받는다.The AND gates AND1-AND3 receive input signals S1-S3 and CON generated by an external timing generator (not shown), and the AND gates AND4-AND6 are connected to the input signals S1-S3. The inverted input signal CONB is applied.
게이트 클록 신호(CPV)의 하이 구간은 1H의 길이를 가지며, 입력 신호(S1-S3)는 1H 내에서 2번씩 각각 발생한다. 입력 신호(CON)는 1H의 주기로서 하이 및 로우가 1/2H씩 반복된다.The high period of the gate clock signal CPV has a length of 1H, and the input signals S1-S3 are generated twice each within 1H. The input signal CON has a period of 1H, and the high and low are repeated by 1 / 2H.
먼저, 입력 신호(S1, CON)가 인가되면 AND 게이트(AND1)는 두 신호가 모두 하이인 구간을 출력하여 도 6에 도시한 스위칭 제어 신호(SW1)를 출력한다. AND 게이트(AND2, AND3) 역시 순차적으로 입력 신호(SW2, SW3, CON)가 입력되면 동일한 동작을 행하여 스위칭 제어 신호(SW2, SW3)를 출력한다. 이 때, 나머지 AND 게이 트(SW4-SW6)는 반전된 입력 신호(CONB), 즉 로우에 해당하는 신호가 입력되므로 출력은 로우를 유지한다.First, when the input signals S1 and CON are applied, the AND gate AND1 outputs a section in which both signals are high to output the switching control signal SW1 shown in FIG. 6. The AND gates AND2 and AND3 also perform the same operation when the input signals SW2, SW3, and CON are sequentially input, and output the switching control signals SW2 and SW3. At this time, since the other AND gates SW4-SW6 are inputted with the inverted input signal CONB, that is, a signal corresponding to a low, the output is kept low.
다음, 1/2H가 지나면 입력 신호(CON)가 반전되고 AND 게이트(AND1-AND3)에는 로우인 입력 신호(CON)와 입력 신호(S1-S3)가 인가되어 로우인 신호가 출력되고, AND 게이트(AND4-AND6)에는 인버터(INV)를 거쳐 반전된 하이 신호와 입력 신호(S1-S3)가 입력되면서 도 6에 도시한 바와 같이 스위칭 제어 신호(SW4-SW6)를 생성한다. Next, when 1 / 2H passes, the input signal CON is inverted, and the input signal CON and the input signals S1-S3 that are low are applied to the AND gates AND1 -AND3 to output a low signal. The inverted high signal and the input signals S1-S3 are input to the AND4-AND6 and the switching control signal SW4-SW6 is generated as shown in FIG. 6.
이렇게 생성된 스위칭 제어 신호(SW1-SW6)가 순차적으로 도 3에 도시한 전송 게이트(TG1-TG6)에 인가되어 순차적으로 턴온되고, 데이터 전압이 해당 화소에 인가된다.The switching control signals SW1-SW6 generated in this way are sequentially applied to the transfer gates TG1-TG6 shown in FIG. 3 and sequentially turned on, and a data voltage is applied to the corresponding pixel.
도 4에 도시한 표시 장치의 구동 장치는 본 발명의 실시예에서는 신호 제어부(600)에 위치하는 것으로 하였으나, 별개의 칩으로 구현될 수 있다.Although the driving device of the display device illustrated in FIG. 4 is located in the
이런 방식으로, 전송 게이트(TG1-TG6)의 수효가 증가하더라도 외부에서 입력되는 신호는 수를 대폭 줄일 수 있다. 다시 말하면, 종래의 방식에서는 외부에서 스위칭 소자의 수효에 해당하는 만큼, 예를 들어 도 6의 경우에는 6개의 스위칭 제어 신호를 인가하여야 한다. 따라서, 스위칭 소자가 늘어나는 만큼 스위칭 제어 신호를 인가하여야 하므로, 외부와의 연결 배선이 늘어나게 된다. In this way, even if the number of transmission gates TG1-TG6 increases, the number of signals input from the outside can be greatly reduced. In other words, in the conventional method, as many as the number of switching elements externally, for example, in the case of FIG. 6, six switching control signals should be applied. Therefore, since the switching control signal must be applied as the switching element increases, the connection wiring with the outside increases.
하지만, 본 발명의 실시예에 따르면 외부와의 연결 배선을 6개에서 4개로 줄일 수 있다. 이는 앞으로 전송 게이트의 수효가 증가하더라도 외부와의 연결 배선의 수효를 크게 증가시키지 않을 것이며, 이로 인해 공정 비용 내지 원가를 줄일 수 있다.However, according to the embodiment of the present invention, it is possible to reduce the number of connection wirings from six to four. This will not increase the number of connection wirings to the outside even if the number of transfer gates increases in the future, thereby reducing the process cost or cost.
전술한 바와 같이, 신호 제어부내 또는 별개의 칩으로 스위칭 제어 신호 생성부를 따로 마련하여 스위칭 제어 신호를 생성하면 외부와의 연결 배선을 줄일 수 있다.As described above, when the switching control signal generation unit is separately provided in the signal controller or as a separate chip to generate the switching control signal, connection wiring with the outside can be reduced.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
Although the preferred embodiments of the present invention have been described in detail above, the scope of the present invention is not limited thereto, and various modifications and improvements of those skilled in the art using the basic concepts of the present invention defined in the following claims are also provided. It belongs to the scope of rights.
Claims (7)
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- 2003-12-08 KR KR1020030088547A patent/KR100961956B1/en not_active IP Right Cessation
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