KR100823194B1 - 플라즈마 표시 장치 및 그 구동 장치 - Google Patents

플라즈마 표시 장치 및 그 구동 장치 Download PDF

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Abstract

본 발명은 플라즈마 표시 장치 및 그 구동 장치에 관한 것이다.
이를 위하여, 본 발명은 복수의 제1 전극을 포함하는 플라즈마 표시 패널, 입력 전압을 변환하여 제1 전압을 생성하는 전원 공급 장치, 제1 전극을 구동하는 제1 구동회로부 및 제1 구동회로부의 구동을 제어하는 제어 신호를 생성하는 제어부를 포함하며, 제1 구동회로부는, 제1단이 제1 전압을 공급하는 제1 전원에 연결되고 제2단이 제1 전극에 연결되는 제1 트랜지스터를 포함하되, 제2단에 페라이트 코어(Ferrite Core)가 형성되는 플라즈마 표시 장치를 제공한다.
본 발명에 의하면, 페라이트 코어를 이용함으로써 트랜지스터의 온/오프 시 발생할 수 있는 고주파 잡음 성분이 트랜지스터와 인접하게 배치되는 다른 회로 소자에 미치는 악영향을 제거할 수 있다.
Figure R1020060114691
PDP, 노이즈, 페라이트 코어

Description

플라즈마 표시 장치 및 그 구동 장치{PLASMA DISPLAY APPARATUS AND DRIVING DEVICE THEREOF}
도 1은 본 발명의 실시예에 따른 플라즈마 표시 장치를 나타내는 블록도이다.
도 2는 본 발명의 실시예에 따른 유지 전극 구동부(500)를 개략적으로 나타낸 도면이다.
도 3a는 페라이트 코어(522)를 포함하지 않는 트랜지스터(Xe2)가 온(ON) 상태에서 오프(OFF) 상태로 변경될 때에 트랜지스터(Xe2)에 근접한 트랜지스터(Xg) 및 유지 전극(X)의 신호 파형을 도시한 도면이다.
도 3b는 본 발명의 실시예에 따라 페라이트 코어(522)를 포함하는 트랜지스터(Xe2)가 온(ON) 상태에서 오프(OFF) 상태로 변경될 때에 트랜지스터(Xe2)에 근접한 트랜지스터(Xg) 및 유지 전극(X)의 신호 파형을 도시한 도면이다.
본 발명은 플라즈마 표시 장치 및 그 구동 장치에 관한 것이다.
플라즈마 표시 장치는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 장치이다. 이러한 플라즈마 표시 패널에는 그 크기에 따라 수십에서 수백 만개 이상의 방전 셀이 매트릭스 형태로 배열되어 있다.
일반적으로 플라즈마 표시 장치에서는 한 프레임이 복수의 서브필드로 분할되어 구동되며, 복수의 서브필드 중 표시 동작이 일어나는 서브필드의 가중치의 조합에 의해 계조가 표시된다. 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간으로 나누어 구동된다. 리셋 기간 동안 방전 셀의 벽 전하 상태가 초기화되고, 어드레스 기간 동안 켜질 셀과 켜지지 않을 셀이 선택되며 유지 기간 동안 실제로 영상을 표시하기 위해 켜질 셀에 대하여 유지 방전이 수행된다. 이러한 동작을 구현하기 위하여 플라즈마 표시 장치는 다수의 구동회로를 포함한다.
최근, 플라즈마 표시 장치의 구현 비용을 저감하기 위하여 플라즈마 표시 장치의 구동회로가 실장되는 인쇄회로 기판(Printed Circuit Board; PCB)의 크기가 점차 소형화되고 있다.
그러나, 구동회로에 포함되는 다수의 스위칭 소자들을 일정 수준 이상 가깝게 위치시키면 온/오프 되는 스위칭 소자와 근접한 다른 스위칭 소자가 스위칭 소자의 온/오프 시 발생되는 노이즈 성분으로 인해 오동작하거나 파손될 위험이 있어 문제가 되어왔다.
본 발명이 이루고자 하는 기술적 과제는 온/오프 되는 스위칭 소자와 근접한 다른 스위칭 소자가 온/오프 시 발생되는 고주파 잡음 성분의 영향을 받지 않도록 하는 플라즈마 표시 장치 및 그 구동 장치를 제공하는 것이다.
이러한 기술적 과제를 달성하기 위하여 본 발명의 특징에 따른 플라즈마 표시 장치는, 복수의 제1 전극을 포함하는 플라즈마 표시 패널, 입력 전압을 변환하여 제1 전압을 생성하는 전원 공급 장치, 상기 제1 전극을 구동하는 제1 구동회로부 및 상기 제1 구동회로부의 구동을 제어하는 제어 신호를 생성하는 제어부를 포함하며, 상기 제1 구동회로부는, 제1단이 상기 제1 전압을 공급하는 제1 전원에 연결되고 제2단이 상기 제1 전극에 연결되는 제1 트랜지스터를 포함하되, 상기 제2단에 페라이트 코어(Ferrite Core)가 형성된다.
또한, 본 발명의 특징에 따른 플라즈마 표시 장치의 구동 장치는, 복수의 제1 전극, 복수의 제2 전극 및 상기 제1 및 제2 전극과 교차하는 방향으로 형성되는 복수의 제3 전극을 포함하는 플라즈마 표시 장치의 구동 장치로서, 제1단이 제1 전압을 공급하는 제1 전원에 연결되고 제2단이 상기 제1 전극에 연결되는 제1 트랜지스터, 제1단이 상기 제1 트랜지스터의 제2단에 연결되고 제2단이 제2 전압을 공급하는 제2 전원에 연결되는 제2 트랜지스터 및 제1단이 제3 전압을 공급하는 제3 전원에 연결되고 제2단이 상기 제1 전극에 연결되는 제3 트랜지스터를 포함하며, 상기 제1 내지 제3 트랜지스터의 제2단에 페라이트 코어(Ferrite Core)가 형성된다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다. 그리고 도면에서 본 발명을 명확하게 설 명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 유사한 부분에 대해서는 유사한 도면 부호를 붙였다.
명세서 전체에서, 어떤 부분이 다른 부분과 "연결"되어 있다고 할 때, 이는 "직접적으로 연결"되어 있는 경우뿐 아니라, 그 중간에 다른 소자를 사이에 두고 "전기적으로 연결"되어 있는 경우도 포함한다. 또한 어떤 부분이 어떤 구성요소를 "포함"한다고 할 때, 이는 특별히 반대되는 기재가 없는 한 다른 구성요소를 제외하는 것이 아니라 다른 구성요소를 더 포함할 수 있는 것을 의미한다.
이제 본 발명의 실시예에 따른 플라즈마 표시 장치 및 그 구동 장치에 대하여 도면을 참고로 하여 상세하게 설명한다.
도 1은 본 발명의 실시예에 따른 플라즈마 표시 장치를 나타내는 블록도이다.
도 1에 나타낸 바와 같이, 본 발명의 실시예에 따른 플라즈마 표시 장치는 플라즈마 표시 패널(100), 제어장치(200), 어드레스 전극 구동부(300), 주사 전극 구동부(400), 유지 전극 구동부(500) 및 전원 공급 장치(600)를 포함한다.
플라즈마 표시 패널(100)은 열 방향으로 뻗어 있는 복수의 어드레스 전극(A1∼Am), 그리고 행 방향으로 서로 쌍을 이루면서 뻗어 있는 복수의 유지 전극(X1∼Xn) 및 주사 전극(Y1∼Yn)을 포함한다. 유지 전극(X1∼Xn)은 각 주사 전극(Y1∼Yn)에 대응해서 형성되며, 일반적으로 그 일단이 서로 공통으로 연결되어 있다. 그리고 플라즈마 표시 패널(100)은 유지 전극(X1∼Xn) 및 주사 전극(Y1∼Yn)이 배열된 기판(도시하지 않음)과 어드레스 전극(A1∼Am)이 배열된 기판(도시하지 않음)으 로 이루어진다. 두 기판은 주사 전극(Y1∼Yn)과 어드레스 전극(A1∼Am) 및 유지 전극(X1∼Xn)과 어드레스 전극(A1∼Am)이 각각 직교하도록 방전 공간을 사이에 두고 대향하여 배치된다. 이때, 어드레스 전극(A1∼Am), 유지 전극(X1∼Xn) 및 주사 전극(Y1∼Yn)의 교차부에 있는 방전 공간이 방전 셀을 형성한다. 이러한 플라즈마 표시 패널(100)의 구조는 일 예이며, 아래에서 설명하는 구동 파형이 적용될 수 있는 다른 구조의 패널도 본 발명에 적용될 수 있다.
제어장치(200)는 외부로부터 영상신호를 수신하여 어드레스 전극 구동 제어 신호(Sa), 유지 전극 구동 제어신호(Sx) 및 주사 전극 구동 제어신호(Sy)를 출력한다. 그리고 제어장치(200)는 한 프레임을 복수의 서브필드로 분할하여 구동하며, 각 서브필드는 시간적인 동작 변화로 표현하면 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다. 또한, 제어장치(200)는 전원 공급 장치(600)로부터 전달받은 DC 전압을 이용하여 어드레스 기간에 어드레스(Address)되지 않는 셀에 인가되는 비주사 전압(VscH)을 생성하여 주사 전극 구동부(400) 또는 유지 전극 구동부(500)로 전달한다.
어드레스 전극 구동부(300)는 제어장치(200)로부터 어드레스 전극 구동 제어신호(Sa)를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가한다.
주사 전극 구동부(400)는 제어장치(200)로부터 주사 전극 구동 제어신호(Sy)를 수신하여 주사 전극(Y)에 구동 전압을 인가한다.
유지 전극 구동부(500)는 제어장치(200)로부터 유지 전극 구동 제어신호(Sx) 를 수신하여 유지 전극(X)에 구동 전압을 인가한다.
전원 공급 장치(600)는 플라즈마 표시 장치의 구동에 필요한 전원을 제어장치(200) 및 각 구동부(300, 400, 500)에 공급한다.
도 2는 본 발명의 실시예에 따른 유지 전극 구동부(500)를 개략적으로 나타낸 도면이다. 도 2에서는 설명의 편의상 유지 구동부(510) 및 Ve 전압 공급부(520)만을 도시하였으며, 유지 구동부(510) 및 Ve 전압 공급부(520)는 도 1의 주사 전극 구동부(400)에 형성될 수 있다. 또한, 복수의 유지 전극(X1-Xn)에 연결된 유지 구동부(510) 및 Ve 전압 공급부(520)는 도 2의 유지 구동부(510) 및 Ve 전압 공급부(520)와 동일한 구조일 수도 있고, 다른 구조를 가질 수도 있다.
이러한 유지 구동부(510) 및 Ve 전압 공급부(520)는 복수의 유지 전극(X1-Xn)에 공통으로 연결되거나 복수의 유지 전극(X1-Xn) 중 일부 전극에만 연결될 수도 있다. 도 2에서는 설명의 편의상 하나의 유지 전극(X)과 하나의 주사 전극(Y)만을 도시하였으며, 유지 전극(X)과 주사 전극(Y)에 의해 형성되는 용량성 성분을 패널 커패시터(Cp)로 도시하였다.
도 2에서는 트랜지스터(Xr, Xf, Xs, Xg, Xe1, Xe2)를 N채널 전계 효과 트랜지스터, 특히 NMOS(N-Channel Metal Oxide Semiconductor) 트랜지스터로 도시하였으며, 이들 트랜지스터(Xr, Xf, Xs, Xg, Xe1, Xe2)에는 소스에서 드레인 방향으로 바디 다이오드가 형성될 수 있다. 한편, NMOS 트랜지스터 대신에 유사한 기능을 하는 다른 트랜지스터가 이들 트랜지스터(Xr, Xf, Xs, Xg, Xe1, Xe2)로 사용될 수도 있다. 또한, 도 2에서는 트랜지스터(Xr, Xf, Xs, Xg)를 각각 하나의 트랜지스 터로 도시하였지만, 트랜지스터(Xr, Xf, Xs, Xg)는 각각 병렬로 연결된 복수의 트랜지스터로 형성될 수 있다.
도 2에 도시한 바와 같이, 본 발명의 실시예에 따른 유지 전극 구동부(500)는 유지 구동부(510) 및 Ve 전압 공급부(520)를 포함한다.
유지 구동부(510)는 전력 회수 회로(Energy Recovery Circuit; ERC)(512) 및 트랜지스터(Xs, Xg)를 포함하고, 유지 기간에 유지 전극(X)에 Vs 전압과 -Vs 전압을 교번하여 공급한다.
전력 회수 회로(512)는 일단이 -Vs 전압을 공급하는 전원(-Vs)에 연결되고 Vs 전압이 충전되어 있는 커패시터(Cx), 드레인이 커패시터(Cx)의 타단에 연결되는 트랜지스터(Xr), 애노드가 트랜지스터(Xr)의 소스에 연결되는 다이오드(Dxr), 애노드가 다이오드(Dxr)의 캐소드에 연결되는 다이오드(Dxf), 드레인이 다이오드(Dxf)의 캐소드에 연결되고 소스가 커패시터(Cx)의 타단에 연결되는 트랜지스터(Xf), 일단이 다이오드(Dxr) 및 다이오드(Dxf)의 접점에 연결되고 타단이 유지 전극(X)에 연결되는 인덕터(Lx)를 포함한다.
트랜지스터(Xs)는 드레인이 Vs 전압을 공급하는 전원(Vs)에 연결되고 소스가 유지 전극(X)에 연결된다. 트랜지스터(Xg)는 드레인이 유지 전극(X)에 연결되고 소스가 -Vs 전압을 공급하는 전원(-Vs)에 연결된다.
Ve 전압 공급부(520)는 트랜지스터(Xe1, Xe2) 및 페라이트 코어(Ferrite Core)(522)를 포함하고, 리셋 기간에서 어드레스 기간이 종료될 때까지유지 전극(X)에 Ve 전압을 공급한다.
트랜지스터(Xe1)는 드레인이 Ve 전압을 공급하는 전원(Ve)에 연결된다. 트랜지스터(Xe2)는 소스가 트랜지스터(Xe1)의 소스에 연결된다. 페라이트 코어(522)는 트랜지스터(Xe2)의 드레인에 형성된다.
여기에서, 트랜지스터(Xe2)는 트랜지스터(Xe1)의 소스에서 드레인 방향으로 형성되는 바디 다이오드로 인해 유지 전극(X)로부터 Ve 전압을 공급하는 전원(Ve)으로의 역 전류 경로의 형성을 방지하기 위한 것이다.
또한, 페라이트 코어(522)는 원통형 관 또는 사각형 관 형태로 형성되고, 관 내부를 통과하는 트랜지스터(Xe2)의 드레인을 통해 출력되는 노이즈 성분을 제거한다. 페라이트 코어(522)는 자기 감쇄 효과가 뛰어나고, 이로 인해 트랜지스터(Xe2)의 드레인을 통해 출력되는 노이즈 성분 중 전자파 장해(ElectroMagnetic Interference; EMI)를 유발하는 고주파 잡음 성분을 제거하는 데에 매우 유용하다.
한편, 도 2로 나타낸 본 발명의 실시예에 따른 유지 전극 구동부(500)에서 Ve 전압 공급부(520)에 포함되는 트랜지스터(Xe2)의 드레인에 페라이트 코어(522)를 형성한 이유는 다음과 같다.
유지 구동부(510)는 전력 회수 회로(512)를 통해 램프 파형으로 점진적으로 상승 또는 하강하는 전압을 생성하여 유지 전극(X)에 공급하고, 트랜지스터(Xs, Xg)는 각각 전력 회수 회로(512)에 의해 이미 유지 전극(X)의 전압이 Vs 또는 -Vs 전압과 비슷한 수준의 전압까지 상승 또는 하강된 이후에 온/오프 구동된다. 즉, 유지 구동부(510)에 포함되는 트랜지스터(Xr, Xf, Xs, Xg)는 온/오프 구동 시 트랜지스터(Xr, Xf, Xs, Xg)가 받게되는 스트레스(Stress)가 적고, 이로 인해 큰 노이 즈를 발생시키지 않는다.
반면, Ve 전압 공급부(520)는 트랜지스터(Xe1, Xe2)를 턴 온 시켜 순간적으로 유지 전극(X)의 전압을 Ve 전압까지 상승시키거나 또는 트랜지스터(Xe1, Xe2)를 턴 오프 시켜 순간적으로 유지 전극(X)의 전압을 접지 전압까지 하강시킨다.
즉, 도 2로 나타낸 본 발명의 실시예에 따른 유지 전극 구동부(500)에서 트랜지스터(Xe2)의 드레인에만 페라이트 코어(522)를 형성한 것은 예시적인 것으로, 트랜지스터(Xe1, Xe2)처럼 온/오프 구동됨에 따라 유지 전극(X)의 전압을 점진적으로 상승 또는 하강시키는 것이 아니라 순간적으로 일정 전압까지 상승 또는 하강시키는 트랜지스터의 온/오프 구동 시 발생하는 고주파 잡음 성분이 주변 회로를 구성하는 회로 소자 또는 유지 전극(X)에 악영향을 끼치는 것을 방지하기 위한 것이다. 그러므로, 본 발명의 실시예에서 페라이트 코어(522)는 트랜지스터(Xe2)의 드레인에만 형성되는 것으로 국한되는 것이 아니다.
예로서, 도 2에는 미도시 하였으나 본 발명의 실시예에 따른 유지 전극 구동부(500)는 어드레스 기간에 유지 전극(X)에 VscL 전압(주사 전압 또는 어드레스 데이터 전압) 및 VscH(비주사 전압)을 공급하는 주사 구동부를 포함하고, 이 주사 구동부에 포함되는 트랜지스터에 페라이트 코어(522)를 형성하는 것은 필수적이다.
도 2에서는 설명의 편의상 유지 구동부(510) 및 Ve 전압 공급부(520)만을 도시한 것이므로, 페라이트 코어(522)는 순간적으로 유지 전극(X)의 전압을 상승 또는 하강시키는 데에 이용되는 미도시된 다른 트랜지스터의 드레인 또는 소스에 형성될 수 있다. 여기에서, 페라이트 코어(522)를 트랜지스터의 드레인에 형성할 것 인지 소스에 형성할 것인지의 여부 또한 확정적인 것이 아니라 해당 트랜지스터의 배치 방향에 따라 달라지는 것으로 트랜지스터의 온/오프 구동 시 발생하는 노이즈로 인해 다른 회로 소자들이 최대한 영향을 적게 받도록 형성하면 무방하다. 특히, 트랜지스터의 온/오프 구동 시 발생하는 노이즈는 유지 전극(X)에도 영향을 끼쳐 유지 전극(X)의 전압을 불안정하게 하는 요인이 되므로 회로 설계 시 트랜지스터의 드레인 또는 소스 중 유지 전극(X)과 연결되는 쪽에 페라이트 코어(522)를 형성하는 것이 플라즈마 표시 장치를 안정적으로 구동시킬 수 있어 유리하다.
Ve 전압 공급부(520)는 트랜지스터(Xe1, Xe2)를 동시에 턴 온 시켜 유지 전극(X)에 Ve 전압을 공급하고, 트랜지스터(Xe1, Xe2)를 동시에 턴 오프 시켜 유지 전극(X)의 전압을 기준 전압으로 하강시킨다. 트랜지스터(Xe1, Xe2)의 온/오프 구동 시 피크 전류(Peak Current) 및 내압이 크게 발생하고, 이로 인한 고주파 잡음 성분은 트랜지스터(Xe1, Xe2)에 가깝게 배치되는 다른 스위칭 소자들의 오동작 또는 파손을 유발하며, 유지 전극(X)의 전압도 불안정해지게 된다.
본 발명의 실시예에 따른 Ve 전압 공급부(520)는 트랜지스터(Xe2)의 드레인에 페라이트 코어(522)를 형성함으로써 트랜지스터(Xe1, Xe2)의 온/오프로 인한 고주파 잡음 성분을 제거한다. 이로 인해 Ve 전압 공급부(520)에 인접하게 배치되는 유지 구동부(510)에 포함되는 스위칭 소자들(Xr, Xf, Xs, Xg)의 오동작 또는 파손을 방지하고, 유지 전극(X)에 안정적인 전압을 공급할 수 있다.
이하, 도 3을 참조하여 본 발명의 실시예에 따라 Ve 전압 공급부(520)에 포함되는 트랜지스터(Xe2)의 드레인에 형성되는 페라이트 코어(522)의 노이즈 제거 효과를 설명한다.
도 3a는 페라이트 코어(522)를 포함하지 않는 트랜지스터(Xe2)가 온(ON) 상태에서 오프(OFF) 상태로 변경될 때에 트랜지스터(Xe2)에 근접한 트랜지스터(Xg) 및 유지 전극(X)의 신호 파형을 도시한 도면이고, 도 3b는 본 발명의 실시예에 따라 페라이트 코어(522)를 포함하는 트랜지스터(Xe2)가 온(ON) 상태에서 오프(OFF) 상태로 변경될 때에 트랜지스터(Xe2)에 근접한 트랜지스터(Xg) 및 유지 전극(X)의 신호 파형을 도시한 도면이다.
도 3a 및 도 3b에서, (a)는 트랜지스터(Xg)의 드레인에서 소스로 흐르는 전류량을 나타낸 것이고, (b)는 유지 전극(X)의 전압 파형을 나타낸 것이다. 또한, T는 트랜지스터(Xe2)가 온(ON) 상태에서 오프(OFF) 상태로 변경되는 시점을 나타낸다.
먼저, 도 3a를 살펴보기로 한다.
T 시점 이전에, 트랜지스터(Xg, Xe2)는 온(ON) 상태를 유지하고, 이로 인해 트랜지스터(Xg)의 드레인에서 소스로 흐르는 전류량 및 유지 전극(X)의 전압은 일정하게 유지된다.
T 시점에, 트랜지스터(Xe2)가 오프(OFF) 되면, 트랜지스터(Xe2)로부터 발생되는 고주파 잡음 성분으로 인해 트랜지스터(Xg)의 드레인에서 소스로 흐르는 전류량이 순간적으로 크게 변동하게 된다. 이때, 트랜지스터(Xe2)가 오프(OFF) 됨에 따라 하강하는 유지 전극(X)의 전압도 고주파 잡음 성분의 영향으로 출렁거리는 현상이 발생한다.
다음, 도 3b를 살펴본다.
트랜지스터(Xe2)가 오프(OFF) 되는 T 시점 이후, 트랜지스터(Xg)의 드레인에서 소스로 흐르는 전류량의 순간 변화량이 도 3a에 비해 매우 작게 나타난다. 또한, 유지 전극(X)의 전압 하강도 도 3a와 달리 출렁거리지 않고 선형(Linear)으로 나타난다. 이로 인해, 트랜지스터(Xe2)의 드레인에 페라이트 코어(522)를 형성하면 고주파 잡음 성분을 제거할 수 있음을 알 수 있다.
상술한 본 발명의 실시예에 따른 Ve 전압 공급부(520)는 트랜지스터(Xe2)의 드레인에 페라이트 코어(522)를 연결함으로써 트랜지스터(Xe2)의 온/오프 구동 시 발생하는 큰 피크 전류(Peak Current) 및 내압으로 인한 고주파 잡음 성분이 트랜지스터(Xe2)에 근접하게 배치되는 다른 스위칭 소자들 또는 유지 전극(X)에 미치는 악영향을 제거할 수 있다.
이상에서 본 발명의 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
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이상에서 설명한 바와 같이 본 발명의 특징에 따르면, 페라이트 코어를 이용함으로써 트랜지스터의 온/오프 시 발생할 수 있는 고주파 잡음 성분이 트랜지스터와 인접하게 배치되는 다른 회로 소자에 미치는 악영향을 제거하여 플라즈마 표시 장치를 안정적으로 구동시킬 수 있다.

Claims (9)

  1. 복수의 제1 전극을 포함하는 플라즈마 표시 패널;
    입력 전압을 변환하여 제1 전압을 생성하는 전원 공급 장치;
    상기 제1 전극을 구동하는 제1 구동회로부 및
    상기 제1 구동회로부의 구동을 제어하는 제어 신호를 생성하는 제어부를 포함하며,
    상기 제1 구동회로부는,
    제1단이 상기 제1 전압을 공급하는 제1 전원에 연결되고 제2단이 상기 제1 전극에 연결되는 제1 트랜지스터; 및
    상기 제1 트랜지스터의 제2단에 형성되는 페라이트 코어(Ferrite Core)를 포함하며,
    상기 제1 전압은 리셋 기간의 일부 구간에서 어드레스 기간이 종료될 때까지 상기 제1 전극에 인가되는 전압인 플라즈마 표시 장치.
  2. 삭제
  3. 삭제
  4. 삭제
  5. 삭제
  6. 제1 전극을 포함하는 플라즈마 표시 장치의 구동 장치에 있어서,
    드레인이 제1 전압을 공급하는 제1 전원에 연결되는 제1 트랜지스터;
    소스가 상기 제1 트랜지스터의 소스에 연결되고 드레인이 상기 제1 전극에 연결되는 제2 트랜지스터; 및
    상기 제2 트랜지스터의 드레인에 형성되는 페라이트 코어(Ferrite Core)
    를 포함하는 플라즈마 표시 장치의 구동 장치.
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