KR100761291B1 - 플라즈마 디스플레이 장치 - Google Patents

플라즈마 디스플레이 장치 Download PDF

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Abstract

본 발명은 스캔 바이어스 신호를 인가하는 스캔 스위치의 양단에 걸리는 전압을 감소시킬 수 있는 플라즈마 디스플레이 장치에 관한 것으로서, 상기 스캔 스위치가 패널 커패시터를 향해 흐르는 공진전류 경로 상의 노드 1에 접속되는 회로 결선, 그리고 셋업 스위치가 스캔 IC와 직접 연결되는 회로 결선을 통해 셋업구간중에 스캔 스위치 양단에 걸리는 전압을 감소시켜 스위치 소자의 내구성을 향상시키고, 내압이 적은 스위치 소자를 채택할 수 있어 제조비용을 절감할 수 있다.
PDP, 스캔 스위치, 내압, 셋업 스위치, 리셋구간

Description

플라즈마 디스플레이 장치{Plasma display panel device}
도 1은 플라즈마 디스플레이 장치에서의 단위 서브필드 동안의 파형,
도 2는 종래 플라즈마 디스플레이 장치의 구동회로도,
도 3은 본 발명의 플라즈마 디스플레이 장치 구동회로의 제 1 실시예도,
도 4는 본 발명의 플라즈마 디스플레이 장치 구동회로의 제 2 실시예도,
도 5는 본 발명의 플라즈마 디스플레이 장치에서의 단위 서브필드 동안의 파형 및 스캔 스위치 내압의 파형이다.
<도면의 주요 부분에 관한 부호의 설명>
10: 에너지 회수부 20: 서스테인신호 인가부
30su,30su': 셋업신호 인가부 30sd: 셋다운신호 인가부
40sb: 스캔바이어스신호 인가부 40sp: 스캔펄스 인가부
본 발명은 스캔 스위치 또는 셋업 스위치의 회로결선을 전환하여 스캔 바이어스 신호를 인가하는 스캔 스위치의 양단에 걸리는 전압을 감소시킬 수 있는 플라즈마 디스플레이 장치에 관한 것이다.
최근 개발되는 평면 표시장치에는 액정 표시장치(liquid crystal display; LCD), 전계방출 표시장치(field emission display; FED), 플라즈마 디스플레이 패널(plasma display panel; PDP) 등이 있다. 이 중, PDP는 다른 평면 표시장치에 비하여 휘도 및 발광효율이 높고 시야각이 넓어 대형 표시장치로 각광받고 있다.
도 1은 플라즈마 디스플레이 장치에서의 단위 서브필드 동안의 파형(①)을 도시한 것으로서, 각 서브필드는 리셋 구간(R), 어드레스 구간(A), 서스테인 구간(S)으로 이루어진다. 이때, X 전극은 어드레스 전극이며, Y 전극은 스캔전극을, Z전극은 서스테인 전극을 나타낸다.
먼저, 리셋구간(R)은 이전의 서스테인 방전에 의해 형성된 벽 전하 상태를 소거하고, 각 셀의 상태를 초기화시키는 구간이며, 어드레스 구간(A)은 방전하고자 하는 셀을 선택하는 구간이다. 또한, 서스테인 구간(S)은 스캔전극(Y) 및 서스테인 전극(Z)에 펄스를 교대로 인가하여 서스테인 방전을 발생시킴으로써 선택된 셀에서 화상이 표시되도록 한다.
여기서, 상기 리셋구간(R)은 Y 전극으로는 상승하는 셋업신호가 공급되어, Z 전극 사이에서 리셋방전이 발생되면서 유전체층에 벽전하가 축적되는 셋업구간(SU)과, Y 전극으로 램프다운(ramp down) 파형의 셋다운 신호가 공급되어, 방전셀 내부 의 벽전하가 소거되는 셋다운 구간(SD)으로 구분된다.
도 2는 종래 플라즈마 디스플레이 패널의 구동회로를 도시한 것으로서, 에너지 회수부(1), 서스테인신호 인가부(2), 리셋신호 인가부(3), 스캔신호 인가부(4)로 구성된다. 다만, 종래 문제점과 연관된 서스테인신호 인가부(2), 리셋신호 인가부(3) 및 스캔신호 인가부(4)의 회로 구성을 중심으로 살펴보기로 한다.
상기 리셋신호 인가부(3)는 셋업전압원(Vsu)과 제 1 노드(n1) 사이에 접속된 제 3 스위치(Q3)가 타이밍 컨트롤러의 제어에 의해 도통(on)되어, 셋업전압원까지 상승하는 셋업신호를 제 1 노드에 공급한다.
또한, 상기 제 1 노드(n1)와 셋다운 전압원(-Vy) 사이에 접속된 제 4 스위치(Q4)가 타이밍 컨트롤러의 제어에 의해 도통(on) 되어, 셋다운 전압원(-Vy)까지 하강하는 셋다운 신호를 제 1 노드에 공급한다.
어드레스 구간(A)동안 상기 스캔신호 인가부(4)는 제 5 스위치(Q5)를 도통하여 리셋구간 중에 셋다운 전압(-Vy)까지 하강된 전압레벨로부터 스캔 바이어스 전압원(-Vsus/2)까지 상승시켜 스캔 바이어스 신호를 인가한다.
이후, 어드레스 전극(X)으로 데이터 신호가 인가되면, 이와 동기적으로 제 6 스위치(Q6)를 도통시킴으로써 스캔전압원(-Vy)까지 하강하는 스캔펄스를 제 1 노드(n1)로 공급한다. 즉, 스캔전극(Y) 및 어드레스 전극(X)간 전압차에 의해 어드레스 방전을 발생시켜 방전셀이 선택되도록 한다.
이때, 제 5 스위치(Q5)와 패널 커패시터(Cp) 사이에는 푸쉬풀 형태로 접속되는 제 7 및 제 8 스위치(Q7,Q8)가 포함되어 구성되며, 각 스위치 사이의 출력단자 는 패널 커패시터(Cp)와 접속된다. 상기 제 7 및 제 8 스위치 각각은 제 1 노드상의 신호 또는 스캔펄스를 패널 커패시터로 공급한다.
상기 어드레스 구간(A)동안 선택된 방전셀에서 서스테인 방전을 일으키는 서스테인신호 인가부(2)는 서스테인 구간동안 스캔전극(Y) 및 서스테인 전극(Z)에 방전전압 이상의 전압차가 형성되도록 한다. 이를 위해, 제 1 스위치(Q1)가 도통되어 최고 서스테인 전압(Vsus/2)을 제 1 노드(n1)에 공급하고, 제 2 스위치(Q2)를 도통하여 최저 서스테인 전압(-Vsus/2)을 공급한다.
이때, 상기 노드 1(n1)의 전압을 어느 레벨로 설정하느냐에 따라 회로상 공급되는 직류전압원의 레벨이 상이해지는바, 도 1에서는 노드 1을 그라운드로 설정하고, 상기 최고 서스테인 전압을 Vsus/2로 하고, 최저 서스테인 전압을 -Vsus/2로 공급하는 것을 예시한다.
여기서, 상기 스캔신호 인가부(4)는 스캔 바이어스 전압원을 상기 최저 서스테인 전압원(-Vsus/2)을 공용하도록 연결되므로, 어드레스 구간이 개시되면 제 5 스위치(Q5)가 도통되어 -Vsus/2레벨의 스캔 바이어스 전압이 인가된다.
이때, 상기 제 5 스위치(Q5)는 일단이 상기 최저 서스테인 전압원(-Vsus)과 연결되고, 타단이 상기 패널 커패시터(Cp)와 연결되며, 셋업구간 중에는 노드 1의 전압이 셋업전압원(Vsu)까지 상승하므로 상기 제 5 스위치의 양단에는 [Vsu-(-Vsus/2)], 즉 [Vsu+Vsus/2]만큼의 전압이 걸린다. 이는 도 1의 ② 파형과 같다.
이로 인해 종래 구동회로에는 스위치 내압이 높은 고가의 스위치를 채용하여야 했고, 제조 비용이 상승된다는 문제점이 있었다.
본 발명은 상기한 종래 기술의 문제점을 해결하기 위하여 안출된 것으로서, 그 목적은 회로 결선을 전환함으로써 내압이 높은 고가의 스위치 소자를 적용하지 않고도 구동이 가능한 플라즈마 디스플레이 장치를 제공하는데 있다.
상기한 과제를 해결하기 위한 본 발명에 의한 플라즈마 디스플레이 장치는 어드레스 구간에서 패널 커패시터로 스캔 바이어스 신호를 인가하는 스캔 스위치를 포함하여 구성되고, 상기 스캔 스위치는 패널 커패시터를 향해 흐르는 공진전류 경로 상의 노드 1에 접속되어, 스캔 바이어스 신호를 인가하는 것을 특징으로 한다.
이때, 리셋구간에서 패널 커패시터로 셋업신호를 인가하는 셋업스위치는 상기 노드 1에 접속된다. 이를 제 1 실시예로 한다.
또한, 리셋구간 중에 상기 셋업신호가 노드 1을 통해 패널 커패시터로 인가되도록 서스테인 구동부와 제 1 노드 사이에 제 1 경로차단용 소자가 연결될 수 있다.
아울러, 어드레스 구간 중에 상기 스캔 바이어스 신호가 노드 1 및 상기 스캔 스위치를 통해 패널 커패시터로 인가되도록 제 1 노드와 스캔 IC 사이에 제 2 경로차단용 소자가 연결될 수 있다.
이때, 리셋구간에서 패널 커패시터로 셋다운 신호를 인가하는 셋다운 스위치 는 상기 제 2 경로차단용 소자와 상기 스캔 IC 사이에 연결된다.
또한, 상기 셋업 스위치는 셋업신호가 상기 노드 1을 경유하지 않고 패널 커패시터로 인가되는 경로를 형성하기 위하여 스캔 IC와 직접 연결될 수 있다.
이때, 상기 노드 1과 서스테인 구동부는 직접 연결되므로, 제 1 경로차단용 소자가 회로상에서 생략 가능하다.
또한, 상기 노드 1에는 패널 커패시터와 공진 전류를 형성하는 인덕터, 상기 인덕터와 연결되는 에너지 회수 스위치를 포함하는 에너지 회수부가 연결된다.
이하, 본 발명의 바람직한 실시예를 첨부된 도면을 참조하여 상세히 설명한다.
도 3 및 도 4 는 본 발명의 플라즈마 디스플레이 장치의 회로도이며, 각각은 바람직한 제 1 실시예 및 제 2 실시예를 도시한 것이다. 이를 참고로 하여 본 발명의 구성을 상세히 설명한다.
먼저, 에너지 회수부(10)는 서스테인 구간동안에 패널 커패시터(Cp)를 서스테인 전압까지 충전시키고, 이를 다시 방전시킴에 따라 발생되는 무효전력에 의한 손실을 최소화하기 위해 후술하는 서스테인신호 인가부(20)와 연결되어 구성된다.
따라서, 상기 에너지 회수부(10)는 상기 패널 커패시터(Cp)와 함께 LC 공진전류를 형성하는 인덕터와, 상기 인덕터와 연결되는 스위치와, 상기 패널 충/방전시 손실되는 에너지가 저장되는 소스 커패시터를 포함하여 구성된다. 이러한 공진전류를 노드 1(n1)을 통해 인가 또는 회수된다.
여기서, 상기 패널 커패시터(Cp)는 스캔 전극(Y)과 서스테인 전극(Z) 사이에 형성되는 정전용량을 등가적으로 나타낸 것이다.
상기 서스테인신호 인가부(20)는 최고 서스테인 전압원(Vsus/2)과 제 1 노드(n1) 사이에 접속된 스위치가 타이밍 컨트롤러의 제어에 의해 도통(ON)되어 공진전류 경로상의 제 1 노드(n1)에 최고 서스테인 전압을 공급한다.
또한, 상기 제 1 노드(n1)와 최저 서스테인 전압원(-Vsus/2) 사이에 접속된 제 2 스위치(Q2)가 타이밍 컨트롤러의 제어에 의해 도통(on)되어 제 1 노드에 최저 서스테인 전압을 공급함으로써 서스테인 펄스를 형성한다.
이때, 상기 노드 1전압을 어느 레벨로 설정하느냐에 따라 회로상 공급되는 직류전압원의 레벨이 상이해지는바, 본 실시예에서는 노드 1을 그라운드 레벨로 설정하고, 최고 서스테인 전압을 Vsus/2로 하고, 최저 서스테인 전압을 -Vsus/2로 공급하는 것을 예시한다.
리셋신호 인가부는 리셋구간 중에 셋업 신호를 인가하는 셋업신호 인가부(30su)와, 셋다운 신호를 인가하는 셋다운신호 인가부(30sd)를 포함하여 구성된다.
먼저, 셋업신호 인가부(30su)는 셋업전압원(Vsu)과 제 1 노드(n1) 사이에 접속된 셋업스위치(Q3)가 타이밍 컨트롤러의 제어에 의해 도통(on) 되어, 셋업전압원까지 상승하는 램프형태의 셋업신호를 제 1 노드에 공급한다. 상기 셋업 스위치의 제어단자에는 상기 램프파형의 기울기 조정을 위한 가변저항(VR1)이 연결된다.
또한, 상기 셋다운신호 인가부(30sd))는 상기 제 1 노드(n1)와 셋다운 전압원(-Vy) 사이에 접속된 셋다운 스위치(Q4)가 타이밍 컨트롤러의 제어에 의해 도통 (on) 되어, 셋다운 전압원(-Vy)까지 하강하는 램프형태의 셋다운 신호를 제 1 노드에 공급한다. 상기 셋다운 스위치의 제어단자에는 상기 램프파형의 기울기 조정을 위한 가변저항(VR2)이 연결된다.
스캔신호 인가부는 어드레스 구간 중에 스캔 바이어스 신호를 인가하는 스캔바이어스신호 인가부(40sb)와 스캔펄스를 인가하는 스캔펄스 인가부(40sp)를 포함하여 구성된다.
먼저, 상기 스캔바이어스신호 인가부(40sb)는 어드레스 구간에서 패널 커패시터(Cp)로 스캔 바이어스 신호를 인가하는 스캔 스위치(Q5)를 포함하여 구성되며, 상기 스캔 스위치는 상기 셋업스위치(Q3)와 함께 노드 1에 접속된다.
이때, 상기 스캔 바이어스 전압원은 서스테인 구동부(20)의 최저 서스테인 전압원(-Vsus/2)과 공용되도록 연결될 수 있고, 상기 스캔 스위치(Q5)가 도통됨에 따라 어드레스 구간이 개시되면, 셋다운 전압원(-Vy)까지 하강한 파형이 상기 최저 서스테인 전압원(-Vsus/2)까지 상승하여 스캔 바이어스 전압이 형성된다.
또한, 상기 스캔펄스 인가부(40sp)는 스캔전압원(-Vy)과 연결되는 스캔펄스 스위치(Q6)를 포함하여 구성되며, 상기 스캔펄스 스위치가 도통됨에 따라, 상기 스캔 바이어스 전압(-Vsus/2)에서 스캔전압원(-Vy)까지 하강하는 스캔펄스가 인가되어 어드레스 방전을 일으킨다.
이때, 스캔전압원(-Vy)과 제 1 노드(n1) 사이에 푸쉬풀 형태로 접속되는 제 7 스위치(high side)및 제 8 스위치(low side)가 스캔 IC를 이룬다. 각 스위치 사이의 출력단자는 패널 커패시터(Cp)와 접속되므로, 상기 스캔 IC를 이루는 스위치 의 도통 여부에 따라 상기 노드 1 상의 전압이 인가되거나, 상기 패널 커패시터의 충전전압이 방전된다.
이와 같이 상기 스캔 스위치(Q5)가 노드 1(n1)에 접속되는 회로 구성을 제 1 실시예로 한다. 이때 서스테인 구간이 종료되는 시점에서 노드 1에는 Vsus/2 의 전압이 인가되며, 패널 커패시터 역시 Vsus/2만큼의 전압이 인가된다.
즉, 상기 노드 1(n1)의 전압과 상기 패널 커패시터(Cp)의 전압레벨이 동일하므로, 셋업 스위치(Q3)가 도통됨에 따라 패널 커패시터로 셋업 신호가 인가되더라도 상기 스캔 스위치(Q5) 양단에 걸리는 전압은 0이 된다. 따라서, 종래 셋업구간 중에 스캔 스위치의 내압을 초과하는 경우를 방지할 수 있게 된다.
또한, 제 1 실시예의 회로에는 리셋구간 중에 상기 셋업신호가 노드 1을 통해 패널 커패시터(Cp)를 향하여 인가되도록 서스테인 구동부(20)와 제 1 노드(n1) 사이에 제 1 경로차단용 소자(Q11)가 연결될 수 있다. 이는 FET 스위치 또는 다이오드 등의 소자가 이용될 수 있다.
또한, 제 1 실시예의 회로에는 어드레스 구간 중에 상기 스캔 바이어스 신호가 노드 1(n1) 및 상기 스캔 스위치(Q5)를 통해 패널 커패시터로 인가되도록 제 1 노드와 스캔 IC 사이에 제 2 경로차단용 소자(Q10)가 연결될 수 있다. 이 또한 FET 스위치 또는 다이오드 등의 소자가 이용될 수 있다.
또한, 상기 제 2 경로차단용 소자(Q10)는 셋다운 구간에서 셋다운 전압원(-Vy)까지 상기 패널 커패시터의 전압레벨이 하강되는 셋다운 신호가 상기 패널 커패시터로 인가되는 중에 노드 1측으로의 전류경로를 차단한다.
아울러, 상기 제 2 경로차단용 소자(Q10)는 어드레스 구간 중에 스캔 바이어스 전압에서 스캔전압원(-Vy)까지 하강되는 스캔펄스가 상기 패널 커패시터로 인가되는 중에 노드 1측으로의 전류경로를 차단한다.
이때, 리셋구간에서 패널 커패시터(Cp)로 셋다운 신호를 인가하는 셋다운 스위치(Q6)가 상기 제 2 경로차단용 소자(Q10)와 상기 스캔 IC 사이에 연결되며, 상기 셋다운 전압원은 스캔전압원과 동일한 외부전원(-Vy)을 이용하는 것으로 예시한다.
이외에도, 서스테인 구간 중에 패널 커패시터(Cp)의 전압레벨이 최저 서스테인 전압원(-Vsus/2)까지 하강하는 전류경로를 형성하기 위해 도통되고, 상기 스캔 스위치(Q5)와 상보적으로 동작하는 상보스캔 스위치(Q9)가 상기 스캔 IC와 병렬로 연결될 수 있다.
이와 같이 구성되는 제 1 실시예의 회로구성에서 상기 셋업신호 인가부(30su)의 결선을 달리 구성한 것을 제 2 실시예로 하며, 이 역시 셋업구간 중에 상기 스캔 스위치(Q5) 양단에 걸리는 전압을 종래보다 개선한 것이다.
먼저, 셋업신호 인가부(30su')는 리셋구간에서 셋업신호가 상기 노드 1을 경유하지 않고 패널 커패시터(Cp)로 직접 인가되도록 셋업 스위치(Q5)가 스캔 IC 와 직접 연결되어 구성된다.
즉, 제 1 실시예에서는 셋업신호가 [셋업전압원-셋업스위치-노드1-제 2 경로차단용 스위치-스캔 IC]를 통해 패널 커패시터로 향하여 인가되었으나, 제 2 실시 예에서는 셋업신호가 [셋업전압원-셋업스위치-스캔IC]를 통해 패널 커패시터(Cp)로 직접 인가된다.
이로써, 서스테인 구간이 종료되는 시점에서 노드 1에는 Vsus/2의 전압이 인가되며, 셋업구간이 개시됨에 따라 상기 노드 1의 전압레벨은 변동이 없고 제 2 실시예와 같이 결선된 셋업신호 인가부(30su')에 의해 패널 커패시터(Cp)의 전압레벨이 상승한다.
즉, 셋업구간 중에 스캔 스위치(Q5)의 일단은 전압레벨(Vsus/2)을 유지하는 노드 1과 연결되고, 타단은 셋업 전압원(Vsu)까지 상승하는 패널 커패시터와 연결되어, 결국 스캔 스위치 양단에 걸리는 최대 전압은 [Vsu-Vsus/2]가 되며, 이를 도 5의 ②'그래프에 도시하였다. 이는 도 1의 ②에 도시된 종래 셋업구간 중의 스캔 스위치 양단에 걸린 [Vsu+Vsus/2]에 비해 감소된 값이다.
이와 같이 셋업신호 인가부(30su')가 스캔 IC와 직접 연결됨에 따라, 제 2 실시예의 회로 구성에서는 셋업신호가 서스테인 구동부(20) 측으로 인가되는 것을 차단하는 제 1 경로차단용 소자가 생략될 수 있어, 노드 1(n1)이 서스테인 구동부(20)와 직접 연결된다.
그 외의 회로구성은 제 1 실시예의 설명으로 대신한다. 따라서, 제 2 실시예의 회로에서도 제 1 노드(n1)와 스캔 IC 사이에는 제 2 경로차단용 소자(Q10)가 연결될 수 있으며, 셋다운 스위치(Q4)가 상기 제 2 경로차단용 소자와 스캔 IC 사이에 접속되며, 상기 셋다운 전압원은 스캔전압원과 동일한 외부전원(-Vy)을 이용하는 것으로 예시한다.
뿐만 아니라, 상기 상보스캔 스위치(Q9) 역시 상기 스캔 IC 와 병렬로 연결되어 제 2 실시예의 회로를 구성한다.
이상과 같이 본 발명에 의한 플라즈마 디스플레이 장치에 관하여 예시된 도면을 참조로 하여 설명하였으나, 본 명세서에 개시된 실시예와 도면에 나타난 외부전원의 크기 등의 수치는 본 발명의 기술사상이 보호되는 범위 이내에서 응용이 가능하다.
상기와 같이 구성되는 본 발명의 플라즈마 디스플레이 장치는 스캔 바이어스 신호를 인가하는 스캔 스위치의 회로결선 및 셋업신호를 인가하는 셋업 스위치의 회로결선을 전환하여 셋업구간 중에 스캔 스위치 양단에 걸리는 전압을 감소시켜 스위치 소자의 내구성을 향상시키고, 내압이 적은 스위치 소자를 채택할 수 있어 제조비용을 절감할 수 있다는 효과가 있다.

Claims (14)

  1. 정극성의 최고 서스테인 전압원과 연결된 제 1 스위치 및 부극성의 최저 서스테인 전압원과 연결된 제 2 스위치가 노드 1을 중심으로 각각 연결되고,
    상기 노드 1에는 어드레스 구간동안 패널 커패시터로 스캔 바이어스 신호가 인가되도록 하는 스캔 스위치가 연결되며, 상기 제 2 스위치 및 상기 스캔 스위치가 도통됨에 따라 상기 최저 서스테인 전압원으로부터 부극성의 스캔 바이어스 신호가 공급되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  2. 청구항 1에서,
    상기 노드 1에서 패널 커패시터로 향하는 경로상에는 리셋구간동안 점진적으로 상승하는 셋업신호를 인가하는 셋업스위치가 접속되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 청구항 1에서,
    상기 패널 커패시터는 스캔 IC와 연결되고, 상기 스캔 IC는 상기 패널 커패시터를 중심으로 제 7 스위치 및 제 8 스위치가 각각 연결되어 상보적으로 도통되며,
    어드레스 구간동안 상기 최저 서스테인 전압원으로부터 상기 노드 1, 스캔 스위치 및 상기 제 7 스위치를 거쳐 전류가 공급됨으로써 패널 커패시터로 스캔 바이어스 신호가 공급되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  4. 청구항 3에서,
    상기 노드 1과 상기 제 8 스위치 사이에는 제2 경로차단용 소자가 연결되며,
    상기 제 2 경로차단용 소자는 어드레스 구간동안 오프되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  5. 청구항 3에서,
    리셋구간동안 점진적으로 하강하는 셋다운 신호를 인가하는 셋다운 스위치는 상기 제 2 경로차단용 소자와 상기 스캔 IC 사이에 연결되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  6. 청구항 1에서,
    서스테인 구간에서 패널 커패시터로 최저 서스테인 전압신호가 인가되는 전류경로를 형성하기 위하여 도통되고, 상기 스캔 스위치와 상보적으로 동작하는 상보스캔 스위치가 스캔 IC와 병렬로 연결되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  7. 청구항 1에서,
    상기 패널 커패시터는 스캔 IC와 연결되고, 상기 스캔 IC는 상기 패널 커패시터를 중심으로 제 7 스위치 및 제 8 스위치가 각각 연결되어 상보적으로 도통되며,
    리셋구간동안 점진적으로 상승하는 셋업신호를 인가하는 셋업스위치는 상기 노드 1을 경유하지 않고 직접 상기 제 7 스위치와 연결되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  8. 삭제
  9. 삭제
  10. 청구항 1 또는 청구항 7에서,
    상기 노드 1에는 패널 커패시터와 공진 전류를 형성하는 인덕터, 상기 인덕터와 연결되는 에너지 회수 스위치를 포함하는 에너지 회수부가 연결되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  11. 삭제
  12. 삭제
  13. 정극성의 최고 서스테인 전압원과 연결된 제 1 스위치 및 부극성의 최저 서스테인 전압원과 연결된 제 2 스위치가 노드 1을 중심으로 각각 연결되고,
    상기 노드 1에 접속된 스캔 스위치 및 제 2 스위치가 도통됨에 따라 어드레스 구간동안 상기 최저 서스테인 전압원으로부터 패널 커패시터로 향하는 전류 경로가 형성되어 일정레벨의 스캔 바이어스 신호를 공급하고,
    상기 노드 1에 접속된 셋업 스위치가 도통됨에 따라 리셋구간동안 셋업 전압원으로부터 패널 커패시터로 향하는 전류 경로가 형성되어 점진적으로 상승하는 셋업 신호를 공급하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  14. 정극성의 최고 서스테인 전압원과 연결된 제 1 스위치 및 부극성의 최저 서스테인 전압원과 연결된 제 2 스위치가 노드 1을 중심으로 각각 연결되고,
    상기 노드 1에 접속된 스캔 스위치 및 상기 제 2 스위치가 도통됨에 따라 어드레스 구간동안 상기 최저 서스테인 전압원으로부터 패널 커패시터로 향하는 전류 경로가 형성되어 일정레벨의 스캔 바이어스 신호를 공급하고,
    상기 노드 1을 거치지 않고 셋업 전압원과 패널 커패시터 사이에 배치된 셋업 스위치가 도통됨에 따라 리셋구간동안 점진적으로 상승하는 셋업 신호를 공급하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
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