JP2005338708A - プラズマディスプレイ装置 - Google Patents
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Abstract
【解決手段】維持回路は、プラズマディスプレイパネルの表示電極に接続される維持電圧源21と、この維持電圧源21とアースとの間に接続されかつ互いに並列接続したコンデンサ30および抵抗31と、このコンデンサ30と維持電圧源21との接続点とアースとの間に配置されかつ直列に接続したFET32、33と、このFET32、33のスイッチングを制御する制御ドライバ34と、前記FET32に並列に配置されかつ互いに並列接続したコンデンサ38および抵抗39とを有し、かつ前記コンデンサ38と抵抗39による時定数を前記コンデンサ30と抵抗31による時定数より大きくした。
【選択図】図3
Description
32、33はこのコンデンサ30と維持電圧源21との接続点とアースとの間に配置された第1および第2のスイッチング素子としてのFETで、このFET32、33は互いに直列接続されており、制御ドライバ34によりスイッチング動作が制御され、交互にオンオフのスイッチングを行うものである。なお、35は制御ドライバ34を動作させるための制御用電源、36はダイオード、37はコンデンサである。
5、6 維持回路
21 維持電圧源
30、38 コンデンサ
31、39 抵抗
32、33 FET
34 制御ドライバ
Claims (1)
- 表示電極とデータ電極との交差部に放電セルを形成してなるプラズマディスプレイパネルと、このプラズマディスプレイパネルの表示電極に維持放電のための維持パルス電圧を印加するための維持回路とを有し、前記維持回路は、前記プラズマディスプレイパネルの表示電極に接続される維持電圧源と、この維持電圧源とアースとの間に接続されかつ互いに並列接続した第1のコンデンサおよび第1の抵抗と、この第1のコンデンサと維持電圧源との接続点とアースとの間に配置されかつ直列に接続した第1および第2のスイッチング素子と、この第1および第2のスイッチング素子のスイッチングを制御する制御ドライバと、前記第1のコンデンサと維持電圧源との接続点に一端を接続した第1のスイッチング素子に並列に配置されかつ互いに並列接続した第2のコンデンサおよび第2の抵抗とを有し、かつ前記第2のコンデンサと第2の抵抗による時定数を前記第1のコンデンサと第1の抵抗による時定数より大きくしたことを特徴とするプラズマディスプレイ装置。
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---|---|---|---|
JP2004161043A JP2005338708A (ja) | 2004-05-31 | 2004-05-31 | プラズマディスプレイ装置 |
Applications Claiming Priority (1)
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100778510B1 (ko) | 2006-07-05 | 2007-11-22 | 삼성에스디아이 주식회사 | 플라즈마 표시 장치 및 그 구동 방법 |
WO2008084792A1 (ja) * | 2007-01-12 | 2008-07-17 | Panasonic Corporation | プラズマディスプレイ装置 |
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2004
- 2004-05-31 JP JP2004161043A patent/JP2005338708A/ja active Pending
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Publication number | Priority date | Publication date | Assignee | Title |
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WO2008084792A1 (ja) * | 2007-01-12 | 2008-07-17 | Panasonic Corporation | プラズマディスプレイ装置 |
JPWO2008084792A1 (ja) * | 2007-01-12 | 2010-05-06 | パナソニック株式会社 | プラズマディスプレイ装置 |
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