KR100658343B1 - Plasma display apparatus and driving method thereof - Google Patents

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Abstract

A plasma display device and a driving method thereof are provided to execute smooth initializing during the reset period of the next subfield by keeping a predetermined voltage on an address electrode in driving a plasma display panel by applying negative sustain pulse. A plasma display device includes a plasma display panel(500) having scan and sustain electrodes(Y1~Yn,Z) to which negative sustain pulse is applied in turn during a sustain period, and address electrodes(X1~Xm) selecting a cell; driving units(502,503,504) for driving the plasma display panel by applying signals to the electrodes; and a voltage control unit(501) for keeping a negative bias voltage on the address electrode during the sustain period of plural subfields by controlling the driving units.

Description

플라즈마 디스플레이 장치 및 그의 구동방법{Plasma Display Apparatus and Driving Method thereof}Plasma display device and driving method thereof {Plasma Display Apparatus and Driving Method}

도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 도시한 도.1 is a diagram showing the structure of a typical plasma display panel.

도 2는 일반적인 플라즈마 디스플이레이 패널의 화상 계조를 구현하는 방법을 나타낸 도.FIG. 2 is a diagram illustrating a method of implementing image gradation of a typical plasma display panel. FIG.

도 3은 종래 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 나타낸 도.3 is a view illustrating a driving waveform according to a driving method of a conventional plasma display panel.

도 4는 종래 플라즈마 디스플레이 패널의 네거티브 서스테인 구동 방법에 따른 구동파형을 나타낸 도.4 is a view illustrating a driving waveform according to a negative sustain driving method of a conventional plasma display panel.

도 5는 본 발명에 따른 플라즈마 디스플레이 장치를 개략적으로 나타낸 도.5 schematically illustrates a plasma display device according to the present invention;

도 6은 본 발명에 따른 플라즈마 디스플레이 장치의 구동방법을 설명하기 위한 도.6 is a view for explaining a method of driving a plasma display device according to the present invention;

본 발명은 플라즈마 디스플레이 장치 및 그의 구동방법에 관한 것으로, 더욱 자세하게는 서스테인 기간에 인가되는 구동펄스를 개선하여 안정된 방전이 발생할 수 있도록 하기 위한 플라즈마 디스플레이 장치 및 그의 구동방법에 관한 것이다.The present invention relates to a plasma display apparatus and a driving method thereof, and more particularly, to a plasma display apparatus and a driving method thereof for improving a driving pulse applied in a sustain period so that stable discharge can occur.

일반적으로 플라즈마 디스플레이 패널(Plasma Display Panel: 이하, PDP라 함.)은 각 전극들에 방전셀을 초기화 시키기 위한 리셋 펄스와, 방전될 셀을 선택하기 위한 어드레스 펄스, 및 방전셀의 방전을 유지시키기 위한 서스테인 펄스를 각 서브필드의 계조값에 따라 소정 횟수 인가하고, 이에 따라 발생하는 가스 방전에 의해 형광체를 발광을 이용한다. 이러한, PDP는 상술한 바와 같은 리셋, 어드레싱, 및 서스테인을, 프레임을 구성하는 각 서브필드마다, 반복하게 되는데 PDP 구동특성을 향상시키기 위해서는 상기 각 서브필드가 시작되기 전에 각 전극 측에 잔존하는 벽전하를 제거하기 위한 소거 펄스를 인가하는 것이 필요하다.In general, a plasma display panel (hereinafter referred to as a PDP) has a reset pulse for initializing a discharge cell, an address pulse for selecting a cell to be discharged, and a discharge cell for maintaining a discharge cell. Sustain pulses are applied a predetermined number of times according to the gray level values of the respective subfields, and the phosphors emit light by the gas discharge generated. The PDP repeats the above-described reset, addressing, and sustain for each subfield constituting the frame. However, in order to improve the PDP driving characteristics, a wall remaining on each electrode side before the start of each subfield is started. It is necessary to apply an erase pulse to remove the charge.

도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도이다.1 illustrates a structure of a general plasma display panel.

도 1에 도시된 바와 같이, 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시면인 전면 글라스(101)에 스캔 전극(102)과 서스테인 전극(103)이 쌍을 이뤄 형성된 복수의 유지전극쌍이 배열된 전면 패널(100)과, 배면을 이루는 후면 글라스(111) 상에 전술한 복수의 유지전극쌍과 교차되도록 복수의 어드레스 전극(113)이 배열된 후면 패널(110)이 일정거리를 사이에 두고 평행하게 결합된다.As shown in FIG. 1, a plasma display panel includes a front panel in which a plurality of sustain electrode pairs formed by pairing a scan electrode 102 and a sustain electrode 103 are arranged on a front glass 101 that is a display surface on which an image is displayed. 100 and the rear panel 110 on which the plurality of address electrodes 113 are arranged so as to intersect the plurality of sustain electrode pairs on the rear glass 111 forming the rear surface are coupled in parallel with a predetermined distance therebetween. do.

전면 패널(100)은 하나의 방전셀에서 상호 방전시키고 셀의 발광을 유지하기 위한 스캔 전극(102) 및 서스테인 전극(103), 즉 투명한 ITO 물질로 형성된 투명 전극(a)과 금속재질로 제작된 버스 전극(b)으로 구비된 스캔 전극(102) 및 서스테인 전극(103)이 쌍을 이뤄 포함된다. 스캔 전극(102) 및 서스테인 전극(103)은 방전 전류를 제한하며 전극 쌍 간을 절연시켜주는 하나 이상의 상부 유전체층(104)에 의해 덮혀지고, 상부 유전체층(104) 상면에는 방전 조건을 용이하게 하기 위하여 산화마그네슘(MgO)을 증착한 보호층(105)이 형성된다.The front panel 100 is made of a scan electrode 102 and a sustain electrode 103, that is, a transparent electrode (a) formed of a transparent ITO material and a metal material to mutually discharge and maintain light emission of the cells in one discharge cell. The scan electrode 102 and the sustain electrode 103 provided as the bus electrode b are included in pairs. The scan electrode 102 and the sustain electrode 103 are covered by one or more upper dielectric layers 104 that limit the discharge current and insulate the electrode pairs, and to facilitate the discharge conditions on the upper dielectric layer 104 top surface. A protective layer 105 on which magnesium oxide (MgO) is deposited is formed.

후면 패널(110)은 복수개의 방전 공간 즉, 방전셀을 형성시키기 위한 스트라이프 타입(또는 웰 타입)의 격벽(112)이 평행을 유지하여 배열된다. 또한, 어드레스 방전을 수행하여 진공자외선을 발생시키는 다수의 어드레스 전극(113)이 격벽(112)에 대해 평행하게 배치된다. 후면 패널(110)의 상측면에는 어드레스 방전시 화상표시를 위한 가시광선을 방출하는 R, G, B 형광체(114)가 도포된다. 어드레스 전극(113)과 형광체(114) 사이에는 어드레스 전극(113)을 보호하기 위한 하부 유전체층(115)이 형성된다.The rear panel 110 is arranged such that a plurality of discharge spaces, that is, barrier ribs 112 of a stripe type (or well type) for forming discharge cells are maintained in parallel. In addition, a plurality of address electrodes 113 which perform address discharge to generate vacuum ultraviolet rays are arranged in parallel with the partition wall 112. On the upper side of the rear panel 110, R, G, and B phosphors 114 which emit visible light for image display during address discharge are coated. A lower dielectric layer 115 is formed between the address electrode 113 and the phosphor 114 to protect the address electrode 113.

이와 같은 플라즈마 디스플레이 패널에서 화상 계조를 구현하는 방법은 다음의 도 2와 같다.A method of implementing image gradation in such a plasma display panel is shown in FIG. 2.

도 2는 일반적인 플라즈마 디스플레이 패널의 화상 계조를 구현하는 방법을 나타낸 도이다.2 is a diagram illustrating a method of implementing image grayscale of a general plasma display panel.

도 2에 도시된 바와 같이, 종래 플라즈마 디스플레이 패널의 화상 계조(Gray Level) 표현 방법은 한 프레임을 발광횟수가 다른 여러 서브필드로 나누고, 각 서브필드는 다시 모든 셀들을 초기화시키기 위한 리셋 기간(RPD), 방전될 셀을 선택하기 위한 어드레스 기간(APD) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(SPD)으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 도 2와 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드 레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.As shown in FIG. 2, in the conventional method of expressing a gray level of a plasma display panel, a frame is divided into several subfields having different number of emission times, and each subfield is a reset period (RPD) for initializing all cells again. ) Is divided into an address period APD for selecting a cell to be discharged and a sustain period SPD for implementing gradation according to the number of discharges. For example, when displaying an image with 256 gray levels, a frame period (16.67 ms) corresponding to 1/60 second is divided into eight subfields SF1 to SF8 as shown in FIG. 2, and eight subfields. Each of the SFs SF1 to SF8 is divided into a reset period, an address period, and a sustain period.

각 서브필드의 리셋 기간 및 어드레스 기간은 각 서브필드마다 동일하다. 방전될 셀을 선택하기 위한 어드레스방전은 어드레스 전극과 스캔 전극인 투명전극 사이의 전압차에 의해 일어난다. 서스테인 기간은 각 서브필드에서 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가된다. 이와 같이 각 서브필드에서 서스테인 기간이 달라지게 되므로 각 서브필드의 서스테인 기간 즉, 서스테인 방전 횟수를 조절하여 화상의 계조를 표현하게 된다. 이러한 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 살펴보면 다음 도 3과 같다.The reset period and the address period of each subfield are the same for each subfield. The address discharge for selecting the cell to be discharged is caused by the voltage difference between the address electrode and the transparent electrode which is the scan electrode. The sustain period is increased at a rate of 2 n ( where n = 0, 1, 2, 3, 4, 5, 6, 7) in each subfield. In this way, since the sustain period is different in each subfield, the gray scale of the image is expressed by adjusting the sustain period of each subfield, that is, the number of sustain discharges. The driving waveforms according to the driving method of the plasma display panel are shown in FIG. 3.

도 3은 종래 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 나타낸 도이다. 3 is a diagram illustrating a driving waveform according to a driving method of a conventional plasma display panel.

도 3에 도시된 바와 같이, 플라즈마 디스플레이 패널은 모든 셀들을 초기화 시키기 위한 리셋 기간, 방전시킬 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인 기간으로 나뉘어 구동된다.As shown in FIG. 3, the plasma display panel is driven by being divided into a reset period for initializing all cells, an address period for selecting a cell to be discharged, and a sustain period for maintaining discharge of the selected cell.

리셋 기간에 있어서, 셋업 기간(SU) 동안에는 모든 스캔전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형에 의해 전화면의 방전셀들 내에는 방전이 일어난다. 이 셋업 방전에 의해 어드레스전극(X)과 서스테인전극(Z)상에는 정극성 벽전하가 쌓이게 되며, 스캔전극(Y)상에는 부극성의 벽전하가 쌓이게 된다. 셋 다운기간(SD)에는 상승 램프파형이 공급된 후, 상승 램프파형의 피크전압보다 낮은 정극성 전압에서부터 떨어지기 시작하여 기저전압(GND) 또는 부극성 의 특정 전압레벨까지 떨어지는 하강 램프파형(Ramp-down)이 인가된다. 이로인해 방전셀들 내에 미약한 소거방전이 발생되어 과도하게 형성된 벽 전하가 일부 소거되며, 이 셋 다운방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 방전셀들 내에 균일하게 잔류된다.In the reset period, the rising ramp waveform Ramp-up is simultaneously applied to all the scan electrodes Y during the setup period SU. Due to this rising ramp waveform, discharge occurs in the discharge cells of the full screen. By this setup discharge, positive wall charges are accumulated on the address electrode X and the sustain electrode Z, and negative wall charges are accumulated on the scan electrode Y. During the set-down period SD, after the rising ramp waveform is supplied, the ramp ramp starts to fall from the positive voltage lower than the peak voltage of the rising ramp waveform and then falls to the base voltage GND or the specific voltage level of the negative ramp. -down) is applied. As a result, a weak erase discharge is generated in the discharge cells, so that the excessively formed wall charge is partially erased, and the wall charge enough to cause the address discharge to be stably caused by the set down discharge remains uniformly in the discharge cells. .

어드레스기간에는 부극성 스캔 펄스(Scan)가 스캔 전극들(Y)에 순차적으로 인가됨과 동시에 스캔 펄스에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 이 스캔 펄스와 데이터 펄스의 전압 차와 초기화기간에 생성된 상기 벽 전하에 의한 벽 전압이 더해지면서 데이터펄스가 인가되는 방전셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 방전셀들 내에는 서스테인 전압이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 이때, 서스테인 전극(Z)에는 셋다운 기간과 어드레스기간 동안에 스캔 전극(Y)과의 전압차를 줄여 스캔 전극(Y)과의 오방전이 일어나지 않도록 하기 위한 정극성 직류전압(Zdc)이 공급된다.In the address period, the negative scan pulse Scan is sequentially applied to the scan electrodes Y, and the positive data pulse data is applied to the address electrodes X in synchronization with the scan pulse. An address discharge is generated in the discharge cell to which the data pulse is applied while the voltage difference between the scan pulse and the data pulse and the wall voltage caused by the wall charge generated in the initialization period are added. In the discharge cells selected by the address discharge, wall charges such that a discharge can occur when a sustain voltage is applied are formed. At this time, the positive electrode DC voltage Zdc is supplied to the sustain electrode Z to reduce the voltage difference between the scan electrode Y during the set-down period and the address period so as to prevent erroneous discharge from the scan electrode Y.

서스테인 기간에는 스캔 전극들(Y)과 서스테인 전극들(Z)에 교번적으로 서스테인 펄스(Sus)가 인가된다. 어드레스방전에 의해 선택된 방전셀은 방전셀 내의 벽 전압과 서스테인 펄스가 더해지면서 매 서스테인 펄스가 인가될 때 마다 스캔 전극(Y)과 서스테인 전극(Z)사이에 서스테인 방전 즉, 표시방전이 일어나게 된다.In the sustain period, a sustain pulse Su is applied to the scan electrodes Y and the sustain electrodes Z alternately. In the discharge cell selected by the address discharge, the sustain voltage, that is, the display discharge, is generated between the scan electrode Y and the sustain electrode Z every time the sustain pulse is applied as the wall voltage and the sustain pulse in the discharge cell are added.

한편, 상술한 바와 같은 플라즈마 디스플레이 장치는 서스테인 기간동안 스캔 전극(Y) 측과 서스테인 전극(Z) 측에 정극성(+)의 서스테인 펄스(sus)를 교번적으로 인가함에 따라 상대적으로 전위차가 낮은 어드레스 전극(X) 측에 양이온들이 쌓이게 된다. 이 때 전자(electron)들보다 상대적으로 무거운 양이온들이 상술한 어드레스 전극(X)이 형성된 후면 패널의 형광층(도 1의114)에 충격(ion bombardment)을 가하게 되어 플라즈마 디스플레이 장치의 수명을 단축시키는 원인이 되었다.On the other hand, the plasma display device as described above has a relatively low potential difference as the positive sustain pulse su is alternately applied to the scan electrode Y side and the sustain electrode Z side during the sustain period. Cations are accumulated on the address electrode X side. At this time, the cations, which are heavier than the electrons, exert an ion bombardment on the fluorescent layer (114 in FIG. 1) of the rear panel on which the above-described address electrode X is formed, which shortens the lifespan of the plasma display apparatus. Caused it.

이에, 최근에는 다음의 도 4에 도시된 바와 같이 상술한 서스테인 펄스(sus)를 부극성(-)의 전압 레벨을 갖도록 하여 상기 스캔 전극(Y)과 서스테인 전극(Z)이 형성된 후면 패널에 전자들이 쌓이도록 하는 네거티브 서스테인 방식의 구동이 이루어지고 있다.Recently, as shown in FIG. 4, the sustain pulse su is described above to have a negative voltage level, and electrons are formed on the rear panel on which the scan electrode Y and the sustain electrode Z are formed. Negative sustain is driven to accumulate.

도 4는 종래 플라즈마 디스플레이 패널의 네거티브 서스테인 구동 방법에 따른 구동파형을 나타낸 도이다.4 is a diagram illustrating a driving waveform according to a negative sustain driving method of a conventional plasma display panel.

도 4에 도시된 바와 같이, 서스테인 기간 동안 스캔 전극(Y)과 서스테인 전극(Z)에는 부극성의 네거티브 서스테인 펄스(-sus)가 서로 교번적으로 인가된다.  As shown in FIG. 4, a negative negative sustain pulse (-sus) is alternately applied to the scan electrode (Y) and the sustain electrode (Z) during the sustain period.

이에 따르면, 상술한 바와 같이 형광층(114)이 형성된 후면 패널(110)에는 상술한 네거티브 서스테인 펄스(-sus)에 의해 상대적으로 전자들이 쌓이게 된다. 따라서, 형광층(114)에 가해지는 충격이 감소된다. 반면, 전면 패널(100)에는 양이온이 쌓이는 과정에서, 상기 전면 패널(100) 상에 형성된 산화마그네슘(MgO) 층(105)에 이온 충격량을 증가시켜 2차 전자(secondary electorn) 발생률을 향상시키게 된다.Accordingly, as described above, electrons are accumulated in the rear panel 110 having the fluorescent layer 114 formed by the negative sustain pulse (-sus) described above. Thus, the impact on the fluorescent layer 114 is reduced. On the other hand, in the process of accumulating cations in the front panel 100, an ion bombardment amount is increased in the magnesium oxide (MgO) layer 105 formed on the front panel 100 to improve the secondary electoral generation rate. .

즉, 형광층(114)의 손실을 방지하면서도 2차 전자 발생량을 증가시켜 플라즈마 디스플레이 장치의 수명은 증가시키고 방전 개시 전압은 낮출 수 있다는 장점이 있었다.That is, while preventing the loss of the fluorescent layer 114, the secondary electron generation amount is increased to increase the lifetime of the plasma display device and to lower the discharge start voltage.

한편, 서스테인 기간동안 스캔 전극 또는 서스테인 전극에 네거티브(negative) 서스테인 펄스를 공급하는 반면, 어드레스 전극에는 그라운드(GND) 레벨의 전압이 유지되게 된다. 이와 같이 어드레스 전극에 그라운드 레벨의 전압이 유지되게 되면 어드레스 전극에는 스캔전극 및 서스테인 전극에 비하여 상대적으로 부극성 벽전하가 쌓이게 된다. 이러한 부극성 전하는 다음 서브필드의 리셋 기간에 전체 방전셀을 초기화 하는데 어려움을 주게 된다.On the other hand, while the negative sustain pulse is supplied to the scan electrode or the sustain electrode during the sustain period, the ground (GND) level voltage is maintained at the address electrode. As such, when the ground level voltage is maintained at the address electrode, negative wall charges are accumulated on the address electrode relative to the scan electrode and the sustain electrode. This negative charge has difficulty in initializing all the discharge cells in the reset period of the next subfield.

즉, 다음 서브필드의 리셋기간에 스캔전극에는 도면에 도시되어 있지 않지만, 소정의 전압을 갖는 정극성 램프파형의 리셋펄스를 공급하여 스캔전극에 부극성 벽전하를 쌓아 방전셀을 초기화하게 되는데, 이전 서브필드에서 어드레스 전극에 부극성 벽전하가 계속 유지되게 되면 스캔전극에 부극성 벽전하를 쌓는데 상대적으로 리셋 펄스의 전압을 높여야 하는 문제점이 있다. That is, in the reset period of the next subfield, although not shown in the drawing, the reset pulse of the positive ramp waveform having a predetermined voltage is supplied to accumulate negative wall charges on the scan electrodes to initialize the discharge cells. In the previous subfield, when the negative wall charge is maintained on the address electrode, there is a problem in that the voltage of the reset pulse needs to be increased relatively to accumulate the negative wall charge on the scan electrode.

따라서 리셋기간에 방전셀을 초기화 하기 위한 셋업전압을 상승하게 하여야 하는데, 이러한 셋업전압의 상승은 이후 어드레스 기간에 오방전을 야기 시킬수 있는 문제점을 가져온다. Therefore, it is necessary to increase the setup voltage for initializing the discharge cells in the reset period, and this increase in the setup voltage brings about a problem that may cause an erroneous discharge in the subsequent address period.

따라서 본 발명은 서스테인 기간에 스캔 전극 또는 서스테인 전극에 네거티브 서스테인 펄스 인가시 어드레스 전극에 인가되는 바이어스 전압을 개선하여 전체 방전특성을 향상시킬 수 있는 플라즈마 디스플레이 장치 및 그의 구동방법을 제공하는데 그 목적이 있다.Accordingly, an object of the present invention is to provide a plasma display apparatus and a driving method thereof which can improve overall discharge characteristics by improving a bias voltage applied to an address electrode when a negative sustain pulse is applied to a scan electrode or a sustain electrode in a sustain period. .

상술한 목적을 달성하기 위한 본 발명에 따른 플라즈마 디스플레이 장치는 서스테인 기간에 부극성 서스테인 펄스가 서로 교번적으로 인가되는 스캔전극 및 서스테인 전극과 셀 선택을 위한 어드레스 전극이 형성된 플라즈마 디스플레이 패널, 상기 전극들에 신호를 인가하여 상기 플라즈마 디스플레이 패널을 구동시키기 위한 각각의 구동부, 및 상기 구동부를 제어하여, 복수개 서브필드의 서스테인 기간에 상기 어드레스 전극에 상기 서스테인 기간동안 부극성 바이어스 전압이 유지되도록 하는 전압 조절부를 포함한다.A plasma display apparatus according to the present invention for achieving the above object is a plasma display panel in which a scan electrode and a sustain electrode and an address electrode for cell selection are alternately applied to the negative sustain pulse alternately applied to each other during the sustain period, the electrodes A control unit for driving the plasma display panel by applying a signal to the control unit, and a voltage adjusting unit configured to control the driving unit to maintain a negative bias voltage at the address electrode during the sustain period of the plurality of subfields. Include.

상기 부극성 바이어스 전압은 상기 부극성 서스테인 펄스의 전압보다 낮은 것을 특징으로 한다.The negative bias voltage is lower than the voltage of the negative sustain pulse.

본 발명에 따른 플라즈마 디스플레이 장치의 구동방법은 서스테인 기간에 스캔전극 및 서스테인 전극에 교번적으로 부극성 서스테인 펄스를 인가하여 방전을 지속시키고, 상기 스캔전극 및 서스테인 전극에 교차되는 어드레스전극에 상기 서스테인 기간동안 부극성 바이어스 전압을 유지시키는 것을 특징으로 한다.In the method of driving a plasma display device according to the present invention, discharge is sustained by alternately applying a negative sustain pulse to a scan electrode and a sustain electrode in a sustain period, and the sustain period is applied to an address electrode intersecting the scan electrode and the sustain electrode. While maintaining the negative bias voltage.

이하 첨부된 도면을 참조하여 본 발명에 따른 플라즈마 디스플레이 장치 및 그의 구동방법에 대해 상세히 설명하도록 한다.Hereinafter, a plasma display device and a driving method thereof according to the present invention will be described in detail with reference to the accompanying drawings.

도 5는 본 발명에 따른 플라즈마 디스플레이 장치를 설명하기 위한 도면이다.5 is a view for explaining a plasma display device according to the present invention.

도 5에 도시된 바와 같이, 본 발명에 따른 플라즈마 디스플레이 장치는 전술한 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1 내지 Xm), 스 캔 전극(Y1 내지 Yn) 및 서스테인 전극(Z)에 구동 펄스가 인가되고 적어도 하나 이상의 서브필드의 조합에 의하여 프레임으로 이루어지는 화상을 표현하는 플라즈마 디스플레이 패널(500)과, 플라즈마 디스플레이 패널(500)에 형성된 어드레스 전극들(X1 내지 Xm)에 데이터를 공급하기 위한 데이터 구동부(502)와, 스캔 전극들(Y1 내지 Yn)을 구동하기 위한 스캔 구동부(503)와, 공통전극인 서스테인 전극들(Z)을 구동하기 위한 서스테인 구동부(504)와, 서스테인 기간에 어드레스 전극에 인가되는 전압을 조절하는 전압 조절부(501), 및 각각의 구동부(502, 503, 504)에 필요한 구동전압을 공급하기 위한 구동전압 발생부(505)를 포함하여 이루어진다.As shown in FIG. 5, the plasma display device according to the present invention is provided with the address electrodes X1 to Xm, the scan electrodes Y1 to Yn, and the sustain electrode Z in the above-described reset period, address period and sustain period. Supplying data to the plasma display panel 500 expressing an image composed of a frame by applying a driving pulse and combining at least one subfield, and the address electrodes X1 to Xm formed on the plasma display panel 500. The data driver 502, the scan driver 503 for driving the scan electrodes Y1 to Yn, the sustain driver 504 for driving the sustain electrodes Z which are common electrodes, and the sustain period. Generation of a driving voltage for supplying a driving voltage necessary for the voltage adjusting unit 501 for adjusting the voltage applied to the address electrode, and for each of the driving units 502, 503, and 504. It comprises a 505. The

데이터 구동부(502)에는 도시하지 않은 역감마 보정회로, 오차확산회로 등에 의해 역감마보정 및 오차확산 된 후, 서브필드 맵핑회로에 의해 각 서브필드에 맵핑된 데이터가 공급된다. 이러한 데이터 구동부(502)는 타이밍 컨트롤부(미도시)로부터의 데이터 타이밍 제어신호(CTRX)에 응답하여 데이터를 샘플링하고 래치(latch)한 다음, 그 데이터를 어드레스 전극들(X1 내지 Xm)에 공급하게 된다. 또한, 소거 기간동안 소거 펄스를 어드레스 전극(X1 내지 Xm)들에 공급한다.The data driver 502 is subjected to inverse gamma correction and error diffusion by an inverse gamma correction circuit, an error diffusion circuit, and the like not shown, and then data mapped to each subfield is supplied by the subfield mapping circuit. The data driver 502 samples and latches data in response to a data timing control signal CTRX from a timing controller (not shown), and then supplies the data to the address electrodes X1 to Xm. Done. In addition, an erase pulse is supplied to the address electrodes X1 to Xm during the erase period.

스캔 구동부(503)는 리셋 기간동안 리셋 펄스를 스캔 전극들(Y1 내지 Yn)에 공급하고, 어드레스 기간동안 스캔 펄스를 스캔 전극들(Y1 내지 Yn)에 공급하고, 서스테인 기간 동안 네거티브 서스테인 펄스를 스캔 전극들(Y1 내지 Yn)에 공급하며, 소거 기간동안 소거 펄스를 스캔 전극들(Y1 내지 Yn)에 공급한다.The scan driver 503 supplies the reset pulses to the scan electrodes Y1 to Yn during the reset period, the scan pulses to the scan electrodes Y1 to Yn during the address period, and scans the negative sustain pulses during the sustain period. The electrodes are supplied to the electrodes Y1 to Yn, and an erase pulse is supplied to the scan electrodes Y1 to Yn during the erase period.

서스테인 구동부(504)는 어드레스 기간 동안 소정 크기의 바이어스전압을 서스테인 전극들(Z)에 공급하고, 서스테인 기간 동안 상술한 스캔 구동부(503)와 교 대로 동작하여 네거티브 서스테인 펄스(-sus)를 서스테인 전극들(Z)에 공급한다.The sustain driver 504 supplies a bias voltage having a predetermined magnitude to the sustain electrodes Z during the address period, and alternately operates with the scan driver 503 described above during the sustain period to generate a negative sustain pulse (-sus). To the field (Z).

전압 조절부(501)는 리셋 기간, 어드레스 기간, 서스테인 기간동안 각 전극에 인가되는 펄스의 전압을 조절한다. 이러한 전압 조절부(501)는 스캔 구동부나 서스테인 구동부 내부에 각 구동펄스의 전압원으로 이루어질 수 있다.The voltage adjusting unit 501 adjusts the voltage of the pulse applied to each electrode during the reset period, the address period, and the sustain period. The voltage adjusting unit 501 may be configured as a voltage source of each driving pulse in the scan driver or the sustain driver.

한편, 전술한 데이터 제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링클럭, 래치제어신호, 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 스캔 제어신호(CTRY)에는 스캔 구동부(503) 내의 에너지 회수회로(미도시)와 구동 스위치소자(미도시)의 온/오프타임을 제어하기 위한 스위치제어신호가 포함되고, 서스테인 제어신호(CTRZ)에는 서스테인 구동부(504) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다.The data control signal CTRX described above includes a sampling clock for latching data, a latch control signal, a switch control signal for controlling the on / off time of the energy recovery circuit and the driving switch element. The scan control signal CTRY includes a switch control signal for controlling on / off time of an energy recovery circuit (not shown) and a driving switch element (not shown) in the scan driver 503, and a sustain control signal CTRZ. Includes a switch control signal for controlling the on / off time of the energy recovery circuit and the drive switch element in the sustain driver 504.

구동전압 발생부(505)는 셋업전압(Vsetup), 스캔 공통전압(Vscan-com), 스캔전압(-Vy), 서스테인전압(Vs), 데이터전압(Vd) 등을 발생한다. 이러한 구동전압들은 방전가스의 조성이나 방전셀 구조에 따라 변할 수 있다.The driving voltage generator 505 generates a setup voltage Vsetup, a scan common voltage Vscan-com, a scan voltage -Vy, a sustain voltage Vs, a data voltage Vd, and the like. These driving voltages may vary depending on the composition of the discharge gas or the structure of the discharge cell.

도 6은 본 발명에 따른 플라즈마 디스플레이 장치의 구동방법을 설명하기 위한 파형도이다. 6 is a waveform diagram illustrating a method of driving a plasma display device according to the present invention.

도 6에 도시된 바와 같이, 본 발명에 따른 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널의 전 화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인 기간으로 나뉘어 구동된다.As shown in FIG. 6, the plasma display apparatus is driven by being divided into a reset period for initializing all screens of the plasma display panel, an address period for selecting cells, and a sustain period for maintaining discharge of the selected cells. do.

먼저, 리셋구간의 셋업기간에는 모든 스캔 전극(Y)에 셋업 전압(Vset-up)까지 상승하는 정극성 램프펄스를 동시에 인가하고, 서스테인 전극(Z)에는 부극성 펄스를 인가한다. 이 때, 부극성 펄스의 전압은 이후 서스테인 기간에 공급되는 네거티브 서스테인 펄스의 전압과 동일한 전압레벨이다. 이로 인해 스캔전극과 서스테인 전극간의 전위차로 인한 전 화면의 방전셀 내에서 미약한 방전을 일으키며 벽전하를 쌓는다. First, during the setup period of the reset section, the positive ramp pulse rising up to the setup voltage Vset-up is simultaneously applied to all the scan electrodes Y, and the negative pulse is applied to the sustain electrode Z. At this time, the voltage of the negative pulse is the same voltage level as that of the negative sustain pulse supplied in the subsequent sustain period. This causes a weak discharge in the discharge cells of the entire screen due to the potential difference between the scan electrode and the sustain electrode to accumulate wall charges.

이후, 셋 다운 기간에 셋업기간에 방전셀에 과도하게 쌓인 벽전하를 소거시켜 전체 방전셀의 벽전하가 균일화 될 수 있도록 모든 스캔전극(Y)에 그라운드 레벨에서 시작하여 소정의 전압(-Vy)까지 하강하는 부극성 램프펄스를 인가하고, 동시에 서스테인 전극에는 그라운드 레벨을 유지시킨다. Thereafter, in the set-down period, the wall charges accumulated in the discharge cells are erased in the set-up period so that the wall charges of all the discharge cells can be uniformed. A negative ramp pulse descending until is applied, and at the same time, the ground electrode is maintained at the sustain electrode.

어드레스 기간에는 스캔전극(Y)에 그라운드 전압 레벨보다 낮고 이후 서스테인 기간에 인가되는 부극성 서스테인 펄스의 전압(-Vs)보다 높은 스캔바이어스 전압(Vscan)을 유지하면서 부극성 스캔 펄스(-Vsp)를 공급한다. 이때, 서스테인 전극에는 셋 다운 기간에 공급된 그라운드 레벨이 유지된다. 또한, 어드레스 전극(X)은 스캔전극에 인가된 부극성 스캔 펄스(-Vsp)와 동기되게 데이터 펄스를 공급한다. 이에 따라 부극성 스캔펄스와 데이터 펄스의 전압 차와 리셋기간에 생성된 벽 전압이 더해지면서 데이터 펄스가 인가되는 셀 내에는 어드레스 방전이 발생된다. In the address period, the negative scan pulse (-Vsp) is applied to the scan electrode (Y) while maintaining the scan bias voltage (Vscan) lower than the ground voltage level and higher than the voltage (-Vs) of the negative sustain pulse applied in the sustain period. Supply. At this time, the ground level supplied to the sustain electrode during the set down period is maintained. In addition, the address electrode X supplies a data pulse in synchronization with the negative scan pulse -Vsp applied to the scan electrode. As a result, the voltage difference between the negative scan pulse and the data pulse and the wall voltage generated during the reset period are added, and an address discharge is generated in the cell to which the data pulse is applied.

서스테인 기간에는 스캔 전극 및 서스테인 전극에 교번적으로 부극성 서스테인 펄스(sus)가 인가한다. 이러한 부극성 서스테인 펄스는 어드레스 기간에 선택된 셀내의 벽전압에 더하여 매 부극성 서스테인 펄스가 인가될 때 마다 스캔 전극 및 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다. 이때, 어드레스 전극에는 부극성 바이어스 전압(-Vd)이 유지된다. 이러한 부극성 바이어스의 절대치 전압은 스캔 전극 및 서스테인 전극에 인가되는 부극성 서스테인 펄스의 절대치 전압보다 더 작다. 이에 따라 서스테인 기간시 방전 공간에 있는 공간 전하 중 양(+)전하는 어드레스 전극 상부에 쌓이게 된다. In the sustain period, a negative sustain pulse sus is alternately applied to the scan electrode and the sustain electrode. Such a negative sustain pulse causes a sustain discharge, that is, a display discharge, between the scan electrode and the sustain electrode every time a negative sustain pulse is applied in addition to the wall voltage in the cell selected in the address period. At this time, the negative bias voltage (-Vd) is maintained at the address electrode. The absolute voltage of this negative bias is smaller than the absolute voltage of the negative sustain pulses applied to the scan electrode and the sustain electrode. Accordingly, positive charges in the space charges in the discharge space during the sustain period are accumulated on the address electrode.

이와 같이 어드레스 전극 상부에 양전하가 쌓이게 되면 다음 서브필드의 리셋 기간에 전체 방전 셀 내의 벽전하를 쉽게 균일하게 할 수 있다. 이는 다음 서브필드의 리셋기간에 스캔전극에 정극성 램프펄스를 인가하여 부극성 벽전하를 쌓는데 종래 서스테인 기간동안 어드레스 전극이 그라운드 레벨로 유지될 때보다 상대적으로 유리하기 때문이다.When positive charges accumulate on the address electrode in this manner, the wall charges in the entire discharge cells can be easily uniformed in the reset period of the next subfield. This is because a negative wall pulse is applied to the scan electrodes in the reset period of the next subfield to accumulate negative wall charges, because it is more advantageous than when the address electrodes are maintained at the ground level during the conventional sustain period.

이에 따라 다음 리셋기간시 방전셀 초기화를 위한 리셋 전압의 상승을 방지할 수 있게 된다.Accordingly, it is possible to prevent the rise of the reset voltage for initializing the discharge cells during the next reset period.

이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.As such, the technical configuration of the present invention described above can be understood by those skilled in the art that the present invention can be implemented in other specific forms without changing the technical spirit or essential features of the present invention.

그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.Therefore, the exemplary embodiments described above are to be understood as illustrative and not restrictive in all respects, and the scope of the present invention is indicated by the appended claims rather than the foregoing detailed description, and the meaning and scope of the claims are as follows. And all changes or modifications derived from the equivalent concept should be interpreted as being included in the scope of the present invention.

이와 같은 본 발명은 네거티브 서스테인 펄스를 인가하여 플라즈마 디스플레이 패널을 구동할때, 어드레스 전극이 소정의 전압을 유지함에 따라 다음 서브필드의 리셋기간에 초기화가 잘 이루어지고, 이에 서브필드의 각 기간에 전체 방전 특성이 향상되는 효과가 있다.In the present invention as described above, when the plasma display panel is driven by applying a negative sustain pulse, the address electrode maintains a predetermined voltage, so that the initialization is performed well in the reset period of the next subfield. There is an effect that the discharge characteristics are improved.

Claims (3)

서스테인 기간에 부극성 서스테인 펄스가 서로 교번적으로 인가되는 스캔전극 및 서스테인 전극과 셀 선택을 위한 어드레스 전극이 형성된 플라즈마 디스플레이 패널;A plasma display panel including a scan electrode and a sustain electrode to which negative sustain pulses are alternately applied in the sustain period, and an address electrode for cell selection; 상기 전극들에 신호를 인가하여 상기 플라즈마 디스플레이 패널을 구동시키기 위한 각각의 구동부; 및 Respective driving units for driving the plasma display panel by applying a signal to the electrodes; And 상기 구동부를 제어하여, 복수개 서브필드의 서스테인 기간에 상기 어드레스 전극에 상기 서스테인 기간동안 부극성 바이어스 전압이 유지되도록 하는 전압 조절부The voltage adjusting unit controls the driving unit to maintain the negative bias voltage at the address electrode during the sustain period of the plurality of subfields. 를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 장치.Plasma display device comprising a. 제 1항에 있어서,The method of claim 1, 상기 부극성 바이어스 전압은 상기 부극성 서스테인 펄스의 전압보다 낮은 것을 특징으로 하는 플라즈마 디스플레이 장치.The negative bias voltage is lower than the voltage of the negative sustain pulse. 서스테인 기간에 스캔전극 및 서스테인 전극에 교번적으로 부극성 서스테인 펄스를 인가하여 방전을 지속시키는 플라즈마 디스플레이 장치의 구동방법에 있어서,In the driving method of the plasma display apparatus which sustains the discharge by applying a negative sustain pulse alternately to the scan electrode and the sustain electrode in the sustain period, 상기 스캔전극 및 서스테인 전극에 교차되는 어드레스전극에 상기 서스테 인 기간동안 부극성 바이어스 전압을 유지시키는 것을 특징으로 하는 플라즈마 디스플레이 장치의 구동방법.And maintaining a negative bias voltage at an address electrode crossing the scan electrode and the sustain electrode during the sustain period.
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