KR100638958B1 - Method for forming fine patterns of semiconductor device - Google Patents
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Abstract
본 발명은 반도체 소자의 미세 패턴 형성 방법에 관한 것으로, 비결정 탄소층으로 미세 패턴의 단차를 매립하고 상기 비결정 탄소층 상부에 얇고 균일한 두께의 감광막을 형성하여 해상도, 노광 여유도 및 초점 여유도를 향상시키며, 임플란트 공정시 반사 방지막 및 감광막 패턴의 이중막이 임플란트 마스크 역할을 하므로 임플란트 불량을 방지하는 기술이다.The present invention relates to a method for forming a fine pattern of a semiconductor device, by filling a step of a fine pattern with an amorphous carbon layer and forming a thin and uniform thickness photosensitive film on the amorphous carbon layer to improve the resolution, exposure margin and focus margin In the implant process, an anti-reflection film and a double layer of a photoresist pattern serve as an implant mask, thereby preventing implant defects.
Description
도 1a 내지 도 1d는 종래 기술에 따른 반도체 소자의 미세 패턴 형성 방법을 도시한 단면도들. 1A to 1D are cross-sectional views illustrating a method for forming a fine pattern of a semiconductor device according to the prior art.
도 2a 내지 도 2h는 본 발명에 따른 반도체 소자의 미세 패턴 형성 방법을 도시한 단면도들. 2A to 2H are cross-sectional views illustrating a method for forming a fine pattern of a semiconductor device according to the present invention.
< 도면의 주요 부분에 대한 부호 설명 ><Explanation of Signs of Major Parts of Drawings>
10, 100 : 반도체 기판 20, 110 : 미세 패턴10, 100:
30, 130, 150 : 감광막 40, 160 : 노광 마스크30, 130, 150:
50, 170 : 임플란트 영역 120 : 비결정 탄소층50, 170: implant region 120: amorphous carbon layer
140 : 반사 방지막 140: antireflection film
본 발명은 반도체 소자의 미세 패턴 형성 방법에 관한 것으로, 비결정 탄소층으로 미세 패턴의 단차를 매립하여 상기 비결정 탄소층 상부에 얇고 균일한 두께의 감광막을 형성하여 해상도, 노광 여유도 및 초점 여유도를 향상시키며, 임플란 트 공정시 반사 방지막 및 감광막 패턴의 이중막이 임플란트 마스크 역할을 하므로 임플란트 불량을 방지하는 기술이다.The present invention relates to a method for forming a fine pattern of a semiconductor device, by filling a step of a fine pattern with an amorphous carbon layer to form a thin and uniform thickness photosensitive film on the amorphous carbon layer to improve the resolution, exposure margin and focus margin In the implant process, an antireflection film and a double layer of a photoresist pattern serve as an implant mask, thereby preventing implant defects.
도 1a 내지 도 1d는 종래 기술에 따른 반도체 소자의 미세 패턴 형성 방법을 도시한 단면도들이다. 1A to 1D are cross-sectional views illustrating a method for forming a fine pattern of a semiconductor device according to the prior art.
도 1a를 참조하면, 단차가 있는 미세 패턴(20)이 형성된 반도체 기판(10) 상부에 감광막(30)을 형성한다. Referring to FIG. 1A, the
이때, 상기 단차상에 감광막(30)이 완전히 매립되지 않아 'A'와 같은 보이드가 발생된다. 상기 보이드는 단차의 깊이가 깊을수록 단차간의 간격이 좁을 수록 많이 발생된다. At this time, the
도 1b를 참조하면, 소정의 노광 마스크(40)를 사용하여 감광막(30)을 노광한다.Referring to FIG. 1B, the
도 1c를 참조하면, 임플란트 예정 부분만 제거되도록 감광막(30)을 현상한다. 감광막(30)을 현상한 후에도 'A'와 같은 보이드가 남게 된다. Referring to FIG. 1C, the
도 1d를 참조하면, 감광막(30)을 마스크로 임플란트를 수행한다. 이때, 상기'A'와 같은 보이드로 인해 감광막(30)의 두께가 얇아져서'B'와 같이 예정되지 않은 부분에도 임플란트 되는 문제점이 발생한다. Referring to FIG. 1D, an implant is performed using the
상술한 종래 기술에 따른 반도체 소자의 미세 패턴 형성 방법에서, 단차가 있는 미세 패턴 상부에 감광막을 형성하면 보이드가 발생한다. 상기 보이드는 단차의 깊이가 깊고 단차간의 간격이 좁을 수록 많이 발생하며, 임플란트 예정 부분만 제거되도록 감광막을 노광하는 과정에서 마스크로 작용하는 상기 감광막의 두께가 얇아져서 임플란트시 원하지 않는 영역에도 임플란트가 수행되는 문제점이 있다. In the above-described method of forming a fine pattern of a semiconductor device according to the related art, voids are generated when a photosensitive film is formed on an upper portion of a fine pattern having steps. The voids are generated more as the depth of the step is deeper and the gap between the steps is narrower, and the thickness of the photosensitive film acting as a mask becomes thinner in the process of exposing the photoresist film so that only the portion of the implant is to be removed. There is a problem.
상기 문제점을 해결하기 위하여, 비결정 탄소층으로 미세 패턴의 단차를 매립하고 상기 비결정 탄소층 상부에 얇고 균일한 두께의 감광막을 형성하여 해상도, 노광 여유도 및 초점 여유도를 향상시키며, 임플란트 공정시 반사 방지막 및 감광막 패턴의 이중막이 임플란트 마스크 역할을 하므로 임플란트 불량을 방지하는 반도체 소자의 미세 패턴 형성 방법을 제공하는 것을 그 목적으로 한다. In order to solve the above problems, a step of filling a fine pattern with an amorphous carbon layer and forming a thin and uniform thickness photosensitive film on the amorphous carbon layer to improve the resolution, exposure margin and focus margin, reflection in the implant process It is an object of the present invention to provide a method for forming a fine pattern of a semiconductor device that prevents implant defects because the double layer of the anti-film and the photosensitive film pattern serves as an implant mask.
본 발명에 따른 반도체 소자의 미세 패턴 형성 방법은Method for forming a fine pattern of a semiconductor device according to the present invention
반도체 기판 상부에 미세 패턴을 형성하는 단계와,Forming a fine pattern on the semiconductor substrate;
상기 미세 패턴을 포함하는 반도체 기판 상부에 비결정 탄소층를 형성하는 단계와,Forming an amorphous carbon layer on the semiconductor substrate including the fine pattern;
상기 비결정 탄소층 상부에 제 1 감광막을 형성하는 단계와,Forming a first photoresist film on the amorphous carbon layer;
상기 제 1 감광막 및 소정 두께의 비결정 탄소층을 평탄화하는 단계와,Planarizing the first photosensitive film and the amorphous carbon layer having a predetermined thickness;
평탄화된 비결정 탄소층 상부에 반사 방지막을 형성하는 단계와,Forming an anti-reflection film on the planarized amorphous carbon layer,
상기 반사 방지막 상부에 제 2 감광막을 형성하는 단계와,Forming a second photoresist film on the anti-reflection film;
소정의 노광 마스크를 사용하여 상기 제 2 감광막을 노광하고 현상하여 제 2 감광막 패턴을 형성하는 단계와,Exposing and developing the second photoresist film using a predetermined exposure mask to form a second photoresist pattern;
상기 제 2 감광막 패턴을 마스크로 상기 반사 방지막을 식각하는 단계와,Etching the anti-reflection film using the second photoresist pattern as a mask;
상기 제 2 감광막 패턴 및 상기 반사 방지막을 마스크로 상기 비결정 탄소층 과 제 2 감광막 패턴을 동시에 제거하는 단계와,Simultaneously removing the amorphous carbon layer and the second photoresist pattern using the second photoresist pattern and the anti-reflection coating as a mask;
상기 반사 방지막 및 비결정 탄소층을 마스크로 임플란트를 수행하는 단계Implanting the anti-reflection film and the amorphous carbon layer as a mask
를 포함하는 것을 특징으로 한다. Characterized in that it comprises a.
이하에서는 본 발명의 실시예를 첨부한 도면을 참조하여 상세히 설명하기로 한다. Hereinafter, with reference to the accompanying drawings an embodiment of the present invention will be described in detail.
도 2a 내지 도 2h는 본 발명에 따른 반도체 소자의 미세 패턴 형성 방법을 도시한 단면도들이다. 2A to 2H are cross-sectional views illustrating a method of forming a fine pattern of a semiconductor device according to the present invention.
도 2a를 참조하면, 반도체 기판(100) 상부에 단차가 있는 미세 패턴(110)을 형성하고, 미세 패턴(110)을 포함하는 반도체 기판(100) 상부에 비결정 탄소층(120)을 형성한다. Referring to FIG. 2A, the
비결정 탄소층(120)은 CCP(Capacitive Coupled PE-CVD)공정으로 400 내지 550℃의 온도 및 1 내지 5 Torr 압력에서 형성하며, 미세 패턴(110) 상부로부터 1800 내지 2200Å의 두께가 되도록 형성한다. 이때, 비결정 탄소층(120)은 미세 패턴(110)의 단차를 따라 형성되는 컨포멀 코팅(Conformal Coating)으로 보이드가 발생하지 않는다. The
도 2b 및 도 2c를 참조하면, 비결정 탄소층(120) 상부에 제 1 감광막(130)을 1000 내지 2000Å의 두께로 형성하고, O2 플라즈마를 이용하여 제 1 감광막(130) 및 소정 두께의 비결정 탄소층(120)을 평탄화하여 도 2c와 같이 평탄화된 비결정 탄소층(120)을 형성한다.
2B and 2C, the first
도 2d를 참조하면, 평탄화된 비결정 탄소층(120) 상부에 반사 방지막(140) 및 제 2 감광막(150)을 형성하고, 소정의 노광 마스크(160)를 사용하여 제 2 감광막(150)을 노광한다. Referring to FIG. 2D, an
이때, 반사 방지막(140)은 450 내지 550Å 두께의 SiON층으로 형성하며, 제 2 감광막(150)은 각각 1000 내지 2000Å의 두께로 형성하는 것이 바람직하다. At this time, the
도 2e를 참조하면, 제 2 감광막(150)을 현상하여 제 2 감광막 패턴(155)을 형성한다. 제 2 감광막(150)의 현상 공정은 표준적 알칼리 현상액인 2.38% TMAH(tetra-methylammonium hydroxide) 용액을 이용하여 30 내지 40초 동안 수행하는 것이 바람직하다. Referring to FIG. 2E, the second
도 2f를 참조하면, 제 2 감광막 패턴(155)을 마스크로 반사 방지막(140)을 식각한다. Referring to FIG. 2F, the
여기서, 반사 방지막(140)을 식각하는 공정은 CF4 플라즈마를 사용하여 수행한다. Here, the process of etching the
도 2g를 참조하면, 제 2 감광막 패턴(155) 및 반사 방지막(140)을 마스크로 비결정 탄소층(120)을 식각함과 동시에 제 2 감광막 패턴(155)을 제거한다. Referring to FIG. 2G, the
비결정 탄소층(120)을 식각하는 공정은 O2 플라즈마를 사용하여 수행하며, 이때 제 2 감광막 패턴(155)이 동시에 식각되어 제거된다. The etching of the
도 2h를 참조하면, 반사 방지막(140) 및 비결정 탄소층(120)을 마스크로 임플란트를 수행한다.
Referring to FIG. 2H, an implant is performed using the
이때, 반사 방지막(140) 및 비결정 탄소층(120)의 이중막이 임플란트 마스크 역할을 하므로 임플란트 불량이 발생하지 않는다. At this time, since the double layer of the
본 발명에 따른 반도체 소자의 미세 패턴 형성 방법은 비결정 탄소층으로 미세패턴의 단차를 매립하고 상기 비결정 탄소층 상부에 얇고 균일한 두께의 감광막을 형성하여 해상도, 노광 여유도 및 초점 여유도를 향상시키며, 임플란트 공정시 반사 방지막 및 감광막 패턴의 이중막이 임플란트 마스크 역할을 하므로 임플란트 불량이 방지되는 효과가 있다. The method of forming a fine pattern of a semiconductor device according to the present invention improves resolution, exposure margin and focus margin by filling a step of fine pattern with an amorphous carbon layer and forming a thin and uniform photosensitive film on the amorphous carbon layer. In the implant process, an antireflection film and a double layer of a photoresist pattern serve as an implant mask, thereby preventing implant defects.
아울러 본 발명의 바람직한 실시예는 예시의 목적을 위한 것으로, 당업자라면 첨부된 특허청구범위의 기술적 사상과 범위를 통해 다양한 수정, 변경, 대체 및 부가가 가능할 것이며, 이러한 수정 변경 등은 이하의 특허청구범위에 속하는 것으로 보아야 할 것이다
In addition, a preferred embodiment of the present invention is for the purpose of illustration, those skilled in the art will be able to various modifications, changes, substitutions and additions through the spirit and scope of the appended claims, such modifications and changes are the following claims It should be seen as belonging to a range
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020040114107A KR100638958B1 (en) | 2004-12-28 | 2004-12-28 | Method for forming fine patterns of semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020040114107A KR100638958B1 (en) | 2004-12-28 | 2004-12-28 | Method for forming fine patterns of semiconductor device |
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Publication Number | Publication Date |
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KR20060075333A KR20060075333A (en) | 2006-07-04 |
KR100638958B1 true KR100638958B1 (en) | 2006-10-26 |
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ID=37167884
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020040114107A KR100638958B1 (en) | 2004-12-28 | 2004-12-28 | Method for forming fine patterns of semiconductor device |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100638958B1 (en) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100843948B1 (en) | 2006-07-10 | 2008-07-03 | 주식회사 하이닉스반도체 | Method for forming fine pattern of semiconductor device |
KR100912958B1 (en) * | 2006-09-28 | 2009-08-20 | 주식회사 하이닉스반도체 | Method for fabricating fine pattern in semiconductor device |
DE102006053956B4 (en) * | 2006-11-15 | 2011-03-31 | Qimonda Ag | Method for producing a semiconductor device, semiconductor device, in particular semiconductor memory device |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1041212A (en) | 1996-07-23 | 1998-02-13 | Oki Electric Ind Co Ltd | Resist pattern forming method |
JP2000138156A (en) | 1998-11-04 | 2000-05-16 | Nippon Telegr & Teleph Corp <Ntt> | Pattern forming method |
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JP2000138156A (en) | 1998-11-04 | 2000-05-16 | Nippon Telegr & Teleph Corp <Ntt> | Pattern forming method |
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---|---|
KR20060075333A (en) | 2006-07-04 |
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