KR100634689B1 - 플라즈마 디스플레이 패널 및 구동방법 - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 패널의 구동장치 및 구동방법에 관한 것이다.
이와 같은 본 발명은 발광횟수가 다른 다수개의 서브필드가 초기화구간, 어드레스 구간, 서스테인 구간으로 나뉘어 화상을 구현하고, 제 1서브필드의 서스테인 구간에서 스캔 전극에 최후 서스테인 펄스가 인가되고, 상기 서스테인 구간의 소정기간 동안 어드레스 전극에 상승 램프 펄스가 인가된 후, 제 1 전압으로 유지되는 제 1유지 펄스가 인가되고, 상기 제 1서브필드를 제외한 나머지 서브필드의 초기화 구간에 상기 스캔 전극에 하강 램프 펄스가 인가되고, 동시에 상기 서스테인 전극에 제 1서브필드의 서스테인 전압과 동일한 전압의 제 2유지펄스가 인가되고, 상기 어드레스 전극에는 상기 제 1전압과 동일한 전압으로 유지되는 제 1 유지펄스가 인가되고, 상기 제 1서브필드를 제외한 나머지 서브필드의 어드레스 구간에 상기 스캔 전극(Y)에 정극성 스캔 펄스가 인가되고, 상기 스캔 펄스와 동기되도록 상기 어드레스 전극에 부극성 데이터 펄스가 인가되는 것을 특징으로 한다.

Description

플라즈마 디스플레이 패널 및 구동방법{Plasma Display Panel and Driving Method thereof}
도 1은 종래 3전극 교류 면방전형 PDP의 구조를 나타낸 사시도.
도 2는 종래 PDP의 화상 계조를 표현하는 방법을 나타낸 도.
도 3은 종래 PDP의 구동방법을 설명하기 위한 구동파형을 나타낸 도.
도 4는 본 발명에 따른 플라즈마 디스플레이 패널의 구동장치를 나타낸 도.
도 5는 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법을 설명하기 위한 구동파형을 나타낸 도.
***** 도면의 주요 부분에 대한 부호의 설명 *****
100: PDP 102: 스캔 구동부
104: 서스테인 구동부 106: 데이터 구동부
본 발명은 플라즈마 디스플레이 패널 및 그의 구동방법에 관한 것으로, 더욱 자세하게는 플라즈마 디스플레이 패널 구동방법을 달리하여 구동마진 및 콘트라스트 특성을 향상시킬 수 있는 플라즈마 디스플레이 패널 및 그의 구동방법에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 He+Xe 또는 Ne+Xe 불활성 혼합가스의 방전시 발생하는 147nm의 자외선에 의해 형광체를 발광시킴으로써 문자 또는 그래픽을 포함한 화상을 표시하게 된다.
도 1은 종래 3전극 교류 면방전형 PDP의 구조를 나타낸 사시도이다. 도 1을 참조하면, 3전극 교류 면방전형 PDP는 상부기판(10) 상에 형성되어진 주사/서스테인전극(11a) 및 공통서스테인전극(12a)과, 하부기판(20) 상에 형성되어진 어드레스전극(22)을 구비한다. 주사/서스테인전극(11a)과 공통서스테인전극(12a) 각각은 투명전극 예를 들면, 인듐틴옥사이드(Indium-Tin-Oxide : ITO)로 형성된다. 주사/서스테인전극(11a)과 공통서스테인전극(12a) 각각에는 저항을 줄이기 위한 금속버스전극(11b,12b)이 형성된다. 주사/서스테인전극(11a)과 공통서스테인전극(12a)이 형성된 상부기판(10)에는 상부 유전체 층(13a)과 보호막(14)이 적층된다. 상부 유전체 층(13a)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(14)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체 층(13a)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(14)으로는 통상 산화마그네슘(MgO)이 이용된다.
한편, 어드레스전극(22)이 형성된 하부기판(20) 상에는 하부 유전체 층(13b), 격벽(21)이 형성되며, 하부 유전체 층(13b)과 격벽(21)의 표면에는 형광체 층(23)이 도포된다. 어드레스전극(22)은 주사/서스테인전극(11a) 및 공통서스테인전극(12a)과 교차되는 방향으로 형성된다. 격벽(21)은 어드레스전극(22)과 나란하 게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층(23)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상부 기판 및 하부기판(10,20)과 격벽(21) 사이에 마련된 방전셀의 방전공간에는 방전을 위한 He+Xe 또는 Ne+Xe 등의 불활성 혼합가스가 주입된다. 이와 같은 구조를 갖는 종래 PDP의 화상 계조를 표현하는 방법을 살펴보면 다음 도 2와 같다.
도 2는 종래 PDP의 화상 계조를 표현하는 방법을 나타낸 것이다. 도시된 바와 같이, PDP의 화상계조는 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 구동하고 있다. 각 서브필드는 방전을 균일하게 일으키기 위한 리셋 기간, 방전 셀을 선택하기 위한 어드레스 기간 및 방전횟수에 따라 계조를 구현하는 서스테인 기간으로 나뉘어 진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들로 나누어지게 된다. 아울러, 8개의 서브 필드들 각각은 어드레스 기간과 서스테인 기간으로 다시 나누어지게 된다. 여기서, 각 서브필드의 리셋기간 및 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간은 각 서브필드에서 2n (n = 0,1,2,3,4,5,6,7)의 비율로 증가된다. 상기 서브필드로 나뉘어 구동되는 PDP 구동파형을 살펴보면 다음과 같다.
도 3은 종래 PDP의 구동방법을 설명하기 위한 구동파형을 나타낸 것이다. 도 3을 살펴보면, PDP는 전 화면을 초기화시키기 위한 초기화구간, 셀을 선택하기 위한 어드레스 구간 및 선택된 셀의 방전을 유지시키기 위한 서스테인 구간으로 나뉘 어 구동된다.
초기화구간에 있어서, 셋업 기간(SU)에는 모든 스캔전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 상승 램프파형에 의해 전화면의 셀들 내에는 방전이 일어난다. 이 셋업 방전에 의해 어드레스전극(X)과 서스테인전극(Z)상에는 정극성 벽전하가 쌓이게 되며, 스캔전극(Y)상에는 부극성의 벽전하가 쌓이게 된다. 셋 다운기간(SD)에는 상승 램프파형이 인가된 후, 상승 램프파형의 피크전압보다 낮은 정극성 전압서 떨어지기 시작하여 기저전압(GND) 또는 부극성의 특정 전압레벨까지 떨어지는 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 과도하게 형성된 벽 전하를 일부 소거시키게 된다. 이 셋 다운방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.
어드레스구간에는 부극성 스캔 펄스(Scan)가 스캔 전극들(Y)에 순차적으로 인가됨과 동시에 스캔 펄스에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 이 스캔 펄스와 데이터 펄스의 전압 차와 초기화기간에 생성된 벽 전압이 더해지면서 데이터펄스가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 서스테인 전압이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 서스테인 전극(Z)에는 셋다운 기간과 어드레스기간 동안에 스캔 전극(Y)과의 전압차를 줄여 스캔 전극(Y)과의 오방전이 일어나지 않도록 정극성 직류전압(Zdc)이 공급된다.
서스테인 구간에는 스캔 전극들(Y)과 서스테인 전극들(Z)에 교번적으로 서스 테인 펄스(Sus)가 인가된다. 어드레스방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테인 펄스가 더해지면서 매 서스테인 펄스가 인가될 때 마다 스캔 전극(Y)과 서스테인 전극(Z)사이에 서스테인 방전 즉, 표시방전이 일어나게 된다.
서스테인 방전이 완료된 후에는 펄스폭과 전압레벨이 작은 램프파형(Ramp-ers)이 서스테인 전극(Z)에 인가되어 전화면의 셀들 내에 잔류하는 벽 전하를 소거시키게 된다.
한편, 서스테인 구간에 인가되는 서스테인 펄스의 수는 이전 어드레스 구간에서 방전 셀의 어드레싱 방전 유, 무와 관계없이 APL값에 따라 스캔 전극 및 서스테인 전극들에 교번적으로 인가하게 된다. 이 때문에 서스테인 방전 후, 방전 셀 내의 벽전하 분포는 불균일하게 형성된다. 이러한 벽전하의 불균일한 분포는 다음 서브필드에서의 방전 특성에 악역향을 끼쳐 오방전 또는 이상방전을 야기시킨다.
따라서 전술한 바와 같이, 종래에는 소거구간을 두어 방전셀 내에 불균일적으로 형성된 벽전하를 거의 대부분을 소거시키고 다음 서브필드의 리셋 구간에서 리셋펄스를 인가하여 안정적인 벽전하 분포에서 방전이 일어날 수 있도록 하는 구동방법을 취하고 있다.
그러나 이와 같은 구동방법은 PDP가 대형화 및 고해상도로 감에 따라 충분한 구동마진을 확보할 수 없는 문제점이 있다. 또한, 초기화 구간에서 발생되는 암방전은 PDP의 콘트라스트 특성을 저하시키는 문제점이 있다.
따라서 본 발명은 플라즈마 디스플레이 패널 구동시 구동방법을 달리하여 콘 트라스트 특성 및 구동마진의 효율을 향상시킬 수 있는 플라즈마 디스플레이 패널 및 구동방법을 제공하는데 그 목적이 있다.
상술한 목적을 달성하기 위한 본 발명에 따른 플라즈마 디스플레이 패널의 구동장치 및 구동방법은 발광횟수가 다른 다수개의 서브필드가 초기화구간, 어드레스 구간, 서스테인 구간으로 나뉘어 화상을 구현하는 플라즈마 디스플레이 패널 구동장치에 있어서, 제 1서브필드의 서스테인 구간에서 스캔 전극에 최후 서스테인 펄스가 인가되고, 상기 서스테인 구간의 소정기간 동안 어드레스 전극에 상승 램프 펄스가 인가된 후, 제 1 전압으로 유지되는 제 1유지 펄스가 인가되고, 상기 제 1서브필드를 제외한 나머지 서브필드의 초기화 구간에 상기 스캔 전극에 하강 램프 펄스가 인가되고, 동시에 상기 서스테인 전극에 제 1서브필드의 서스테인 전압과 동일한 전압의 제 2유지펄스가 인가되고, 상기 어드레스 전극에는 상기 제 1전압과 동일한 전압으로 유지되는 제 1 유지펄스가 인가되고, 상기 제 1서브필드를 제외한 나머지 서브필드의 어드레스 구간에 상기 스캔 전극(Y)에 정극성 스캔 펄스가 인가되고, 상기 스캔 펄스와 동기되도록 상기 어드레스 전극에 부극성 데이터 펄스가 인가되는 것을 특징으로 한다.
상기 상승 램프 펄스는 서브필드의 서스테인 구간동안 스캔 전극 및 서스테인 전극에 서스테인 펄스가 각각 10개 이상 인가될 때 데이터 전극에 인가되는 것을 특징으로 한다.
상기 데이터 전극에 인가되는 상승 램프 펄스의 소정기간은 상기 서브필드의 서스테인 구간동안 스캔 전극 및 서스테인 전극에 서스테인 펄스가 각각 5개이상 30개이하 인가되는 기간인 것을 특징으로 한다.
상기 유지펄스의 제 1전압은 부극성 데이터 펄스 전압의 절대치 값인 것을 특징으로 한다.
상기 제 1서브필드를 제외한 나머지 서브필드에서 어드레스 구간동안 스캔전극에 인가되는 정극성 스캔펄스의 전압은 60V이상 80V이하인 것을 특징으로 한다.
이하에서는 첨부된 도면을 참고로 하여 본 발명의 바람직한 실시예를 보다 상세히 설명하기로 한다.
도 4는 본 발명에 따른 플라즈마 디스플레이 패널의 구동장치를 나타낸 도이다.
도 4를 참조하면, 본 발명에 따른 플라즈마 디스플레이 패널의 구동장치는 m×n 개의 방전셀들(1)이 스캔전극라인들(Y1 내지 Ym), 서스테인전극라인들(Z1 내지 Zm) 및 데이터전극라인들(X1 내지 Xn)과 접속되게끔 매트릭스 형태로 배치된 PDP(100)와, 스캔전극라인들(Y1 내지 Ym)을 구동하기 위한 스캔 구동부(102)와, 서스테인전극라인들(Z1 내지 Zm)을 구동하기 위한 서스테인 구동부(104)와, 어드레스전극라인들(X1 내지 Xn)을 구동하기 위한 데이터 구동부(106)을 구비한다.
스캔 구동부(102)는 스캔전극라인들(Y1 내지 Ym)에 스캔펄스와 서스테인펄스를 순차적으로 인가하여 방전셀들(1)이 라인 단위로 순차적으로 주사되게 함과 아울러 m×n 개의 방전셀들(1) 각각에서의 방전이 지속되게 한다. 서스테인 구동부(104)는 서스테인전극라인들(Z1 내지 Zm) 모두에 서스테인 펄스를 인가하게 된다. 데이터 구동부(106)은 스캔펄스에 동기되게끔 영상 데이터를 어드레스전극라인들(X1 내지 Xn)에 인가하게 된다.
이와 같은 구조를 갖는 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법을 설명하면 다음과 같다.
도 5는 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법을 설명하기 위한 구동파형이다. 도 5를 참조하면, 본 발명의 플라즈마 디스플레이 패널 구동방법은 제 1서브필드의 초기화기간에 인가되는 램프 파형 및 어드레스 기간에 인가되는 스캔 파형과 나머지 서브필드의 초기화 기간의 램프 파형 및 어드레스 기간의 스캔 파형이 상이하게 설정되어 인가된다.
먼저, 제 1 서브필드의 초기화기간은 종래와 마찬가지로 셋업 기간(SU)에 모든 스캔전극들(Y)에 상승 램프펄스(Ramp-up1)가 동시에 인가되고, 셋 다운(SD)에는 하강 램프펄스(Ramp-down1)가 인가되어 셀들 내에 미약한 소거방전을 일으킴으로써 과도하게 형성된 벽 전하를 일부 소거시키게 된다.
제 1 서브필드의 어드레스 기간 역시 종래와 마찬가지로 부극성 스캔 펄스(-Scan)가 스캔 전극들(Y)에 순차적으로 인가됨과 동시에 스캔 펄스에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 이 스캔 펄스와 데이터 펄스의 전압 차와 초기화기간에 생성된 벽 전압이 더해지면서 데이터 펄스가 인가되는 셀 내에는 어드레스 방전이 발생된다.
제 1 서브필드의 서스테인 기간에는 종래 최초 서스테인 펄스(sus)가 스캔 전극(Y)에 인가되는것 과는 달리 서스테인 전극(Z)에 인가되고, 마지막 서스테인 펄스는 스캔 전극에 인가된다. 이때 어드레스 전극(X)들에는 소정기간 동안 데이터 전극에 상승 램프 펄스(Ramp-up2)가 인가된 후, 제 1 전압으로 유지되는 제 1유지펄스(Vd)가 인가된다. 어드레스 전극(X)에 제 1전압으로 유지되는 제 1유지펄스는 이후 제 1서브필드를 제외한 나머지 서브필드의 초기화 기간에 스캔전극(Y)과의 미약한 소거방전을 일으킴으로써 이후 어드레스 기간에 안정된 방전이 일어날 수 있는 벽전하를 셀들내에 균일하게 잔류시킨다. 이 때, 어드레스 전극(X)에 인가되는 제 1유지펄스의 제 1전압(Vd)은 제 1서브필드의 어드레스 기간에 공급된 정극성의 데이터 펄스 전압(Vd)과 동일하다.
한편, 최초 서스테인 펄스(sus)를 스캔 전극(Y)에 인가하는 시점부터 어드레스 전극(X)에 소정기간 동안 상승 램프 펄스(Ramp-up2)를 인가하는 이유는 표시방전이 시작되는 서스테인 구간에 스캔전극(Y)과 서스테인 전극(Z)간의 면 방전이 아닌 스캔전극(Y)과 어드레스 전극(X)간의 방전 혹은 서스테인 전극(Z)과 어드레스 전극(X)간의 대향방전의 발생됨을 방지하기 위함이다. 즉, 서스테인 방전이 시작시 어드레스 전극(X)에 구형 펄스를 인가하게 되면 스캔전극(Y)과 어드레스 전극(X) 간 혹은 서스테인 전극(Z)과 어드레스 전극(X)간의 대향방전이 발생될 수 있어 화상을 구현할 수 있는 면방전의 휘도를 저해 시키기 때문이다. 이때, 어드레스 전극(X)에 인가되는 상승 램프 펄스의 소정기간은 스캔 전극(Y) 및 서스테인 전극(Z)에 서스테인 펄스가 각각 5개이상 30개이하가 인가되는 기간으로, 이러한 기간은 서스테인 펄스가 최초 인가되는 시점부터 기산된 기간이다.
또한, 상승 램프 펄스(Ramp-up2)는 서브필드의 서스테인 구간동안 스캔 전극 (Y) 및 서스테인 전극(Z)에 서스테인 펄스가 각각 10개 이상 인가될 때 어드레스 전극에 인가됨이 바람직하다. 이는 서스테인 펄스의 수에 따라 나타나는 계조값의 차이를 고려한 것으로, 예를 들어, 스캔 전극(Y) 및 서스테인 전극(Z)에 인가되는 서스테인 펄스가 10개 미만일 경우는 저계조값의 화상이 표현됨으로 이 때, 어드레스 전극(X)에 인가되는 상승램프 펄스(Ramp-up2)는 스캔전극(Y)과 어드레스전극(X) 간 혹은 서스테인전극(Z)과 어드레스전극(X)간의 미약한 방전으로 표현하고자 하는 계조값 보다 더 낮은 저 계조값을 갖는 화상이 표현되는 문제점이 발생될 수 있기 때문이다.
이 후, 제 2 서브필드의 초기화기간에 스캔 전극(Y)에 하강 램프 펄스(Ramp-down2)를 공급하고, 서스테인 전극(Z)에는 하강 램프 펄스(Ramp-down2)가 공급되는 시점에 제 1서브필드의 서스테인 전압(Vz)과 동일한 전압의 제 2유지펄스를 공급하고, 이 때, 어드레스 전극(X)에는 이전 서브필드인 제 1서브필드의 서스테인 기간에 제 1전압으로 유지되는 제 1유지펄스(Vd)가 공급되어 제 1서브필드의 서스테인 방전 후, 방전 셀마다의 불규칙적인 벽전하를 균일하게 형성하여 이 후 어드레스 구간에서의 어드레싱 방전을 안정적으로 일으킬수 있게 한다. 즉, 스캔전극(Y)과 서스테인 전극(Z)간의 방전 및 스캔전극(Y)과 어드레스전극(X)간의 미약한 방전을 일으켜 방전셀 내의 변전하를 균일하게 형성한다.
이와 같이, 제 1 서브필드의 서스테인 기간동안 어드레스 전극(X)에 제 1전압으로 유지되는 제 1유지펄스가 공급하여 정극성 벽전하를 쌓아두고, 제 2서브필드의 초기화 기간동안 스캔전극(Y)에 하강램프펄스(Ramp-down2)를 공급하여 미약한 스캔전극(Y)과 서스테인 전극(Z)간의 면방전 및 스캔전극(Y)과 어드레스 전극(X)간의 대향방전을 발생시켜 방전 셀 공간내의 벽전하를 균일하게 함으로써 종래 제 1서브필드를 제외한 나머지 서브필드의 초기화 기간에 상승 램프 펄스를 스캔전극에 공급할 필요가 없게 된다. 또한, 종래 서스테인 방전이 끝난 후 방전셀 공간내의 벽전하를 완전소거 하기 위한 소거 파형을 공급할 필요가 없게 된다. 이에 따라 구동마진이 종래 플라즈마 디스플레이 패널 구동시 보다 더욱 향상된 구동마진을 확보할 수 있게 된다.
또한, 제 1 서브필드를 제외한 나머지 서브필드의 초기화 기간에 상승 램프 펄스에 의한 셋업 방전이 일어나지 않아 플라즈마 디스플레이 패널의 블랙 휘도 값이 매우 낮아 콘트라스트 특성을 향상시키게 된다.
이 후, 제 2 서브필드의 어드레스 기간에 정극성 전압의 스캔 펄스(Scan)가 스캔 전극(Y)에 순차적으로 공급되고 동시에 어드레스 전극(X)에 부극성 데이터 펄스(-Vd)가 인가된다. 이 때, 스캔전극(Y)에 인가되는 정극성 스캔펄스(Scan)의 전압은 60V이상 80V이하로 제 1서브필드의 어드레스 기간에 공급된 부극성 전압과 극성이 다른 전압값이다. 이 스캔 펄스와 데이터 펄스의 전압차와 초기화 기간에 생성된 벽전압이 더해지면서 데이터 펄스가 인가되는 셀 내에는 어드레스 방전이 발생된다. 이 때, 어드레스 전극에 공급된 부극성 데이터 펄스 전압(-Vd)의 절대치는 제 1서브필드의 서스테인 구간에 공급된 제 1유지펄스의 제 1전압(Vd)과 동일하다. 이에 따라 스캔 전극(Y)과 어드레스 전극(X) 간은 어드레스 방전개시를 위한 전위차가 형성되어 원활한 어드레스 방전이 일어날 수 있도록 한다.
이상에서 보는 바와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이와 같이, 본 발명은 플라즈마 디스플레이 패널 구동방법을 달리하여 종래 서스테인 방전 후, 방전 셀내의 벽전하 소거를 위한 소거 기간 및 제 1 서브필드를 제외한 나머지 서브필드의 초기화 기간에 셋업기간을 삭제하여 콘트라스트 특성 뿐만 아니라 구동마진을 더욱 향상시킬 수 있는 효과가 있다.

Claims (10)

  1. 발광횟수가 다른 다수개의 서브필드가 초기화구간, 어드레스 구간, 서스테인 구간으로 나뉘어 화상을 구현하는 플라즈마 디스플레이 패널 구동장치에 있어서,
    제 1서브필드의 서스테인 구간에서 스캔 전극에 최후 서스테인 펄스가 인가되고, 상기 서스테인 구간의 소정기간 동안 어드레스 전극에 상승 램프 펄스가 인가된 후, 제 1 전압으로 유지되는 제 1유지 펄스가 인가되고,
    상기 제 1서브필드를 제외한 나머지 서브필드의 초기화 구간에 상기 스캔 전극에 하강 램프 펄스가 인가되고, 동시에 상기 서스테인 전극에 제 1서브필드의 서스테인 전압과 동일한 전압의 제 2유지펄스가 인가되고, 상기 어드레스 전극에는 상기 제 1전압과 동일한 전압으로 유지되는 제 1 유지펄스가 인가되고,
    상기 제 1서브필드를 제외한 나머지 서브필드의 어드레스 구간에 상기 스캔 전극에 정극성 스캔 펄스가 인가되고, 상기 스캔 펄스와 동기되도록 상기 어드레스 전극에 부극성 데이터 펄스가 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제 1항에 있어서,
    상기 상승 램프 펄스는 서브필드의 서스테인 구간동안 스캔 전극 및 서스테인 전극에 서스테인 펄스가 각각 10개 이상 인가될 때 어드레스 전극에 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 제 1항에 있어서,
    상기 어드레스 전극에 인가되는 상승 램프 펄스의 소정기간은
    상기 서브필드의 서스테인 구간동안 스캔 전극 및 서스테인 전극에 서스테인 펄스가 각각 5개이상 30개이하가 인가되는 기간인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  4. 제 1항에 있어서,
    상기 유지펄스의 제 1전압은 상기 부극성 데이터 펄스 전압의 절대치 값인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  5. 제 1항에 있어서,
    상기 제 1서브필드를 제외한 나머지 서브필드에서 어드레스 구간동안 스캔전극에 인가되는 정극성 스캔펄스의 전압은 60V이상 80V이하인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  6. 발광횟수가 다른 다수개의 서브필드가 초기화구간, 어드레스 구간, 서스테인 구간으로 나뉘어 화상을 구현하는 플라즈마 디스플레이 패널 구동방법에 있어서,
    (a) 제 1서브필드의 서스테인 구간에서 스캔 전극에 최후 서스테인 펄스가 인가되고, 상기 서스테인 구간의 소정기간 동안 어드레스 전극에 상승 램프 펄스가 인가된 후, 제 1 전압으로 유지되는 제 1유지 펄스가 인가되는 단계,
    (b) 상기 제 1서브필드를 제외한 나머지 서브필드의 초기화 구간에 상기 스캔 전극에 하강 램프 펄스가 인가되고, 동시에 상기 서스테인 전극에 제 1서브필드의 서스테인 전압과 동일한 전압의 제 2유지펄스가 인가되고, 상기 어드레스 전극에는 상기 제 1전압과 동일한 전압으로 유지되는 제 1 유지펄스가 인가되는 단; 및
    (c) 상기 제 1서브필드를 제외한 나머지 서브필드의 어드레스 구간에 상기 스캔 전극(Y)에 정극성 스캔 펄스가 인가되고, 상기 스캔 펄스와 동기되도록 상기 어드레스 전극에 부극성 데이터 펄스가 인가되는 단계
    를 포함하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제 6항에 있어서,
    상기 상승 램프 펄스는 서브필드의 서스테인 구간동안 스캔 전극 및 서스테인 전극에 서스테인 펄스가 각각 10개 이상 인가될 때 어드레스 전극에 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  8. 제 6항에 있어서,
    상기 어드레스 전극에 인가되는 상승 램프 펄스의 소정기간은
    상기 서브필드의 서스테인 구간동안 스캔 전극 및 서스테인 전극에 서스테인 펄스가 각각 5개이상 30개이하 인가되는 기간인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제 6항에 있어서,
    상기 유지펄스의 제 1전압은 부극성 데이터 펄스 전압의 절대치 값인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 6항에 있어서,
    상기 제 1서브필드를 제외한 나머지 서브필드에서 어드레스 구간동안 스캔전극에 인가되는 정극성 스캔펄스의 전압은 60V이상 80V이하인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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