KR100617073B1 - Method for Fabricating of Semiconductor Device - Google Patents
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Abstract
본 발명은 소자의 전기적 안정성 및 공정 마진을 확보할 수 있는 반도체 소자의 제조방법에 관한 것으로서, 반도체 기판에 제 1 절연막과 제 2 절연막을 적층하여 형성하는 단계와, 상기 제 2 절연막의 소정부분을 노출시키는 마스크를 이용하여 상기 반도체 기판이 노출되도록 상기 제 2 절연막과 제 1 절연막을 제거하여 트렌치를 정의하는 단계와, 상기 반도체 기판에 산소를 포함한 반응 가스를 플로우시키고 아르곤 가스를 스퍼터링하여 상기 마스크 물질의 일부가 떨어져 나와서 상기 트렌치가 정의된 상기 반도체 기판에 부착되어 형성된 블랙 마스크를 제거하는 단계와, 상기 마스크를 이용하여 상기 노출된 반도체 기판을 소정 깊이 식각하여 트렌치를 형성하는 단계와, 상기 트렌치 내부에 제 3 절연막을 매립하여 소자 격리 영역을 형성하는 단계를 포함하여 형성한다.The present invention relates to a method of manufacturing a semiconductor device that can ensure the electrical stability and process margin of the device, comprising the steps of forming a first insulating film and a second insulating film on a semiconductor substrate, and a predetermined portion of the second insulating film Removing the second insulating film and the first insulating film to expose the semiconductor substrate using an exposed mask to define a trench; flowing a reactive gas containing oxygen into the semiconductor substrate and sputtering argon gas to form the trench; Removing a black mask formed by attaching a portion of the trench to the semiconductor substrate in which the trench is defined, etching the exposed semiconductor substrate using the mask to form a trench, and forming a trench in the trench; Forming a device isolation region by filling a third insulating film in the Forms, including.
STI(Shallow Trench Isolation), DefectShallow Trench Isolation (STI), Defect
Description
도 1a 내지 도 1c는 종래의 반도체 소자의 제조공정 단면도1A to 1C are cross-sectional views of a manufacturing process of a conventional semiconductor device.
도 2a 내지 도 2b는 종래의 반도체 소자의 트렌치 프로파일을 촬영한 사진2A and 2B are photographs taken of trench profiles of a conventional semiconductor device.
도 3a 내지 도 3d는 본 발명의 실시예에 따른 반도체 소자의 제조공정 단면도3A to 3D are cross-sectional views illustrating a manufacturing process of a semiconductor device in accordance with an embodiment of the present invention.
도 4는 본 발명의 실시예에 따른 반도체 소자의 트렌치 프로파일을 촬영한 사진4 is a photograph of a trench profile of a semiconductor device according to an embodiment of the present invention;
도면의 주요 부분에 대한 부호설명Explanation of Signs of Major Parts of Drawings
21 : 반도체 기판 22 : 패드 산화막21
23 : 질화막 24 : 포토레지스트23
25 : 트렌치 26 : STI 영역25: trench 26: STI region
본 발명은 반도체 소자에 관한 것으로 특히, 트렌치 영역의 디팩트(Defect)를 제거여 누설전류를 방지하고 수율(Yield)을 향상시킬 수 있는 반도체 소자의 제조방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a semiconductor device, and more particularly, to a method of manufacturing a semiconductor device capable of removing a defect in a trench region to prevent leakage current and improving yield.
이하, 첨부된 도면을 참조하여 종래의 반도체 소자의 제조방법을 설명하면 다음과 같다.Hereinafter, a manufacturing method of a conventional semiconductor device will be described with reference to the accompanying drawings.
도 1a 내지 도 1b는 종래의 반도체 소자의 제조공정 단면도이다.1A to 1B are cross-sectional views of a manufacturing process of a conventional semiconductor device.
도 1a에 도시된 바와 같이 반도체 기판(11)상에 패드 산화막(12)과 질화막(13)을 차례로 적층하여 형성한다.As shown in FIG. 1A, a
여기에서 상기 패드 산화막(12)과 상기 질화막(13)은 각각 100∼150Å과 1000∼1500Å의 두께로 증착하여 형성한다.Here, the
그리고, 상기 질화막(13)상에 포토레지스트(14)를 도포한 후, 노광 및 현상 공정으로 상기 질화막(13)의 소정부분이 노출되도록 상기 포토레지스트(14)를 패터닝한다.After the
이어, 상기 패터닝된 포토레지스트(14)를 마스크로 이용하여 상기 반도체 기판(11)의 표면이 노출되도록 상기 질화막(13)과 패드 산화막(12)을 선택적으로 제거하여 트렌치 영역을 정의한다.Next, the trench region is defined by selectively removing the
이때, 상기 질화막(13)과 패드 산화막(12)의 식각 이후에 상기 포토레지스트(14)를 구성하는 CF계열의 중합체 물질이 상기 트렌치 영역이 정의된 상기 반도체 기판(11)상에 잔류하게 된다.In this case, after etching the
이는 차후에 트렌치(15)를 형성하기 위하여 상기 트렌치가 정의된 반도체 기판(11)을 식각할 때에 식각 공정을 방해하는 블랙 마스크(Black mask)로 작용한다.This later acts as a black mask that interferes with the etching process when etching the
그리고, 도 1b에 도시된 바와 같이 포토레지스트(14)를 마스크로 이용한 건식 식각(Dry etch)으로 상기 노출된 반도체 기판(11)을 소정 깊이로 제거하여 트렌 치(15)를 형성하고, 상기 포토레지스트(14)를 제거한다.As illustrated in FIG. 1B, the exposed
이때, 상기 블랙 마스크 하부의 상기 반도체 기판(11)이 식각되지 않으므로 인하여 상기 트렌치(15)가 형성된 반도체 기판(11)에 디팩트(16)가 발생된다.In this case, since the
즉, 상기 트렌치(15) 내부에 실리콘 기둥(Silicon Pillar) 또는 블랙 실리콘(Black Silicon) 내지 실리콘 코어(Silicon core)라 불리우는 콘 타입 디팩트(Cone Type Defect) 등이 발생된다.In other words, a silicon pillar or a cone type defect called black silicon to silicon core is generated in the
이어, 도 1c에 도시된 바와 같이 상기 트렌치(15)가 매립되도록 상기 트렌치(15)를 포함한 반도체 기판(11)의 전면에 산화막을 증착하고, CMP(Chemical Mechanical Polishing) 공정으로 상기 트렌치(15) 내부에만 남도록 상기 산화막을 제거하여 STI(Shallow Trench Isolation) 영역(17)을 형성하여 종래의 반도체 소자를 완성한다.Subsequently, as illustrated in FIG. 1C, an oxide film is deposited on the entire surface of the
도 2a 내지 도 2b는 종래의 반도체 소자의 트렌치 프로파일을 촬영한 사진으로 트렌치(15) 내부에 콘 타입 디팩트가 발생되었음을 나타낸다.2A to 2B are photographs taken of a trench profile of a conventional semiconductor device, indicating that cone type defects are generated in the
그러나, 상기와 같은 종래의 반도체 소자의 제조방법은 소자 격리 영역 내에 형성되는 실리콘 기둥 내지 콘 타입 디팩트로 인하여 소자의 절연 특성이 열화되고 누설 전류가 증가는 등의 결함으로 인하여 반도체 소자의 신뢰성 및 수율을 저하시키는 문제점이 있다.However, the conventional method of manufacturing a semiconductor device as described above has the reliability and reliability of a semiconductor device due to defects such as deterioration of insulation characteristics and increase of leakage current due to silicon pillars or cone type defects formed in the device isolation region. There is a problem of lowering the yield.
본 발명은 상기와 같은 문제점을 해결하기 위하여 안출한 것으로 안정적인 트렌치를 형성하여 누설전류를 방지하고 수율을 향상시키는데 적합한 반도체 소자 의 제조방법을 제공하는데 그 목적이 있다.An object of the present invention is to provide a method for manufacturing a semiconductor device suitable for forming a stable trench to prevent leakage current and improve the yield to solve the above problems.
상기와 같은 목적을 달성하기 위한 본 발명의 반도체 소자의 제조방법은 반도체 기판에 제 1 절연막과 제 2 절연막을 적층하여 형성하는 단계와, 상기 제 2 절연막의 소정부분을 노출시키는 마스크를 이용하여 상기 반도체 기판이 노출되도록 상기 제 2 절연막과 제 1 절연막을 제거하여 트렌치를 정의하는 단계와, 상기 반도체 기판에 산소를 포함한 반응 가스를 플로우시키고 아르곤 가스를 스퍼터링하여 상기 마스크 물질의 일부가 떨어져 나와서 상기 트렌치가 정의된 상기 반도체 기판에 부착되어 형성된 블랙 마스크를 제거하는 단계와, 상기 마스크를 이용하여 상기 노출된 반도체 기판을 소정 깊이 식각하여 트렌치를 형성하는 단계와, 상기 트렌치 내부에 제 3 절연막을 매립하여 소자 격리 영역을 형성하는 단계를 포함하여 형성함을 특징으로 한다.The method of manufacturing a semiconductor device of the present invention for achieving the above object is a step of forming a first insulating film and a second insulating film stacked on a semiconductor substrate, and using a mask to expose a predetermined portion of the second insulating film Removing the second insulating film and the first insulating film to expose the semiconductor substrate, and defining a trench; flowing a reactive gas containing oxygen through the semiconductor substrate, and sputtering argon gas so that a portion of the mask material is separated to form the trench. Removing the black mask formed on the semiconductor substrate, wherein the black mask is attached to the semiconductor substrate, and forming a trench by etching the exposed semiconductor substrate by a predetermined depth using the mask, and filling a third insulating film in the trench. Forming a device isolation region. .
이하, 첨부된 도면을 참조하여 본 발명의 반도체 소자의 제조방법을 설명하면 다음과 같다.Hereinafter, a method of manufacturing a semiconductor device of the present invention will be described with reference to the accompanying drawings.
도 3a 내지 도 3d는 본 발명의 실시예에 따른 반도체 소자의 제조공정 단면도이다.3A to 3D are cross-sectional views illustrating a process of manufacturing a semiconductor device in accordance with an embodiment of the present invention.
우선, 도 3a에 도시된 바와 같이 반도체 기판(21)에 패드 산화막(22)과 질화막(23)을 적층하여 형성한다.First, as shown in FIG. 3A, a
이때, 상기 패드 산화막(22)은 100∼150Å의 두께로 증착하고, 상기 질화막(23)은 1000∼1500Å의 두께로 증착하여 형성한다.In this case, the
그리고, 상기 질화막(23)상에 포토레지스트(24)를 도포하고 노광 및 현상 공정으로 상기 질화막(23)의 일정영역이 노출되도록 상기 포토레지스트(24)를 패터닝한다.Then, the
이어, 상기 패터닝된 포토레지스트(24)를 마스크로 이용하여 상기 반도체 기판(21)의 표면이 노출되도록 상기 질화막(23)과 패드 산화막(22)을 선택적으로 제거하여 트렌치 영역을 정의한다.Next, the trench region is defined by selectively removing the
이때, 상기 질화막(23)과 패드 산화막(22)의 식각 후에 트렌치 형성시에 블랙 마스크로 작용하는 CF계열의 중합체 물질이 상기 트렌치 영역이 정의된 상기 반도체 기판(21)상에 잔류하게 된다.At this time, after etching the
그리고, 도 3b에 도시된 바와 같이 상기 블랙 마스크가 발생된 상기 반도체 기판(21)을 10∼15mtorr의 압력조건의 반응챔버에 로딩한 후에 상기 반응챔버 내부로 산소를 포함한 반응 가스를 플로우시킴과 동시에 아르곤 가스를 스퍼터링한다. 이때, 상기 산소의 플로우량이 20∼40sccm이고, 아르곤(Ar) 가스의 플로우량이 50∼100sccm이 되도록 한다. 그리고, 상기 반응챔버에 100Watt의 바이어스 전력을 인가하고, 300Watt의 플라즈마 동작 전력을 인가하여 식각 공정을 실시한다. 그러면, 상기 아르곤 가스의 스퍼터링(Sputtering)에 의하여 물리적으로 상기 블랙 마스크가 제거됨과 동시에 다음과 같은 화학반응을 통하여 블랙 마스크가 제거된다.As shown in FIG. 3B, the
또는 or
상기 산소를 포함한 반응가스에 20∼40sccm의 N2H2가스를 더하면, 다음과 같은 화학반응을 통하여 상기 블랙 마스크가 제거된다.When the N 2 H 2 gas of 20-40 sccm is added to the reaction gas containing oxygen, the black mask is removed through the following chemical reaction.
즉, 플라즈마내에서 산소 반응성 핵종이 블랙 마스크 표면으로 확산되어 흡착과 화학반응을 통하여 휘발성 물질로 변화시키어 상기 블랙 마스크를 상기 반도체 기판(21)으로부터 탈리시키는 것이다.In other words, oxygen-reactive nuclides diffuse into the black mask surface in the plasma and are converted into volatile materials through adsorption and chemical reactions to detach the black mask from the
그리고, 도 3b에 도시된 바와 같이 상기 포토레지스트(24)를 마스크로 이용하여 상기 노출된 반도체 기판(21)을 소정깊이로 식각하여 트렌치(25)를 형성하고 상기 포토레지스트(24)를 제거한다.As shown in FIG. 3B, the exposed
그리고, 도 3d에 도시된 바와 같이 상기 트렌치(25)가 매립되도록 상기 트렌치(25)를 포함한 반도체 기판(21)의 전면에 산화막을 증착하고, CMP 공정으로 상기 트렌치(25) 내부에만 남도록 상기 산화막을 제거하여 STI 영역(26)을 형성하여 본 발명에 따른 반도체 소자를 완성한다.3D, an oxide film is deposited on the entire surface of the
도 4는 본 발명에 따른 반도체 소자의 트렌치 프로파일을 찍은 사진으로 콘 타입 디팩트 혹은 실리콘 기둥과 같은 불량이 발생되지 않았음을 나타낸다.4 is a photograph of a trench profile of a semiconductor device according to the present invention, indicating that defects such as cone type defects or silicon pillars do not occur.
상기와 같은 본 발명의 반도체 소자의 제조방법은 다음과 같은 효과가 있다. The method of manufacturing a semiconductor device of the present invention as described above has the following effects.
첫째, 소자 격리 영역의 콘 타입 디팩트를 제거할 수 있으므로 누설 전류를 감소시킬 수 있다.First, the cone type defect in the device isolation region can be eliminated, thereby reducing leakage current.
둘째, 소자 격리 영역의 콘 타입 디팩트를 제거할 수 있으므로 소자간의 절연도를 증가시킬 수 있어 소자의 전기적 안정성 및 신뢰성을 향상시킬 수 있다.Second, since the cone type defect of the device isolation region can be eliminated, insulation between devices can be increased, thereby improving the electrical stability and reliability of the device.
셋째, 소자 격리 영역의 결함을 줄일 수 있으므로 반도체 소자의 수율을 향상시킬 수 있다.Third, since the defects in the device isolation region can be reduced, the yield of the semiconductor device can be improved.
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