KR100603320B1 - 중간 전극 라인에 의하여 어드레싱이 수행되는 방전디스플레이 장치 - Google Patents

중간 전극 라인에 의하여 어드레싱이 수행되는 방전디스플레이 장치 Download PDF

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Abstract

본 발명에 따른 방전 디스플레이 장치에서는, 서로 대향 이격된 앞쪽 기판과 뒷쪽 기판을 갖고, 상기 기판들 사이에 X 및 Y 전극 라인들이 교호하고 나란하게 형성되어 XY 전극 라인쌍들 및 YX 전극 라인쌍들이 교호하게 설정되고, 어드레스 전극 라인들이 상기 X 및 Y 전극 라인들에 대하여 교차되게 형성되어, 상기 교차 영역들로써 방전 셀들이 설정된다. 여기서, 상기 모든 XY 전극 라인쌍들 및 모든 YX 전극 라인쌍들 사이에 M 전극 라인들이 각각 형성된다. 또한, 상기 M 전극 라인들 각각에 주사 펄스가 순차적으로 인가됨과 동시에 상기 어드레스 전극 라인들중에서 선택된 어드레스 전극 라인들에 데이터 펄스가 인가되는 어드레싱이 수행된다. 그리고, 상기 어드레싱에 의하여 선택된 방전 셀들이 디스플레이-유지 방전을 일으키도록 상기 X 전극 라인들과 Y 전극 라인들 사이에 교류 전압이 인가된다.

Description

중간 전극 라인에 의하여 어드레싱이 수행되는 방전 디스플레이 장치{Discharge display apparatus wherein addressing is performed by middle electrode line}
도 1은 본 발명의 일 실시예에 의한 방전 디스플레이 패널로서의 4-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.
도 2는 도 1의 패널의 한 방전 셀의 예를 보여주는 단면도이다.
도 3은 도 1의 플라즈마 디스플레이 패널의 M 전극 라인들 모두가 제1 방향으로만 인출되는 경우의 플라즈마 디스플레이 장치를 보여주는 도면이다.
도 4는, 도 1의 플라즈마 디스플레이 패널의 M 전극 라인들 모두가 제1 방향으로만 인출되고, 어드레스 전극 라인들의 중앙부가 단절된 경우의 플라즈마 디스플레이 장치를 보여주는 도면이다.
도 5는 도 1의 플라즈마 디스플레이 패널의 홀수번째 M 전극 라인들이 제1 방향으로 인출되고, 짝수번째 M 전극 라인들이 상기 제1 방향과 반대인 제2 방향으로 인출되는 경우의 플라즈마 디스플레이 장치를 보여주는 도면이다.
도 6은 도 1의 플라즈마 디스플레이 패널의 홀수번째 M 전극 라인들이 제1 방향으로 인출되고, 짝수번째 M 전극 라인들이 상기 제1 방향과 반대인 제2 방향으로 인출되며, 어드레스 전극 라인들의 중앙부가 단절된 경우의 플라즈마 디스플레 이 장치를 보여주는 도면이다.
도 7은 도 3의 플라즈마 디스플레이 패널의 M 전극 라인들에 대한 어드레스-디스플레이 분리(Address-Display Separation) 구동 방법을 보여주는 타이밍도이다.
도 8은 본 발명의 일 실시예의 구동 방법에 따라 도 3의 플라즈마 디스플레이 패널의 전극 라인들에 인가되는 신호들의 파형도이다.
도 9는 도 8의 t1 ~ t2 시간에서의 어느 한 방전 셀의 벽전하 분포 변화를 보여주는 단면도이다.
도 10은 도 8의 t2 ~ t3 시간에서의 어느 한 방전 셀의 벽전하 분포 변화를 보여주는 단면도이다.
도 11은 도 8의 t3 ~ t4 시간에서의 어느 한 방전 셀의 벽전하 분포 변화를 보여주는 단면도이다.
도 12는 도 8의 t5 ~ t6 시간에서의 어느 한 선택된 방전 셀의 벽전하 분포 변화를 보여주는 단면도이다.
도 13은 도 8의 t7 ~ t8 시간에서의 어느 한 선택된 방전 셀의 벽전하 분포 변화를 보여주는 단면도이다.
도 14는 도 8의 t8 ~ t12 시간에서의 어느 한 선택된 방전 셀의 반복적인 벽전하 분포 변화를 보여주는 단면도이다.
도 15는 본 발명의 또다른 실시예의 구동 방법에 따라 도 3의 플라즈마 디스플레이 패널의 전극 라인들에 인가되는 신호들의 파형도이다.
도 16은 종래의 3-전극 면방전 방식과 본 발명의 일 실시예의 4-전극 면방전 방식의 플라즈마 디스플레이 장치들의 성능을 보여주는 그래프이다.
<도면의 주요 부분에 대한 부호의 설명>
1...플라즈마 디스플레이 패널, 10...앞쪽 글라스 기판,
11, 15...유전체층, 12...보호층,
13...뒤쪽 글라스 기판, 14...방전 공간,
16...형광층, 17...격벽,
M1, ..., M2n-1...M 전극 라인들, X1, ..., Xn...X 전극 라인들,
Y1, ..., Yn...Y 전극 라인들,
AR1, ..., ABm...어드레스 전극 라인들, Xna, Yna...투명 전극 라인들,
Xnb, Ynb...금속 전극 라인, 62...논리 제어부,
63...어드레스 구동부, 64...X 구동부,
65...Y 구동부, 66...영상 처리부,
67...M 구동부, 63U..상부 어드레스 구동부,
63L..하부 어드레스 구동부, 67U...상부 M 구동부,
67L...하부 M 구동부, 67RI...우측 M 구동부,
67LE...좌측 M 구동부, 67LU...좌상부 M 구동부,
67LL...좌하부 M 구동부, 67RU...우상부 M 구동부,
67RL...우하부 M 구동부, R1, ..., R8...리셋 주기,
SF1, ...SF8...서브-필드, SM...M 구동-제어 신호,
SY...Y 구동-제어 신호, SX...X 구동-제어 신호,
SA...어드레스 신호, SMU...상부 M 구동-제어 신호,
SML...하부 M 구동-제어 신호, SAU...상부 어드레스 신호,
SAL...하부 어드레스 신호, SMRI...우측 M 구동-제어 신호,
SMLE...좌측 M 구동-제어 신호,
SMRU...우상부 M 구동-제어 신호,
SMRL...우하부 M 구동-제어 신호,
SMLU...좌상부 M 구동-제어 신호,
SMLL...좌하부 M 구동-제어 신호, VG...접지 전압.
본 발명은, 방전 디스플레이 장치에 관한 것으로서, 보다 상세하게는, 서로 대향 이격된 앞쪽 기판과 뒷쪽 기판을 갖고, 상기 기판들 사이에 X 및 Y 전극 라인들이 교호하고 나란하게 형성되어 XY 전극 라인쌍들 및 YX 전극 라인쌍들이 교호하게 설정되고, 어드레스 전극 라인들이 상기 X 및 Y 전극 라인들에 대하여 교차되게 형성되어, 상기 교차 영역들로써 방전 셀들이 설정되는 방전 디스플레이 장치에 관한 것이다.
종래의 방전 디스플레이 장치로서의 3-전극 구조의 플라즈마 디스플레이 장치에 의하면, 상기 Y 전극 라인들과 상기 어드레스 전극 라인들 사이에서 어드레싱이 수행된 후에 상기 Y 전극 라인들과 상기 X 전극 라인들 사이에서 디스플레이-유지 방전이 수행된다. 이에 따라, 어느 한 Y 전극 라인 또는 어느 한 X 전극 라인은 어느 한 XY 전극 라인쌍에만 소속되고 또다른 전극 라인쌍에 소속되지 못한다. 이에 따라, 각각의 XY 전극 라인쌍 사이에 불가피하게 존재하는 비방전 영역들은 방전 디스플레이 장치의 발광 효율 및 휘도를 낮추는 요인이 된다.
상기 문제점을 개선하기 위한 미국 특허 6,531,995호의 플라즈마 디스플레이 장치에 의하면, 비월(interlace) 구동 방식을 사용함으로써, 어느 한 Y 전극 라인 또는 어느 한 X 전극 라인이 인접하는 두 X 전극 라인들 또는 두 Y 전극 라인들과 함께 두 XY 전극 라인쌍들에 속할 수 있다. 하지만, 인터레이스(interlace) 구동 방식에 따라 플리커(flicker)의 발생이 심해질 수 있다. 또한, XY 전극 라인쌍들의 길이 방향과 같은 방향으로 격벽들이 형성되는 경우, 주사될 Y 전극 라인들이 격벽들과 어긋나게 배열되어야 한다. 이에 따라, 주사될 Y 전극 라인들에 존재하 는 금속 전극 라인이 출사광을 차단하므로, 방전 디스플레이 장치의 발광 효율 및 휘도가 낮아질 수 있다. 상기 문제점들은 방전 디스플레이 패널의 해상도가 높아질수록 심해질 것이다.
본 발명의 목적은, 순차(progressive) 구동 방식을 사용하여 플리커(flicker)의 발생을 방지하면서도, 발광 효율 및 휘도를 높일 수 있는 방전 디스플레이 장치를 제공하는 것이다.
상기 목적을 이루기 위한 본 발명의 방전 디스플레이 장치에서는, 서로 대향 이격된 앞쪽 기판과 뒷쪽 기판을 갖고, 상기 기판들 사이에 X 및 Y 전극 라인들이 교호하고 나란하게 형성되어 XY 전극 라인쌍들 및 YX 전극 라인쌍들이 교호하게 설정되고, 어드레스 전극 라인들이 상기 X 및 Y 전극 라인들에 대하여 교차되게 형성되어, 상기 교차 영역들로써 방전 셀들이 설정된다. 여기서, 상기 모든 XY 전극 라인쌍들 및 모든 YX 전극 라인쌍들 사이에 M 전극 라인들이 각각 형성된다. 또한, 상기 M 전극 라인들 각각에 주사 펄스가 순차적으로 인가됨과 동시에 상기 어드레스 전극 라인들중에서 선택된 어드레스 전극 라인들에 데이터 펄스가 인가되는 어드레싱이 수행된다. 그리고, 상기 어드레싱에 의하여 선택된 방전 셀들이 디스플레이-유지 방전을 일으키도록 상기 X 전극 라인들과 Y 전극 라인들 사이에 교류 전압이 인가된다.
본 발명의 상기 방전 디스플레이 장치에 의하면, 상기 모든 XY 전극 라인쌍 들 및 모든 YX 전극 라인쌍들 사이에 각각 형성된 상기 M 전극 라인들이 주사되면서 상기 어드레싱이 수행된다. 이에 따라, 상기 모든 XY 전극 라인쌍들 및 모든 YX 전극 라인쌍들에 의하여 방전 셀들이 설정될 수 있다.
또한, 상기 어드레싱에 의하여, 선택된 방전 셀의 X 및 Y 전극들 모두에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되고, 선택되지 않은 방전 셀의 X 및 Y 전극들중 적어도 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다. 예를 들어, 어느 한 어드레스 전극 라인을 따라 선택된 두 방전 셀들 사이에 선택되지 않은 두 방전 셀들이 있는 경우, 상기 선택되지 않은 두 방전 셀들 각각의 X 및 Y 전극들중 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다.
따라서, 상기 모든 XY 전극 라인쌍들 및 모든 YX 전극 라인쌍들에 의하여 방전 셀들이 설정되면서도 순차(progressive) 구동 방식이 사용될 수 있으므로, 발광 효율 및 휘도가 높아지면서도 플리커(flicker)의 발생이 억제될 수 있다.
추가적으로, 모든 X 및 Y 전극 라인들이 어드레싱에 직접 관여하지 않으므로, XY 전극 라인쌍들의 길이 방향과 같은 방향으로 격벽들이 형성되는 경우, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 상기 격벽들 위에 위치할 수 있다. 이에 따라, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 출사광을 차단하지 않으므로, 방전 디스플레이 장치의 발광 효율 및 휘도가 보다 높아질 수 있다.
상기 효과들은 방전 디스플레이 패널의 해상도가 높아질수록 증배될 것이다.
이하, 본 발명에 따른 바람직한 실시예가 상세히 설명된다.
도 1은 본 발명의 일 실시예에 의한 방전 디스플레이 패널로서의 4-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여준다. 도 2는 도 1의 패널의 한 방전 셀의 예를 보여준다. 도 1 및 2를 참조하면, 본 발명의 일 실시예에 의한 4-전극 면방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1, ..., ABm), 유전체층(11, 15), Y 전극 라인들(Y1, ..., Yn), M 전극 라인들(M1, ..., M2n-1), X 전극 라인들(X1, ..., Xn), 형광체(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.
어드레스 전극 라인들(AR1, ..., ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 하부 유전체층(15)은 어드레스 전극 라인들(AR1, ..., ABm )의 앞쪽에서 전면(全面) 도포된다. 하부 유전체층(15)의 앞쪽에는 격벽(17)들이 어드레스 전극 라인들(AR1, ..., ABm)과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 방전 셀의 방전 영역을 구획하고 각 방전 셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광층(16)은 격벽(17)들 사이에 도포된다.
앞쪽 글라스 기판(10)의 뒤쪽에 있어서, X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)은 교호하고 나란하게 형성되어 XY 전극 라인쌍들(X1 Y1, X2Y2, ..., XnYn) 및 YX 전극 라인쌍들(Y1X2, Y2X 3, ..., Yn-1Xn)이 교호하게 설정된다. 참 고로, XY 전극 라인쌍들(X1Y1, X2Y2, ..., XnY n)이 n 개이면, YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)은 n-1 개이다. 따라서, 모든 XY 전극 라인쌍들(X 1Y1, X2Y2, ..., XnYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X 3, ..., Yn-1Xn) 사이에 2n-1 개의 M 전극 라인들(M1, ..., M2n-1)이 각각 형성되며, 어드레스 전극 라인들(AR1, ..., ABm)이 상기 X, M, 및 Y 전극 라인들에 대하여 교차되게 형성되어, 상기 교차 영역들로써 방전 셀들이 설정된다.
각 M 전극 라인(M1, ..., M2n-1), 각 X 전극 라인(X1, ..., Xn ), 및 각 Y 전극 라인(Y1, ..., Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(도 2의 M(2n-1)a, Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(도 2의 M(2n-1)b, Xnb, Ynb)이 결합되어 형성된다.
앞쪽 유전체층(11)은 X 전극 라인들(X1, ..., Xn), M 전극 라인들(M1, ..., M2n-1), 및 Y 전극 라인들(Y1, ..., Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(12) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전체층(11)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.
이와 같은 플라즈마 디스플레이 패널에 기본적으로 적용되는 구동 방법에서는, 리셋팅(resetting), 어드레싱(addressing), 및 디스플레이-유지(display- sustaining) 단계들이 단위 서브-필드에서 순차적으로 수행된다. 리셋팅 단계에서는 모든 방전 셀들이 일정한 벽전하 상태를 가지게 된다. 어드레싱 단계에서는, 선택된 방전 셀들에 소정의 벽전압이 생성된다. 디스플레이-유지 단계에서는, 모든 XY 전극 라인쌍들에 소정의 교류 전압이 인가됨으로써 어드레싱 단계에서 상기 벽전압이 형성된 방전 셀들이 디스플레이-유지 방전을 일으킨다. 이 디스플레이-유지 단계에 있어서, 디스플레이-유지 방전을 일으키는 선택된 방전 셀들의 방전 공간(14) 즉, 가스층에서 플라즈마가 형성되고, 그 자외선 방사에 의하여 형광층(16)이 여기되어 빛이 발생된다.
도 3을 참조하면, 도 1의 플라즈마 디스플레이 패널(1)의 M 전극 라인들(M1, ..., M2n-1) 모두가 제1 방향으로만 인출되는 경우의 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(1), 영상 처리부(66), 논리 제어부(62), 어드레스 구동부(63), M 구동부(67), X 구동부(64) 및 Y 구동부(65)를 포함한다.
영상 처리부(66)는 외부 영상 신호를 처리하여 적색(R), 녹색(G), 및 청색(B)의 디지털 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 포함하는 내부 영상 신호를 발생시킨다. 논리 제어부(62)는 영상 처리부(66)로부터의 내부 영상 신호에 따라 구동-제어 신호들(SA,SM,SY,SX)을 발생시킨다. 어드레스 구동부(63)는, 논리 제어부(62)로부터의 어드레스 신호들(SA)을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 어드레스 전 극 라인들(AR1, ..., ABm)에 인가한다. M 구동부(67)는 논리 제어부(62)로부터의 M 구동-제어 신호(SM)에 따라 동작하여 M 전극 라인들(M1, ..., M2n-1)을 구동한다. X 구동부(64)는 논리 제어부(62)로부터의 X 구동-제어 신호(SX)에 따라 동작하여 X 전극 라인들(X1, ..., Xn)을 구동한다. Y 구동부(64)는 논리 제어부(62)로부터의 Y 구동-제어 신호(SY)에 따라 동작하여 Y 전극 라인들(Y1, ..., Yn)을 구동한다.
여기서, M 전극 라인들(M1, ..., M2n-1) 각각에 주사 펄스가 순차적으로 인가됨과 동시에 어드레스 전극 라인들(AR1, ..., ABm)중에서 선택된 어드레스 전극 라인들에 데이터 펄스가 인가되는 어드레싱이 수행된다. 예를 들어, M 전극 라인들(M1, ..., M2n-1)의 주사 순서는 M1 -> M2 -> ... -> Mn-1 -> Mn ->... -> M2n-1 이다. 다음에, 상기 어드레싱에 의하여 선택된 방전 셀들이 디스플레이-유지 방전을 일으키도록 모든 X 전극 라인들(X1, ..., Xn)과 모든 Y 전극 라인들(Y1, ..., Y n) 사이에 교류 전압이 인가된다.
이에 따라, 모든 XY 전극 라인쌍들(X1Y1, X2Y2, ..., X nYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)에 의하여 방전 셀들이 설정될 수 있다.
또한, 상기 어드레싱에 의하여, 선택된 방전 셀의 X 및 Y 전극들 모두에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되고, 선택되지 않은 방전 셀의 X 및 Y 전극들중 적어도 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다. 예를 들어, 연속적으로 배열된 4 개의 M 전극 라인들에 있어서, 선택된 두 방전 셀들 사이에 선택되지 않은 두 방전 셀들이 있는 경우, 상기 선택되지 않은 두 방전 셀들 각각의 X 및 Y 전극들중 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다.
따라서, 상기 모든 XY 전극 라인쌍들(X1Y1, X2Y2, ..., X nYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)에 의하여 방전 셀들이 설정되면서도 순차(progressive) 구동 방식이 사용될 수 있으므로, 발광 효율 및 휘도를 높이면서도 플리커(flicker)의 발생이 억제될 수 있다.
추가적으로, 모든 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)이 어드레싱에 직접 관여하지 않으므로, XY 전극 라인쌍들의 길이 방향과 같은 방향으로 격벽들이 형성되는 경우, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 상기 격벽들 위에 위치할 수 있다. 이에 따라, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 출사광을 차단하지 않으므로, 방전 디스플레이 장치의 발광 효율 및 휘도가 보다 높아질 수 있다.
상기 효과들은 방전 디스플레이 패널(1)의 해상도가 높아질수록 증배될 것이다.
도 4를 참조하면, 도 1의 플라즈마 디스플레이 패널(1)의 M 전극 라인들(M1, ..., M2n-1) 모두가 제1 방향으로만 인출되고, 어드레스 전극 라인들(AR1, ..., A Bm)의 중앙부가 단절되는 경우의 플라즈마 디스플레이 장치는, 플라즈마 디스플레이 패널(1), 영상 처리부(66), 논리 제어부(62), 상부 어드레스 구동부(63U), 하부 어드레스 구동부(63L), 상부 M 구동부(67U), 하부 M 구동부(67L), X 구동부(64) 및 Y 구동부(65)를 포함한다. 여기서, 어드레스 전극 라인들(AR1, ..., ABm)의 중앙부가 단절됨에 따라 상부 및 하부 디스플레이 패널들이 설정되며, 어드레싱이 상부 및 하부 디스플레이 패널들에서 동시에 수행된다.
영상 처리부(66)는 외부 영상 신호를 처리하여 적색(R), 녹색(G), 및 청색(B)의 디지털 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 포함하는 내부 영상 신호를 발생시킨다. 논리 제어부(62)는 영상 처리부(66)로부터의 내부 영상 신호에 따라 구동-제어 신호들(SAU,SAL,SMU,SML,S Y,SX)을 발생시킨다. 상부 어드레스 구동부(63U)는, 논리 제어부(62)로부터의 상부 어드레스 신호들(SAU)을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 상부 디스플레이 패널의 어드레스 전극 라인들에 인가한다. 하부 어드레스 구동부(63L)는, 논리 제어부(62)로부터의 하부 어드레스 신호들(SAU)을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 상부 디스플레이 패널의 어드레스 전극 라인들에 인가한다. 상부 M 구동부(67U)는 논리 제어부(62)로부터의 상부 M 구동-제어 신호(SMU)에 따라 동작하여 상부 디스플레이 패널의 M 전극 라인들(M1, ..., Mn-1)을 구동한다. 하부 M 구동부(67L )는 논리 제어부(62)로부터의 하부 M 구동-제어 신호(SML)에 따라 동작하여 상부 디스플레이 패널의 M 전극 라인들(Mn, ..., M2n-1)을 구동한다. X 구동부(64)는 논리 제어부(62)로부터의 구동-제어 신호들(SA,SM,SY,SX)중에서 X 구동-제어 신호(S X)에 따라 동작하여 X 전극 라인들(X1, ..., Xn)을 구동한다. Y 구동부(64)는 논리 제어부(62)로부터의 구동-제어 신호들(SA,SM,SY,SX)중에서 Y 구동-제어 신호(S Y)에 따라 동작하여 Y 전극 라인들(Y1, ..., Yn)을 구동한다.
여기서, 상부 M 전극 라인들(M1, ..., Mn-1) 각각과 하부 M 전극 라인들(Mn , ..., M2n-1) 각각에 주사 펄스가 순차적으로 인가됨과 동시에 어드레스 전극 라인들(AR1, ..., ABm)중에서 선택된 어드레스 전극 라인들에 데이터 펄스가 인가되는 어드레싱이 수행된다. 예를 들어, M 전극 라인들(M1, ..., M2n-1)의 주사 순서는 M1,Mn -> M2,Mn+1 -> ... -> Mn-1,M 2n-1 이다. 다음에, 상기 어드레싱에 의하여 선택된 방전 셀들이 디스플레이-유지 방전을 일으키도록 모든 X 전극 라인들(X1, ..., Xn)과 모든 Y 전극 라인들(Y1, ..., Yn) 사이에 교류 전압이 인가된다.
이에 따라, 모든 XY 전극 라인쌍들(X1Y1, X2Y2, ..., X nYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)에 의하여 방전 셀들이 설정될 수 있다.
또한, 상기 어드레싱에 의하여, 선택된 방전 셀의 X 및 Y 전극들 모두에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되고, 선택되지 않은 방전 셀의 X 및 Y 전극들중 적어도 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다. 예를 들어, 연속적으로 배열된 4 개의 M 전극 라인들에 있어서, 선택된 두 방전 셀들 사이에 선택되지 않은 두 방전 셀들이 있는 경우, 상기 선택되지 않은 두 방전 셀들 각각의 X 및 Y 전극들중 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다.
따라서, 상기 모든 XY 전극 라인쌍들(X1Y1, X2Y2, ..., X nYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)에 의하여 방전 셀들이 설정되면서도 순차(progressive) 구동 방식이 사용될 수 있으므로, 발광 효율 및 휘도를 높이면서도 플리커(flicker)의 발생이 억제될 수 있다.
추가적으로, 모든 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)이 어드레싱에 직접 관여하지 않으므로, XY 전극 라인쌍들의 길이 방향과 같은 방향으로 격벽들이 형성되는 경우, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 상기 격벽들 위에 위치할 수 있다. 이에 따라, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 출사광을 차단하지 않으므로, 방전 디스플레이 장치의 발광 효율 및 휘도가 보다 높아질 수 있다.
상기 효과들은 방전 디스플레이 패널(1)의 해상도가 높아질수록 증배될 것이다. 한편, 플라즈마 디스플레이 패널(1)의 상부와 하부가 동시에 어드레싱되므로, 어드레싱 속도가 증배될 수 있다.
도 5를 참조하면, 도 1의 플라즈마 디스플레이 패널(1)의 홀수번째 M 전극 라인들(M1,...,Mn,...,M2n-2)이 우측 방향으로 인출되고, 짝수번째 M 전극 라인들(M2,...,Mn-1,...,M2n-1)이 상기 좌측 방향으로 인출되는 경우의 플라즈마 디스플레이 장치는, 플라즈마 디스플레이 패널(1), 영상 처리부(66), 논리 제어부(62), 어드레스 구동부(63), 우측 M 구동부(67RI), 좌측 M 구동부(67LE), X 구동부(64) 및 Y 구동부(65)를 포함한다.
영상 처리부(66)는 외부 영상 신호를 처리하여 적색(R), 녹색(G), 및 청색(B)의 디지털 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 포함하는 내부 영상 신호를 발생시킨다. 논리 제어부(62)는 영상 처리부(66)로부터의 내부 영상 신호에 따라 구동-제어 신호들(SAU,SAL,SMU,SML,S Y,SX)을 발생시킨다. 어드레스 구동부(63)는, 논리 제어부(62)로부터의 어드레스 신호들(SA)을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 어드레스 전극 라인들(AR1, ..., ABm)에 인가한다. 우측 M 구동부(67RI)는 논리 제어부(62)로부터의 우측 M 구동-제어 신호(SMRI)에 따라 동작하여 홀수번째 M 전극 라인들(M1,...,Mn,...,M2n-2)을 구동한다. 좌측 M 구동부(67LE )는 논리 제어부(62)로부터의 좌측 M 구동-제어 신호(SMLE)에 따라 동작하여 짝수번째 M 전극 라인들(M2,...,Mn-1,...,M2n-1)을 구동한다. X 구동부(64)는 논리 제어부(62)로부터의 구동-제어 신호들(SA,SMRI,SMLE,SY,SX)중에서 X 구동-제어 신호(SX)에 따라 동작하여 X 전극 라인들(X1, ..., Xn)을 구동한다. Y 구동부(64)는 논리 제어부(62)로부터의 구동-제어 신호들(SA,SM,SY,SX)중에서 Y 구동-제어 신호(S Y)에 따라 동작하여 Y 전극 라인들(Y1, ..., Yn)을 구동한다.
여기서, M 전극 라인들(M1, ..., M2n-1) 각각에 주사 펄스가 순차적으로 인가됨과 동시에 어드레스 전극 라인들(AR1, ..., ABm)중에서 선택된 어드레스 전극 라인들에 데이터 펄스가 인가되는 어드레싱이 수행된다. 예를 들어, M 전극 라인들(M1, ..., M2n-1)의 주사 순서는 M2 -> M4 -> ... -> Mn-1 -> ... -> M2n-1 -> M1 -> M3 -> ... -> Mn -> M2n-2 이다. 여기서, 후반부에 주사되는 홀수번째 M 전극 라인들(M1,...,Mn,...,M2n-2)의 주사 순서를 거꾸로 하는 경우, M 전극 라인들(M1, ..., M2n-1)의 주사 순서는 M2 -> M4 -> ... -> Mn-1 -> ... -> M2n-1 -> M2n-2 -> ... -> Mn -> ... -> M3 -> M1 이다. 다음에, 상기 어드레싱에 의하여 선택된 방전 셀들이 디스플레이-유지 방전을 일으키도록 모든 X 전극 라인들(X1, ..., Xn)과 모든 Y 전극 라인들(Y1, ..., Yn) 사이에 교류 전압이 인가된다.
이에 따라, 모든 XY 전극 라인쌍들(X1Y1, X2Y2, ..., X nYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)에 의하여 방전 셀들이 설정될 수 있다.
또한, 상기 어드레싱에 의하여, 선택된 방전 셀의 X 및 Y 전극들 모두에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되고, 선택되지 않은 방전 셀의 X 및 Y 전극들중 적어도 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다. 예를 들어, 연속적으로 배열된 4 개의 M 전극 라인들에 있어서, 선택된 두 방전 셀들 사이에 선택되지 않은 두 방전 셀들이 있는 경우, 상기 선택되지 않은 두 방전 셀들 각각의 X 및 Y 전극들중 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다.
따라서, 상기 모든 XY 전극 라인쌍들(X1Y1, X2Y2, ..., X nYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)에 의하여 방전 셀들이 설정되면서도 순차(progressive) 구동 방식이 사용될 수 있으므로, 발광 효율 및 휘도를 높이면서도 플리커(flicker)의 발생이 억제될 수 있다.
추가적으로, 모든 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)이 어드레싱에 직접 관여하지 않으므로, XY 전극 라인쌍들의 길이 방향과 같은 방향으로 격벽들이 형성되는 경우, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 상기 격벽들 위에 위치할 수 있다. 이에 따라, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 출사광을 차단하지 않으므로, 방전 디스플레이 장치의 발광 효율 및 휘도가 보다 높아질 수 있다.
상기 효과들은 방전 디스플레이 패널(1)의 해상도가 높아질수록 증배될 것이다. 한편, M 전극 라인들(M1, ..., M2n-1)이 좌측과 우측에서 교호하게 연결되므로, 방전 디스플레이 장치의 제조 공정에서 M 전극 라인들(M1, ..., M2n-1)의 연결 작업이 용이해질 수 있다.
도 6을 참조하면, 도 1의 플라즈마 디스플레이 패널(1)의 홀수번째 M 전극 라인들(M1,...,Mn,...,M2n-2)이 우측 방향으로 인출되고, 짝수번째 M 전극 라인들(M2,...,Mn-1,...,M2n-1)이 좌측 방향으로 인출되며, 어드레스 전극 라인들(AR1, ..., ABm)의 중앙부가 단절된 경우의 플라즈마 디스플레이 장치는, 플라즈마 디스플레이 패널(1), 영상 처리부(66), 논리 제어부(62), 상부 어드레스 구동부(63U), 하부 어드레스 구동부(63L), 좌상부 M 구동부(67LU), 좌하부 M 구동부(67LL ), 우상부 M 구동부(67RU), 우하부 M 구동부(67RL), X 구동부(64) 및 Y 구동부(65)를 포함한다. 여기서, 어드레스 전극 라인들(AR1, ..., ABm)의 중앙부가 단절됨에 따라 상부 및 하부 디스플레이 패널들이 설정되며, 어드레싱이 상부 및 하부 디스플레이 패널들에서 동시에 수행된다.
영상 처리부(66)는 외부 영상 신호를 처리하여 적색(R), 녹색(G), 및 청색(B)의 디지털 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 포함하는 내부 영상 신호를 발생시킨다. 논리 제어부(62)는 영상 처리부(66)로부터의 내부 영상 신호에 따라 구동-제어 신호들(SAU,SAL,SMU,SML,S Y,SX)을 발생시킨다. 상부 어드레스 구동부(63U)는, 논리 제어부(62)로부터의 상부 어드레스 신호들(SAU)을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 상부 디스플레이 패널의 어드레스 전극 라인들에 인가한다. 하부 어드레스 구동부(63L)는, 논리 제어부(62)로부터의 하부 어드레스 신호들(SAU)을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 상부 디스플레이 패널의 어드레스 전극 라인들에 인가한다. 좌상부 M 구동부(67LU)는 논리 제어부(62)로부터의 좌상부 M 구동-제어 신호(SMLU)에 따라 동작하여 상부 디스플레이 패널의 짝수번째 M 전극 라인들(M2, ..., Mn-1)을 구동한다. 좌하부 M 구동부(67LL)는 논리 제어부(62)로부터의 좌하부 M 구동-제어 신호(SMLL)에 따라 동작하여 하부 디스플레이 패널의 짝수번째 M 전극 라인들(Mn+1, ..., M2n-1)을 구동한다. 우상부 M 구동부(67RU)는 논리 제어부(62)로부터의 우상부 M 구동-제어 신호(SMRU)에 따라 동작하여 상부 디스플레이 패널의 홀수번째 M 전극 라인들(M1, ..., Mn-2)을 구동한다. 우하부 M 구동부(67RL)는 논리 제어부(62)로부터의 우하부 M 구동-제어 신 호(SMRL)에 따라 동작하여 하부 디스플레이 패널의 홀수번째 M 전극 라인들(Mn, ..., M2n-2)을 구동한다. X 구동부(64)는 논리 제어부(62)로부터의 구동-제어 신호들(SA,SM,SY,SX)중에서 X 구동-제어 신호(SX )에 따라 동작하여 X 전극 라인들(X1, ..., Xn)을 구동한다. Y 구동부(64)는 논리 제어부(62)로부터의 구동-제어 신호들(SA,SM,SY,SX)중에서 Y 구동-제어 신호(SY )에 따라 동작하여 Y 전극 라인들(Y1, ..., Yn)을 구동한다.
여기서, 상부 M 전극 라인들(M1, ..., Mn-1) 각각과 하부 M 전극 라인들(Mn , ..., M2n-1) 각각에 주사 펄스가 순차적으로 인가됨과 동시에 어드레스 전극 라인들(AR1, ..., ABm)중에서 선택된 어드레스 전극 라인들에 데이터 펄스가 인가되는 어드레싱이 수행된다. 예를 들어, M 전극 라인들(M1, ..., M2n-1)의 주사 순서는 M2,Mn+1 -> M4,Mn+2 -> ... -> Mn-1,M 2n-1 -> M1,Mn -> M3,Mn+1 -> ... -> Mn-2,M2n-2 이다. 여기서, 후반부에 주사되는 홀수번째 M 전극 라인들(M1,...,Mn,...,M2n-2 )의 주사 순서를 거꾸로 하는 경우, M 전극 라인들(M1, ..., M2n-1)의 주사 순서는 M2 ,Mn+1 -> M4,Mn+2 -> ... -> Mn-1,M2n-1 -> Mn-2 ,M2n-2 -> ... -> M3,Mn+1 -> M1,Mn 이다. 다음에, 상기 어드레싱에 의하여 선택된 방전 셀들이 디스플레이-유지 방전을 일으키도록 모든 X 전극 라인들(X1, ..., Xn)과 모든 Y 전극 라인들(Y1, ..., Y n) 사이에 교류 전 압이 인가된다.
이에 따라, 모든 XY 전극 라인쌍들(X1Y1, X2Y2, ..., X nYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)에 의하여 방전 셀들이 설정될 수 있다.
또한, 상기 어드레싱에 의하여, 선택된 방전 셀의 X 및 Y 전극들 모두에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되고, 선택되지 않은 방전 셀의 X 및 Y 전극들중 적어도 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다. 예를 들어, 연속적으로 배열된 4 개의 M 전극 라인들에 있어서, 선택된 두 방전 셀들 사이에 선택되지 않은 두 방전 셀들이 있는 경우, 상기 선택되지 않은 두 방전 셀들 각각의 X 및 Y 전극들중 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다.
따라서, 상기 모든 XY 전극 라인쌍들(X1Y1, X2Y2, ..., X nYn) 및 모든 YX 전극 라인쌍들(Y1X2, Y2X3, ..., Yn-1Xn)에 의하여 방전 셀들이 설정되면서도 순차(progressive) 구동 방식이 사용될 수 있으므로, 발광 효율 및 휘도를 높이면서도 플리커(flicker)의 발생이 억제될 수 있다.
추가적으로, 모든 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)이 어드레싱에 직접 관여하지 않으므로, XY 전극 라인쌍들의 길이 방향과 같은 방향으로 격벽들이 형성되는 경우, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 상기 격벽들 위에 위치할 수 있다. 이에 따라, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 출사광을 차단하지 않으므로, 방전 디스플레이 장치의 발광 효율 및 휘도가 보다 높아질 수 있다.
상기 효과들은 방전 디스플레이 패널(1)의 해상도가 높아질수록 증배될 것이다. 한편, 플라즈마 디스플레이 패널(1)의 상부와 하부가 동시에 어드레싱되므로, 어드레싱 속도가 증배될 수 있다. 또한, M 전극 라인들(M1, ..., M2n-1)이 좌측과 우측에서 교호하게 연결되므로, 방전 디스플레이 장치의 제조 공정에서 M 전극 라인들(M1, ..., M2n-1)의 연결 작업이 용이해질 수 있다.
도 7은 도 3의 플라즈마 디스플레이 패널(1)의 M 전극 라인들(M1, ..., M2n-1)에 대한 어드레스-디스플레이 분리(Address-Display Separation) 구동 방법을 보여준다. 도 7을 참조하면, 모든 단위 프레임들 각각은 시분할 계조 디스플레이를 실현하기 위하여 8 개의 서브-필드들(SF1, ..., SF8)로 분할된다. 또한, 각 서브-필드(SF1, ..., SF8)는 리셋팅 시간(R1, ..., R8), 어드레싱 시간(A1, ..., A8), 및 디스플레이-유지 시간(S1, ..., S8)로 분할된다.
모든 방전 셀들의 방전 조건들은 각 리셋팅 시간(R1, ..., R8)에서 균일해지면서 동시에 다음 단계에서 수행될 어드레싱에 적합해지도록 된다.
각 어드레싱 시간(A1, ..., A8)에서는, 어드레스 전극 라인들(도 1의 AR1, ..., ABm)에 디스플레이 데이터 신호들이 인가됨과 동시에 각 M 전극 라인(M1, ..., M2n-1)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가 되는 동안에 높은 레벨의 디스플레이 데이터 신호들이 인가되면 상응하는 방전셀에서 어드레싱 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다.
각 디스플레이-유지 시간(S1, ..., S8)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 모든 X 전극 라인들(X1, ..., Xn)에 디스플레이-유지용 펄스가 교호하게 인가되어, 상응하는 어드레싱 시간(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 디스플레이-유지 방전을 일으킨다. 따라서 방전 디스플레이 장치의 휘도는 단위 프레임에서 차지하는 디스플레이-유지 시간(S1, ..., S8)의 길이에 비례한다. 단위 프레임에서 차지하는 디스플레이-유지 시간(S1, ..., S8)의 길이는 255T(T는 단위 시간)이다. 따라서 단위 프레임에서 한 번도 표시되지 않은 경우를 포함하여 256 계조로써 표시할 수 있다.
여기서, 제1 서브-필드(SF1)의 디스플레이-유지 시간(S1)에는 20에 상응하는 시간(1T)이, 제2 서브-필드(SF2)의 디스플레이-유지 시간(S2)에는 21에 상응하는 시간(2T)이, 제3 서브-필드(SF3)의 디스플레이-유지 시간(S3)에는 22에 상응하는 시간(4T)이, 제4 서브-필드(SF4)의 디스플레이-유지 시간(S4)에는 23에 상응하는 시간(8T)이, 제5 서브-필드(SF5)의 디스플레이-유지 시간(S5)에는 24에 상응하는 시간(16T)이, 제6 서브-필드(SF6)의 디스플레이-유지 시간(S6)에는 25에 상응하는 시간(32T)이, 제7 서브-필드(SF7)의 디스플레이-유지 시간(S7)에는 26에 상응하는 시간(64T)이, 그리고 제8 서브-필드(SF8)의 디스플레이-유지 시간(S8)에는 27에 상응하는 시간(128T)이 각각 설정된다.
이에 따라, 8 개의 서브-필드들중에서 표시될 서브-필드를 적절히 선택하면, 어느 서브-필드에서도 표시되지 않는 0(영) 계조를 포함하여 모두 256 계조의 디스플레이가 수행될 수 있다.
도 8은 본 발명의 일 실시예의 구동 방법에 따라 도 3의 플라즈마 디스플레이 패널(1)의 전극 라인들에 인가되는 신호들을 보여준다. 도 8에서 참조부호 SAR1..ABm은 각 어드레스 전극 라인(도 1의 AR1, AG1, ..., AGm , ABm)에 인가되는 구동 신호들을, SX1..Xn은 모든 X 전극 라인들(도 1의 X1, ...Xn)에 인가되는 구동 신호를, SM1, ..., SM(2n-1)은 각 M 전극 라인(도 1의 M1, ..., M2n-1 )에 인가되는 구동 신호들을, 그리고 SY1..SYn은 모든 Y 전극 라인들(도 1의 Y1, ...Yn )에 인가되는 구동 신호를 가리킨다. 도 9는 도 8의 t1 ~ t2 시간에서의 어느 한 방전 셀의 벽전하 분포 변화를 보여준다. 도 10은 도 8의 t2 ~ t3 시간에서의 어느 한 방전 셀의 벽전하 분포 변화를 보여준다. 도 11은 도 8의 t3 ~ t4 시간에서의 어느 한 방전 셀의 벽전하 분포 변화를 보여준다. 도 12는 도 8의 t5 ~ t6 시간에서의 어느 한 선택된 방전 셀의 벽전하 분포 변화를 보여준다. 도 13은 도 8의 t7 ~ t8 시간에서의 어느 한 선택된 방전 셀의 벽전하 분포 변화를 보여준다. 도 14는 도 8의 t8 ~ t12 시간에서의 어느 한 선택된 방전 셀의 반복적인 벽전하 분포 변화를 보여준다. 도 9 내지 14에서 도 2와 동일한 참조 부호는 동일한 기능의 대상을 가리킨다.
도 8을 참조하면, 단위 서브-필드의 최종 시점(t12 시점)의 직전에 최종 디스플레이-유지 펄스가 모든 X 전극 라인들(X1, ...Xn)에 인가되므로, 어느 한 단위 서브필드의 최종 시점(t12 시점) 즉, 상기 단위 서브필드에 이어지는 단위 서브필드(SF)의 최초 시점(t1)에서는, 이전 서브필드에서 선택되었던 방전 셀들의 X 전극 주위에 부극성의 벽전하들이 형성되고, 이전 서브필드에서 선택되었던 방전 셀들의 Y 전극 주위에 정극성의 벽전하들이 형성된다(도 14 및 도 9의 왼쪽 도면들 참조).
단위 서브-필드(SF)의 리셋팅 시간(R)의 벽전하 소거 시간(t1 ~ t2)에서는, 모든 Y 전극 라인들(Y1, ...Yn)에 제2 전압(VS)의 펄스가 인가되는 동안에 모든 M 전극 라인들(M1, ..., M2n-1)에 인가되는 전압이 제2 전압(VS)으로부터 제3 전압으로서의 접지 전압(VG)까지 지속적으로 하강된다. 이 시간(t1 ~ t2)에서, X 전극 라인들(X1, ..., Xn)과 어드레스 전극 라인들(AR1, ..., ABm)에는 접지 전압(VG)이 인가된다. 이에 따라, 모든 방전 셀들의 전극들 사이에서 약한 방전들이 일어나면서 모든 방전 셀들의 벽전하들이 소거된다(도 9 참조).
벽전하 축적 시간(t2 ~ t3)에서는, X 전극 라인들(X1, ..., Xn ), Y 전극 라인들(Y1, ..., Yn), 및 어드레스 전극 라인들(AR1, ..., ABm)에는 접지 전압(VG)이 인가된 상태에서, 모든 M 전극 라인들(M1, ..., M2n-1)에 인가되는 전압이 제2 전압(V S)보다 제4 전압(VSET)만큼 더 높은 제1 전압(VSET+VS)까지 지속적으로 상승된다. 여기서, 실선으로 도시된 바와 같이 비선형적으로 상승되거나, 점선으로 도시된 바와 같이 선형적으로 상승될 수 있다. 이에 따라, 모든 방전 셀들의 전극들 사이에서 약한 방전이 일어나면서, M 전극들 주위에 부극성 벽전하들이 많이 형성되고, 나머지 전극들 주위에 정극성 벽전하들이 형성된다(도 10 참조).
벽전하 배분 시간(t3 ~ t4)에서는, 모든 X 전극 라인들(X1, ..., X n)과 Y 전극 라인들(Y1, ..., Yn)에 인가되는 전압이 제2 전압(VS)으로 유지되고, 어드레스 전극 라인들(AR1, ..., ABm)에 접지 전압(VG)이 인가된 상태에서, 모든 M 전극 라인들(M1, ..., M2n-1)에 인가되는 전압이 제2 전압(VS)으로부터 제3 전압으로서의 접지 전압(VG)까지 지속적으로 하강된다. 여기서, 실선으로 도시된 바와 같이 비선형적으로 하강되거나, 점선으로 도시된 바와 같이 선형적으로 하강될 수 있다. 이에 따라, 모든 방전 셀들의 전극들 사이에서 약한 방전이 일어나면서, M 전극 주위의 부극성 벽전하들의 일부가 X 및 Y 전극들 주위로 이동한다. 또한, 어드레스 전극들 주위의 정극성 벽전하들이 보다 많아진다(도 11 참조).
이에 따라, X 전극 라인들(X1, ..., Xn) 및 Y 전극 라인들(Y1, ..., Y n)의 벽전위(wall electric-potential)가 어드레스 전극 라인들(AR1, ..., ABm)의 벽전위보다 낮고 M 전극 라인들(M1, ..., M2n-1)의 벽전위보다 높아진다. 이에 따라, 이어지는 어드레싱 시간(A)에서 선택된 어드레스 전극 라인들과 Y 전극 라인 사이의 대향 방전에 요구되는 어드레싱 전압(VA-VG)이 낮아질 수 있다.
이어지는 어드레싱 시간(A)에서, 어드레스 전극 라인들(AR1, ..., ABm)에 디스플레이 데이터 신호들이 인가되고, 제2 전압(VS)보다 낮은 제5 전압(VSCAN)으로 바이어싱된 M 전극 라인들(M1, ..., M2n-1)에 접지 전압(VG)의 주사 펄스가 순차적으로 인가된다. 각 어드레스 전극 라인(AR1, ..., ABm)에 인가되는 디스플레이 데이터 신호들은 방전 셀을 선택할 경우에 정극성 어드레싱 전압(VA)을, 그렇지 않을 경우에 접지 전압(VG)을 가진다. 여기서, 모든 X 전극 라인들(X1, ..., Xn)에는 접지 전압(VG)이 인가되고, 모든 Y 전극 라인들(Y1, ..., Yn)에는 상기 제2 전압(V S)이 인가된다. 이에 따라, 선택된 방전 셀들에 있어서, 접지 전압(VG)의 주사 펄스가 인가되는 동안에 정극성 어드레싱 전압(VA)의 디스플레이 데이터 신호들이 인가되면, 어드레싱 방전이 일어난다. 이 어드레싱 방전으로 인하여 선택된 방전 셀들의 X 및 M 전극들 주위에는 정극성의 벽전하들이 형성되고, 선택된 방전 셀들의 Y 및 어 드레스 전극들 주위에는 부극성의 벽전하들이 형성된다(도 12 참조).
이어지는 디스플레이-유지 시간(S)에 있어서, 모든 M 전극 라인들(M1, ..., M2n-1)에 제2 전압(VS)이 인가되고 모든 어드레스 전극 라인들(AR1, ..., ABm)에 접지 전압(VG)이 인가된 상태에서, 모든 X 전극 라인들(X1, ...Xn)과 모든 Y 전극 라인들(Y1, ...Yn)에 상기 제2 전압(VS)의 디스플레이-유지 펄스들이 교호하게 인가된다. 이에 따라, 어드레싱 시간(A)에서 상기 상태로 벽전하들이 형성되었던 방전 셀들에서 디스플레이-유지를 위한 방전을 일으킨다(도 13 및 14 참조)..
도 15는 본 발명의 또다른 실시예의 구동 방법에 따라 도 3의 플라즈마 디스플레이 패널(1)의 전극 라인들에 인가되는 신호들을 보여준다. 도 15에서 도 8과 동일한 참조 부호는 동일한 기능의 대상을 가리킨다. 도 15에서 제6 서브-필드(SF6)의 파형은 도 8의 단위 서브-필드(SF)의 파형과 동일하다. 콘트라스트를 높이기 위한 도 15의 실시예가 도 8의 실시예에 대하여 갖는 차이점은, 단위 프레임에서 적어도 어느 한 서브-필드 예를 들어, 제7 서브-필드(SF7)의 리셋 시간(R7)에 있다. 즉, 상기 높은 제1 전압(VSET + VS)으로써 모든 방전 셀들에서 방전이 일어나지 않고, 이전 서브-필드(SF6)에서 선택되어 디스플레이-유지 방전을 수행하였던 방전 셀들에 대해서만 벽전하 축적 및 배분이 수행된다. 이를 보다 상세히 설명하면 다음과 같다.
상기한 바와 같이, 이전 서브-필드(SF6)의 최종 시점(t12 시점)의 직전에 최 종 디스플레이-유지 펄스가 모든 X 전극 라인들(X1, ...Xn)에 인가되므로, 이전 서브-필드(SF6)의 최종 시점 즉, 현재 서브-필드(SF7)의 최초 시점(t12 시점)에서는, 이전 서브필드(SF6)에서 선택되었던 방전 셀들의 X 전극 주위에 부극성의 벽전하들이 형성되고, 이전 서브필드(SF6)에서 선택되었던 방전 셀들의 Y 전극 주위에 정극성의 벽전하들이 형성된다(도 14 및 도 9의 왼쪽 도면들 참조).
현재 서브-필드(SF7)의 선택적 축적 시간(t12 ~ t14)의 제1 시간(t12 ~ t13)에서, 모든 X 전극 라인들(X1, ...Xn)과 모든 어드레스 전극 라인들(AR1, ..., ABm)에 접지 전압(VG)이 인가되고 모든 M 전극 라인들(M1, ..., M2n-1)에 제2 전압(V S)이 인가된 상태에서, 모든 Y 전극 라인들(Y1, ...Yn)에 인가되는 전압이 접지 전압(V G)으로부터 제2 전압(VS)까지 지속적으로 상승한다. 이에 따라, 이전 서브-필드(SF6)에서 선택되어 디스플레이-유지 방전을 수행하였던 방전 셀들에서만 약한 방전이 일어난다. 또한, 선택적 축적 시간(t12 ~ t14)의 제2 시간(t13 ~ t 14)에서, 모든 어드레스 전극 라인들(AR1, ..., ABm)에 접지 전압(VG)이 인가된 상태에서, 나머지 모든 전극 라인들에 제2 전압(VS)이 공통적으로 인가된다. 이에 따라, 모든 어드레스 전극 라인들(AR1, ..., ABm) 주위에 정극성 벽전하들이 형성되고, 나머지 모든 전극 라인들 주위에 부극성 벽전하들이 형성된다. 여기서, 이전 서브-필드의 디스플레이- 유지 시간(S6)에서부터 모든 M 전극 라인들(M1, ..., M2n-1)에 제2 전압(VS )이 지속적으로 인가되므로, 모든 M 전극 라인들(M1, ..., M2n-1) 주위에 보다 많은 부극성 벽전하들이 축적된다. 참고로, 상기 제1 시간(t13 ~ t14) 즉, 모든 Y 전극 라인들(Y 1, ...Yn)에 인가되는 전압의 상승 시간(TE)은 상기 벽전하 축적의 효율과 관계가 있다. 따라서, 방전 디스플레이 장치의 제조 과정에서 반복적인 실험에 의하여 적절히 설정하는 것이 바람직하다.
벽전하 배분 시간(t14 ~ t15)에 있어서, 모든 X 전극 라인들(X1, ..., X n)과 Y 전극 라인들(Y1, ..., Yn)에 인가되는 전압이 제2 전압(VS)으로 유지되고, 어드레스 전극 라인들(AR1, ..., ABm)에 접지 전압(VG)이 인가된 상태에서, 모든 M 전극 라인들(M1, ..., M2n-1)에 인가되는 전압이 제2 전압(VS)으로부터 제3 전압으로서의 접지 전압(VG)까지 지속적으로 하강된다. 여기서, 실선으로 도시된 바와 같이 비선형적으로 하강되거나, 점선으로 도시된 바와 같이 선형적으로 하강될 수 있다. 이에 따라, 모든 방전 셀들의 전극들 사이에서 약한 방전이 일어나면서, M 전극 주위의 부극성 벽전하들의 일부가 X 및 Y 전극들 주위로 이동한다. 또한, 어드레스 전극들 주위의 정극성 벽전하들이 보다 많아진다(도 11의 우측 도면 참조, 도 11의 좌측 도면은 무관함). 이에 따라, 이어지는 어드레싱 시간에서 선택된 어드레스 전극 라인들과 Y 전극 라인 사이의 대향 방전에 요구되는 어드레싱 전압(VA-VG)이 낮 아질 수 있다.
도 16의 그래프는 동일한 비교 조건에서 종래의 3-전극 면방전 방식과 본 발명의 일 실시예의 4-전극 면방전 방식의 플라즈마 디스플레이 장치들의 성능을 보여준다. 도 16에서 참조 부호 VS는 모든 X 및 Y 전극들에 인가되는 디스플레이-유지 펄스들의 전압을 가리킨다. 도 16을 참조하면, 본 발명의 일 실시예의 4-전극 면방전 방식의 플라즈마 디스플레이 장치의 휘도 특성 라인(BNEW) 및 발광 효율 특성 라인(ENEW)이 종래의 3-전극 면방전 방식의 플라즈마 디스플레이 장치의 휘도 특성 라인(BOLD) 및 발광 효율 특성 라인(EOLD)에 비하여 높게 위치한다.
이상 설명된 바와 같이, 본 발명에 따른 방전 디스플레이 장치에 의하면, 모든 XY 전극 라인쌍들 및 모든 YX 전극 라인쌍들 사이에 각각 형성된 M 전극 라인들이 주사되면서 어드레싱이 수행된다. 이에 따라, 모든 XY 전극 라인쌍들 및 모든 YX 전극 라인쌍들에 의하여 방전 셀들이 설정될 수 있다.
또한, 상기 어드레싱에 의하여, 선택된 방전 셀의 X 및 Y 전극들 모두에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되고, 선택되지 않은 방전 셀의 X 및 Y 전극들중 적어도 어느 하나에 디스플레이-유지 방전에 필요한 벽전하 상태가 형성되지 않는다. 예를 들어, 어느 한 어드레스 전극 라인을 따라 선택된 두 방전 셀들 사이에 선택되지 않은 두 방전 셀들이 있는 경우, 상기 선택되지 않은 두 방전 셀들 각각의 X 및 Y 전극들중 어느 하나에 디스플레이-유지 방전에 필요한 벽전 하 상태가 형성되지 않는다.
따라서, 모든 XY 전극 라인쌍들 및 모든 YX 전극 라인쌍들에 의하여 방전 셀들이 설정되면서도 순차(progressive) 구동 방식이 사용될 수 있으므로, 발광 효율 및 휘도가 높아지면서도 플리커(flicker)의 발생이 억제될 수 있다.
추가적으로, 모든 X 및 Y 전극 라인들이 어드레싱에 직접 관여하지 않으므로, XY 전극 라인쌍들의 길이 방향과 같은 방향으로 격벽들이 형성되는 경우, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 격벽들 위에 위치할 수 있다. 이에 따라, 모든 X 및 Y 전극 라인들의 금속 전극 라인들이 출사광을 차단하지 않으므로, 방전 디스플레이 장치의 발광 효율 및 휘도가 보다 높아질 수 있다.
상기 효과들은 방전 디스플레이 패널의 해상도가 높아질수록 증배될 것이다.
본 발명은, 상기 실시예들에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.

Claims (8)

  1. 서로 대향 이격된 앞쪽 기판과 뒷쪽 기판을 갖고, 상기 기판들 사이에 X 및 Y 전극 라인들이 교호하고 나란하게 형성되어 XY 전극 라인쌍들 및 YX 전극 라인쌍들이 교호하게 설정되고, 어드레스 전극 라인들이 상기 X 및 Y 전극 라인들에 대하여 교차되게 형성되어, 상기 교차 영역들로써 방전 셀들이 설정되는 방전 디스플레이 장치에 있어서,
    상기 모든 XY 전극 라인쌍들 및 모든 YX 전극 라인쌍들 사이에 M 전극 라인 들이 각각 형성되고,
    상기 M 전극 라인들 각각에 주사 펄스가 순차적으로 인가됨과 동시에 상기 어드레스 전극 라인들중에서 선택된 어드레스 전극 라인들에 데이터 펄스가 인가되는 어드레싱이 수행되고,
    상기 어드레싱에 의하여 선택된 방전 셀들이 디스플레이-유지 방전을 일으키도록 상기 X 전극 라인들과 Y 전극 라인들 사이에 교류 전압이 인가되는 방전 디스플레이 장치.
  2. 제1항에 있어서,
    상기 M 전극 라인들 모두가 제1 방향으로만 인출되는 방전 디스플레이 장치.
  3. 제2항에 있어서,
    외부 영상 신호를 처리하여 적색, 녹색, 및 청색의 디지털 영상 데이터를 포함하는 내부 영상 신호를 발생시키는 영상 처리부;
    상기 영상 처리부로부터의 내부 영상 신호에 따라 구동-제어 신호들을 발생시키는 제어부;
    상기 제어부로부터의 어드레스 신호들을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 상기 어드레스 전극 라인들에 인가하는 어드레스 구동부;
    상기 제어부로부터의 M 구동-제어 신호에 따라 동작하여 상기 M 전극 라인들 을 구동하는 M 구동부;
    상기 제어부로부터의 X 구동-제어 신호에 따라 동작하여 상기 X 전극 라인들을 구동하는 X 구동부; 및
    상기 제어부로부터의 Y 구동-제어 신호에 따라 동작하여 상기 Y 전극 라인들을 구동하는 Y 구동부를 포함한 방전 디스플레이 장치.
  4. 제2항에 있어서,
    상기 어드레스 전극 라인들의 중앙부가 단절됨에 따라 상부 및 하부 디스플레이 패널들이 설정되고, 상기 어드레싱이 상기 상부 및 하부 디스플레이 패널들에서 동시에 수행되는 방전 디스플레이 장치.
  5. 제4항에 있어서,
    외부 영상 신호를 처리하여 적색, 녹색, 및 청색의 디지털 영상 데이터를 포함하는 내부 영상 신호를 발생시키는 영상 처리부;
    상기 영상 처리부로부터의 내부 영상 신호에 따라 구동-제어 신호들을 발생시키는 제어부;
    상기 제어부로부터의 제1 어드레스 신호들을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 상기 상부 디스플레이 패널의 어드레스 전극 라인들에 인가하는 상부 어드레스 구동부;
    상기 제어부로부터의 제2 어드레스 신호들을 처리하여 디스플레이 데이터 신 호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 상기 하부 디스플레이 패널의 어드레스 전극 라인들에 인가하는 하부 어드레스 구동부;
    상기 제어부로부터의 제1 M 구동-제어 신호에 따라 동작하여 상기 상부 디스플레이 패널의 M 전극 라인들을 구동하는 상부 M 구동부;
    상기 제어부로부터의 제2 M 구동-제어 신호에 따라 동작하여 상기 하부 디스플레이 패널의 M 전극 라인들을 구동하는 하부 M 구동부;
    상기 제어부로부터의 X 구동-제어 신호에 따라 동작하여 상기 X 전극 라인들을 구동하는 X 구동부; 및
    상기 제어부로부터의 Y 구동-제어 신호에 따라 동작하여 상기 Y 전극 라인들을 구동하는 Y 구동부를 포함한 방전 디스플레이 장치.
  6. 제1항에 있어서,
    상기 M 전극 라인들중에서 홀수번째 M 전극 라인들이 제1 방향으로 인출되고, 상기 M 전극 라인들중에서 짝수번째 M 전극 라인들이 상기 제1 방향과 반대인 제2 방향으로 인출되는 방전 디스플레이 장치.
  7. 제6항에 있어서,
    외부 영상 신호를 처리하여 적색, 녹색, 및 청색의 디지털 영상 데이터를 포함하는 내부 영상 신호를 발생시키는 영상 처리부;
    상기 영상 처리부로부터의 내부 영상 신호에 따라 구동-제어 신호들을 발생 시키는 제어부;
    상기 제어부로부터의 어드레스 신호들을 처리하여 디스플레이 데이터 신호들을 발생시키고, 발생된 디스플레이 데이터 신호들을 상기 어드레스 전극 라인들에 인가하는 어드레스 구동부;
    상기 제어부로부터의 제1 M 구동-제어 신호에 따라 동작하여 상기 홀수번째 M 전극 라인들을 구동하는 제1 M 구동부;
    상기 제어부로부터의 제2 구동-제어 신호에 따라 동작하여 상기 짝수번째 M 전극 라인들을 구동하는 제2 M 구동부;
    상기 제어부로부터의 X 구동-제어 신호에 따라 동작하여 상기 X 전극 라인들을 구동하는 X 구동부; 및
    상기 제어부로부터의 Y 구동-제어 신호에 따라 동작하여 상기 Y 전극 라인들을 구동하는 Y 구동부를 포함한 방전 디스플레이 장치.
  8. 제6항에 있어서,
    상기 어드레스 전극 라인들의 중앙부가 단절됨에 따라 상부 및 하부 디스플레이 패널들이 설정되고, 상기 어드레싱이 상기 상부 및 하부 디스플레이 패널들에서 동시에 수행되는 방전 디스플레이 장치.
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