KR100590058B1 - Plasma display panel and a driving method of the same - Google Patents

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Abstract

본 발명은 방전유지전극의 형상을 개선하여 방전 효율을 향상한 플라즈마 디스플레이 패널에 관한 것이다. The present invention relates to a plasma display panel having improved discharge efficiency by improving the shape of the discharge sustaining electrode.

상기한 목적을 달성하기 위하여 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널은, 서로 대향 배치되는 제1 기판과 제2 기판; 상기 제2 기판에 일방향을 따라 형성되는 어드레스전극들; 상기 제1 기판과 제2 기판의 사이공간에 배치되어 다수의 방전셀들을 구획하는 격벽; 상기 각 방전셀 내에 형성되는 형광체층; 및 상기 제1 기판상에 상기 어드레스전극과 교차하는 방향을 따라 길게 이어지면서 각 방전셀에 대응되는 제1 전극과 제2 전극을 포함하고, 상기 제1 전극은 상기 제2 전극을 향해 연장되는 돌출부를 가지고 상기 제2 전극은 상기 제1 전극의 돌출부를 수용하는 오목부를 가지며, 상기 돌출부와 오목부는 상기 어드레스전극과 교차하는 방향으로 제1 간격을 두고 이격되고 상기 어드레스전극과 나란한 방향으로 상기 제1 간격보다 더 큰 제2 간격을 두고 이격된다. In order to achieve the above object, a plasma display panel according to an embodiment of the present invention, the first substrate and the second substrate disposed opposite to each other; Address electrodes formed in one direction on the second substrate; A partition wall disposed between the first substrate and the second substrate to partition a plurality of discharge cells; Phosphor layers formed in the discharge cells; And a first electrode and a second electrode corresponding to each discharge cell while extending in a direction crossing the address electrode on the first substrate, wherein the first electrode extends toward the second electrode. The second electrode has a recess for accommodating the protrusion of the first electrode, wherein the protrusion and the recess are spaced at a first interval in a direction crossing the address electrode and are parallel to the address electrode. Spaced at a second interval that is greater than the interval.

플라즈마 디스플레이 패널, 격벽, 형광체, 효율Plasma display panel, bulkhead, phosphor, efficiency

Description

플라즈마 디스플레이 패널 및 그 구동 방법{PLASMA DISPLAY PANEL AND A DRIVING METHOD OF THE SAME} Plasma display panel and driving method thereof {PLASMA DISPLAY PANEL AND A DRIVING METHOD OF THE SAME}

도 1은 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 부분 평면도이다. 1 is a partial plan view of a plasma display panel according to a first embodiment of the present invention.

도 2는 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 부분 평면도이다. 2 is a partial plan view of a plasma display panel according to a second embodiment of the present invention.

도 3은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 부분 평면도이다. 3 is a partial plan view of a plasma display panel according to a third embodiment of the present invention.

도 4는 본 발명의 제2 실시예 및 제3 실시예에 따른 플라즈마 디스플레이 패널의 제1 구동 파형도이다.4 is a first driving waveform diagram of a plasma display panel according to a second embodiment and a third embodiment of the present invention.

도 5는 본 발명의 제2 실시예 및 제3 실시예에 따른 플라즈마 디스플레이 패널의 제2 구동 파형도이다.5 is a second driving waveform diagram of the plasma display panel according to the second and third embodiments of the present invention.

도 6는 종래 기술에 따른 플라즈마 디스플레이 패널의 분해 사시도이다. 6 is an exploded perspective view of a plasma display panel according to the prior art.

본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 보다 상세하게는 방전 유지전극의 형상을 개선하여 방전 효율을 향상하는 플라즈마 디스플레이 패널에 관한 것이다. The present invention relates to a plasma display panel, and more particularly, to a plasma display panel for improving the discharge efficiency by improving the shape of the discharge sustaining electrode.

플라즈마 디스플레이 패널(Plasma Display Panel : PDP)은 기체방전을 통하여 얻어진 플라즈마로부터 방사되는 진공자외선(VUV: Vacuum Ultra-Violet)이 형광체를 여기시킴으로서 발생되는 적(R), 녹(G), 청(B)의 가시광을 이용하여 소정의 영상을 구현하는 디스플레이 소자이다. 이러한 PDP는 60인치 이상의 초대형 화면을 불과 10㎝ 이내의 두께로 구현할 수 있고, CRT와 같은 자발광 디스플레이 소자이므로 색재현력 및 시야각에 따른 왜곡현상이 없는 특성을 가지며, 또한 LCD 등에 비해 제조공법이 단순하여 생산성 및 원가 측면에서도 강점을 갖는 TV 및 산업용 평판 디스플레이로 각광 받고 있다. Plasma Display Panel (PDP) is a red (R), green (G), blue (B) generated by the vacuum ultraviolet (VUV: Vacuum Ultra-Violet) emitted from the plasma obtained through gas discharge to excite the phosphor A display device that implements a predetermined image using visible light. The PDP can realize a 60-inch or larger screen with a thickness of only 10 cm or less, and since it is a self-luminous display device such as a CRT, it has no characteristic of distortion due to color reproduction and viewing angle, and also has a simple manufacturing method compared to LCD. It is gaining attention as a TV and industrial flat panel display that have strengths in terms of productivity and cost.

도 6을 참조하면, 종래의 일반적인 AC 플라즈마 디스플레이 패널은 제2 기판(110) 상에 일방향(도면의 x축 방향)을 따라 어드레스전극(112)이 형성되고 이 어드레스전극(112)을 덮으면서 제2 기판(110)의 전면에 유전층(113)이 형성된다. 유전층(113) 위로 스트라이프(stripe) 또는 매트릭스(matrix) 형상으로 배치되는 격벽(115)이 방전셀을 구획한다. 각각의 격벽(115)의 측면과 방전셀(19)의 바닥면에는 적(R), 녹(G), 청(B)색의 형광체층(117)이 형성된다. Referring to FIG. 6, in a conventional AC plasma display panel, an address electrode 112 is formed on a second substrate 110 in one direction (the x-axis direction of the drawing) and covers the address electrode 112. The dielectric layer 113 is formed on the entire surface of the second substrate 110. The partition wall 115 arranged in a stripe or matrix shape on the dielectric layer 113 defines a discharge cell. Phosphor layers 117 of red (R), green (G), and blue (B) colors are formed on the side surfaces of the partition walls 115 and the bottom surfaces of the discharge cells 19.

그리고 제2 기판(110)에 대향하는 제1 기판(100)의 일면에는 어드레스전극(112)과 교차하는 방향(도면의 y축 방향)을 따라 공통전극(102)과 스캔전극(103)으로 구성되는 방전유지전극(102, 103)이 형성되는 바, 상기 제2 기판(110) 상의 어드레스전극(112)과 제1 기판(100) 상의 한 쌍의 방전유지전극(102, 103)이 교차하는 지점이 방전셀을 구성하는 부분이 된다. One surface of the first substrate 100 facing the second substrate 110 includes a common electrode 102 and a scan electrode 103 along a direction crossing the address electrode 112 (y-axis direction in the drawing). The discharge sustain electrodes 102 and 103 are formed, and a point where the address electrodes 112 on the second substrate 110 and the pair of discharge sustain electrodes 102 and 103 on the first substrate 100 cross each other. It becomes a part which comprises this discharge cell.

이들 각 공통전극(102)과 스캔전극(103)은 각 방전셀의 중심에서 상기 어드레스전극 방향과 교차되는 방향의 가장자리를 마주하며 형성되며, 공통전극(102)과 스캔전극(103)은 각각 투명전극(102a, 103a)과 버스전극(102b, 103b)으로 이루어진다. Each of the common electrode 102 and the scan electrode 103 is formed at the center of each discharge cell facing the edge of the direction intersecting the direction of the address electrode, the common electrode 102 and the scan electrode 103 are each transparent It consists of electrodes 102a and 103a and bus electrodes 102b and 103b.

이러한 방전유지전극(102, 103)을 덮으면서 제1 기판(100) 전체에 유전층(106)과 MgO보호막(108)이 차례대로 형성된다. The dielectric layer 106 and the MgO passivation layer 108 are sequentially formed on the entire first substrate 100 while covering the discharge sustain electrodes 102 and 103.

이렇게 구성되는 플라즈마 디스플레이 패널의 내부에는 수백만 개 이상의 단위 방전셀들이 매트릭스(matrix) 형태로 배열되어 있다. 매트릭스 형태로 배열된 방전셀들을 동시 구동하기 위해서는 기억특성을 이용한 구동을 하게 된다.In the plasma display panel configured as described above, millions of unit discharge cells are arranged in a matrix form. In order to simultaneously drive the discharge cells arranged in a matrix form, driving is performed using a memory characteristic.

보다 자세히 설명하면, 한 쌍의 방전유지전극(102, 103)을 구성하는 공통전극(102)과 스캔전극(103) 사이에 방전을 일으키기 위해서는 특정 전압 이상의 전위차가 필요하며, 이 경계가 되는 전압을 방전개시전압(Vf: Firing Voltage)이라고 한다. 공통전극(102)과 스캔전극(103)이 짧은 방전 갭(gap)을 가지는 방전셀의 중심에서 방전개시전압이 가장 낮다. 따라서, 방전셀의 중심에서 방전이 개시되어 방전셀 전체로 확산된다. 방전이 개시된 방전셀의 중심부에서 상대적으로 강한 방전이, 격벽(115)이 형성된 부분에서는 상대적으로 약한 방전이 일어난다. In more detail, in order to cause a discharge between the common electrode 102 and the scan electrode 103 constituting the pair of discharge sustaining electrodes 102 and 103, a potential difference of a specific voltage or more is required, It is called the firing voltage (Vf). The discharge start voltage is lowest at the center of the discharge cell in which the common electrode 102 and the scan electrode 103 have a short discharge gap. Therefore, discharge starts at the center of the discharge cell and diffuses to the entire discharge cell. A relatively strong discharge occurs at the center of the discharge cell where the discharge is started, and a relatively weak discharge occurs at the portion where the partition wall 115 is formed.

격벽(115)은 측면에 형광체가 형성되어 강한 강도(intensity)의 광을 생성될 수 있는 부분이지만, 전술한 바와 같이 격벽(115) 주위에서는 상대적으로 약한 방전이 일어난다. 즉, 종래의 플라즈마 디스플레이 패널은 격벽(115)의 측면에 형성 된 형광체층을 효과적으로 활용할 수 없으므로 방전 효율이 낮다. The partition wall 115 is a portion in which phosphors are formed on the side surface to generate light of strong intensity, but as described above, relatively weak discharge occurs around the partition wall 115. That is, in the conventional plasma display panel, since the phosphor layer formed on the side surface of the partition wall 115 cannot be effectively utilized, the discharge efficiency is low.

본 발명은 상기한 문제를 해결하기 위한 것으로, 격벽 측면에 형성된 형광층을 효과적으로 활용하여 방전 효율이 높은 플라즈마 디스플레이 패널을 제공하는 것이다. The present invention is to solve the above problems, to provide a plasma display panel with high discharge efficiency by effectively utilizing the fluorescent layer formed on the side wall of the partition.

상기한 목적을 달성하기 위하여 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널은, 서로 대향 배치되는 제1 기판과 제2 기판; 상기 제2 기판에 일방향을 따라 형성되는 어드레스전극들; 상기 제1 기판과 제2 기판의 사이공간에 배치되어 다수의 방전셀들을 구획하는 격벽; 상기 각 방전셀 내에 형성되는 형광체층; 및 상기 제1 기판상에 상기 어드레스전극과 교차하는 방향을 따라 길게 이어지면서 각 방전셀에 대응되는 제1 전극과 제2 전극을 포함하고, 상기 제1 전극은 상기 제2 전극을 향해 연장되는 돌출부를 가지고 상기 제2 전극은 상기 제1 전극의 돌출부를 수용하는 오목부를 가지며, 상기 돌출부와 오목부는 상기 어드레스전극과 교차하는 방향으로 제1 간격을 두고 이격되고 상기 어드레스전극과 나란한 방향으로 상기 제1 간격보다 더 큰 제2 간격을 두고 이격된다. In order to achieve the above object, a plasma display panel according to an embodiment of the present invention, the first substrate and the second substrate disposed opposite to each other; Address electrodes formed in one direction on the second substrate; A partition wall disposed between the first substrate and the second substrate to partition a plurality of discharge cells; Phosphor layers formed in the discharge cells; And a first electrode and a second electrode corresponding to each discharge cell while extending in a direction crossing the address electrode on the first substrate, wherein the first electrode extends toward the second electrode. The second electrode has a recess for accommodating the protrusion of the first electrode, wherein the protrusion and the recess are spaced at a first interval in a direction crossing the address electrode and are parallel to the address electrode. Spaced at a second interval that is greater than the interval.

상기 제1 전극 및 제2 전극의 상기 제1 간격을 이루는 가장자리는 각각 어드레스 전극과 평행하게 형성될 수 있고, 상기 제1 전극 및 제2 전극의 상기 제2 간격을 이루는 가장자리는 각각 어드레스전극과 교차하는 방향으로 형성될 수 있다. The first spacing edges of the first electrode and the second electrode may be formed in parallel with the address electrode, respectively, and the second spacing edges of the first electrode and the second electrode cross each other with the address electrode. It may be formed in the direction.

상기 제1 전극 및 제2 전극 각각은 상기 제1 기판에 상기 어드레스전극과 교 차하는 방향을 따라 연장되어 형성되는 버스전극과, 이 버스전극으로부터 방전셀 중심을 향해 연장되는 투명전극을 포함하고, 상기 투명전극에 돌출부와 오목부가 형성될 수 있다. Each of the first electrode and the second electrode includes a bus electrode formed on the first substrate so as to extend along a direction crossing the address electrode, and a transparent electrode extending from the bus electrode toward the center of the discharge cell. Protrusions and recesses may be formed in the transparent electrode.

상기 돌출부와 오목부는 어드레스전극 연장방향으로 이웃한 방전셀들의 중심을 지나는 기준선에 대하여 대칭으로 형성될 수 있다. The protruding portion and the concave portion may be formed symmetrically with respect to a reference line passing through the centers of the discharge cells neighboring in the address electrode extending direction.

또한, 본 발명의 다른 실시예에 따른 플라즈마 디스플레이 패널은, 서로 대향 배치되는 제1 기판과 제2 기판; 상기 제2 기판에 일방향을 따라 형성되는 어드레스전극들; 상기 제1 기판과 제2 기판의 사이공간에 배치되어 다수의 방전셀들을 구획하는 격벽; 상기 각 방전셀 내에 형성되는 형광체층; 상기 제1 기판에 상기 어드레스전극과 교차하는 방향을 따라 길게 이어지며 형성되는 버스전극과, 상기 버스전극으로부터 각 방전셀 내부로 연장되는 돌출전극을 각각 포함하는 제1 전극과 제2 전극; 및 상기 제1 기판에 제1 전극과 제2 전극 사이에서 상기 어드레스전극과 교차하는 방향을 따라 길게 이어지며 형성되는 버스전극과, 상기 버스전극으로부터 상기 제1 전극과 제2 전극 각각을 향해 연장되는 돌출전극을 포함하는 제3 전극을 포함하고, 상기 제3 전극의 돌출전극은 상기 제1 전극 및 제2 전극의 돌출전극과 각각 어드레스전극과 교차하는 방향으로 제1 간격을 두고 이격되고, 상기 제3 전극의 버스전극은 제1 전극 및 제2 전극의 돌출전극과 각각 상기 어드레스전극과 나란한 방향으로 제2 간격을 두고 이격되며, 상기 제1 간격이 상기 제2 간격보다 더 작게 형성된다. In addition, the plasma display panel according to another embodiment of the present invention, the first substrate and the second substrate disposed opposite to each other; Address electrodes formed in one direction on the second substrate; A partition wall disposed between the first substrate and the second substrate to partition a plurality of discharge cells; Phosphor layers formed in the discharge cells; A first electrode and a second electrode on the first substrate, the bus electrode extending in a direction crossing the address electrode and a protruding electrode extending from the bus electrode into each discharge cell; And a bus electrode formed on the first substrate and extending in a direction crossing the address electrode between the first electrode and the second electrode, and extending from the bus electrode toward the first electrode and the second electrode, respectively. A third electrode including a protruding electrode, wherein the protruding electrode of the third electrode is spaced apart from the protruding electrodes of the first electrode and the second electrode at a first interval in a direction crossing the address electrode, respectively; The bus electrodes of the three electrodes are spaced apart from the protruding electrodes of the first electrode and the second electrode at a second interval in a direction parallel to the address electrodes, respectively, and the first interval is smaller than the second interval.

상기 제1 전극의 돌출전극과 제2 전극의 돌출전극은 상기 제3 전극의 돌출전 극과 상기 어드레스전극과 평행한 격벽 사이에서 각각 한 쌍이 형성되거나, 또는 상기 어드레스전극과 교차하는 방향으로 이웃한 방전셀은 제1 전극 및 제2 전극의 돌출전극을 적어도 한 쌍을 공유할 수 있다. The protruding electrode of the first electrode and the protruding electrode of the second electrode are each formed between a protruding electrode of the third electrode and a partition wall parallel to the address electrode, or adjacent to each other in a direction crossing the address electrode. The discharge cells may share at least one pair of protruding electrodes of the first electrode and the second electrode.

한편, 본 발명에 따른 플라즈마 디스플레이 패널의 일구동 방법은, 리셋구간에서 상기 제3 전극에 리셋 파형을 인가하는 단계; 스캔구간에서 상기 제3 전극에 스캔 펄스를 인가하는 단계; 유지방전기간에서 상기 제1 전극 및 상기 제2 전극에 공통의 유지 방전 전압 펄스를 인가하고, 상기 제3 전극에 이와 교번하는 유지 방전 펄스를 인가하는 단계를 포함한다. On the other hand, one driving method of the plasma display panel according to the present invention, the step of applying a reset waveform to the third electrode in the reset period; Applying a scan pulse to the third electrode in the scan period; And applying a common sustain discharge voltage pulse to the first electrode and the second electrode in a sustain discharge period, and applying a sustain discharge pulse alternately to the third electrode.

또한, 본 발명에 따른 플라즈마 디스플레이 패널의 다른 구동 방법은, 리셋기간에서 상기 제3 전극에 리셋 파형을 인가하는 단계; 스캔기간에서 상기 제3 전극에 스캔 펄스를 인가하는 단계; 유지방전기간에서 제1 전극과 제2 전극에 유지 방전 펄스를 교번하여 인가하는 단계를 포함한다. In addition, another driving method of the plasma display panel according to the present invention comprises the steps of: applying a reset waveform to the third electrode in the reset period; Applying a scan pulse to the third electrode in the scan period; And alternately applying a sustain discharge pulse to the first electrode and the second electrode in the sustain discharge period.

이하, 본 발명의 다양한 실시예를 첨부한 도면을 참조하여 상세하게 설명하면 다음과 같다. Hereinafter, various embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 부분 평면도이다. 1 is a partial plan view of a plasma display panel according to a first embodiment of the present invention.

본 실시예에 따른 플라즈마 디스플레이 패널은 기본적으로 제1 기판(미도시)과 제2 기판(미도시)이 소정의 간격을 두고 서로 대향 배치되고, 양 기판의 사이 공간에는 플라즈마 방전이 일어나는 다수의 방전셀(19)들이 격벽(15)에 의해 구획된다. 격벽(15)을 비롯한 방전셀(19)의 바닥면에는 적색(R), 녹색(G), 청색(B)의 형광체층(미도시)이 형성된다. In the plasma display panel according to the present exemplary embodiment, a plurality of discharges in which a first substrate (not shown) and a second substrate (not shown) are disposed to face each other at predetermined intervals, and a plasma discharge occurs in a space between both substrates The cells 19 are partitioned by the partition walls 15. Phosphor layers (not shown) of red (R), green (G), and blue (B) are formed on the bottom surface of the discharge cells 19 including the partition walls 15.

상기 제1 기판 상에는 이 기판의 일방향(도면의 x축 방향)을 따라 복수의 방전유지전극(12, 13)이 형성되며, 상기 제2 기판 상에는 상기 방전유지전극(12, 13)과 교차하는 방향(도면의 y축 방향)을 따라 복수의 어드레스전극(21)들이 형성된다.On the first substrate, a plurality of discharge sustaining electrodes 12 and 13 are formed along one direction (x-axis direction of the drawing) of the substrate, and a direction intersecting with the discharge sustaining electrodes 12 and 13 on the second substrate. A plurality of address electrodes 21 are formed along the (y-axis direction in the drawing).

상기 격벽(15)들은 서로 이웃하는 어드레스전극(21)들 사이에 각각 배치되면서 어드레스전극(21)과 나란한 방향을 따라 형성된다. 본 실시예에서는 상기와 같은 스트라이프형 격벽을 예로 들어 설명하고 있으나, 본 발명은 이에 한정되는 것이 아니며 어드레스전극(21)과 나란한 격벽부재 및 어드레스전극(21)과 교차하는 격벽부재가 함께 형성되어 방전셀(19)을 구획하는 폐쇄형 격벽구조에서도 본 발명이 적용될 수 있다. The barrier ribs 15 are disposed between the address electrodes 21 adjacent to each other, and are formed along a direction parallel to the address electrodes 21. In the present embodiment, the stripe-type partition wall is described as an example. However, the present invention is not limited thereto, and the partition member parallel to the address electrode 21 and the partition member intersecting the address electrode 21 are formed together and discharged. The present invention can also be applied to a closed partition structure that partitions the cell 19.

방전유지전극(12, 13)은 제1 전극(12)과 제2 전극(13)으로 이루어지고, 제1 전극(12)과 제2 전극(13)은 각각 투명전극(12a, 13a)과 버스전극(12b, 13b)으로 이루어진다. 여기서 투명전극(12a, 13a)은 방전셀(19) 내부에서 플라즈마 방전을 일으키는 역할을 하는 것으로 휘도확보를 위해 투명전극인 ITO(Indium Tin Oxide) 전극을 사용하는 것이 바람직하고, 버스전극(12b, 13b)은 이러한 투명전극의 높은 저항을 보상하여 통전성을 확보하기 위한 것으로 금속전극을 사용하는 것이 바람직하다. The discharge sustaining electrodes 12 and 13 are composed of a first electrode 12 and a second electrode 13, and the first electrode 12 and the second electrode 13 are each a transparent electrode 12a, 13a and a bus. It consists of electrodes 12b and 13b. In this case, the transparent electrodes 12a and 13a play a role of causing plasma discharge in the discharge cell 19. It is preferable to use an indium tin oxide (ITO) electrode, which is a transparent electrode, to secure luminance, and the bus electrodes 12b, 13b) is to compensate for the high resistance of the transparent electrode to secure the electrical conductivity, it is preferable to use a metal electrode.

상기 제1 전극과 제2 전극의 버스전극(12b, 13b)은 각 방전셀(19)에서 어드레스전극(21)과 교차하는 방향으로 일자형으로 서로 마주보며 나란히 배치된다. 제1 전극(12)의 투명전극(12a)에는 제2 전극(13)을 향해 연장되는 돌출부(12a´)가 형성되고, 제2 전극(13)의 투명전극(13a)에는 상기 돌출부를 수용하는 오목부(13a´)가 형성된다. 돌출부(12a')와 오목부(13a')는 방전셀(19)의 어드레스전극(21)의 연장방향으로 이웃한 방전셀들의 중심을 지나는 기준선(V)에 대해 각각 대칭으로 형성된다. The bus electrodes 12b and 13b of the first electrode and the second electrode are arranged side by side facing each other in a straight line in a direction crossing the address electrode 21 in each discharge cell 19. Protrusions 12a 'extending toward the second electrode 13 are formed in the transparent electrode 12a of the first electrode 12, and the protruding portions are accommodated in the transparent electrode 13a of the second electrode 13. A recess 13a 'is formed. The protruding portion 12a 'and the concave portion 13a' are formed symmetrically with respect to the reference line V passing through the center of the adjacent discharge cells in the extending direction of the address electrode 21 of the discharge cell 19, respectively.

상기 돌출부(12a')와 오목부(13a')는 어드레스전극(21)과 교차하는 방향(도면의 x축 방향)으로 제1 간격(L1)을 두고 이격되며, 어드레스전극(21)과 평행한 방향(도면의 y축 방향)으로 제2 간격(L2)을 두고 이격된다. 제1 간격(L1)을 이루는 가장자리는 어드레스전극(21)과 평행하는 방향(도면의 y축 방향)으로 형성되며, 제2 간격(L2)을 이루는 가장자리는 어드레스전극(21)과 교차하는 방향(도면의 x축 방향)으로 형성된다. The protruding portion 12a 'and the concave portion 13a' are spaced apart from each other at a first interval L1 in a direction crossing the address electrode 21 (the x-axis direction of the drawing) and parallel to the address electrode 21. In the direction (y-axis direction in the drawing) at a second interval L2. An edge forming the first gap L1 is formed in a direction parallel to the address electrode 21 (y-axis direction in the drawing), and an edge forming the second gap L2 is a direction crossing the address electrode 21 ( X-axis direction in the drawing).

상기 제1 간격(L1)은 상기 제2 간격(L2)보다 더 작게 형성된다. 따라서, 제1 전극(12)과 제2 전극(13)에서 사이의 방전은 제1 간격을 이루는 가장자리 사이에서 먼저 개시되어 제2 간격을 이루는 주방전 영역으로 확산된다. 방전이 개시되는 부분에서 상대적으로 강한 방전이 일어나므로, 제1 간격을 이루는 가장자리에서는 상대적으로 강한 방전이 일어난다. 즉, 방전셀의 중심이 아닌 방전셀의 측면에서 강한 방전이 일어나므로, 격벽 측면을 따라 형성된 형광체층을 강한 방전에 의해 여기시킬 수 있다. 즉, 형광체층을 효과적으로 여기시켜 휘도가 증가되고, 방전 효율이 향상되는 효과가 있다. The first gap L1 is smaller than the second gap L2. Therefore, the discharge between the first electrode 12 and the second electrode 13 is first initiated between the edges forming the first interval and diffused into the discharging region forming the second interval. Since a relatively strong discharge occurs at the portion where the discharge is started, a relatively strong discharge occurs at the edge forming the first interval. That is, since strong discharge occurs at the side of the discharge cell, not at the center of the discharge cell, the phosphor layer formed along the side wall of the partition can be excited by the strong discharge. In other words, the phosphor layer is effectively excited, thereby increasing the luminance and improving the discharge efficiency.

이하에서는 본 발명의 제2 실시예와 제3 실시예에 따른 플라즈마 디스플레이 패널을 설명한다. Hereinafter, the plasma display panel according to the second and third embodiments of the present invention will be described.

본 발명의 제2 실시예와 제3 실시예에 따른 플라즈마 디스플레이 패널은 제1 기판, 제2 기판, 격벽 및 형광체층은 전술한 제1 실시예에 따른 플라즈마 디스플레이 패널과 동일한 구조를 가지면서, 방전유지전극들의 구조가 다른 실시예들이다.In the plasma display panel according to the second and third embodiments of the present invention, the first substrate, the second substrate, the partition wall, and the phosphor layer have the same structure as the plasma display panel according to the first embodiment, and the discharge is performed. The structure of the sustain electrodes is another embodiment.

도 2는 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 부분 평면도이다. 2 is a partial plan view of a plasma display panel according to a second embodiment of the present invention.

방전유지전극(32, 33, 34)은 제1 전극(32), 제2 전극(33) 및 제3 전극(34)으로 이루어지며, 제1 전극(32), 제2 전극(33) 및 제3 전극(34)은 각각 돌출전극(32a, 33a, 34a)과 버스전극(32b, 33b, 34b)으로 이루어진다. 여기서 돌출전극(32a, 33a, 34a)은 방전셀(19) 내부에서 플라즈마 방전을 일으키는 역할을 하는 것으로 휘도 확보를 위해 투명전극인 ITO(Indium Tin Oxide) 전극을 사용하는 것이 바람직하고, 버스전극(32b, 33b, 34b)은 이러한 투명전극의 높은 저항을 보상하여 통전성을 확보하기 위한 것으로 금속전극을 사용하는 것이 바람직하다. The discharge sustaining electrodes 32, 33, and 34 are formed of the first electrode 32, the second electrode 33, and the third electrode 34, and the first electrode 32, the second electrode 33, and the first electrode 32. The three electrodes 34 consist of the protruding electrodes 32a, 33a, 34a and the bus electrodes 32b, 33b, 34b, respectively. The protruding electrodes 32a, 33a, and 34a serve to cause plasma discharge in the discharge cells 19. It is preferable to use an indium tin oxide (ITO) electrode, which is a transparent electrode, to secure luminance. 32b, 33b, and 34b are used to compensate for the high resistance of the transparent electrode to secure electrical conductivity, and it is preferable to use a metal electrode.

버스전극(32b, 33b, 34b)은 상기 제1 기판에 상기 어드레스전극과 교차하는 방향을 따라 길게 이어지며 형성된다. 제1 전극 및 제2 전극의 돌출전극(32a, 33a)은 각각 방전셀(19) 내부로 연장되며 형성되고, 제3 전극(34)의 돌출전극(34a)은 상기 제1 전극 및 제2 전극의 돌출전극(32a, 33a) 사이에서 연장되며 형성된다. Bus electrodes 32b, 33b, and 34b are formed on the first substrate so as to extend in a direction crossing the address electrode. The protruding electrodes 32a and 33a of the first electrode and the second electrode are formed to extend into the discharge cell 19, respectively, and the protruding electrodes 34a of the third electrode 34 are the first electrode and the second electrode. Extending between the protruding electrodes 32a and 33a.

제1 전극 및 제2 전극의 돌출전극(32a, 33a)은 제3 전극의 돌출전극(34a)과 어드레스전극(21)과 평행한 격벽(15) 사이에서 각각 한 쌍이 형성된다. A pair of protruding electrodes 32a and 33a of the first electrode and the second electrode are formed between the protruding electrode 34a of the third electrode and the partition wall 15 parallel to the address electrode 21.

제3 전극의 돌출전극(34a)은 상기 제1 전극 및 제2 전극의 돌출전극(32a, 33a)과 각각 어드레스전극(21)과 교차하는 방향으로 제1 간격(L3)을 두고 이격되고, 상기 제3 전극의 버스전극(34b)은 제1 전극 및 제2 전극의 돌출전극(32a, 33a)과 각각 상기 어드레스전극(21)과 나란한 방향으로 제2 간격(L4)을 두고 이격된다. The protruding electrode 34a of the third electrode is spaced apart from the protruding electrodes 32a and 33a of the first electrode and the second electrode at a first interval L3 in a direction crossing the address electrode 21, respectively. The bus electrode 34b of the third electrode is spaced apart from the protruding electrodes 32a and 33a of the first electrode and the second electrode at a second interval L4 in a direction parallel to the address electrode 21, respectively.

상기 제1 간격(L3)이 상기 제2 간격(L4)보다 더 작게 형성된다. 따라서, 방전유지기간에서의 방전은 제1 간격(L3)을 이루는 가장자리에서 개시되어 주방전 영역으로 확산된다. 방전이 개시되는 부분에서 상대적으로 강한 방전이 일어나므로, 제1 간격(L3)을 이루는 가장자리에서는 상대적으로 강한 방전이 일어난다. 즉, 방전셀의 중심이 아닌 방전셀의 측면에서 강한 방전이 일어나므로, 격벽 측면을 따라 형성된 형광체층을 효과적으로 여기시킬 수 있다.  The first gap L3 is smaller than the second gap L4. Therefore, the discharge in the discharge sustain period starts at the edge forming the first interval L3 and diffuses into the discharging region. Since a relatively strong discharge occurs at the portion where the discharge is started, a relatively strong discharge occurs at the edge forming the first interval (L3). That is, since strong discharge occurs at the side of the discharge cell, not at the center of the discharge cell, it is possible to effectively excite the phosphor layer formed along the sidewall of the partition wall.

도 3는 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 부분 평면도이다. 3 is a partial plan view of a plasma display panel according to a third embodiment of the present invention.

도 3을 참조하면, 본 발명의 제3 실시예는 전술한 제2 실시예와 기본적인 구조가 공통되며 제1 전극 및 제2 전극의 돌출전극의 구조가 제2 실시예에서 변형된 구조를 갖는다. Referring to FIG. 3, the third embodiment of the present invention has a basic structure in common with the above-described second embodiment, and the structures of the first electrode and the protruding electrode of the second electrode are modified in the second embodiment.

방전유지전극(42, 43, 44)은 제1 전극(42), 제2 전극(43) 및 제3 전극(44)으로 이루어지며, 제1 전극(42), 제2 전극(43) 및 제3 전극(44)은 각각 돌출전극(42a, 43a, 44a)과 버스전극(42b, 43b, 44b)으로 이루어진다. The discharge sustaining electrodes 42, 43, and 44 are composed of the first electrode 42, the second electrode 43, and the third electrode 44, and the first electrode 42, the second electrode 43, and the first electrode 42. The three electrodes 44 consist of the protruding electrodes 42a, 43a, 44a and the bus electrodes 42b, 43b, 44b, respectively.

제1 전극 및 제2 전극의 돌출전극(42a, 43a)을 상기 어드레스전극(21)과 교차하는 방향(도면의 x축 방향)으로 이웃한 방전셀(19)이 공유한다. The adjacent discharge cells 19 share the protruding electrodes 42a and 43a of the first electrode and the second electrode in the direction crossing the address electrode 21 (the x-axis direction in the drawing).

제3 전극의 돌출전극(44a)은 상기 제1 전극 및 제2 전극의 돌출전극(42a, 43a)과 각각 어드레스전극(21)과 교차하는 방향으로 제1 간격(L5)을 두고 이격되고, 상기 제3 전극의 버스전극(44b)은 제1 전극 및 제2 전극의 돌출전극(42a, 43a)과 각각 상기 어드레스전극(21)과 나란한 방향으로 제2 간격(L6)을 두고 이격된다. The protruding electrode 44a of the third electrode is spaced apart from the protruding electrodes 42a and 43a of the first electrode and the second electrode at a first interval L5 in a direction crossing the address electrode 21, respectively. The bus electrode 44b of the third electrode is spaced apart from the protruding electrodes 42a and 43a of the first electrode and the second electrode at a second interval L6 in a direction parallel to the address electrode 21, respectively.

상기 제1 간격(L5)이 상기 제2 간격(L6)보다 더 작게 형성된다. 따라서, 방전유지기간에서의 방전은 제1 간격(L5)을 이루는 가장자리에서 개시되어 주방전 영역으로 확산된다. 방전이 개시되는 부분에서 상대적으로 강한 방전이 일어나므로, 제1 간격(L5)을 이루는 가장자리에서는 상대적으로 강한 방전이 일어난다. 즉, 방전셀의 중심이 아닌 방전셀의 측면에서 강한 방전이 일어나므로, 격벽 측면을 따라 형성된 형광체층을 효과적으로 여기시킬 수 있다.  The first gap L5 is formed to be smaller than the second gap L6. Therefore, the discharge in the discharge sustain period starts at the edge forming the first interval L5 and diffuses into the discharging region. Since a relatively strong discharge occurs at the portion where the discharge is started, a relatively strong discharge occurs at the edge forming the first interval (L5). That is, since strong discharge occurs at the side of the discharge cell, not at the center of the discharge cell, it is possible to effectively excite the phosphor layer formed along the sidewall of the partition wall.

이하에서는, 본 발명의 제2 실시예와 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 방법에 대하여 설명한다. Hereinafter, a driving method of the plasma display panel according to the second and third embodiments of the present invention will be described.

도 4는 본 발명의 제2 실시예 및 제3 실시예에 따른 플라즈마 디스플레이 패널에 적용될 수 있는 제1 구동 파형도이다. 이 구동 방법은 Y전극, X전극 및 어드레스전극이 하나의 방전 셀을 이루는 3 전극 구조의 구동 방법으로, 본 발명의 제2 실시예 및 제3 실시예의 플라즈마 디스플레이 패널의 제1 및 제2 전극은 X 전극으로, 제3 전극은 Y 전극으로 기능한다. 4 is a first driving waveform diagram applicable to the plasma display panel according to the second and third embodiments of the present invention. The driving method is a driving method of a three-electrode structure in which the Y electrode, the X electrode, and the address electrode form one discharge cell. The first and second electrodes of the plasma display panel of the second and third embodiments of the present invention As the X electrode, the third electrode functions as the Y electrode.

도 4를 참조하면, 각 서브필드는 리셋기간, 어드레스 기간, 유지기간으로 구성된다. 4, each subfield is composed of a reset period, an address period, and a sustain period.

리셋 기간은 소거기간(I), Y 전극 상승파형 기간(Ⅱ) 및 X 전극 하강파형 기간(Ⅲ)으로 이루어진다. The reset period consists of the erasing period (I), the Y electrode rising waveform period (II) and the X electrode falling waveform period (III).

소거기간(Ⅰ)에는 제1 전극과 제2 전극에 완만하게 상승하는 전위를 인가하여 Ve 까지 상승하게 한다. Y 전극 상승파형 기간(Ⅱ)에서는 제1 및 제2 전극을 접지전압으로 바이어스시킨 상태에서, 제3 전극에 Vset 까지 완만하게 상승하는 파형을 인가한다. 이 때, 제3 전극에는 (-) 벽전하가 축적되고, 동시에 제1 및 제2 전극에는 (+) 벽전하가 축적된다. Y 전극 하강파형 기간(Ⅲ)에서는 제1 및 제2 전극을 Ve로 바이어스시킨 상태에서, 제3 전극에 완만하게 하강하는 파형을 인가한다. 그러면, 모든 셀의 각 전극의 벽전하가 균등하게 소거된다. In the erasing period (I), a slowly rising potential is applied to the first electrode and the second electrode to rise to Ve. In the Y electrode rising waveform period (II), a waveform rising slowly to Vset is applied to the third electrode while the first and second electrodes are biased to the ground voltage. At this time, negative wall charges are accumulated on the third electrode, and positive wall charges are accumulated on the first and second electrodes. In the Y-electrode falling waveform period (III), a gently falling waveform is applied to the third electrode while the first and second electrodes are biased to Ve. Then, the wall charges of the electrodes of all the cells are evenly erased.

어드레스 기간은 제1 및 제2 전극을 정전압(Ve)로 바이어스시킨 상태에서, 제3 전극에 순차적으로 스캔 전압을 인가하여 스캔 펄스를 인가하고, 동시에 어드레스 전극에는 방전을 원하는 셀에 어드레스 전압을 인가한다. 그러면, 제3 전극과 어드레스전극 사이에서 방전이 일어나면서, 제3 전극에는 (+) 벽전하가 축적되고, 제1 및 제2 전극에는 (-) 벽전하가 축적된다. In the address period, while the first and second electrodes are biased to the constant voltage Ve, scan pulses are sequentially applied to the third electrodes to apply scan pulses, and at the same time, the address electrodes are applied to the cells to be discharged. do. As a result, discharge occurs between the third electrode and the address electrode, whereby positive wall charges are accumulated on the third electrode and negative wall charges are accumulated on the first and second electrodes.

유지 방전 기간에서는, 제1 및 제2 전극에 공통의 유지 방전 전압 펄스를 인가하고, 상기 제3 전극에 이와 교번하는 유지 방전 펄스를 인가한다. 이와 같은 전압의 인가를 통해 어드레스 기간에서 선택된 방전 셀에서는 유지방전이 일어나게 된다. In the sustain discharge period, a common sustain discharge voltage pulse is applied to the first and second electrodes, and a sustain discharge pulse alternately to the third electrode is applied. Through the application of such a voltage, sustain discharge occurs in the discharge cells selected in the address period.

도 5는 본 발명의 제2 실시예 및 제3 실시예에 따른 플라즈마 디스플레이 패널에 적용될 수 있는 제2 구동 파형도이다. 이 구동 방법은 Y 전극, X 전극, M 전극 및 어드레스전극이 하나의 방전 셀을 이루는 4 전극 구조의 구동 방법으로, 본 발명의 제2 실시예 및 제3 실시예의 플라즈마 디스플레이 패널의 제1 전극은 Y전극 으로, 제2 전극은 X전극으로, 제3 전극은 M 전극으로 기능한다. 5 is a second driving waveform diagram applicable to the plasma display panel according to the second and third embodiments of the present invention. The driving method is a driving method of a four-electrode structure in which the Y electrode, the X electrode, the M electrode, and the address electrode form one discharge cell. The first electrode of the plasma display panel of the second and third embodiments of the present invention is It functions as the Y electrode, the second electrode as the X electrode, and the third electrode as the M electrode.

도 5를 참조하면, 각 서브필드는 리셋기간, 어드레스 기간, 유지기간으로 구성된다. Referring to FIG. 5, each subfield includes a reset period, an address period, and a sustain period.

리셋 기간은 소거 기간(Ⅰ), Y 전극 상승파형 기간(Ⅱ) 및 Y 전극 하강파형 기간(Ⅲ)으로 이루어진다. 소거 기간(Ⅰ)에서는 제1 전극을 전압 Vyc로 바이어스시킨 상태에서, 제3 전극에 Vmc 전압에서 접지전압까지 완만하게 하강하는 파형을 인가하여, 이전의 유지 기간에서 형성된 벽전하를 제거한다. 제3 전극 상승 파형기간(Ⅱ)에서는 이 기간 동안에는 제2전극 및 제1 전극을 접지전압으로 바이어스시킨 상태에서, 제3 전극에 전압 Vmd에서 Vset으로 완만하게 상승하는 파형 인가한다. 제3 전극 하강 파형기간(Ⅲ)에서는 제2전극 및 제1 전극을 각각 Vxe와 Vye로 바이어스시킨 상태에서, 제3 전극에 전압 Vme부터 접지 전압을 향해 완만하게 하강하는 파형을 인가한다. 그러면, 모든 셀의 각 전극에 쌓였던 벽전하가 균등하게 소거되어, 어드레스 전극에는 (+) 벽전하가 축적되고, 동시에 제2 전극, 제1 전극 및 제3 전극에는 (-) 벽전하가 축적된다.The reset period consists of the erasing period (I), the Y electrode rising waveform period (II) and the Y electrode falling waveform period (III). In the erasing period (I), while the first electrode is biased with the voltage Vyc, a waveform that gently falls from the Vmc voltage to the ground voltage is applied to the third electrode to remove the wall charges formed in the previous sustain period. In the third electrode rising waveform period (II), a waveform rising slowly from the voltage Vmd to Vset is applied to the third electrode while the second electrode and the first electrode are biased to the ground voltage during this period. In the third electrode falling waveform period (III), a waveform falling gently from the voltage Vme to the ground voltage is applied to the third electrode while the second electrode and the first electrode are biased at Vxe and Vye, respectively. Then, the wall charges accumulated on the electrodes of all the cells are evenly erased, and positive wall charges are accumulated on the address electrode, and negative wall charges are accumulated on the second electrode, the first electrode, and the third electrode at the same time. .

어드레스 기간에서는 다수의 제3 전극을 Vsc 전압으로 바이어스시킨 상태에서 제3 전극에 순차적으로 스캔 전압을 인가하여 스캔 펄스를 인가하고, 동시에 어드레스 전극에는 방전을 원하는 셀에 어드레스 전압을 인가한다. 이 때, 제2 전극에는 접지 전압으로 유지하고, 제1 전극에 제2 전극의 전압보다 높은 전압인 Vye를 인가한다. 그러면, 제3 전극과 어드레스 전극 사이의 방전이 일어나면서, 방전이 제2 전극 및 제1 전극으로 확장되고, 제2 전극 및 제3 전극에는 (+) 전하가 축 적되고, 제1 전극 및 어드레스 전극에는 (-) 벽전하가 축적된다.In the address period, scan pulses are sequentially applied to the third electrodes while the plurality of third electrodes are biased to the Vsc voltage, and at the same time, the address electrodes are applied to the cells to be discharged. At this time, the second electrode is maintained at a ground voltage, and Vye, which is higher than the voltage of the second electrode, is applied to the first electrode. Then, discharge occurs between the third electrode and the address electrode, the discharge extends to the second electrode and the first electrode, positive charge is accumulated on the second electrode and the third electrode, and the first electrode and the address are accumulated. Negative wall charges are accumulated on the electrodes.

유지 방전 기간에서는, 제3 전극을 유지 방전 전압 Vm로 바이어스시킨 상태에서, 제2 전극 및 제1 전극에 유지방전 전압 펄스를 교대로 인가한다. 이와 같은 전압의 인가를 통해 어드레스 기간에서 선택된 방전 셀에는 유지방전이 일어나게 된다. In the sustain discharge period, sustain discharge voltage pulses are alternately applied to the second electrode and the first electrode while the third electrode is biased at the sustain discharge voltage Vm. The sustain discharge occurs in the discharge cells selected in the address period by applying such a voltage.

유지 방전 초기에 발생하는 방전은, 제2 전극에 (+) 전압 펄스가 인가되고 제1 전극에 (-) 전압 펄스가 인가되고(여기서, + 및 -의 부호는 제2 전극에 인가된 전압과 제1 전극에 인가된 전압의 크기를 비교한 상대적인 개념으로서, 제2 전극에 + 펄스 전압이 인가되었다는 의미는 제2 전극에 제1 전극보다 큰 전압이 인가되었다는 것을 의미한다.), 동시에 제3 전극에 (+) 전압펄스가 인가된다. 제2 전극/제3 전극과 제1 전극과의 방전이 일어나게 된다. 특히, 본 실시예에 따르면 제3 전극과 제1 전극의 제1 간격을 이루는 가장자리 사이에서 방전이 주도적인 역할을 한다.The discharge generated at the beginning of the sustain discharge has a positive voltage pulse applied to the second electrode and a negative voltage pulse applied to the first electrode (where the signs of + and-are equal to the voltage applied to the second electrode). As a relative concept comparing the magnitudes of the voltages applied to the first electrode, the fact that + pulse voltage is applied to the second electrode means that a voltage greater than the first electrode is applied to the second electrode. A positive voltage pulse is applied to the electrode. Discharge of the second electrode / third electrode and the first electrode occurs. In particular, according to the present embodiment, the discharge plays a dominant role between the edges forming the first gap between the third electrode and the first electrode.

유지 방전의 첫 번째 유지방전 펄스 인가 후에는, 제3 전극의 전압이 일정 전압(Vm)으로 바이어스되기 때문에, 주 방전은 제2 전극 및 제1 전극 사이의 방전이 되고, 결국 제2 전극 및 제1 전극에 교대로 인가되는 방전 펄스 수에 의해 입력된 영상을 표시할 수 있게 된다. After applying the first sustain discharge pulse of sustain discharge, since the voltage of the third electrode is biased to a constant voltage (Vm), the main discharge becomes a discharge between the second electrode and the first electrode, and eventually the second electrode and the first electrode. The input image can be displayed by the number of discharge pulses applied alternately to one electrode.

이처럼 제2 구동방법에 따르면, 유지 방전 초기에는 제1 간격을 이루는 가장자리 사이의 숏갭 방전에 의해 방전을 수행하기 때문에 프라이밍 파티클이 적은 상태에서도 충분한 방전을 수행하고, 정상적인 상태에서는 제2 전극 및 제1 전극 사 이의 롱갭 방전에 의해 방전을 수행하기 때문에 안정적인 방전을 수행할 수 있다. As described above, according to the second driving method, since the discharge is performed by the short gap discharge between the edges forming the first interval at the initial stage of the sustain discharge, sufficient discharge is performed even in the state where the priming particles are small, and in the normal state, the second electrode and the first electrode are discharged. Since the discharge is performed by the long gap discharge between the electrodes, a stable discharge can be performed.

상기에서 제1 전극과 제2 전극의 파형을 서로 바뀌어도 구동이 가능하며, 또한 M 전극에 인가되는 리셋 파형은 다양한 형태의 리셋 파형이 인가될 수 있다. The waveforms of the first electrode and the second electrode may be driven by changing the waveforms of the first electrode and the second electrode, and the reset waveforms applied to the M electrodes may be applied with various reset waveforms.

이상을 통해 본 발명의 바람직한 실시예에 대하여 설명하였지만, 본 발명은 이에 한정되는 것이 아니고 특허청구범위와 발명의 상세한 설명 및 첨부한 도면의 범위 안에서 여러 가지로 변형하여 실시하는 것이 가능하고 이 또한 본 발명의 범위에 속하는 것은 당연하다. Although the preferred embodiments of the present invention have been described above, the present invention is not limited thereto, and various modifications and changes can be made within the scope of the claims and the detailed description of the invention and the accompanying drawings. Naturally, it belongs to the scope of the invention.

이상과 같이 본 발명에 따른 플라즈마 디스플레이 패널은 방전셀의 측면에서 방전이 개시되어, 방전셀의 측면에서 강한 방전이 일어나므로, 격벽에 형성된 형광체층을 강한 방전에 의해 여기시킬 수 있다. 즉, 형광체층을 효과적으로 여기시켜 휘도가 증가되고, 방전 효율이 향상되는 효과가 있다. As described above, in the plasma display panel according to the present invention, since the discharge starts from the side of the discharge cell and the strong discharge occurs from the side of the discharge cell, the phosphor layer formed on the partition wall can be excited by the strong discharge. In other words, the phosphor layer is effectively excited, thereby increasing the luminance and improving the discharge efficiency.

Claims (10)

삭제delete 삭제delete 삭제delete 삭제delete 삭제delete 서로 대향 배치되는 제1 기판과 제2 기판; A first substrate and a second substrate disposed to face each other; 상기 제2 기판에 일방향을 따라 형성되는 어드레스전극들;Address electrodes formed in one direction on the second substrate; 상기 제1 기판과 제2 기판의 사이공간에 배치되어 다수의 방전셀들을 구획하는 격벽; A partition wall disposed between the first substrate and the second substrate to partition a plurality of discharge cells; 상기 각 방전셀 내에 형성되는 형광체층; Phosphor layers formed in the discharge cells; 상기 제1 기판에 상기 어드레스전극과 교차하는 방향을 따라 길게 이어지며 형성되는 버스전극과, 상기 버스전극으로부터 각 방전셀 내부로 연장되는 돌출전극을 각각 포함하는 제1 전극과 제2 전극; 및A first electrode and a second electrode on the first substrate, the bus electrode extending in a direction crossing the address electrode and a protruding electrode extending from the bus electrode into each discharge cell; And 상기 제1 기판에 제1 전극과 제2 전극 사이에서 상기 어드레스전극과 교차하는 방향을 따라 상기 방전셀을 가로질러 길게 이어지며 형성되는 버스전극과, 상기 각 방전셀 내에서 상기 버스전극으로부터 상기 제1 전극과 제2 전극 각각을 향해 연장되는 돌출전극을 포함하는 제3 전극A bus electrode formed on the first substrate to extend across the discharge cell in a direction intersecting the address electrode between a first electrode and a second electrode, and the first electrode from the bus electrode in each of the discharge cells; A third electrode including a protruding electrode extending toward each of the first electrode and the second electrode 을 포함하고, Including, 상기 제3 전극의 돌출전극은 상기 제1 전극 및 제2 전극의 돌출전극과 각각 어드레스전극과 교차하는 방향으로 제1 간격을 두고 이격되고, 상기 제3 전극의 버스전극은 제1 전극 및 제2 전극의 돌출전극과 각각 상기 어드레스전극과 나란한 방향으로 제2 간격을 두고 이격되며, 상기 제1 간격이 상기 제2 간격보다 더 작은 플라즈마 디스플레이 패널.The protruding electrodes of the third electrode are spaced apart from the protruding electrodes of the first and second electrodes at first intervals in a direction crossing the address electrodes, respectively, and the bus electrodes of the third electrode are formed of the first electrode and the second electrode. And a first gap spaced apart from the protruding electrode of the electrode by a second interval in a direction parallel to the address electrode, wherein the first gap is smaller than the second gap. 제 6 항에서, In claim 6, 상기 제1 전극의 돌출전극과 제2 전극의 돌출전극은 상기 제3 전극의 돌출전극과 상기 어드레스전극과 평행한 격벽 사이에서 각각 한 쌍이 형성되는 플라즈마 디스플레이 패널.And a pair of the protruding electrode of the first electrode and the protruding electrode of the second electrode are formed between the protruding electrode of the third electrode and the partition wall parallel to the address electrode. 제 6 항에서, In claim 6, 상기 어드레스전극과 교차하는 방향으로 이웃한 방전셀은 제1 전극 및 제2 전극의 돌출전극을 적어도 한 쌍을 공유하는 플라즈마 디스플레이 패널.And a discharge cell adjacent in the direction crossing the address electrode shares at least one pair of protruding electrodes of the first electrode and the second electrode. 삭제delete 제 6 항의 플라즈마 디스플레이 패널을 구동하는 방법에 있어서, In the method of driving the plasma display panel of claim 6, 리셋기간에서 상기 제3 전극에 리셋 파형을 인가하는 단계; Applying a reset waveform to the third electrode in a reset period; 스캔기간에서 상기 제3 전극에 스캔 펄스를 인가하는 단계; 및Applying a scan pulse to the third electrode in the scan period; And 유지방전기간에서 상기 제3 전극에는 일정한 전압을 유지하면서 상기 제1 전극과 상기 제2 전극에 유지 방전 펄스를 교번하여 인가하는 단계Alternately applying sustain discharge pulses to the first electrode and the second electrode while maintaining a constant voltage to the third electrode during the sustain discharge period; 를 포함하는 플라즈마 디스플레이 패널의 구동 방법. Method of driving a plasma display panel comprising a.
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