KR100491006B1 - 제너다이오드 및 트랜지스터를 이용한 정전압 회로 - Google Patents

제너다이오드 및 트랜지스터를 이용한 정전압 회로 Download PDF

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Abstract

본 발명은 제너다이오드 및 트랜지스터를 이용한 정전압 회로에 관한 것으로, 본 발명은 입력단자(PI,G)를 통한 입력전압을 원하는 정전압으로 제어하여 출력단자(PO,G)로 출력하는 정전압 회로에 있어서, 상기 입력단자의 PI단에 일단을 접속한 제1 저항(Rz)과, 이 제1 저항(Rz)의 타단과 접지(G)단 사이에 접속한 적어도 1개의 제너다이오드를 포함하는 기준전압 설정부(42); 상기 입력단자의 PI단에 컬렉터단을 접속하고, 상기 출력단자의 PO에 에미터단을 접속하여, 상기 컬렉터단과 베이스단을 제2 저항(Rc)을 통해 접속한 제1 트랜지스터(Q1)를 포함한 출력전압 조절부(43); 상기 출력단자(PO,G) 사이에 제3 저항(R1) 및 제4 저항(R2)을 직렬로 접속한 출력전압 검출부(44); 상기 기준전압 설정부(42)의 제너다이오드의 캐소드단에 반전(-)단자를 접속하고, 상기 출력전압 검출부(44)의 제3 저항(R1)과 제4 저항(R2)의 접속점(P2)에 비반전(+)단자를 비교한 비교부(45); 및 상기 비교부(45)의 출력단에 베이스를 접속하고, 상기 제1 트랜지스터(Q1)의 베이스에 컬렉터단을 접속하며, 접지(G)단에 제5 저항(Re)을 통해 에미터단을 접속한 제2 트랜지스터(Q2)를 포함하는 출력전압 제어부(46)를 구비하며, 이와 같이 구성된 본 발명에 의하면, 제너다이오드와 트랜지스터를 이용하여 정전압 회로를 간단하게 구현함으로서, 사용 부품수를 줄여서 고장 발생율을 낮출 수 있으며, 또한 사전에 설정한 원하는 출력전압으로 제어할 수 있다.

Description

제너다이오드 및 트랜지스터를 이용한 정전압 회로{constant-voltage CIRCUIT USING ZENER DIODE AND TRANSISTOR}
본 발명은 제너다이오드 및 트랜지스터를 이용한 정전압 회로에 관한 것으로, 특히 제너다이오드와 트랜지스터를 이용하여 정전압 회로를 간단하게 구현함으로서, 사용 부품수를 줄여서 고장 발생율을 낮출 수 있으며, 또한 사전에 설정한 원하는 출력전압으로 제어할 수 있도록 하는 제너다이오드 및 트랜지스터를 이용한 정전압 회로에 관한 것이다.
도 1은 일반적인 배터리 차저 회로도로서, 도 1을 참조하면, 배터리 차저(Battery Charger) 장치는 교류전압원의 전압에 의해 인버터회로(다이오드와 SCR 로 구성)가 동작하고, 이 정전압 회로(SID)에 의해 정전압이 제공된다. 즉, 평상시에는 일정한 에너지(전원)를 저장해 두었다가 사고 및 설비 점검시 정전을 시킬 때 기타 전장품 장치가 정상적으로 동작할 수 있도록 에너지를 공급해 주는 장치이며, 이 배터리 차저를 이용하면, 일정기간 정전이 발생하더라도 일정한 전압을 지속적으로 발생시키기 위해서 일반적으로 정전압 입력전압을 20% 이상 높게 전압이 입력되고 출력을 정전압을 출력하게 한다.
도 2는 종래 정전압 회로(SID)도로서, 도 2를 참조하면, 입력단자(Po-No)의 입력 전압(대략 120V)을 출력단자(P-N)의 출력전압(대략 100V)을 생성시키는데 있어서, 직렬 삽입 다이오드(D10(10개), D20(10개), D30(10개))의 강하 전압(drop voltage)을 이용하여 출력단자(P-N)의 출력 전압을 조정하는 기능을 가지는 회로이다. 여기서, 다이오드는 직렬로 삽입되는 경우 한 개당 0.7V씩 전압 강하가 발생된다. 또한, 실리콘 강하기(SID: Silicon Dropper), SID1 ~ SID3의 직렬 연결 다이오드 개수에 따라 출력 전압의 조정 간극(step)이 결정되고, SID가 많이 연결될수록 출력 전압 조정 전압 폭이 넓어진다.
예를 들어, 각 SID에 다이오드가 3개씩 연결되면 각 SIP의 강하 전압폭이 2.1V가 되며, 회로에 투입된 SID의 개수가 5개인 경우, 입력 전압과 출력 전압의 차이는 2.1V씩 최대 10.5V가 된다. 이때, 출력 전압의 조정은 SID단에 병렬로 연결되어 있는 MC(magnetic contact, MS1 ~ MS3)들의 동작으로 수행되는데, MC의 동작 상황에 따라 출력 전압이 조정된다.
또한, 도2에서, 각 MC(MS1 ~ MS3)는 도3에 도시된 하이/로우(High/Low) 릴레이의 동작에 따라 SID PCB에서 제어되며, 입력 전압을 그대로 출력측으로 보내고자 하는 경우에는 MS1을 동작시키고, 출력 전압을 낮추고자 하는 경우에는 직렬연결 다이오드(D10 ~ D30)의 개수를 늘이도록 MC(MS1 ~ MS3)를 제어한다. 이러한 MC(MS1 ~ MS3)들은 릴레이들(RYA ~ RYC)의 접점에 의해 동작되는데, 릴레이(RYA ~ RYC)의 코일 여자는, 하이/로우(High/Low) 릴레이에서 원하는 전압보다 높은 전압이 출력되는 경우에 순차적으로 직렬 연결 다이오드의 개수를 늘이도록 제어된다.
순차적으로 직렬 연결 SID의 개수를 늘어나는 동작은 다음과 같이 수행된다. 동작 초기에는 릴레이 MC MS1이 동작하여 입력 전압이 그대로 출력 전압으로 전달된다. 만약 출력전압이 원하는 설정 전압보다 높은 경우, 하이/로우 릴레이의 접점(H-N)이 동작, 릴레이A(RYA) 동작하게 되는데, 릴레이A(RYA)의 접점이 동작하고, MC MS1이 열리고, 릴레이B(RYB)가 여자되어 MC MS2가 투입된다. 이 경우에도 출력전압이 원하는 설정 전압보다 높은 경우, 하이/로우 릴레이의 접점(H-N)이 다시 동작, 릴레이B(RYB)의 접점이 동작, MC MS2가 열리고, 릴레이C(RYC)가 여자되어, MC MS3이 투입된다.
만약, 입력 전압이 낮아져서 출력 전압이 하강하는 경우, 직렬 투입 다이오드의 개수를 낮춰야 한다. 출력전압이 원하는 설정 전압보다 낮은 경우에는, 하이/로우 릴레이의 접점(P-L)이 동작, 릴레이B(RYB)의 접점이 동작, 릴레이C(RYC)에 의해 MC MS3이 열리고, MC MS2가 투입된다. 이와 같이 동작함으로서 능동적으로 출력 전압이 일정하도록 제어된다.
이와 같은 종래의 배터리 처저에서 정전압을 발생시키기 위한 제어방법으로는 다이오드를 이용하는 전압강하 방법을 이용하고 있는데, 이러한 방법을 수행하기 위한 종래의 배터리 처저 회로에서는 각 전압강하 단계별(예,3단계)로 10여개의 다이오드를 직렬로 연결하여 다이오드의 애노드와 캐소드간 전압강하(voltage drop)(대략, 0.7-1.0V)를 이용하여 원하는 정전압을 제공한다.
따라서, 이를 제어하기 위해서는 제어회로 외에 별도 30여개의 다이오드와 3개의 자기 접촉기(Magnetic Contactor)가 필요하게 되며, 이 자기 접촉기는 영구적인 전장품이 아니라 접촉기 팁(Tip)의 마모상태에 따라 매번 교환해 주어야 하는 문제점이 있고, 또한, 다이오드는 내부 전압 강하값에 의해 제어를 하므로 다이오드의 열을 냉각해 주어야 하는 문제점이 있었으며, 정전압 회로의 출력측의 10V의 스텝을 가지고 온/오프되는 문제점이 있었던 것이다.
본 발명은 상기한 문제점을 해결하기 위해 안출한 것으로, 따라서, 본 발명의 목적은 제너다이오드와 트랜지스터를 이용하여 정전압 회로를 간단하게 구현함으로서, 사용 부품수를 줄여서 고장 발생율을 낮출 수 있으며, 또한 사전에 설정한 원하는 출력전압으로 제어할 수 있도록 하는 제너다이오드 및 트랜지스터를 이용한 정전압 회로를 제공하는데 있다.
상기한 본 발명의 목적을 달성하기 위한 기술적인 수단으로써, 본 발명의 회로는 입력단자를 통한 입력전압을 원하는 정전압으로 제어하여 출력단자로 출력하는 정전압 회로에 있어서, 상기 입력단자의 PI단에 일단을 접속한 제1 저항과, 이 제1 저항의 타단과 접지(G)단 사이에 접속한 적어도 1개의 제너다이오드를 포함하는 기준전압 설정부; 상기 입력단자의 PI단에 컬렉터단을 접속하고, 상기 출력단자의 PO에 에미터단을 접속하여, 상기 컬렉터단과 베이스단을 제2 저항을 통해 접속한 제1 트랜지스터를 포함한 출력전압 조절부; 상기 출력단자 사이에 제3 저항 및 제4 저항을 직렬로 접속한 출력전압 검출부; 상기 기준전압 설정부의 제너다이오드의 캐소드단에 반전(-)단자를 접속하고, 상기 출력전압 검출부의 제3 저항과 제4 저항의 접속점에 비반전(+)단자를 비교한 비교부; 및 상기 비교부의 출력단에 베이스를 접속하고, 상기 제1 트랜지스터의 베이스에 컬렉터단을 접속하며, 접지단에 제5 저항을 통해 에미터단을 접속한 제2 트랜지스터를 포함하는 출력전압 제어부를 구비함을 특징으로 한다.
이하, 본 발명에 따른 정전압 회로에 대하여 첨부도면을 참조하여 그 구성 및 작용을 상세하게 설명한다. 본 발명에 참조된 도면에서 실질적으로 동일한 구성과 기능을 가진 구성요소들은 동일한 부호를 사용할 것이다.
도 3은 본 발명에 따른 제너다이오드를 이용한 배터리 차저 정전압 회로도로서, 도 3을 참조하면, 본 발명에 따른 정전압 회로는 입력단자(PI,G)를 통한 입력전압을 원하는 정전압으로 제어하여 출력단자(PO,G)로 출력하는 정전압 회로로서, 이는 상기 입력단자의 PI단에 일단을 접속한 제1 저항(Rz)과, 이 제1 저항(Rz)의 타단과 접지(G)단 사이에 접속한 적어도 1개의 제너다이오드를 포함하는 기준전압 설정부(42)와, 상기 입력단자의 PI단에 컬렉터단을 접속하고, 상기 출력단자의 PO에 에미터단을 접속하여, 상기 컬렉터단과 베이스단을 제2 저항(Rc)을 통해 접속한 제1 트랜지스터(Q1)를 포함한 출력전압 조절부(43)와, 상기 출력단자(PO,G) 사이에 제3 저항(R1) 및 제4 저항(R2)을 직렬로 접속한 출력전압 검출부(44)와, 상기 기준전압 설정부(42)의 제너다이오드의 캐소드단에 반전(-)단자를 접속하고, 상기 출력전압 검출부(44)의 제3 저항(R1)과 제4 저항(R2)의 접속점(P2)에 비반전(+)단자를 비교한 비교부(45)와, 그리고 상기 비교부(45)의 출력단에 베이스를 접속하고, 상기 제1 트랜지스터(Q1)의 베이스에 컬렉터단을 접속하며, 접지(G)단에 제5 저항(Re)을 통해 에미터단을 접속한 제2 트랜지스터(Q2)를 포함하는 출력전압 제어부(46)를 포함한다.
상기 기준전압 설정부(42)는 상기 입력단자의 PI단에 일단을 접속한 제1 저항(Rz)과, 이 제1 저항(Rz)의 타단에 캐소드단을 접속한 제1 제너다이오드(ZD1)와, 상기 제1 제너다이오드(ZD1)의 애노드단에 캐소드단을 접속하고, 접지(G)단에 애노드단을 접속한 제2 제너다이오드(ZD2)와, 상기 제2 제너다이오드(ZD2)에 병렬로 연결한 제5 커패시터(C5)를 포함하고, 상기 제1 제너다이오드(ZD1)와 제2 제너다이오드(ZD2)와의 접속점에 상기 비교부(45)의 반전단자를 접속하여 구성한다.
또한, 본 발명에 따른 정전압 회로는 상기 기준전압 설정부(42)의 접지(G)단과 제1 제너다이오드(ZD1)의 캐소드단 사이에 제3 및 제4 커패시터(C3,C4)를 병렬로 접속한 필터부(41)를 더 포함한다. 상기 출력전압 조절부(43)는 상기 제2 저항(Rc)에 병렬로 접속한 제1 커패시터(C1)를 더 포함한다.
상기 출력전압 검출부(44)는 제3 저항(R1)과 제4 저항(R2)의 합저항과 제4 저항(R2)의 저항 비를 기준전압(Vref)과 출력전압(Vout)의 비로 설정하며, 그리고, 상기 출력전압 검출부(44)는 상기 제3 저항(R1)에 병렬로 접속한 제2 커패시터(C2)를 더 포함한다.
도 4는 본 발명에 다른 정전압 회로의 주요 신호 타임챠트이다.그리고, 도 5는 본 발명과 종래간의 출력전압 비교 파형도이다.
이와 같이 구성된 본 발명의 바람직한 실시예에 동작을 첨부도면에 의거하여 하기에 상세히 설명한다.
도 3 내지 도 5를 참조하여 본 발명에 따른 정전압 회로에 대한 동작을 설명하면, 입력단자(PI,G)를 통한 입력전압(Vin)(120V)은 본 발명의 정전압 회로에 의해서 사전에 설정된 정전압으로 제어하여 출력단자(PO,G)로 출력한다. 이에 대해서 구체적으로 설명하면 다음과 같다.
먼저, 입력단자(PI,G)를 통한 입력전압(120V)은 기준전압 설정부(42)의 제1 및 제2 제너다이오드(ZD1,ZD2)에 의해서 사전에 설정된 기준전압으로 유지되며, 특히 상기 제2 제너다이오드(ZD2)의 양단에 걸리는 기준전압, 즉 항복전압이 비교부(45)의 반전자로 제공된다.
이때, 상기 제1 및 제2 제너다이오드(ZD1,ZD2)에 걸리는 전압에 대한 노이즈(잡음)는 필터부(41)의 제3,제4 커패시터에 의해서 접지로 바이패스되어, 제1 및 제2 제너다이오드(ZD1,ZD2)에 의해 발생되는 전압은 노이즈가 없는 전압이 되고, 또한, 상기 제2 제너다이오드(ZD2)에 의한 전압은 제5 커패시터(C5)에 의해 평활되어 보다 깨끗한 전압이 상기 비교부(45)의 반전단자로 공급될 수 있다.
또한, 입력단자(PI,G)를 통한 입력전압(120V)은 출력전압 조절부(43)를 통해서 출력단자로 공급되며, 이때, 직렬로 제1 트랜지스터(Q1)를 통하는데, 이 제1 트랜지스터(Q1)의 베이스단자로 주입되는 전류에 따라 제1 트랜지스터(Q1)의 컬렉터단자와 에미터단자 사이의 드랍(drop)전압이 변화하여 출력단자의 전압이 제어된다.
한편, 이러한 부궤한(negative feedback) 회로에서 과도상태에서 공진으로 인해 출력단자부의 출력전압(Vout)이 안정화 되지 못하고 출렁이는 경우가 있는데, 이를 방지하기 위해서 제1 커패시터(C1)를 추가적으로 설치하였으며, 상기 제1 트랜지스터(Q1)의 베이스단자로 제공되는 전류는 제1 커패시터(C1)에 의해서 적당하게 지연되고, 이로 인해 공진으로 인한 출력전압의 불안정을 방지할 수 있다. 상기 출력전압 조절부(43)의 제1 트랜지스터(Q1)는 하기에 설명되는 출력전압 제어부(46)에 의해 제어된다.
그리고, 출력전압 검출부(44)는 상기 출력전압 조절부(43)를 통한 전압을 제3 저항(R1) 및 제4 저항(R2)으로 분할하고, 상기 제4 저항(R2) 양단에 걸리는 전압은 상기 비교부(45)의 비반전(+)단자로 공급된다. 이때, 상기 제3 저항(R1)과 제4 저항(R2)의 합저항과 제4 저항(R2)의 저항 비를 기준전압(Vref)과 출력전압(Vout)의 비로 설정하는데, 예를 들어, 원하는 출력전압이 100V이고, 상기 기준전압 설정부(42)에 의해 설정된 기준전압이 10V일 경우에, 상기 제3, 제4 저항의 합저항(R1+R2)과 제4 저항(R2)의 저항비는 10:1(100V:10V)이 되며, 이에 따르면, 100V에서 90V는 제3 저항(R1)에 걸리고, 10V는 제4 저항(R2)에 걸린다.
상기 비교부(45)는 반전(-)단자로 입력되는 기준전압 설정부(42)의 기준전압(Vref)과, 비반전(+)단자로 입력되는 상기 출력전압 검출부(44)의 검출전압(VR2)을 비교하는데, 검출전압이 기준전압보다 크면 하이레벨을, 반대이면 로우레벨을 출력한다. 예를 들면, 입력전압이 120V이고, 원하는 출력전압이 100V일 경우에, 기준전압(Vref)을 10V로 설정한 경우에, 상기 출력단자(PO,G)로 출력되는 출력전압이 100V일 경우에는 검출전압이 10V가 되며, 출력전압이 100V이하로 떨어지면 검출전압이 10V보다 작아지게 되고, 반면, 출력전압이 100V이상으로 상승되면, 검출전압이 10V보다 커지게 된다.
이때, 출력전압 제어부(46)는 상기 비교부(45)의 출력레벨에 따라 상기 출력전압 조절부(43)의 동작을 제어하여 출력전압을 조절하게 되는데, 상기 비교부(45)의 출력레벨이 하이레벨이면 상기 출력전압 제어부(46)의 제2 트랜지스터(Q2)가 턴온 되고, 이에 따라 상기 출력전압 조절부(43)의 제1 트랜지스터(Q1)의 베이스로 공급되는 전류를 접지로 바이패스시켜, 전압(VA)이 도 4에 도시한 P1지점과 같이 낮아지며, 이에 따라 출력단자의 출력전압(Vout)을 낮아지게 한다.
반면에, 상기 비교부(45)의 출력레벨이 로우레벨이면 상기 출력전압 제어부(46)의 제2 트랜지스터(Q2)가 턴오프 되고, 이에 따라 상기 출력전압 조절부(43)의 제1 트랜지스터(Q1)의 베이스에 전류가 정상적으로 공급되어 전압(VA)이 도 4에 도시한 P2지점과 같이 높아지며, 이에 따라 출력잔자의 출력전압(Vout)을 높아지게 한다. 이러한 동작타이밍은 도 4를 참조하면 쉽게 알 수 있다.
또한, 상기 제3 저항(R1)에 병렬로 접속한 제2 커패시터(C2)에의해서, 출력전압은 평활되어 리플성분 등이 보다 더 개선된 안정된 전압으로 된다.
이와 같이, 원하는 출력전압 100V를 중심으로 하여, 상기 출력전압 제어부(46)의 제어에 따른 상기 출력전압 조절부(43)의 동작, 즉 제1 트랜지스터가 턴온/턴오프를 반복적으로 수행함에 의해서, 도 7에 도시한 바와 같이, 출력전압이 크게 변동하지 않고 종래의 정전압 회로에 의한 출력전압 보다 상대적으로 안정된 100V의 정전압을 출력하게 된다.
상술한 바와 같은 본 발명에 따르면, 제너다이오드와 트랜지스터를 이용하여 정전압 회로를 간단하게 구현함으로서, 사용 부품수를 줄여서 고장 발생율을 낮출 수 있으며, 또한 사전에 설정한 원하는 출력전압으로 제어할 수 있도록 하는 특별한 효과가 있다.
이상의 설명은 본 발명의 구체적인 실시 예에 대한 설명에 불과하고, 본 발명은 이러한 구체적인 실시 예에 한정되지 않으며, 또한, 본 발명에 대한 상술한 구체적인 실시 예로부터 그 구성의 다양한 변경 및 개조가 가능하다는 것을 본 발명이 속하는 기술분야의 통상의 지식을 가진 자는 쉽게 알 수 있다.
도 1은 일반적인 배터리 차저 회로도이다.
도 2는 종래 정전압 회로도이다.
도 3은 본 발명에 따른 제너다이오드를 이용한 배터리 차저 정전압 회로도이다.
도 4는 본 발명에 다른 정전압 회로의 주요 신호 타임챠트이다.
도 5는 본 발명과 종래간의 출력전압 비교 파형도이다.
* 도면의 주요부분에 대한 부호의 설명 *
41 : 필터부 42 : 기준전압 설정부
43 : 출력전압 조절부 44 : 출력전압 검출부
45 : 비교부 46 : 출력전압 제어부
ZD1,ZD2 : 제1,제2 제너다이오드 C1 : 제1 커패시터(전류지연용)
C2 : 제2 커패시터(출력전압 평활용) C3, C4 : 제3,제4 커패시터(필터용)
C5 : 제5 커패시터(기준전압 평활용)

Claims (6)

  1. 입력단자(PI,G)를 통한 입력전압을 원하는 정전압으로 제어하여 출력단자(PO,G)로 출력하는 정전압 회로에 있어서,
    상기 입력단자의 PI단에 일단을 접속한 제1 저항(Rz)과, 이 제1 저항(Rz)의 타단과 접지(G)단 사이에 접속한 적어도 1개의 제너다이오드를 포함하는 기준전압 설정부(42);
    상기 입력단자의 PI단에 컬렉터단을 접속하고, 상기 출력단자의 PO에 에미터단을 접속하여, 상기 컬렉터단과 베이스단을 제2 저항(Rc)을 통해 접속한 제1 트랜지스터(Q1)를 포함한 출력전압 조절부(43);
    상기 출력단자(PO,G) 사이에 제3 저항(R1) 및 제4 저항(R2)을 직렬로 접속한 출력전압 검출부(44);
    상기 기준전압 설정부(42)의 제너다이오드의 캐소드단에 반전(-)단자를 접속하고, 상기 출력전압 검출부(44)의 제3 저항(R1)과 제4 저항(R2)의 접속점(P2)에 비반전(+)단자를 비교한 비교부(45); 및
    상기 비교부(45)의 출력단에 베이스를 접속하고, 상기 제1 트랜지스터(Q1)의 베이스에 컬렉터단을 접속하며, 접지(G)단에 제5 저항(Re)을 통해 에미터단을 접속한 제2 트랜지스터(Q2)를 포함하는 출력전압 제어부(46)를 구비함을 특징으로 하는 정전압 회로.
  2. 제1항에 있어서, 상기 기준전압 설정부(42)는
    상기 입력단자의 PI단에 일단을 접속한 제1 저항(Rz)과, 이 제1 저항(Rz)의 타단에 캐소드단을 접속한 제1 제너다이오드(ZD1);
    상기 제1 제너다이오드(ZD1)의 애노드단에 캐소드단을 접속하고, 접지(G)단에 애노드단을 접속한 제2 제너다이오드(ZD2); 및
    상기 제2 제너다이오드(ZD2)에 병렬로 연결한 제5 커패시터(C5)를 포함하고,
    상기 제1 제너다이오드(ZD1)와 제2 제너다이오드(ZD2)와의 접속점에 상기 비교부(45)의 반전단자를 접속한 것을 특징으로 하는 정전압 회로.
  3. 제2항에 있어서,
    상기 기준전압 설정부(42)의 접지(G)단과 제1 제너다이오드(ZD1)의 캐소드단 사이에 제3 및 제4 커패시터(C3,C4)를 병렬로 접속한 필터부(41)를 더 포함함을 특징으로 하는 정전압 회로.
  4. 제1항에 있어서, 상기 출력전압 조절부(43)는
    상기 제2 저항(Rc)에 병렬로 접속한 제1 커패시터(C1)를 더 포함하는 것을 특징으로 하는 정전압 회로.
  5. 제1항에 있어서, 상기 출력전압 검출부(44)는
    제3 저항(R1)과 제4 저항(R2)의 합저항과 제4 저항(R2)의 저항 비를 기준전압(Vref)과 출력전압(Vout)의 비로 설정한 것을 특징으로 하는 정전압 회로.
  6. 제1항에 있어서, 상기 출력전압 검출부(44)는
    상기 제3 저항(R1)에 병렬로 접속한 제2 커패시터(C2)를 더 포함하는 것을 특징으로 하는 정전압 회로.
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