KR100340062B1 - 아날로그-디지털 변환 시간을 최적화한 아날로그-디지털변환 장치 및 그 변환 방법 - Google Patents
아날로그-디지털 변환 시간을 최적화한 아날로그-디지털변환 장치 및 그 변환 방법 Download PDFInfo
- Publication number
- KR100340062B1 KR100340062B1 KR1019990060573A KR19990060573A KR100340062B1 KR 100340062 B1 KR100340062 B1 KR 100340062B1 KR 1019990060573 A KR1019990060573 A KR 1019990060573A KR 19990060573 A KR19990060573 A KR 19990060573A KR 100340062 B1 KR100340062 B1 KR 100340062B1
- Authority
- KR
- South Korea
- Prior art keywords
- analog
- signal
- reference signal
- digital
- equivalent
- Prior art date
Links
- 238000000034 method Methods 0.000 title claims abstract description 40
- 238000006243 chemical reaction Methods 0.000 claims abstract description 48
- 230000004044 response Effects 0.000 claims abstract description 4
- 238000010586 diagram Methods 0.000 description 7
- 230000008569 process Effects 0.000 description 7
- 230000008901 benefit Effects 0.000 description 2
- 230000008859 change Effects 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/50—Analogue/digital converters with intermediate conversion to time interval
- H03M1/56—Input signal compared with linear ramp
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/14—Conversion in steps with each step involving the same or a different conversion means and delivering more than one bit
- H03M1/16—Conversion in steps with each step involving the same or a different conversion means and delivering more than one bit with scale factor modification, i.e. by changing the amplification between the steps
- H03M1/164—Conversion in steps with each step involving the same or a different conversion means and delivering more than one bit with scale factor modification, i.e. by changing the amplification between the steps the steps being performed sequentially in series-connected stages
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
Description
Claims (7)
- 삭제
- 디지털 기준 신호를 저장하는 저장수단;상기 디지털 기준 신호를 아날로그 신호로 변환하여 아날로그 기준 신호로 출력하는 디지털-아날로그 변환 수단;상기 디지털-아날로그 변환 수단으로부터 입력되는 상기 아날로그 기준 신호 및 변환하고자 입력되는 아날로그 입력 신호를 서로 비교하여, 상기 아날로그 입력 신호가 상기 아날로그 기준 신호보다 크거나 같은 경우 "1"의 비교 결과 신호를 출력하는 비교 수단;상기 비교 수단으로부터 출력되는 비교 결과 신호를 차례대로 각각 저장하는 제1 및 제2 래치수단;상기 제1 및 제2 래치수단에 저장된 비교 결과 신호에 대한 등가 여부를 비교하는 등가비교수단; 및상기 등가비교수단으로부터 출력되는 등가비교결과신호에 응답하여 상기 디지털 기준 신호를 제어하는 제어수단을 포함하는 아날로그-디지털 변환 장치.
- 제 2 항에 있어서,상기 비교 수단은,상기 아날로그 입력 신호가 상기 아날로그 기준 신호보다 작은 경우에 상기 비교 결과 신호를 "0"으로 출력하는 아날로그-디지털 변환 장치.
- 제 2 항에 있어서,상기 등가비교수단은,상기 아날로그 입력 신호가 상기 아날로그 기준 신호보다 2번 연속으로 크거나 작을 때 상기 등가비교결과신호를 인에이블시켜 출력하는 것을 특징으로 하는 아날로그-디지털 변환 장치.
- 제 4 항에 있어서,상기 제어 수단은,상기 등가비교결과신호가 인에이블된 경우에 N비트의 상기 아날로그 입력 신호에 대해 SAR(Successive Approximation Register) 방식으로 아날로그-디지털 변환하도록 상기 저장 수단을 제어하는 것을 특징으로 하는 아날로그-디지털 변환 장치.
- 제 4 항에 있어서,상기 제어 수단은,상기 등가비교결과신호가 디스에이블된 경우에 N비트의 상기 아날로그 입력 신호에 대해 트래킹(tracking) 방식으로 아날로그-디지털 변환하도록 상기 저장 수단을 제어하는 것을 특징으로 하는 아날로그-디지털 변환 장치.
- 상기 제 2 항의 아날로그-디지털 변환 장치를 위한 아날로그-디지털 변환 방법에 있어서,상기 등가비교수단으로부터 출력되는 등가비교결과신호의 인에이블 여부를 체크하는 제1 단계;상기 제1 단계의 체크 결과, 상기 등가비교결과신호가 인에이블되었을 경우에 상기 디지털 기준 신호의 비트를 카운팅하기 위한 제1 변수를 "1"로 세팅하고, 상기 디지털 기준 신호를 초기화하는 제2 단계;상기 제1 변수 값에 해당하는 상기 디지털 기준 신호의 비트에 "1"을 할당하는 제3 단계;상기 제3 단계로부터 출력되는 디지털 기준 신호를 제1 아날로그 기준 신호로 변환한 후 상기 제1 아날로그 기준 신호와 변환하고자 외부로부터 입력되는 제1 아날로그 입력 신호를 비교하는 제4 단계;상기 제4 단계의 비교 결과, 상기 제1 아날로그 기준 신호가 상기 제1 아날로그 입력 신호보다 큰 경우 상기 제1 변수 값에 해당하는 상기 디지털 기준 신호의 비트에 "0"을 할당하며, 상기 제1 아날로그 기준 신호가 상기 제1 아날로그 입력 신호보다 작거나 같은 경우 상기 디지탈 기준 신호의 비트에 "1"을 할당하는 제5 단계;상기 제5 단계 수행 후 상기 제1 변수와 상기 디지털 기준 신호의 비트수를 비교하는 제6 단계;상기 제6 단계의 비교 결과, 상기 제1 변수가 상기 디지털 기준 신호의 비트수보다 작은 경우 상기 제1 변수에 "1"을 가산한 후에 상기 제3 단계부터 반복수행하고, 상기 제1 변수가 상기 디지털 기준 신호의 비트수보다 크거나 같은 경우 상기 제1 단계로 피드백하여 반복수행하는 제7 단계;상기 제1 단계의 체크 결과, 상기 등가비교결과신호가 디스에이블되었을 경우 상기 디지털 기준 신호를 제2 아날로그 기준 신호로 변환한 후 상기 제2 아날로그 기준 신호와 변환하고자 외부로부터 입력되는 제2 아날로그 입력 신호를 비교하는 제8 단계;상기 제8 단계의 비교 결과, 상기 제2 아날로그 입력 신호가 상기 제2 아날로그 기준 신호보다 크거나 같은 경우 상기 디지털 기준 신호를 소정 크기 증가시켜 상기 제2 아날로그 입력 신호의 변환된 디지털 신호로 출력하고, 상기 제1 단계로 피드백하는 제9 단계; 및상기 제8 단계의 비교 결과, 상기 제2 아날로그 입력 신호가 상기 제2 아날로그 기준 신호보다 작은 경우 상기 디지털 기준 신호를 소정 크기 감소시켜 상기 제2 아날로그 입력 신호의 변환된 디지털 신호로 출력하고, 상기 제1 단계로 피드백하는 제10 단계를 포함하여 이루어지는 N비트 아날로그-디지털 변환 방법.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019990060573A KR100340062B1 (ko) | 1999-12-22 | 1999-12-22 | 아날로그-디지털 변환 시간을 최적화한 아날로그-디지털변환 장치 및 그 변환 방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019990060573A KR100340062B1 (ko) | 1999-12-22 | 1999-12-22 | 아날로그-디지털 변환 시간을 최적화한 아날로그-디지털변환 장치 및 그 변환 방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20010063488A KR20010063488A (ko) | 2001-07-09 |
KR100340062B1 true KR100340062B1 (ko) | 2002-06-12 |
Family
ID=19628296
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019990060573A KR100340062B1 (ko) | 1999-12-22 | 1999-12-22 | 아날로그-디지털 변환 시간을 최적화한 아날로그-디지털변환 장치 및 그 변환 방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100340062B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7714763B2 (en) | 2007-12-11 | 2010-05-11 | Hynix Semiconductor, Inc. | Circuit and method for preventing bang-bang error, calibration circuit including the circuit, and analog-to-digital converter including the circuit |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100447235B1 (ko) * | 2001-12-28 | 2004-09-04 | 주식회사 하이닉스반도체 | 아날로그-디지털 변환장치 |
KR100696945B1 (ko) * | 2004-06-10 | 2007-03-20 | 전자부품연구원 | 아날로그 디지털 변환기의 단위 블록을 재사용하여고해상도를 구현하는 축차근사형 아날로그 디지털 변환 장치 |
-
1999
- 1999-12-22 KR KR1019990060573A patent/KR100340062B1/ko active IP Right Grant
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7714763B2 (en) | 2007-12-11 | 2010-05-11 | Hynix Semiconductor, Inc. | Circuit and method for preventing bang-bang error, calibration circuit including the circuit, and analog-to-digital converter including the circuit |
Also Published As
Publication number | Publication date |
---|---|
KR20010063488A (ko) | 2001-07-09 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100318441B1 (ko) | 아날로그-디지털변환장치및그변환방법 | |
US7535391B1 (en) | Analog-to-digital converter having random capacitor assignment and method thereof | |
US8514123B2 (en) | Compact SAR ADC | |
CA2004317C (en) | Successive comparison type analog-to-digital converting apparatus | |
US5187483A (en) | Serial-to-parallel type analog-digital converting apparatus and operating method thereof | |
TW201524133A (zh) | 連續近似式類比數位轉換器 | |
US20210159906A1 (en) | Analog to digital converter | |
US6891490B2 (en) | Analog-to-digital converter with digital signal processing functionality to emulate many different sample frequencies, resolutions, and architectures | |
EP0289081A1 (en) | Digital-to-analog converter | |
KR101844555B1 (ko) | Flash ADC가 결합된 SAR ADC | |
US5455583A (en) | Combined conventional/neural network analog to digital converter | |
US10218376B1 (en) | Capacitive digital-to-analog converter | |
KR100340062B1 (ko) | 아날로그-디지털 변환 시간을 최적화한 아날로그-디지털변환 장치 및 그 변환 방법 | |
US20230261665A1 (en) | Successive-approximation analog-to-digital converters | |
US5424736A (en) | Latched neural network A/D converter | |
US6847322B2 (en) | Sequential comparison type AD converter and microcomputer | |
US5479169A (en) | Multiple neural network analog to digital converter for simultaneously processing multiple samples | |
US6927723B2 (en) | A/D converter and A/D conversion method | |
US6700523B2 (en) | Analog to digital converter selecting reference voltages in accordance with feedback from prior stages | |
JP2014236373A (ja) | A/d変換装置 | |
KR20000003449A (ko) | 아날로그-디지털 변환 장치 및 그 변환 방법 | |
JPH1070463A (ja) | アナログ/ディジタル変換回路 | |
US6040794A (en) | High-speed analog-to-digital converter | |
KR100339542B1 (ko) | 고속 아날로그/디지털 변환기 | |
KR100318446B1 (ko) | 축차근사레지스터를이용한아날로그-디지털변환장치 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 20130422 Year of fee payment: 12 |
|
FPAY | Annual fee payment |
Payment date: 20140421 Year of fee payment: 13 |
|
FPAY | Annual fee payment | ||
FPAY | Annual fee payment |
Payment date: 20160418 Year of fee payment: 15 |
|
FPAY | Annual fee payment |
Payment date: 20170418 Year of fee payment: 16 |
|
FPAY | Annual fee payment |
Payment date: 20180418 Year of fee payment: 17 |
|
FPAY | Annual fee payment |
Payment date: 20190417 Year of fee payment: 18 |