KR100290857B1 - 디지털 티브이(Ｄｉｇｉｔａｌ ＴＶ)의 클럭 복원장치 - Google Patents
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Abstract
디지털 티브이(Digital TV)의 클럭 복원장치는 QAM 시스템 또는 VSB 시스템에서의 심볼 클럭을 복원하는 과정에서 시스템 클럭의 지터를 최소화시키도록 하기 위한 것으로서, 제 1 및 제 2 데시메이트(decimate)부와 전압 제어 발진부를 구비한 디지털 티브이(Digital TV)의 클럭 복원장치에 있어서, 상기 제 1 데시메이트(decimate)부의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하는 제 3 필터와, 상기 제 2 데시메이트(decimate)부의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하는 제 4 필터와, 상기 제 3 및 제 4 필터에서 각각 출력된 신호의 제로-크로싱(zero-crossing) 영역의 타이밍 에러를 검출하는 가드너 타이밍 에러 검출부(Gardner TED)와, 루프 밴드위스(loop bandwidth)의 크기를 조정하여 기어 시프팅(gear shifting)시키기 위한 락 디텍트(lock detect)부와, 상기 락 디텍트(lock detect)부의 신호에 따라 가드너 타이밍 에러 검출부(Gardner TED)에서 출력된 신호의 루프 밴드위스(loop bandwidth)를 필터링하여 그 결과신호를 상기 전압 제어 발진부로 출력하는 루프 필터로 구성되는데 그 요지가 있다.
Description
본 발명은 디지털 티브이(Digital TV)에 관한 것으로, 특히 디지털 티브이(Digital TV)의 클럭 복원장치에 관한 것이다.
디지털 커뮤니케이션 시스템(Digital Communication System)에서 송신부와 수신부의 동기를 위해 클럭을 따로 전송한다는 것은 매우 비효율적이다.
왜냐하면 부가적인 회로, 밴드위스, 파워 등을 더 필요하게 된다.
따라서 현재의 시스템에서는 모듈레이티드 웨이브펌(modulated waveform)에서 심볼 레이트의 다중 또는 심볼 레이트에 해당하는 클럭을 복원하게 된다.
이렇게 심볼 클럭을 복원하는 시스템은 데이터-에이드(Data-Aided) 방식과 넌-데이터-에이드(Non-Data-Aided) 방식으로 분류하기도 한다.
상기 데이터-에이드(Data-Aided) 방식은 결정 지향 방식이라고 부르기도 한다.
이 방법은 시간 간격이 긴 등화기에서는 긴 지연의 조정 회로에서 생기는 타이밍 지터 문제와 반송파 동기 회로의 등화기의 상호 연관성 문제 때문에 그다지 적합하지 않다.
한편, 빠른 심볼 동기를 위해 반송파 복구와 독립적으로 동작할 수 있는 NDA방식이 선호되기도 한다.
이하, 일반적인 가드너(Gardner) 알고리즘을 사용하였을 경우 디지털 티브이(Digital TV)의 클럭 복원장치에 대하여 첨부한 도면을 참조하여 설명하면 다음과 같다.
도 1 은 일반적인 가드너(Gardner) 알고리즘을 사용하였을 경우 디지털 티브이(Digital TV)의 클럭 복원장치의 구성을 나타낸 도면으로, 수신되는 QAM(Quadrature Amplitude Modulation)신호를 그에 상응하는 디지털 신호로 변환하는 아날로그/디지털 변환부(1)와, 상기 아날로그/디지털 변환부(1)에서 변환된 신호와 Cosnπ/2(1, 0, -1, 0....)를 혼합하는 제 1 혼합부(2)와, 상기 제 1 혼합부(2)에서 혼합된 신호에 포함된 노이즈 제거 및 소정 대역으로 필터링하는 제 1 필터(3)와, 상기 제 1 필터(3)에서 필터링된 신호를 데시메이트(decimate)하는 제 1 데시메이트(decimate)부(4)와, 상기 아날로그/디지털 변환부(1)에서 변환된 신호와 Sinnπ/2(1, 0, -1, 0....)를 혼합하는 제 2 혼합부(5)와, 상기 제 2 혼합부(5)에서 혼합된 신호에 포함된 노이즈 제거 및 소정 대역으로 필터링하는 제 2 필터(6)와, 상기 제 2 필터(6)에서 필터링된 신호를 데시메이트(decimate)하는 제 2 데시메이트(decimate)부(7)와, 상기 제 1 및 제 2 데시메이트(decimate)부(4)(7)에서 출력된 신호의 타이밍 에러를 검출하는 가드너 타이밍 에러 검출부(Gardner TED)(8)와, 상기 가드너 타이밍 에러 검출부(Gardner TED)(8)에서 출력된 신호의 루프 밴드위스(loop bandwidth)를 필터링하는 루프 필터(9)와, 상기 루프 필터(9)의 신호에 따라 소정 주파수를 발생하는 전압 제어 발진부(10)로 구성된다.
이와 같이 구성된 일반적인 가드너(Gardner) 알고리즘을 사용하였을 경우 디지털 티브이(Digital TV)의 클럭 복원장치의 동작을 첨부한 도면을 참조하여 상세히 설명하면 다음과 같다.
먼저, 아날로그/디지털 변환부(1)는 수신되는 4체배된 QAM신호를 그에 상응하는 디지털 신호로 변환하여 그 결과신호를 출력한다.
그러면 제 1 혼합부(2)는 상기 아날로그/디지털 변환부(1)에서 변환된 QAM신호인 I신호와 Cosnπ/2(1, 0, -1, 0....)를 혼합하여 그 결과신호를 출력한다.
이어 제 1 필터(3)는 상기 제 1 혼합부(2)에서 혼합된 신호에 포함된 노이즈 제거 및 소정 대역으로 필터링하여 그 결과신호를 출력한다.
이에 따라 제 1 데시메이트(decimate)부(4)는 상기 제 1 필터(3)에서 필터링된 신호를 데시메이트(decimate)하여 2체배의 QAM신호(yI, I)를 출력한다.
또한, 제 2 혼합부(5)는 상기 아날로그/디지털 변환부(1)에서 변환된 신호와 Sinnπ/2(1, 0, -1, 0....)를 혼합하여 그 결과신호를 출력한다.
그러면 제 2 필터(6)는 상기 제 2 혼합부(5)에서 혼합된 신호에 포함된 노이즈 제거 및 소정 대역으로 필터링하여 그 결과신호를 출력한다.
상기 제 1 및 제 2 필터(3)(6)는 스퀘어 루트 알씨 필터(Square Root RC filer)이다.
이어 제 2 데시메이트(decimate)부(7)는 상기 제 2 필터(6)에서 필터링된 신호를 데시메이트(decimate)하여 2체배의 QAM신호(yQ, Q)를 출력한다.
이에 따라 가드너 타이밍 에러 검출부(Gardner TED)(8)는 상기 제 1 및 제 2 데시메이트(decimate)부(4)(7)에서 각각 출력된 2체배의 QAM신호의 타이밍 에러를 검출하여 그 결과신호를 출력한다.
즉 가드너 타이밍 에러 검출부(Gardner TED)(8)는 상기 QAM신호와 같이 I, Q신호 모두에 타이밍 정보가 있는 경우에는 상기 제 1 및 제 2 데시메이트(decimate)부(4)(7)에서 각각 출력된 yI, yQ신호를 입력받고, VSB(Vestigial SideBand)신호의 경우 I신호에만 타이밍 정보가 있는 경우에는 상기 제 1 데시메이트(decimate)부(4)에서 출력된 yI신호만을 입력받아 타이밍 에러를 검출하여 그 결과신호를 출력한다.
그러면 루프 필터(9)는 상기 가드너 타이밍 에러 검출부(Gardner TED)(8)에서 출력된 신호의 루프 밴드위스(loop bandwidth)를 필터링하여 그 결과신호를 출력한다.
이에 따라 전압 제어 발진부(10)는 상기 루프 필터(9)의 신호에 따라 소정 주파수를 발생한다.
그러면 아날로그/디지털 변환부(1)는 상기 전압 제어 발진부(10)의 소정 주파수에 따라 수신되는 4체배의 QAM신호를 그에 상응하는 디지털 신호로 변환하여 출력하며 이후의 과정을 전술한 바와 동일함으로써 이에 대한 설명은 생략한다.
이러한 일반적인 가드너(Gardner) 알고리즘을 사용하였을 경우 디지털 티브이(Digital TV)의 클럭 복원장치에 있어서는 인접한 펄스의 스펙트럼 중첩 부분에서 타이밍 정보를 얻게 되므로 신호의 대역이 심하게 제한되지 않는 경우 타이밍 함수의 경사가 커서 우수한 성능을 보이지만 8VSB 시스템 또는 256QAM 시스템과 같이 심하게 대역을 제한하는 경우에서는 타이밍 함수의 경사가 낮아져 복구된 시스템 클럭의 지터가 심하거나 복구가 불가능한 문제점이 있다.
따라서 본 발명은 상기와 같은 문제점을 해결하기 위해 안출한 것으로서, QAM 시스템 또는 VSB 시스템에서의 심볼 클럭을 복원하는 과정에서 시스템 클럭의 지터를 최소화시키도록 한 디지털 티브이(Digital TV)의 클럭 복원장치를 제공하는데 그 목적이 있다.
도 1 은 일반적인 가드너(Gardner) 알고리즘을 사용하였을 경우 디지털 티브이(Digital TV)의 클럭 복원장치의 구성을 나타낸 도면
도 2 는 본 발명에 따른 디지털 티브이(Digital TV)의 클럭 복원장치의 구성을 나타낸 일실시예도
도 3 은 도 2 의 루프 필터의 구성을 나타낸 일실시예도
도 4 는 도 2 에 따른 시그널 베어리언스(signal variance)의 결과를 나타낸 도면
도면의 주요부분에 대한 부호의 설명
101 : 아날로그/디지털 변환부 102 : 제 1 혼합부
103 : 제 1 필터 104 : 제 1 데시메이트(decimate)부
105 : 제 3 필터 106 : 제 2 혼합부
107 : 제 2 필터 108 : 제 2 데시메이트(decimate)부
109 : 제 4 필터
110 : 가드너 타이밍 에러 검출부(Gardner TED)
111 : 락 디텍트(lock detect)부 112 : 루프 필터
113 : 전압 제어 발진부
상기와 같은 목적을 달성하기 위한 본 발명에 따른 디지털 티브이(Digital TV)의 클럭 복원장치의 특징은, 제 1 및 제 2 데시메이트(decimate)부와 전압 제어 발진부를 구비한 디지털 티브이(Digital TV)의 클럭 복원장치에 있어서, 상기 제 1 데시메이트(decimate)부의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하는 제 3 필터와, 상기 제 2 데시메이트(decimate)부의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하는 제 4 필터와, 상기 제 3 및 제 4 필터에서 각각 출력된 신호의 제로-크로싱(zero-crossing) 영역의 타이밍 에러를 검출하는 가드너 타이밍 에러 검출부(Gardner TED)와, 루프 밴드위스(loop bandwidth)의 크기를 조정하여 기어 시프팅(gear shifting)시키기 위한 락 디텍트(lock detect)부와, 상기 락 디텍트(lock detect)부의 신호에 따라 가드너 타이밍 에러 검출부(Gardner TED)에서 출력된 신호의 루프 밴드위스(loop bandwidth)를 필터링하여 그 결과신호를 상기 전압 제어 발진부로 출력하는 루프 필터를 포함하여 구성되는데 있다.
상기 루프 필터는 상기 가드너 타이밍 에러 검출부(Gardner TED)에서 출력된 신호에 소정 이득값을 연산하는 제 1 및 제 2 연산부와, 상기 제 1 및 제 2 연산부의 신호를 상기 락 디텍트(lock detect)부의 스위치(switch)신호에 따라 멀티플렉싱하는 제 1 멀티플렉서와, 상기 가드너 타이밍 에러 검출부(Gardner TED)에서 출력된 신호에 소정 이득값을 연산하는 제 3 및 제 4 연산부와, 상기 제 3 및 제 4 연산부의 신호를 상기 락 디텍트(lock detect)부의 스위치(switch)신호에 따라 멀티플렉싱하는 제 2 멀티플렉서와, 상기 제 2 멀티플렉서에서 멀티플렉싱된 신호를 어큐뮬레이트(accumulate)하는 어큐뮬레이터와, 상기 제 1 멀티플렉서에서 멀티플렉싱된 신호와 상기 어큐뮬레이터에서 어큐뮬레이트(accumulate)된 신호를 혼합하는 혼합부를 포함하여 구성되는데 다른 특징이 있다.
이하, 본 발명에 따른 디지털 티브이(Digital TV)의 클럭 복원장치의 바람직한 실시예에 대하여 첨부한 도면을 참조하여 설명하면 다음과 같다.
도 2 는 본 발명에 따른 디지털 티브이(Digital TV)의 클럭 복원장치의 구성을 나타낸 일실시예도로, 수신되는 QAM신호를 그에 상응하는 디지털 신호로 변환하는 아날로그/디지털 변환부(101)와, 상기 아날로그/디지털 변환부(101)에서 변환된 신호와 Cosnπ/2(1, 0, -1, 0....)를 혼합하는 제 1 혼합부(102)와, 상기 제 1 혼합부(102)에서 혼합된 신호에 포함된 노이즈 제거 및 소정 대역으로 필터링하는 제 1 필터(103)와, 상기 제 1 필터(103)에서 필터링된 신호를 데시메이트(decimate)하는 제 1 데시메이트(decimate)부(104)와, 상기 제 1 데시메이트(decimate)부의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하는 제 3 필터(105)와, 상기 아날로그/디지털 변환부(101)에서 변환된 신호와 Sinnπ/2(1, 0, -1, 0....)를 혼합하는 제 2 혼합부(106)와, 상기 제 2 혼합부(106)에서 혼합된 신호에 포함된 노이즈 제거 및 소정 대역으로 필터링하는 제 2 필터(107)와, 상기 제 2 필터(107)에서 필터링된 신호를 데시메이트(decimate)하는 제 2 데시메이트(decimate)부(108)와, 상기 제 2 데시메이트(decimate)부(108)의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하는 제 4 필터(109)와, 상기 제 3 및 제 4 필터(105)(109)에서 각각 출력된 신호의 제로-크로싱(zero-crossing) 영역의 타이밍 에러를 검출하는 가드너 타이밍 에러 검출부(Gardner TED)(110)와, 루프 밴드위스(loop bandwidth)의 크기를 조정하여 기어 시프팅(gear shifting)시키기 위한 락 디텍트(lock detect)부(111)와, 상기 락 디텍트(lock detect)부(111)의 신호에 따라 가드너 타이밍 에러 검출부(Gardner TED)(110)에서 출력된 신호의 루프 밴드위스(loop bandwidth)를 필터링하는 루프 필터(112)와, 상기 루프 필터(112)의 신호에 따라 소정 주파수를 발생하는 전압 제어 발진부(113)로 구성된다.
도 3 은 도 2 의 루프 필터의 구성을 나타낸 일실시예도로, 상기 가드너 타이밍 에러 검출부(Gardner TED)(110)에서 출력된 신호에 소정 이득값을 연산하는 제 1 및 제 2 연산부(112a)(112b)와, 상기 제 1 및 제 2 연산부(112a)(112b)의 신호를 상기 락 디텍트(lock detect)부(111)의 스위치(switch)신호에 따라 멀티플렉싱하는 제 1 멀티플렉서(112c)와, 상기 가드너 타이밍 에러 검출부(Gardner TED)(110)에서 출력된 신호에 소정 이득값을 연산하는 제 3 및 제 4 연산부(112d)(112e)와, 상기 제 3 및 제 4 연산부(112d)(112e)의 신호를 상기 락 디텍트(lock detect)부(111)의 스위치(switch)신호에 따라 멀티플렉싱하는 제 2 멀티플렉서(112f)와, 상기 제 2 멀티플렉서(112f)에서 멀티플렉싱된 신호를 어큐뮬레이트(accumulate)하는 어큐뮬레이터(112g)와, 상기 제 1 멀티플렉서(112c)에서 멀티플렉싱된 신호와 상기 어큐뮬레이터(112g)에서 어큐뮬레이트(accumulate)된 신호를 혼합하는 혼합부(112h)로 구성된다.
도 4 는 도 2 에 따른 시그널 베어리언스(signal variance)의 결과를 나타낸 도면이다.
이와 같이 구성된 본 발명에 따른 디지털 티브이(Digital TV)의 클럭 복원장치의 동작을 첨부한 도면을 참조하여 상세히 설명하면 다음과 같다.
먼저, 아날로그/디지털 변환부(101)는 수신되는 QAM신호를 그에 상응하는 디지털 신호로 변환하여 그 결과신호를 출력한다.
그러면 제 1 혼합부(102)는 상기 아날로그/디지털 변환부(101)에서 변환된 신호와 Cosnπ/2(1, 0, -1, 0....)를 혼합하여 그 결과신호를 출력한다.
이어 제 1 필터(103)는 상기 제 1 혼합부(102)에서 혼합된 신호에 포함된 노이즈 제거 및 소정 대역으로 필터링하여 그 결과신호를 출력한다.
그러면 제 1 데시메이트(decimate)부(104)는 상기 제 1 필터(103)에서 필터링된 신호를 데시메이트(decimate)하여 그 결과신호(yI, I)를 출력한다.
이에 따라 제 3 필터(105)는 상기 제 1 데시메이트(decimate)부(104)의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하여 그 결과신호를 출력한다.
또한, 제 2 혼합부(106)는 상기 아날로그/디지털 변환부(101)에서 변환된 신호와 Sinnπ/2(1, 0, -1, 0....)를 혼합하여 그 결과신호를 출력한다.
그러면 제 2 필터(107)는 상기 제 2 혼합부(106)에서 혼합된 신호에 포함된 노이즈 제거 및 소정 대역으로 필터링하여 그 결과신호를 출력한다.
상기 제 1 및 제 2 필터(3)(6)는 스퀘어 루트 알씨 필터(Square Root RC filer)이다.
이어 제 2 데시메이트(decimate)부(108)는 상기 제 2 필터(107)에서 필터링된 신호를 데시메이트(decimate)하여 그 결과신호(yQ, Q)를 출력한다.
이에 따라 제 4 필터(109)는 상기 제 2 데시메이트(decimate)부(108)의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하여 그 결과신호를 출력한다.
상기 제 3 및 제 4 필터(105)(109)는 프리-필터(pre-filter)로서, IIR 필터이다.
그러면 가드너 타이밍 에러 검출부(Gardner TED)(110)는 상기 제 3 및 제 4 필터에서 각각 출력된 신호의 제로-크로싱(zero-crossing) 영역의 타이밍 에러를 검출하여 그 결과신호를 출력한다.
즉 가드너 타이밍 에러 검출부(Gardner TED)(110)는 상기 QAM신호와 같이 I, Q신호 모두에 타이밍 정보가 있는 경우에는 상기 제 3 및 제 4 필터(105)(109)에서 각각 필터링된 신호를 입력받고, VSB(Vestigial SideBand)신호의 경우 I신호에만 타이밍 정보가 있는 경우에는 상기 제 3 필터(105)에서 필터링된 신호만을 입력받아 제로-크로싱(zero-crossing)영역의 타이밍 에러를 검출하여 그 결과신호를 출력한다.
이때 락 디텍트(lock detect)부(111)는 루프 밴드위스(loop bandwidth)의 크기를 조정하여 기어 시프팅(gear shifting)시키기 위한 신호를 출력한다.
여기서 기어 시프팅(gear shifting)이란 루프 필터(112)의 노이즈 밴드위스를 점진적으로 좁혀 나가는 것이다.
즉 락 디텍트(lock detect)부(111)는 자동으로 동작시키는 방법과 수동으로 동작시키는 두 가지 방법이 있으며, 상기 루프 밴드위스(loop bandwidth)를 크게 하여 루프 필터(112)의 수렴 속도를 작게 하거나, 상기 루프 밴드위스(loop bandwidth)를 작게 하여 상기 루프 필터(112)의 수렴 속도를 크게 하도록 조정하게 된다.
그러면 루프 필터(112)는 상기 락 디텍트(lock detect)부(111)의 신호에 따라 가드너 타이밍 에러 검출부(Gardner TED)(8)에서 출력된 신호의 루프 밴드위스(loop bandwidth)를 필터링하여 그 결과신호를 출력한다.
즉 도 3 에 도시된 바와 같이, 루프 필터(112)내 제 1 및 제 2 연산부(112a)(112b)는 상기 가드너 타이밍 에러 검출부(Gardner TED)(110)에서 출력된 신호에 소정 이득값을 연산하여 그 결과신호를 출력한다.
그러면 제 1 멀티플렉서(112c)는 상기 제 1 및 제 2 연산부(112a)(112b)의 신호를 상기 락 디텍트(lock detect)부(111)의 스위치(switch)신호에 따라 멀티플렉싱하여 그 결과신호를 출력한다.
아울러 제 3 및 제 4 연산부(112d)(112e)는 상기 가드너 타이밍 에러 검출부(Gardner TED)(110)에서 출력된 신호에 소정 이득값을 연산하여 그 결과신호를 출력한다.
그러면 제 2 멀티플렉서(112f)는 상기 제 3 및 제 4 연산부(112d)(112e)의 신호를 상기 락 디텍트(lock detect)부(111)의 스위치(switch)신호에 따라 멀티플렉싱하여 그 결과신호를 출력한다.
이에 따라 어큐뮬레이터(112g)는 상기 제 2 멀티플렉서(112f)에서 멀티플렉싱된 신호를 어큐뮬레이트(accumulate)하여 그 결과신호를 출력한다.
그러면 혼합부(112h)는 상기 제 1 멀티플렉서(112c)에서 멀티플렉싱된 신호와 상기 어큐뮬레이터(112g)에서 어큐뮬레이트(accumulate)된 신호를 혼합하여 그 결과신호를 출력한다.
이와 같이 상기 제 3 및 제 4 필터(105)(109)를 사용하여 루프 필터(112)를 기어 시프팅(gear shifting)시킴으로써 도 4 에 도시된 바와 같이 가장 우수한 성능을 얻을 수 있다.
이에 따라 전압 제어 발진부(113)는 상기 루프 필터(112)의 신호에 따라 소정 주파수를 발생한다.
그러면 아날로그/디지털 변환부(101)는 상기 전압 제어 발진부(113)의 소정 주파수에 따라 수신되는 4체배의 QAM신호를 그에 상응하는 디지털 신호로 변환하여 출력하며 이후의 과정을 전술한 바와 동일함으로써 이에 대한 설명은 생략한다.
이상에서 설명한 바와 같이 본 발명에 따른 디지털 티브이(Digital TV)의 클럭 복원장치는 QAM 시스템 또는 VSB 시스템에서의 심볼 클럭을 복원하는 과정에서 시스템 클럭의 지터를 최소화시키도록 함으로써 VSB, QAM 병합 시스템에서 심볼 동기 부분의 공유가 가능하게 되므로 하드웨어 사이즈를 줄일 수 있는 효과가 있다.
Claims (2)
- 제 1 및 제 2 데시메이트(decimate)부와 전압 제어 발진부를 구비한 디지털 티브이(Digital TV)의 클럭 복원장치에 있어서,상기 제 1 데시메이트(decimate)부의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하는 제 3 필터와;상기 제 2 데시메이트(decimate)부의 신호의 제로-크로싱(zero-crossing)을 검출하기 위한 영역을 필터링하는 제 4 필터와;상기 제 3 및 제 4 필터에서 각각 출력된 신호의 제로-크로싱(zero-crossing) 영역의 타이밍 에러를 검출하는 가드너 타이밍 에러 검출부(Gardner TED)와;루프 밴드위스(loop bandwidth)의 크기를 조정하여 기어 시프팅(gear shifting)시키기 위한 락 디텍트(lock detect)부와;상기 락 디텍트(lock detect)부의 신호에 따라 가드너 타이밍 에러 검출부(Gardner TED)에서 출력된 신호의 루프 밴드위스(loop bandwidth)를 필터링하여 그 결과신호를 상기 전압 제어 발진부로 출력하는 루프 필터를 포함하여 구성된 것을 특징으로 하는 디지털 티브이(Digital TV)의 클럭 복원장치.
- 제 1 항에 있어서,상기 루프 필터는상기 가드너 타이밍 에러 검출부(Gardner TED)에서 출력된 신호에 소정 이득값을 연산하는 제 1 및 제 2 연산부와;상기 제 1 및 제 2 연산부의 신호를 상기 락 디텍트(lock detect)부의 스위치(switch)신호에 따라 멀티플렉싱하는 제 1 멀티플렉서와;상기 가드너 타이밍 에러 검출부(Gardner TED)에서 출력된 신호에 소정 이득값을 연산하는 제 3 및 제 4 연산부와;상기 제 3 및 제 4 연산부의 신호를 상기 락 디텍트(lock detect)부의 스위치(switch)신호에 따라 멀티플렉싱하는 제 2 멀티플렉서와;상기 제 2 멀티플렉서에서 멀티플렉싱된 신호를 어큐뮬레이트(accumulate)하는 어큐뮬레이터와;상기 제 1 멀티플렉서에서 멀티플렉싱된 신호와 상기 어큐뮬레이터에서 어큐뮬레이트(accumulate)된 신호를 혼합하는 혼합부를 포함하여 구성된 것을 특징으로 하는 디지털 티브이(Digital TV)의 클럭 복원장치.
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