KR100257606B1 - Thin film actuated mirror array having a tilting angle sensor and method for manufacturing the same - Google Patents

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Abstract

PURPOSE: A thin film actuated mirror arrays and a method for fabricating the same are to drive an actuator at a desired drive angle by generating the proper voltage between an upper electrode and a lower electrode. CONSTITUTION: The first metal layer is formed on an active matrix(100) with an MxN transistor provided therein. The first metal layer includes a drain pad(135) and a lower displacement measuring line(145) connected to a drain(105) of the transistor, and a displacement measuring pad connected to the drain pad. An actuator(230) is formed on the first metal layer and the active matrix. The actuator includes a support layer(180), a lower electrode(185), a deformation layer(190), and an upper electrode(195). A displacement measuring member(199) is formed on the actuator, and includes a displacement measuring piezoelectric layer(196) and an upper displacement measuring line(198). The first via contact(215) connects the lower electrode and the drain pad. The second via contact connects the upper displacement measuring line and the displacement measuring pad. A mirror(200) is formed on the support layer.

Description

변위 측정 부재를 장착한 박막형 광로 조절 장치 및 그 제조 방법Thin film type optical path adjusting device equipped with displacement measuring member and manufacturing method thereof

본 발명은 AMA(Actuated Mirror Arrays)를 이용한 박막형 광로 조절 장치 및 그 제조 방법에 관한 것으로, 보다 상세하게는 액츄에이터의 상부에 변위 측정 부재를 장착하여 액츄에이터의 구동 각도를 정확하게 측정함으로써 원하는 구동 각도로 액츄에이터를 구동시킬 수 있는 박막형 광로 조절 장치 및 그 제조 방법에 관한 것이다.The present invention relates to a thin film type optical path control apparatus using AMA (Actuated Mirror Arrays) and a method of manufacturing the same. More specifically, the actuator is mounted at a desired driving angle by accurately measuring the driving angle of the actuator by mounting a displacement measuring member on the upper part of the actuator. The present invention relates to a thin film type optical path control device capable of driving a light emitting device and a method of manufacturing the same.

광학 에너지(optical energy)를 스크린 상에 투영하기 위한 장치인 공간적인 광 변조기(spatial light modulator)는 광통신, 화상 처리 및 정보 디스플레이 장치와 같은 다양한 분야에 응용될 수 있다. 이러한 광로 조절 장치 또는 공간적 광 변조기를 이용한 화상 처리 장치는 통상적으로 광학 에너지를 스크린 상에 표시하는 방법에 따라 직시형 화상 표시 장치(direct-view image display device)와 투사형 화상 표시 장치(projection-type image display device)로 구분된다.Spatial light modulators, which are devices for projecting optical energy onto a screen, can be applied to various fields such as optical communication, image processing, and information display devices. An image processing apparatus using such an optical path adjusting device or a spatial light modulator typically has a direct-view image display device and a projection-type image device according to a method of displaying optical energy on a screen. display device).

직시형 화상 표시 장치의 예로서는 CRT(Cathode Ray Tube)를 들 수 있는데, 이러한 CRT 장치는 소위 브라운관으로 불리는 것으로서 화질은 우수하나 화면의 대형화에 따라 그 중량과 용적이 증가하여 제조 비용이 상승하게 되는 문제가 있다. 투사형 화상 표시 장치로는 액정 표시 장치(Liquid Crystal Display : LCD), DMD(Deformable Mirror Device), 및 AMA를 들 수 있다. 이러한 투사형 화상 표시 장치는 다시 그들의 광학적 특성에 따라 2개의 그룹으로 나뉠 수 있다. 즉, LCD와 같은 장치는 전송 광 변조기(transmissive spatial light modulators)로 분류될 수 있는데 반하여, DMD 및 AMA는 반사 광 변조기(reflective spatial light modulators)로 분류될 수 있다.An example of a direct-view image display device is a CRT (Cathode Ray Tube). The CRT device is called a CRT, which has excellent image quality but increases in weight and volume as the screen is enlarged, leading to an increase in manufacturing cost. There is. Examples of the projection image display apparatus include a liquid crystal display (LCD), a deformable mirror device (DMD), and an AMA. Such projection image display devices can be further divided into two groups according to their optical characteristics. That is, devices such as LCDs can be classified as transmissive spatial light modulators, while DMD and AMA can be classified as reflective spatial light modulators.

LCD와 같은 전송 광 변조기는 광학적 구조가 매우 간단하므로, 얇게 형성하여 중량을 가볍게 할 수 있으며 용적을 줄이는 것이 가능하다. 그러나, 빛의 극성으로 인하여 광효율이 낮으며, 액정 재료에 고유하게 존재하는 문제, 예를 들면 응답 속도가 느리고 그 내부가 과열되기 쉬운 단점이 있다. 또한, 현존하는 전송 광 변조기의 최대 광효율은 1 내지 2 % 범위로 한정되며, 수용 가능한 디스플레이 품질을 제공하기 위해서 암실 조건을 필요로 한다. 따라서, 상술한 문제점들을 해결하기 위하여 DMD 및 AMA와 같은 광 변조기가 개발되었다.Transmission optical modulators, such as LCDs, have a very simple optical structure, which makes them thinner, lighter in weight, and smaller in volume. However, due to the polarity of the light, the light efficiency is low, there is a problem inherent in the liquid crystal material, for example, there is a disadvantage that the response speed is slow and the inside is easy to overheat. In addition, the maximum light efficiency of existing transmission light modulators is limited to a range of 1-2%, requiring dark room conditions to provide acceptable display quality. Therefore, optical modulators such as DMD and AMA have been developed to solve the above problems.

DMD는 5% 정도의 비교적 양호한 광효율을 나타내지만, DMD에 채용된 힌지 구조물에 의해서 심각한 피로 문제가 발생할 뿐만 아니라, 매우 복잡하고 값비싼 구동 회로가 요구된다는 단점이 있다. AMA는 그 내부에 설치된 각각의 거울들이 광원으로부터 입사되는 빛을 소정의 각도로 반사하고, 반사된 빛이 슬릿(slit)이나 핀홀(pinhole)과 같은 개구(aperture)를 통과하여 스크린에 투영되어 화상을 맺도록 광속을 조절할 수 있는 장치이다. 따라서, 그 구조와 동작 원리가 간단하며, LCD나 DMD에 비해 높은 광효율(10% 이상)을 얻을 수 있다. 또한, 스크린에 투영되는 화상의 콘트라스트(contrast)가 향상되어 보다 밝고 선명한 화상을 얻을 수 있다.Although DMD shows a relatively good light efficiency of about 5%, the hinge structure employed in the DMD not only causes serious fatigue problems, but also requires a very complicated and expensive driving circuit. The AMA reflects the light incident from the light source at each angle installed in the mirrors, and the reflected light is projected on the screen through an aperture such as a slit or pinhole to be imaged. The device can adjust the luminous flux to bear. Therefore, its structure and operation principle are simple, and high light efficiency (10% or more) can be obtained compared to LCD or DMD. In addition, the contrast of the image projected on the screen is improved to obtain a brighter and clearer image.

AMA의 각 액츄에이터는 인가되는 전기적인 화상 신호 및 바이어스 신호에 의하여 발생되는 전기장에 따라 변형을 일으킨다. 액츄에이터가 변형을 일으킬 때 그 상부에 장착된 각각의 거울들이 경사지게 된다. 따라서, 경사진 거울들은 입사된 빛을 소정의 각도로 반사시켜 스크린 상에 화상을 맺을 수 있도록 한다. 각각의 거울들을 구동하는 액츄에이터로서 PZT(Pb(Zr, Ti)O3) 또는 PLZT((Pb, La)(Zr, Ti)O3) 등의 압전 물질이 이용된다. 또한, PMN(Pb(Mg, Nb)O3) 등의 전왜 물질로서 액츄에이터를 구성할 수도 있다.Each actuator of the AMA generates a deformation in accordance with the electric field generated by the applied electric picture signal and the bias signal. As the actuator deforms, each of the mirrors mounted on top thereof is inclined. Thus, the inclined mirrors reflect the incident light at a predetermined angle to form an image on the screen. As an actuator for driving the respective mirrors, piezoelectric materials such as PZT (Pb (Zr, Ti) O 3 ) or PLZT ((Pb, La) (Zr, Ti) O 3 ) are used. It is also possible to configure the actuator as electrostrictive material such as PMN (Pb (Mg, Nb) O 3).

이러한 AMA 장치는 크게 벌크형(bulk type)과 박막형(thin film type)으로 구분된다. 벌크형 광로 조절 장치는 Gregory Um 등에게 허여된 미합중국 특허 제5,085,497호에 개시되어 있다. 벌크형 광로 조절 장치는 다층 세라믹을 얇게 절단하여 내부에 금속 전극이 형성된 세라믹 웨이퍼를 트랜지스터가 내장된 액티브 매트릭스(active matrix)에 장착한 후, 쏘잉 방법을 이용하여 가공하고 그 상부에 거울을 설치함으로써 이루어진다. 그러나, 벌크형 광로 조절 장치는 설계 및 제조에 있어서 매우 높은 정밀도가 요구되며, 변형층의 응답이 느리다는 단점이 있다.These AMA devices are largely divided into bulk type and thin film type. Bulk light path control devices are disclosed in US Pat. No. 5,085,497 to Gregory Um et al. The bulk optical path control device is made by thinly cutting a multilayer ceramic to mount a ceramic wafer having a metal electrode therein into an active matrix in which a transistor is built, and then processing by using a sawing method and installing a mirror on the top. . However, the bulk optical path control device requires very high precision in design and manufacturing, and has a disadvantage in that the response of the strained layer is slow.

이에 따라, 반도체 제조 공정을 이용하여 제조할 수 있는 박막형 광로 조절 장치가 개발되었다. 이러한 박막형 광로 조절 장치는 본 출원인이 1996년 9월 24일 대한민국 특허청에 특허 출원한 특허 출원 제96-42197호(발명의 명칭: 멤브레인의 스트레스를 조절할 수 있는 박막형 광로 조절 장치 및 그 제조 방법)에 개시되어 있다.Accordingly, a thin film type optical path control apparatus that can be manufactured using a semiconductor manufacturing process has been developed. Such a thin film type optical path control device is disclosed in Patent Application No. 96-42197 filed by the applicant of the Korean Patent Office on September 24, 1996 (name of the invention: thin film type optical path control device that can control the stress of the membrane and its manufacturing method). Is disclosed.

도 1a 및 도 1b는 상기 선행 출원에 기재된 박막형 광로 조절 장치의 단면도를 도시한 것이다.1A and 1B show a cross-sectional view of the thin film type optical path adjusting device described in the preceding application.

도 1b를 참조하면, 상기 박막형 광로 조절 장치는 액티브 매트릭스(1) 및 액츄에이터(60)를 포함한다. 그 내부에 M×N(M, N은 정수) 개의 MOS 트랜지스터가 내장되고 트랜지스터의 드레인 영역으로부터 연장되는 드레인 패드(5)가 형성된 액티브 매트릭스(1)는, 액티브 매트릭스(1) 및 드레인 패드(5)의 상부에 적층된 보호층(10)과 보호층(10)의 상부에 적층된 식각 방지층(15)을 포함한다.Referring to FIG. 1B, the thin film type optical path adjusting device includes an active matrix 1 and an actuator 60. The active matrix 1 in which M x N (M, N is an integer) MOS transistors and a drain pad 5 extending from the drain region of the transistor is formed in the active matrix 1 and the drain pad 5. The protective layer 10 stacked on top of the protective layer 10 and the etch stop layer 15 stacked on the protective layer 10 is included.

액츄에이터(60)는, 식각 방지층(15) 중 그 아래에 드레인 패드(5)가 형성된 부분에 일측이 접촉되며 타측이 에어 갭(25)을 개재하여 액티브 매트릭스(1)의 하부와 수평하게 형성된 멤브레인(30), 멤브레인(30)의 상부에 적층된 하부 전극(35), 하부 전극(35)의 상부에 적층된 변형층(40), 변형층(40)의 상부에 적층된 상부 전극(45), 그리고 변형층(40)의 일측으로부터 하부 전극(35), 멤브레인(30), 식각 방지층(15) 및 보호층(10)을 통하여 드레인 패드(5)까지 수직하게 형성된 비어 홀(50) 내에 하부 전극(35)과 드레인 패드(5)가 서로 연결되도록 형성된 비어 컨택(55)을 포함한다.The actuator 60 is a membrane formed on one side of the etch stop layer 15 below the drain pad 5, and the other side is horizontally formed with the lower portion of the active matrix 1 via the air gap 25. 30, the lower electrode 35 stacked on the membrane 30, the strained layer 40 stacked on the lower electrode 35, and the upper electrode 45 stacked on the strained layer 40. And a lower portion in the via hole 50 formed vertically from one side of the strained layer 40 to the drain pad 5 through the lower electrode 35, the membrane 30, the etch stop layer 15, and the protective layer 10. The via 35 includes a via contact 55 formed to connect the electrode 35 and the drain pad 5 to each other.

상부 전극(45)의 일부에는 스트라이프(46)가 형성된다. 스트라이프(46)는 상부 전극(45)을 균일하게 작동시켜 상부 전극(45) 중 변형층(40)의 변형에 따라 변형되는 부분과 변형되지 않는 부분의 경계에서 광원으로부터 입사되는 빛이 난반사 되는 것을 방지한다.A stripe 46 is formed on a part of the upper electrode 45. The stripe 46 operates the upper electrode 45 uniformly so that the light incident from the light source is diffusely reflected at the boundary between the portion of the upper electrode 45 which is deformed and the portion which is not deformed according to the deformation of the deforming layer 40. prevent.

이하, 상술한 박막형 광로 조절 장치의 제조 방법을 도 1a 내지 1b를 참조하여 설명한다.Hereinafter, the manufacturing method of the above-mentioned thin film type optical path control apparatus is demonstrated with reference to FIGS. 1A-1B.

도 1a를 참조하면, M×N(M, N은 정수) 개의 MOS 트랜지스터(도시되지 않음)가 내장되고 트랜지스터의 드레인 영역으로부터 연장되는 드레인 패드(5)가 형성된 액티브 매트릭스(1) 상에 인 실리케이트 유리(PSG)로 구성된 보호층(10)을 형성한다. 보호층(10)은 화학 기상 증착(CVD) 방법을 이용하여 1.0㎛ 정도의 두께를 갖도록 형성한다. 보호층(10)은 후속하는 공정 동안 트랜지스터가 내장된 액티브 매트릭스(1)를 보호한다.Referring to FIG. 1A, an silicate is formed on an active matrix 1 in which M x N (M, N is an integer) MOS transistors (not shown) are formed and a drain pad 5 extending from the drain region of the transistor is formed. A protective layer 10 made of glass PSG is formed. The protective layer 10 is formed to have a thickness of about 1.0 μm using a chemical vapor deposition (CVD) method. The protective layer 10 protects the active matrix 1 in which the transistor is embedded during the subsequent process.

보호층(10)의 상부에는 질화물로 이루어진 식각 방지층(15)이 형성된다. 식각 방지층(15)은 저압 화학 기상 증착(LPCVD) 방법을 이용하여 1000∼2000Å 정도의 두께를 갖도록 형성한다. 식각 방지층(15)은 후속하는 식각 공정 동안 보호층(10) 및 액티브 매트릭스(1)가 식각되는 것을 방지한다.An etch stop layer 15 made of nitride is formed on the passivation layer 10. The etch stop layer 15 is formed to have a thickness of about 1000 to 2000 kPa using a low pressure chemical vapor deposition (LPCVD) method. The etch stop layer 15 prevents the protective layer 10 and the active matrix 1 from being etched during the subsequent etching process.

식각 방지층(15) 상에는 희생층(20)이 형성된다. 희생층(20)은 인(P)의 농도가 높은 인 실리케이트 유리(PSG)를 대기압 화학 기상 증착(APCVD) 방법을 이용하여 1.0∼3.0㎛ 정도의 두께를 갖도록 형성한다. 이 경우, 희생층(20)은 트랜지스터가 내장된 액티브 매트릭스(1)의 상부를 덮고 있으므로, 그 표면의 평탄도가 매우 불량하다. 따라서, 희생층(20)의 표면을 스핀 온 글래스(SOG)를 사용하는 방법 또는 화학 기계적 연마(CMP) 방법을 이용하여 평탄화시킨다. 이어서, 희생층(20) 중 그 아래에 드레인 패드(5)가 형성되어 있는 부분을 식각하여 식각 방지층(15)의 일부를 노출시킴으로써 액츄에이터(60)의 지지부가 형성될 위치를 만든다.The sacrificial layer 20 is formed on the etch stop layer 15. The sacrificial layer 20 is formed of phosphorous silicate glass (PSG) having a high concentration of phosphorus (PG) to have a thickness of about 1.0 to 3.0 μm by using an atmospheric pressure chemical vapor deposition (APCVD) method. In this case, since the sacrificial layer 20 covers the upper portion of the active matrix 1 in which the transistor is embedded, the surface flatness is very poor. Accordingly, the surface of the sacrificial layer 20 is planarized by using spin on glass (SOG) or chemical mechanical polishing (CMP). Subsequently, a portion of the sacrificial layer 20 in which the drain pad 5 is formed is etched to expose a portion of the etch stop layer 15, thereby making a position where the support of the actuator 60 is to be formed.

노출된 식각 방지층(15) 및 희생층(20) 상에 0.1∼1.0㎛ 정도의 두께로 멤브레인(30)을 형성한다. 멤브레인(30)은 질화물을 저압 화학 기상 증착(LPCVD) 방법을 이용하여 형성한다. 이때, 저압의 반응 용기 내에서 반응 가스의 비를 변화시키면서 멤브레인(30)을 형성하여 멤브레인(30) 내의 스트레스(stress)를 조절한다.The membrane 30 is formed on the exposed etch stop layer 15 and the sacrificial layer 20 to a thickness of about 0.1 to 1.0㎛. Membrane 30 is formed using low pressure chemical vapor deposition (LPCVD). At this time, the membrane 30 is formed while varying the ratio of the reaction gas in the reaction vessel at a low pressure to control the stress in the membrane 30.

멤브레인(30) 상에는 백금(Pt), 탄탈륨(Ta), 백금-탄탈륨 등의 금속으로 구성된 하부 전극(35)이 형성된다. 하부 전극(35)은 스퍼터링 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 갖도록 형성한다. 이어서, 하부 전극(35)을 패터닝하여 각각의 화소별로 하부 전극(35)을 분리시킴으로써 각 화소들에 독립적인 제1 신호(화상 신호)가 인가되도록 한다(Iso­Cut 식각 공정).On the membrane 30, a lower electrode 35 made of metal such as platinum (Pt), tantalum (Ta), platinum-tantalum, or the like is formed. The lower electrode 35 is formed to have a thickness of about 0.1 to 1.0 μm using a sputtering method. Subsequently, the lower electrode 35 is patterned to separate the lower electrode 35 for each pixel so that an independent first signal (image signal) is applied to each pixel (Iso­Cut etching process).

하부 전극(35) 상에는 PZT 또는 PLZT 등의 압전 물질로 구성된 변형층(40)이 형성된다. 변형층(40)은 졸-겔(sol-gel)법을 이용하여 0.1∼1.0㎛, 바람직하게는 0.4㎛ 정도의 두께를 갖도록 형성한 후, 급속 열처리(RTA) 방법으로써 상변이시킨다. 변형층(40)은 상부 전극(45)에 제2 신호(바이어스 신호)가 인가되고 하부 전극(35)에 제1 신호가 인가되어 상부 전극(45)과 하부 전극(35) 사이에 전위차에 따라 발생하는 전기장에 의하여 변형을 일으킨다.On the lower electrode 35, a strained layer 40 made of a piezoelectric material such as PZT or PLZT is formed. The strained layer 40 is formed to have a thickness of about 0.1 μm to about 1.0 μm, preferably about 0.4 μm using a sol-gel method, and then phase-shifted by a rapid heat treatment (RTA) method. In the strained layer 40, a second signal (bias signal) is applied to the upper electrode 45, and a first signal is applied to the lower electrode 35, according to a potential difference between the upper electrode 45 and the lower electrode 35. It is deformed by the generated electric field.

상부 전극(45)은 변형층(40)의 상부에 형성된다. 상부 전극(45)은 알루미늄 또는 백금 등의 전기 전도성 및 반사성을 갖는 금속을 스퍼터링 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 갖도록 형성한다. 상부 전극(45)에는 외부로부터 공통 전극선(도시되지 않음)을 통하여 제2 신호가 인가된다. 또한, 상부 전극(45)은 광원으로부터 입사되는 빛을 반사하는 거울의 기능도 함께 수행한다.The upper electrode 45 is formed on the strained layer 40. The upper electrode 45 is formed of a metal having electrical conductivity and reflectivity, such as aluminum or platinum, to have a thickness of about 0.1 to 1.0 μm using a sputtering method. The second signal is applied to the upper electrode 45 through a common electrode line (not shown) from the outside. In addition, the upper electrode 45 also functions as a mirror that reflects light incident from the light source.

도 1b를 참조하면, 상부 전극(45), 변형층(40), 그리고 하부 전극(35)을 각기 소정의 화소 형상으로 패터닝한다. 이 때, 상부 전극(45)의 일부에는 스트라이프(46)가 형성되도록 패터닝한다. 계속해서, 변형층(40)의 일측으로부터 드레인 패드(5)의 상부까지 변형층(40), 하부 전극(35), 멤브레인(30), 식각 방지층(15) 및 보호층(10)을 순차적으로 식각함으로써 비어 홀(50)을 형성한다. 이어서, 비어 홀(50)의 내부에 텅스텐, 백금 또는 티타늄 등의 금속을 스퍼터링하여 드레인 패드(5)와 하부 전극(35)을 연결시키는 비어 컨택(55)을 형성한다. 따라서, 비어 컨택(55)은 비어 홀(50) 내에서 하부 전극(35)으로부터 드레인 패드(5)까지 수직하게 형성된다. 그러므로, 외부로부터 인가된 제1 신호는 액티브 매트릭스(1)에 내장된 트랜지스터, 드레인 패드(5) 및 비어 컨택(55)을 통하여 하부 전극(35)에 인가된다.Referring to FIG. 1B, the upper electrode 45, the strained layer 40, and the lower electrode 35 are each patterned into a predetermined pixel shape. At this time, a portion of the upper electrode 45 is patterned to form a stripe 46. Subsequently, the strained layer 40, the lower electrode 35, the membrane 30, the etch stop layer 15, and the protective layer 10 are sequentially formed from one side of the strained layer 40 to the top of the drain pad 5. The via hole 50 is formed by etching. Subsequently, a metal contact such as tungsten, platinum or titanium is sputtered into the via hole 50 to form a via contact 55 connecting the drain pad 5 and the lower electrode 35 to each other. Thus, the via contact 55 is formed vertically from the lower electrode 35 to the drain pad 5 in the via hole 50. Therefore, the first signal applied from the outside is applied to the lower electrode 35 through the transistor, the drain pad 5, and the via contact 55 embedded in the active matrix 1.

계속하여, 멤브레인(30)을 소정의 화소 형상을 갖도록 패터닝한다. 그리고, 49% 플루오르화 수소 증기에 의해 희생층(20)을 식각함으로써 희생층(20)의 위치에 에어 갭(25)을 형성한 후, 남아 있는 식각 용액을 제거하기 위하여 세정 및 건조 공정을 실시함으로써 AMA 소자를 완성한다.Subsequently, the membrane 30 is patterned to have a predetermined pixel shape. After the air gap 25 is formed at the position of the sacrificial layer 20 by etching the sacrificial layer 20 by 49% hydrogen fluoride vapor, a cleaning and drying process is performed to remove the remaining etching solution. This completes the AMA device.

상술한 박막형 광로 조절 장치에 있어서, 제1 신호는 액티브 매트릭스(1)에 내장된 MOS 트랜지스터, 드레인 패드(5) 및 비어 컨택(55)을 통하여 하부 전극(35)에 인가된다. 동시에, 상부 전극(45)에는 공통 전극선을 통하여 제2 신호가 인가되어 상부 전극(45)과 하부 전극(35) 사이에 전기장이 발생한다. 이러한 전기장에 의하여 상부 전극(45)과 하부 전극(35) 사이에 적층되어 있는 변형층(40)이 변형을 일으킨다. 변형층(40)은 발생한 전기장에 대하여 직교하는 방향으로 수축하며, 변형층(40)을 포함하는 액츄에이터(60)는 소정의 각도를 가지고 상방으로 휘어진다. 따라서, 액츄에이터(60) 상부의 상부 전극(45)도 같은 방향으로 경사진다. 광원으로부터 입사되는 빛은 상부 전극(45)에 의해 소정의 각도로 반사된 후, 스크린에 투영되어 화상을 맺는다.In the above-described thin film type optical path adjusting device, the first signal is applied to the lower electrode 35 through the MOS transistor, the drain pad 5, and the via contact 55 embedded in the active matrix 1. At the same time, a second signal is applied to the upper electrode 45 through the common electrode line to generate an electric field between the upper electrode 45 and the lower electrode 35. By the electric field, the strained layer 40 stacked between the upper electrode 45 and the lower electrode 35 causes deformation. The strained layer 40 contracts in a direction perpendicular to the generated electric field, and the actuator 60 including the strained layer 40 is bent upward at a predetermined angle. Therefore, the upper electrode 45 on the actuator 60 is also inclined in the same direction. Light incident from the light source is reflected by the upper electrode 45 at a predetermined angle, and then is projected onto the screen to form an image.

그러나, 상술한 박막형 광로 조절 장치에서는 M×N 개의 MOS 트랜지스터에 대응하여 형성된 액츄에이터들이 각기 주어진 입력 신호(input signal)에 대하여 오픈 루프(open loop)로 작동하므로 정확하게 원하는 구동 각도로 구동하는지의 여부를 알 수 없다. 즉, 액츄에이터의 구동시 변형층의 압전 특성에 미치는 여러 가지 외적 요인들, 예컨대 열 변화, 전기적 변화, 또는 기계적 변화에 의하여 액츄에이터의 구동 각도가 변할 경우, 액츄에이터의 구동 각도의 변화를 측정할 수 없다. 따라서, 액츄에이터들의 구동 각도를 균일하게 조절할 수 없게 되어 화상의 콘트라스트가 저하되는 문제점이 발생하게 된다.However, in the above-described thin film type optical path control device, actuators formed corresponding to M × N MOS transistors operate in an open loop with respect to a given input signal. I can not know. That is, when the actuator's driving angle is changed by various external factors such as thermal change, electrical change, or mechanical change when the actuator is driven, it is impossible to measure the change in the actuator's driving angle. . Therefore, it becomes impossible to uniformly adjust the driving angles of the actuators, which causes a problem of lowering the contrast of the image.

따라서, 본 발명의 목적은 상부 전극의 상부에 변위 측정용 압전층 및 상부 변위 측정 라인을 포함하는 변위 측정 부재를 형성하고, 하부 변위 측정 라인 및 변위 측정용 패드를 액티브 매트릭스에 별도로 배선한다. 제2 비어 컨택을 통하여 변위 측정 부재를 액티브 매트릭스에 배선된 하부 변위 측정 라인이 접속된 변위 측정용 패드와 연결함으로써, 변위 측정용 압전층의 변형에 따른 전류를 측정할 수 있게 된다. 따라서, 발생된 전류가 적정 영역을 초과하거나 미달하는 경우, 상부 전극 및 하부 전극 사이에 적정 전압을 발생시켜 원하는 구동 각도로 액츄에이터를 구동시킬 수 있다.Accordingly, an object of the present invention is to form a displacement measuring member including a piezoelectric layer for displacement measurement and an upper displacement measurement line on the upper electrode, and separately wire the lower displacement measurement line and the displacement measurement pad to the active matrix. By connecting the displacement measuring member to the displacement measuring pad connected to the lower displacement measuring line wired to the active matrix through the second via contact, the current according to the deformation of the piezoelectric layer for displacement measurement can be measured. Therefore, when the generated current exceeds or falls below the proper range, a proper voltage can be generated between the upper electrode and the lower electrode to drive the actuator at a desired driving angle.

도 1a 및 도 1b는 본 출원인의 선행 출원에 기재된 박막형 광로 조절 장치의 제조 방법을 설명하기 위한 단면도들이다.1A and 1B are cross-sectional views illustrating a method of manufacturing a thin film type optical path adjusting device described in the applicant's prior application.

도 2는 본 발명에 따른 박막형 광로 조절 장치의 평면도이다.2 is a plan view of a thin film type optical path control apparatus according to the present invention.

도 3은 도 2에 도시한 장치를 A­A′선으로 자른 단면도이다.3 is a cross-sectional view of the device shown in FIG. 2 taken along line A′A ′.

도 4는 도 2에 도시한 장치를 B­B′선으로 자른 단면도이다.4 is a cross-sectional view taken along line B′B ′ of the apparatus shown in FIG. 2.

도 5a 내지 도 9b는 도 3 및 도 4에 도시한 장치의 제조 공정도이다.5A to 9B are manufacturing process diagrams of the apparatus shown in FIGS. 3 and 4.

〈도면의 주요 부분에 대한 부호의 설명〉<Explanation of symbols for main parts of drawing>

100 : 액티브 매트릭스 105 : 드레인100: active matrix 105: drain

110 : 소오스 115 : 게이트110: source 115: gate

120 : 소자 분리막 125 : 게이트 라인120: device isolation layer 125: gate line

130 : 소오스 라인 135 : 드레인 패드130: source line 135: drain pad

140 : 변위 측정용 패드 145 : 하부 변위 측정 라인140: displacement measurement pad 145: lower displacement measurement line

150 : 제1 금속층 155 : 제1 보호층150: first metal layer 155: first protective layer

160 : 제2 금속층 165 : 제2 보호층160: second metal layer 165: second protective layer

170 : 식각 방지층 175 : 희생층170: etch stop layer 175: sacrificial layer

180 : 지지층 185 : 하부 전극180 support layer 185 lower electrode

190 : 변형층 195 : 상부 전극190 strain layer 195 upper electrode

196 : 변위 측정용 압전층 198 : 상부 변위 측정 라인196: piezoelectric layer for displacement measurement 198: upper displacement measurement line

199 : 변위 측정 부재 200 : 거울199: displacement measurement member 200: mirror

205 : 제1 비어 홀 210 : 제2 비어 홀205: first via hole 210: second via hole

215 : 제1 비어 컨택 220 : 제2 비어 컨택215: first via contact 220: second via contact

225:에어 갭 230:액츄에이터225: Air gap 230: Actuator

상기 목적을 달성하기 위하여 본 발명은, ⅰ) M×N 개의 트랜지스터가 내장된 액티브 매트릭스의 상부에 형성되며 소오스 라인, 드레인에 접속된 드레인 패드 및 하부 변위 측정 라인과, 이에 접속된 변위 측정용 패드를 포함하는 제1 금속층, ⅱ) 제1 금속층 및 액티브 매트릭스의 상부에 형성되며 지지층, 하부 전극, 변형층 및 상부 전극을 포함하는 액츄에이터, ⅲ) 액츄에이터의 상부에 형성되며 변위 측정용 압전층 및 상부 변위 측정 라인을 포함하는 변위 측정 부재, ⅳ) 하부 전극과 드레인 패드를 연결하는 제1 비어 컨택, ⅴ) 상부 변위 측정 라인과 변위 측정용 패드를 연결하는 제2 비어 컨택, 그리고 ⅵ) 지지층의 상부에 형성된 거울을 포함하는 박막형 광로 조절 장치를 제공한다.In order to achieve the above object, the present invention provides a display device comprising: (i) a source pad, a drain pad connected to a drain, and a lower displacement measuring line formed on an active matrix including M × N transistors; A first metal layer comprising: ii) an actuator formed on the first metal layer and the active matrix, the actuator including a support layer, a lower electrode, a deformation layer, and an upper electrode; A displacement measuring member comprising a displacement measuring line, iii) a first via contact connecting the lower electrode and the drain pad, iii) a second via contact connecting the upper displacement measuring line and the displacement measuring pad, and iii) an upper portion of the support layer. It provides a thin film type optical path control device including a mirror formed in the.

또한, 상술한 목적을 달성하기 위하여 본 발명은, M×N 개의 트랜지스터가 내장된 액티브 매트릭스의 상부에 제1 금속층을 적층한 후 패터닝하여 소오스 라인, 드레인에 접속된 드레인 패드 및 하부 변위 측정 라인과, 이에 접속된 변위 측정용 패드를 형성하는 단계, 제1 금속층 및 액티브 매트릭스의 상부에 지지층, 하부 전극, 변형층 및 상부 전극을 포함하는 액츄에이터를 형성하는 단계, 액츄에이터의 상부에 변위 측정용 압전층 및 상부 변위 측정 라인을 포함하는 변위 측정 부재를 형성하는 단계, 하부 전극과 드레인 패드를 연결하는 제1 비어 컨택을 형성하는 단계, 상부 변위 측정 라인과 변위 측정용 패드를 연결하는 제2 비어 컨택을 형성하는 단계, 그리고 지지층의 상부에 거울을 형성하는 단계를 포함하는 박막형 광로 조절 장치의 제조 방법을 제공한다.In addition, in order to achieve the above object, the present invention, the first metal layer is stacked on top of the active matrix containing the M × N transistors and patterned by patterning the drain line connected to the source line, drain and lower displacement measuring line and And forming a displacement measuring pad connected thereto, forming an actuator including a support layer, a lower electrode, a deformation layer, and an upper electrode on the first metal layer and the active matrix, and a piezoelectric layer for displacement measurement on the actuator. And forming a displacement measuring member including an upper displacement measuring line, forming a first via contact connecting the lower electrode and the drain pad, and forming a second via contact connecting the upper displacement measuring line and the displacement measuring pad. Forming, and forming a mirror on top of the support layer of the manufacturing method of the thin film type optical path control apparatus to provide.

본 발명에 따른 박막형 광로 조절 장치 및 그 제조 방법에 의하면, 상부 전극의 상부에 변위 측정용 압전층 및 상부 변위 측정 라인을 포함하는 변위 측정 부재를 형성하고, 하부 변위 측정 라인 및 변위 측정용 패드를 액티브 매트릭스에 별도로 배선한다. 제2 비어 컨택을 통하여 변위 측정 부재를 액티브 매트릭스에 배선된 하부 변위 측정 라인이 접속된 변위 측정용 패드와 연결함으로써, 변위 측정용 압전층의 변형에 따른 전류를 측정할 수 있게 된다. 따라서, 발생된 전류가 적정 영역을 초과하거나 미달하는 경우, 상부 전극 및 하부 전극 사이에 적정 전압을 발생시켜 원하는 구동 각도로 액츄에이터를 구동시킬 수 있다.According to the thin film type optical path adjusting device and the manufacturing method thereof according to the present invention, a displacement measuring member including a piezoelectric layer for measuring displacement and an upper displacement measuring line is formed on the upper electrode, and a lower displacement measuring line and a displacement measuring pad are formed. Wire to the active matrix separately. By connecting the displacement measuring member to the displacement measuring pad connected to the lower displacement measuring line wired to the active matrix through the second via contact, the current according to the deformation of the piezoelectric layer for displacement measurement can be measured. Therefore, when the generated current exceeds or falls below the proper range, a proper voltage can be generated between the upper electrode and the lower electrode to drive the actuator at a desired driving angle.

이하, 첨부한 도면을 참조하여 본 발명의 실시예에 따른 박막형 광로 조절 장치 및 그 제조 방법을 상세하게 설명한다.Hereinafter, a thin film type optical path adjusting apparatus and a method of manufacturing the same according to an embodiment of the present invention will be described in detail with reference to the accompanying drawings.

도 2는 본 발명에 따른 박막형 광로 조절 장치의 평면도를 도시한 것이며, 도 3은 도 2에 도시한 장치를 A­A′선으로 자른 단면도를 도시한 것이며, 도 4는 도 2에 도시한 장치를 B­B′선으로 자른 단면도를 도시한 것이다.2 is a plan view of a thin film type optical path control device according to the present invention, Figure 3 is a cross-sectional view taken along the line AA 'of the device shown in Figure 2, Figure 4 is a BB of the device shown in Figure 2 It shows a cross-sectional view cut in line.

도 2 내지 도 4를 참조하면, 본 발명에 따른 상술한 박막형 광로 조절 장치는 액티브 매트릭스(100), 액츄에이터(230), 변위 측정 부재(199), 및 거울(200)을 포함한다.2 to 4, the above-described thin film type optical path adjusting device according to the present invention includes an active matrix 100, an actuator 230, a displacement measuring member 199, and a mirror 200.

액티브 매트릭스(100)는, 액티브 매트릭스(100)를 액티브 영역과 필드 영역으로 구분하기 위한 소자 분리막(120)과, 액티브 영역에 게이트(115), 소오스(110), 드레인(105) 및 공통 전극 패드(140)를 갖고 형성된 M×N 개의 MOS 트랜지스터를 포함한다. 또한, 액티브 매트릭스(100)는 MOS 트랜지스터의 상부에 적층되고 게이트(115)에 접속된 게이트 라인(125), 소오스(110)에 접속된 소오스 라인(130), 드레인(105)에 접속된 드레인 패드(135) 및 변위 측정용 패드(140)에 접속된 하부 변위 측정 라인(145)을 포함하는 제1 금속층(150), 제1 금속층의 상부에 적층된 제1 보호층(155), 제1 보호층의 상부에 적층된 제2 금속층(160), 제2 금속층의 상부에 적층된 제2 보호층(165), 및 제2 보호층의 상부에 적층된 식각 방지층(170)을 포함한다. 여기서, 제2 금속층(160)은 티타늄(Ti)층 및 질화티타늄(TiN)층으로 이루어진다.The active matrix 100 includes an isolation layer 120 for dividing the active matrix 100 into an active region and a field region, and a gate 115, a source 110, a drain 105, and a common electrode pad in the active region. And M × N MOS transistors formed with 140. In addition, the active matrix 100 is stacked on top of the MOS transistor and is connected to the gate line 125 connected to the gate 115, the source line 130 connected to the source 110, and the drain pad connected to the drain 105. A first metal layer 150 including a lower displacement measuring line 145 connected to the 135 and a displacement measuring pad 140, a first protective layer 155 stacked on top of the first metal layer, and a first protective layer A second metal layer 160 stacked on top of the layer, a second passivation layer 165 stacked on top of the second metal layer, and an etch stop layer 170 stacked on top of the second passivation layer. Here, the second metal layer 160 includes a titanium (Ti) layer and a titanium nitride (TiN) layer.

도 3 및 도 4를 참조하면, 액츄에이터(230)는, 식각 방지층(170) 중 아래에 드레인 패드(135)가 형성된 부분에 일측이 접촉되며 타측이 에어 갭(225)을 개재하여 액티브 매트릭스(100)의 하부와 수평하게 형성된 지지층(180), 지지층(180)의 상부에 형성된 하부 전극(185), 하부 전극(185)의 상부에 형성된 변형층(190), 및 변형층(190)의 상부에 형성된 상부 전극(195)을 포함한다.Referring to FIGS. 3 and 4, the actuator 230 has one side in contact with a portion of the etch stop layer 170 in which the drain pad 135 is formed, and the other side thereof has an active matrix 100 through the air gap 225. ) The support layer 180 formed horizontally with the bottom of the lower layer, the lower electrode 185 formed on the upper portion of the support layer 180, the strained layer 190 formed on the lower electrode 185, and the upper portion of the strained layer 190. And formed upper electrode 195.

액츄에이터(230)의 상부에는 변위 측정용 압전층(196) 및 상부 변위 측정 라인(198)을 포함하는 변위 측정 부재(199)가 형성된다.A displacement measuring member 199 including a piezoelectric layer 196 for measuring displacement and an upper displacement measuring line 198 is formed on the actuator 230.

액츄에이터(230)에는 변형층(190)의 일측으로부터 변형층(190), 하부 전극(185), 지지층(180), 식각 방지층(170), 제2 보호층(165) 및 제1 보호층(155)을 통하여 드레인 패드(135)까지 수직하게 형성된 제1 비어 홀(205)의 내부에 하부 전극(185)과 드레인 패드(135)가 연결되도록 제1 비어 컨택(215)이 형성되며, 상부 변위 측정 라인(198)의 일측으로부터 상부 변위 측정 라인(198), 변위 측정용 압전층(196), 지지층(180), 식각 방지층(170), 제2 보호층(165) 및 제1 보호층(155)을 통하여 변위 측정용 패드(140)까지 수직하게 형성된 제2 비어 홀(210)의 내부에 상부 변위 측정 라인(198)과 변위 측정용 패드(140)가 연결되도록 제2 비어 컨택(220)이 형성된다. 제1 비어 홀(205)과 제2 비어 홀(210)은 동시에 수행되는 것이 바람직하다. 제2 비어 컨택(220)이 형성된 부분의 상부 전극(195), 변형층(190) 및 하부 전극(185)은 미리 패터닝되어 제2 비어 컨택(220)과 접촉되지 않는다. 그러므로, 하부 전극(185)은 제1 비어 컨택(215)을 통하여 드레인 패드(135)에 연결되며, 상부 변위 측정 라인(198)은 제2 비어 컨택(220)을 통하여 하부 변위 측정 라인(145)이 접속된 변위 측정용 패드(140)에 연결된다. 본 발명의 지지층(180)은 상기 선행 출원에 기재된 멤브레인의 기능을 수행한다.The actuator 230 includes a strained layer 190, a lower electrode 185, a support layer 180, an etch stop layer 170, a second protective layer 165, and a first protective layer 155 from one side of the strained layer 190. The first via contact 215 is formed to connect the lower electrode 185 and the drain pad 135 to the inside of the first via hole 205 formed vertically through the drain pad 135. An upper displacement measuring line 198, a piezoelectric layer 196 for displacement measurement, a support layer 180, an etch stop layer 170, a second protective layer 165, and a first protective layer 155 from one side of the line 198. The second via contact 220 is formed to connect the upper displacement measuring line 198 and the displacement measuring pad 140 to the inside of the second via hole 210 vertically formed to the displacement measuring pad 140 through the through hole. do. Preferably, the first via hole 205 and the second via hole 210 are performed at the same time. The upper electrode 195, the strain layer 190, and the lower electrode 185 of the portion where the second via contact 220 is formed are previously patterned so that the second via contact 220 is not in contact with the second via contact 220. Therefore, the lower electrode 185 is connected to the drain pad 135 through the first via contact 215, and the upper displacement measuring line 198 is connected to the lower displacement measuring line 145 through the second via contact 220. It is connected to this connected displacement measuring pad 140. The support layer 180 of the present invention performs the function of the membrane described in the preceding application.

지지층(180)은 양측 지지부로부터 평행하게 형성된 2개의 사각형 형상의 암(arm)들의 사이에 사각형 형상의 평판이 동일 평면상에서 암들과 일체로 형성되어 있는 형상을 갖는다. 지지층(180)의 사각형 형상의 평판의 상부에는 거울(200)이 형성된다. 따라서, 거울(200)은 사각형의 평판의 형상을 갖는다.The support layer 180 has a shape in which a rectangular flat plate is integrally formed with the arms on the same plane between two rectangular arms formed in parallel from both support portions. The mirror 200 is formed on the rectangular flat plate of the support layer 180. Thus, the mirror 200 has the shape of a rectangular flat plate.

이하, 본 발명에 따른 박막형 광로 조절 장치의 제조 방법을 도면을 참조하여 상세하게 설명한다.Hereinafter, a method of manufacturing a thin film type optical path control device according to the present invention will be described in detail with reference to the drawings.

도 5a 내지 도 9b는 본 발명에 따른 박막형 광로 조절 장치의 제조 공정도를 도시한 것이다.5a to 9b show a manufacturing process of the thin film type optical path control apparatus according to the present invention.

도 5a는 본 발명에 따른 장치에 있어서, 제1 금속층을 패터닝한 후의 상태를 나타내는 도 3의 A­A' 선에 따른 액티브 매트릭스의 단면도이며, 도 5b는 제1 금속층을 패터닝한 후의 상태를 나타내는 도 4의 B­B' 선에 따른 액티브 매트릭스의 단면도이며, 도 5c는 본 발명에 따른 장치에 있어서, 제1 금속층을 패터닝한 후의 상태를 나타내는 액티브 매트릭스의 평면도이다.FIG. 5A is a cross-sectional view of the active matrix along line AA ′ of FIG. 3 showing a state after patterning a first metal layer in the device according to the invention, and FIG. 5B shows a state after patterning the first metal layer. 5B is a plan view of an active matrix showing a state after patterning a first metal layer in the apparatus according to the present invention.

도 5a, 도 5b 및 도 5c를 참조하면, n형으로 도우프된 실리콘(Si) 기판으로 구성된 액티브 매트릭스(100)를 준비한 후, 통상의 소자분리 공정, 예컨대 실리콘 부분 산화법(local oxidation of silicon; LOCOS)을 이용하여 액티브 매트릭스(100)에 액티브 영역 및 필드 영역을 구분하기 위한 소자 분리막(120)을 형성한다. 이어서, 액티브 영역의 상부에 불순물이 도우프된 폴리실리콘과 같은 도전물질로 이루어진 게이트(115)를 형성한 후, 이온주입 공정으로 p+소오스(110) 및 드레인(105)을 형성함으로써, M×N(M, N은 정수) 개의 MOS 트랜지스터를 형성한다.5A, 5B and 5C, after preparing an active matrix 100 composed of an n-type doped silicon (Si) substrate, a conventional device isolation process, such as local oxidation of silicon; A device isolation layer 120 is formed in the active matrix 100 to classify the active region and the field region using the LOCOS. Subsequently, a gate 115 made of a conductive material such as polysilicon doped with impurities is formed on the active region, and then a p + source 110 and a drain 105 are formed by an ion implantation process, thereby forming M x. N (M, N is an integer) to form MOS transistors.

트랜지스터가 형성된 결과물의 상부에 산화물로 이루어진 절연막(112)을 형성한 후, 사진 식각 공정으로 게이트(115), 소오스(110) 및 드레인(105)의 일측 상부를 각각 노출시키는 개구부들을 형성한다. 이어서, 개구부들이 형성된 결과물의 상부에 텅스텐(W)과 같은 금속으로 이루어진 제1 금속층(150)을 증착한 후 제1 금속층(150)을 사진 식각 공정으로 패터닝함으로써, 소오스(110)에 접속되는 소오스 라인(130) 및 드레인(105)에 접속되는 드레인 패드(135)를 형성한다. 이와 동시에 드레인 패드(135)와 게이트 라인(125)에 인접한 부위에 변위 측정용 패드(140)를 형성하고, 소오스 라인(130)과 평행하며 변위 측정용 패드(140)에 접속되는 하부 변위 측정 라인(145)을 형성한다. 계속하여, 게이트(115), 소오스 라인(130) 및 하부 변위 측정 라인(145)의 일측 상부에 산화물로 이루어진 절연막(112)을 형성한다. 절연막(112)이 형성된 부위의 상부에 제1 금속층을 적층한 후 패터닝하여 게이트(115)에 접속되는 게이트 라인(125)을 형성한다. 외부로부터 인가된 제1 신호(화상 신호)는 액티브 매트릭스(100)에 내장된 MOS 트랜지스터 및 드레인 패드(135)를 통하여 하부 전극(185)에 전달된다.After the insulating film 112 made of oxide is formed on the resultant transistor, the openings exposing the top of one side of the gate 115, the source 110, and the drain 105 are formed by a photolithography process. Subsequently, the first metal layer 150 made of a metal such as tungsten (W) is deposited on the top of the resultant product in which the openings are formed, and then the first metal layer 150 is patterned by a photolithography process to thereby connect the source 110 to the source 110. A drain pad 135 is formed that is connected to the line 130 and the drain 105. At the same time, a displacement measuring pad 140 is formed at a portion adjacent to the drain pad 135 and the gate line 125, and is a lower displacement measuring line parallel to the source line 130 and connected to the displacement measuring pad 140. 145 is formed. Subsequently, an insulating film 112 made of oxide is formed on one side of the gate 115, the source line 130, and the lower displacement measurement line 145. The first metal layer is stacked on the portion where the insulating layer 112 is formed, and then patterned to form a gate line 125 connected to the gate 115. The first signal (image signal) applied from the outside is transferred to the lower electrode 185 through the MOS transistor and the drain pad 135 embedded in the active matrix 100.

도 6a 및 도 6b는 하부 전극층(184)을 형성한 상태를 나타내는 도면들이다.6A and 6B are diagrams illustrating a state in which the lower electrode layer 184 is formed.

도 6a 및 도 6b를 참조하면, MOS 트랜지스터가 내장된 액티브 매트릭스(100)를 보호하기 위하여 제1 금속층(150)의 상부에 제1 보호층(155)을 형성한다. 제1 보호층(155)은 인 실리케이트 유리(PSG)를 화학 기상 증착(CVD) 방법을 이용하여 8000Å 정도의 두께를 가지도록 형성한다. 제1 보호층(155)은 후속하는 공정 동안 MOS 트랜지스터가 내장된 액티브 매트릭스(100)가 손상을 입게 되는 것을 방지한다.6A and 6B, a first protective layer 155 is formed on the first metal layer 150 to protect the active matrix 100 in which the MOS transistors are embedded. The first passivation layer 155 is formed to have a thickness of about 8000 GPa by using the silicate glass PSG using a chemical vapor deposition (CVD) method. The first protective layer 155 prevents damage to the active matrix 100 in which the MOS transistor is embedded during the subsequent process.

제1 보호층(155)의 상부에는 제2 금속층(160)이 형성된다. 제2 금속층(160)을 형성하기 위하여, 먼저 티타늄(Ti)을 스퍼터링하여 300Å 정도의 두께로 티타늄층을 형성한다. 이어서, 티타늄층의 상부에 질화티타늄을 물리 기상 증착(PVD) 방법을 사용하여 적층하여 질화티타늄층을 형성한다. 제2 금속층(160)은 광원으로부터 입사되는 광이 거울(200)뿐만 아니라, 거울(200)이 형성된 부분을 제외한 부분에도 입사됨으로 인하여, 액티브 매트릭스(100)에 광 누설 전류가 흐르게 되는 것을 방지한다. 이어서, 제2 금속층(160) 중 후속 공정에서 제1 비어 컨택(215) 및 제2 비어 컨택(220)이 형성될 부분을 사진 식각 공정을 통해 식각하여 제2 금속층(160)에 개구부를 형성한다.The second metal layer 160 is formed on the first passivation layer 155. In order to form the second metal layer 160, first, a titanium layer is formed by sputtering titanium (Ti) to a thickness of about 300 μm. Subsequently, titanium nitride is deposited on top of the titanium layer using a physical vapor deposition (PVD) method to form a titanium nitride layer. The second metal layer 160 prevents light leakage current from flowing through the active matrix 100 because light incident from the light source is incident not only to the mirror 200 but also to a portion other than the portion where the mirror 200 is formed. . Subsequently, in the subsequent process of the second metal layer 160, portions in which the first via contact 215 and the second via contact 220 are to be formed are etched through a photolithography process to form openings in the second metal layer 160. .

제2 금속층(160)의 상부에는 제2 보호층(165)이 형성된다. 제2 보호층(165)은 인 실리케이트 유리(PSG)를 사용하여 2000Å 정도의 두께를 갖도록 형성한다. 제2 보호층(165) 역시 후속하는 공정 동안 MOS 트랜지스터가 내장된 액티브 매트릭스(100)와 액티브 매트릭스(100) 상에 형성된 결과물들이 손상을 입게 되는 것을 방지한다.The second passivation layer 165 is formed on the second metal layer 160. The second protective layer 165 is formed to have a thickness of about 2000 GPa using phosphorus silicate glass (PSG). The second protective layer 165 also prevents damage to the active matrix 100 in which the MOS transistor is embedded and the results formed on the active matrix 100 during the subsequent process.

제2 보호층(165)의 상부에는 식각 방지층(170)이 형성된다. 식각 방지층(170)은 액티브 매트릭스(100) 및 제2 보호층(165)이 후속되는 식각 공정으로 인하여 식각되는 것을 방지한다. 식각 방지층(170)은 질화물(Si3N4)을 저압 화학 기상 증착(LPCVD) 방법으로 증착하여 1000∼2000Å 정도의 두께를 가지도록 형성한다.An etch stop layer 170 is formed on the second passivation layer 165. The etch stop layer 170 prevents the active matrix 100 and the second passivation layer 165 from being etched due to the subsequent etching process. The etch stop layer 170 is formed by depositing nitride (Si 3 N 4 ) by a low pressure chemical vapor deposition (LPCVD) method to have a thickness of about 1000 to 2000 kPa.

식각 방지층(170)의 상부에는 희생층(175)이 형성된다. 희생층(175)은 인 실리케이트 유리(PSG)를 대기압 화학 기상 증착(APCVD) 방법을 이용하여 2. 0∼3. 0㎛ 정도의 두께로 증착하여 형성한다. 이 경우, 희생층(175)은 MOS 트랜지스터가 내장된 액티브 매트릭스(100)의 상부를 덮고 있으므로 그 표면의 평탄도가 매우 불량하다. 따라서, 스핀 온 글래스(SOG)를 사용하는 방법 또는 화학 기계적 연마(CMP) 방법을 이용하여 희생층(175)이 1. 1㎛ 정도의 두께가 되도록 희생층(175)의 표면을 연마함으로써 평탄화시킨다.The sacrificial layer 175 is formed on the etch stop layer 170. The sacrificial layer 175 is formed of phosphorous silicate glass (PSG) using an atmospheric pressure chemical vapor deposition (APCVD) method. 0 to 3. It is formed by depositing at a thickness of about 0㎛. In this case, since the sacrificial layer 175 covers the upper portion of the active matrix 100 in which the MOS transistor is embedded, the surface flatness is very poor. Accordingly, the surface of the sacrificial layer 175 is planarized by using spin on glass (SOG) or chemical mechanical polishing (CMP) to polish the surface of the sacrificial layer 175 to a thickness of about 1 μm. .

이어서, 희생층(175) 중 아래에 제2 금속층(160)의 개구부가 형성된 두 부분을 식각하여 식각 방지층(170)의 일부를 노출시킴으로써, 액츄에이터(230)의 지지부인 앵커(anchor)가 형성될 위치를 만든다.Subsequently, two portions of the sacrificial layer 175 having the opening of the second metal layer 160 are etched to expose a portion of the etch stop layer 170, thereby forming an anchor, which is a support of the actuator 230. Make a location.

노출된 식각 방지층(170)의 상부 및 희생층(175)의 상부에 제1층(179)을 형성한다. 제1층(179)은 질화물을 저압 화학 기상 증착(LPCVD) 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 가지도록 형성한다. 제1층(179)은 후에 지지층(180)으로 패터닝된다.The first layer 179 is formed on the exposed etch stop layer 170 and on the sacrificial layer 175. The first layer 179 is formed to have a thickness of about 0.1 to 1.0 탆 using low pressure chemical vapor deposition (LPCVD). The first layer 179 is later patterned into the support layer 180.

제1층(179)의 상부에는 전기 전도성이 우수한 금속인 백금, 탄탈륨, 또는 백금-탄탈륨(Pt-Ta) 등의 금속을 사용하여 하부 전극층(184)을 형성한다. 하부 전극층(184)은 스퍼터링 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 가지도록 형성한다. 이어서, 하부 전극층(184) 중 아래에 변위 측정용 패드(140)가 형성된 부분을 식각함과 동시에 제2 비어 컨택(220)이 형성될 부분의 주변을 제2 비어 컨택(220)보다 크게 식각하여 제1층(179)을 노출시킨다. 하부 전극층(184)을 각각의 화소별로 분리시킴으로써 각 화소들에 독립적인 제1 신호가 인가되도록 한다(Iso­Cut 공정). 하부 전극층(184)은 후에 하부 전극(185)으로 패터닝된다. 하부 전극(185)에는 액티브 매트릭스(100)에 내장된 트랜지스터로부터 전달된 제1 신호가 인가된다.The lower electrode layer 184 is formed on the first layer 179 using a metal such as platinum, tantalum, or platinum-tantalum (Pt-Ta), which is a metal having excellent electrical conductivity. The lower electrode layer 184 is formed to have a thickness of about 0.01 to 1.0 µm using a sputtering method. Subsequently, the portion of the lower electrode layer 184 having the displacement measuring pad 140 formed thereon is etched, and at the same time, the periphery of the portion where the second via contact 220 is to be formed is etched larger than the second via contact 220. The first layer 179 is exposed. By separating the lower electrode layer 184 for each pixel, an independent first signal is applied to each pixel (Iso­Cut process). The lower electrode layer 184 is later patterned into the lower electrode 185. The first signal transferred from the transistor embedded in the active matrix 100 is applied to the lower electrode 185.

도 7a 및 도 7b는 하부 전극(185)을 형성한 상태를 나타내는 도면들이다.7A and 7B are diagrams illustrating a state in which the lower electrode 185 is formed.

도 7a 및 도 7b를 참조하면, 하부 전극층(184)의 상부에는 제2층이 적층된다. 제2층은 PZT, 또는 PLZT 등의 압전 물질을 사용하여 0.1∼1.0㎛, 바람직하게는 0.4㎛ 정도의 두께를 가지도록 형성한다. 제2층은 졸-겔(Sol-Gel)법, 스퍼터링 방법, 또는 화학 기상 증착(CVD) 방법을 이용하여 형성한 후, 급속 열처리(RTA) 방법으로 열처리하여 상변이시킨다. 이어서, 제2층 중 제2 비어 컨택(220)이 형성될 부분의 주변을 하부 전극층(184)이 패터닝된 형상으로 하부 전극층(184)보다 좁게 식각하여 제1층(179)을 노출시킨다. 제2층은 후에 변형층(190)으로 패터닝된다. 변형층(190)은 상부 전극(195)에 제2 신호가 인가되고 하부 전극(185)에 제1 신호가 인가되어 상부 전극(195)과 하부 전극(185) 사이의 전위차에 따라 발생하는 전기장에 의하여 변형을 일으킨다.7A and 7B, a second layer is stacked on the lower electrode layer 184. The second layer is formed using a piezoelectric material such as PZT or PLZT so as to have a thickness of 0.1 to 1.0 mu m, preferably about 0.4 mu m. The second layer is formed using a sol-gel method, a sputtering method, or a chemical vapor deposition (CVD) method, and then subjected to a phase change by heat treatment using a rapid heat treatment (RTA) method. Subsequently, the first layer 179 is exposed by etching a portion of the second layer in which the second via contact 220 is to be formed to be narrower than the lower electrode layer 184 in a patterned pattern of the lower electrode layer 184. The second layer is later patterned into a strained layer 190. The strained layer 190 is applied to an electric field generated by a second signal applied to the upper electrode 195 and a first signal applied to the lower electrode 185 according to a potential difference between the upper electrode 195 and the lower electrode 185. Cause deformation.

제2층의 상부에는 상부 전극층이 적층된다. 상부 전극층은 백금, 알루미늄, 또는 은 등의 전기 전도성 및 반사성을 갖는 금속을 스퍼터링 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 가지도록 형성한다. 이어서, 상부 전극층 중 제2 비어 컨택(220)이 형성될 부분의 주변을 제2층이 패터닝된 형상으로 제2층보다 좁게 식각하여 제1층(179)을 노출시킨다. 이와 동시에, 상부 전극층 중 제1 비어 컨택(215)이 형성될 부분의 주변을 식각하여 제2층을 노출시킨다. 상부 전극층은 후에 상부 전극(195)으로 패터닝된다.An upper electrode layer is stacked on top of the second layer. The upper electrode layer is formed of a metal having electrical conductivity and reflectivity, such as platinum, aluminum, or silver, to have a thickness of about 0.01 to 1.0 탆 using a sputtering method. Subsequently, the first layer 179 is exposed by etching the peripheral portion of the upper electrode layer in which the second via contact 220 is to be formed to be narrower than the second layer in a patterned pattern of the second layer. At the same time, the periphery of the portion of the upper electrode layer where the first via contact 215 is to be formed is etched to expose the second layer. The upper electrode layer is later patterned into the upper electrode 195.

상부 전극층의 상부에는 변위 측정용 압전층(196)이 형성된다. 변위 측정용 압전층(196)은 변형층(190)과 마찬가지로 PZT, 또는 PLZT 등의 압전 물질을 사용하여 형성한다. 변위 측정용 압전층(196)은 졸-겔(Sol-Gel)법, 스퍼터링 방법, 또는 화학 기상 증착(CVD) 방법을 이용하여 형성한 후, 급속 열처리(RTA) 방법으로 열처리하여 상변이시킨다. 이어서, 변위 측정용 압전층(196) 중 제1 비어 컨택(215)이 형성될 부분의 주변을 상부 전극층이 패터닝된 형상으로 상부 전극층보다 좁게 식각하여 제2층을 노출시킨다.The piezoelectric layer 196 for displacement measurement is formed on the upper electrode layer. The piezoelectric layer 196 for displacement measurement is formed using a piezoelectric material such as PZT or PLZT similarly to the strained layer 190. The piezoelectric layer 196 for displacement measurement is formed by using a sol-gel method, a sputtering method, or a chemical vapor deposition (CVD) method, and then subjected to a phase change by heat treatment using a rapid heat treatment (RTA) method. Subsequently, the upper electrode layer is patterned around the portion of the displacement measurement piezoelectric layer 196 on which the first via contact 215 is to be formed to be narrower than the upper electrode layer to expose the second layer.

변위 측정용 압전층(196)의 상부에는 상부 변위 측정 금속층이 형성된다. 상부 변위 측정 금속층은 백금, 탄탈륨, 백금-탄탈륨, 알루미늄, 또는 은을 사용하여 형성한다. 상부 변위 측정 금속층은 스퍼터링 방법 또는 화학 기상 증착 방법을 사용하여 형성한다.An upper displacement measuring metal layer is formed on the piezoelectric layer 196 for displacement measurement. The upper displacement measurement metal layer is formed using platinum, tantalum, platinum-tantalum, aluminum, or silver. The upper displacement measuring metal layer is formed using a sputtering method or a chemical vapor deposition method.

상부 변위 측정 금속층의 상부에 제1 포토 레지스트(도시되지 않음)를 스핀 코팅(spin coating) 방법으로 도포한 후, 상부 변위 측정 금속층이 도 2에 도시한 바와 같이 거울상의‘ㄷ’자의 형상을 가지도록 패터닝하여 상부 변위 측정 라인(198)을 형성한다. 이어서, 제1 포토 레지스트를 제거한 후, 패터닝된 상부 변위 측정 라인(198) 및 변위 측정용 압전층(196)의 상부에 제2 포토 레지스트(도시되지 않음)를 스핀 코팅 방법으로 도포한 후, 변위 측정용 압전층(196)이 상부 변위 측정 라인(198) 보다 약간 넓은 거울상의‘ㄷ’자의 형상을 갖도록 패터닝하여 변위 측정 부재(199)를 완성한다(도 2 참조). 계속하여, 제2 포토 레지스트를 제거하고 상부 변위 측정 라인(198), 변위 측정용 압전층(196) 및 상부 전극층의 상부에 제3 포토 레지스트(도시되지 않음)를 스핀 코팅 방법으로 도포한 후, 상부 전극층을 변위 측정용 압전층(196)보다 약간 넓은 거울상의‘ㄷ’자의 형상을 갖도록 패터닝하여 상부 전극(195)을 형성한다. 제3 포토 레지스트를 제거하고 변위 측정 부재(199), 상부 전극(195), 제2층의 상부에 제4 포토 레지스트(도시되지 않음)를 스핀 코팅 방법으로 도포한 후, 제2층을 상부 전극(195)보다 약간 넓은 거울상의‘ㄷ’자의 형상을 갖도록 패터닝하여 변형층(190)을 형성한다. 제4 포토 레지스트를 제거하고 변위 측정 부재(199), 상부 전극(195), 변형층(190), 및 하부 전극층의 상부에 제5 포토 레지스트(도시되지 않음)를 스핀 코팅 방법으로 도포한 후, 하부 전극층을 변형층(190)보다 약간 넓은 거울상의‘ㄷ’자의 형상을 갖도록 패터닝하여 하부 전극(185)을 형성한다.After applying the first photoresist (not shown) to the upper portion of the upper displacement measuring metal layer by spin coating, the upper displacement measuring metal layer has a mirror-shaped 'C' shape as shown in FIG. 2. Patterned to form the upper displacement measurement line 198. Subsequently, after the first photoresist is removed, a second photoresist (not shown) is applied on the patterned upper displacement measuring line 198 and the piezoelectric layer 196 for displacement measurement by spin coating, and then displaced. The piezoelectric layer 196 for measurement is patterned to have a mirror-shaped 'c' shape slightly wider than the upper displacement measuring line 198 to complete the displacement measuring member 199 (see FIG. 2). Subsequently, after removing the second photoresist and applying a third photoresist (not shown) on the upper displacement measuring line 198, the piezoelectric layer 196 for displacement measurement, and the upper electrode layer by spin coating, The upper electrode layer is patterned to have a mirror-shaped 'c' shape slightly wider than the piezoelectric layer 196 for displacement measurement to form the upper electrode 195. After removing the third photoresist and applying a fourth photoresist (not shown) on the displacement measuring member 199, the upper electrode 195, and the second layer by spin coating, the second layer is applied to the upper electrode. The strained layer 190 may be formed by patterning the mirror to have a shape of 'c' slightly wider than the width of 195. After removing the fourth photoresist and applying a fifth photoresist (not shown) on the displacement measuring member 199, the upper electrode 195, the deformation layer 190, and the lower electrode layer by spin coating, The lower electrode layer is patterned to have a mirror-shaped 'c' shape slightly wider than the deformation layer 190 to form the lower electrode 185.

도 8a 및 도 8b는 제1 비어 컨택(215) 및 제2 비어 컨택(220)을 형성한 상태를 나타내는 도면들이다.8A and 8B are diagrams illustrating a state in which the first via contact 215 and the second via contact 220 are formed.

도 8a 및 도 8b를 참조하면, 변형층(190) 중 아래에 드레인 패드(135)가 형성되어 있는 부분을 식각하여 제1 비어 홀(205)을 형성한다. 이와 동시에, 상부 변위 측정 라인(198) 중 아래에 변위 측정용 패드(140)가 형성되어 있는 부분을 식각하여 제2 비어 홀(210)을 형성한다. 즉, 변형층(190), 하부 전극(185), 제1층(179), 식각 방지층(170), 제2 보호층(165), 그리고 제1 보호층(155)을 차례로 식각하여 변형층(190)의 일측으로부터 드레인 패드(135)까지 제1 비어 홀(205)을 형성한다. 이와 동시에, 상부 변위 측정 라인(198), 변위 측정용 압전층(196), 제1층(179), 식각 방지층(170), 제2 보호층(165), 그리고 제1 보호층(155)을 차례로 식각하여 상부 변위 측정 라인(198)의 일측으로부터 하부 변위 측정 라인(145)이 접속된 변위 측정용 패드(140)까지 제2 비어 홀(210)을 형성한다. 이어서, 제1 비어 홀(205)의 내부에 텅스텐(W), 백금, 알루미늄, 또는 티타늄 등의 금속을 스퍼터링 방법을 이용하여 드레인 패드(135)와 하부 전극(185)이 연결되도록 제1 비어 컨택(215)을 형성한다. 마찬가지로, 제2 비어 홀(210)의 내부에 텅스텐(W), 백금, 알루미늄, 또는 티타늄 등의 금속을 스퍼터링 방법을 이용하여 변위 측정용 패드(140)와 상부 변위 측정 라인(198)이 연결되도록 제2 비어 컨택(220)을 형성한다. 제2 비어 컨택(220)이 형성된 부분의 하부 전극(185)은 제2 비어 컨택(220)보다 큰 호의 형상으로 패터닝되어 있으므로, 제2 비어 컨택(220)은 하부 전극(185)과 접촉되지 않는다.8A and 8B, a portion of the strain layer 190 in which the drain pad 135 is formed is etched to form a first via hole 205. At the same time, a portion of the upper displacement measuring line 198 in which the displacement measuring pad 140 is formed is etched to form a second via hole 210. That is, the strained layer 190, the lower electrode 185, the first layer 179, the etch stop layer 170, the second passivation layer 165, and the first passivation layer 155 are sequentially etched to form the strain layer ( The first via hole 205 is formed from one side of the 190 to the drain pad 135. At the same time, the upper displacement measuring line 198, the piezoelectric layer 196 for displacement measurement, the first layer 179, the etch stop layer 170, the second protective layer 165, and the first protective layer 155 are disposed. Etching is sequentially performed to form a second via hole 210 from one side of the upper displacement measuring line 198 to the displacement measuring pad 140 to which the lower displacement measuring line 145 is connected. Subsequently, the first via contact is connected to the drain pad 135 and the lower electrode 185 by sputtering a metal such as tungsten (W), platinum, aluminum, or titanium into the first via hole 205. 215 is formed. Similarly, the displacement measuring pad 140 and the upper displacement measuring line 198 may be connected to the inside of the second via hole 210 by sputtering a metal such as tungsten (W), platinum, aluminum, or titanium. The second via contact 220 is formed. Since the lower electrode 185 of the portion where the second via contact 220 is formed is patterned in an arc shape larger than the second via contact 220, the second via contact 220 does not contact the lower electrode 185. .

도 9a 및 도 9b는 거울(200)을 형성한 상태를 나타내는 도면들이다.9A and 9B are views illustrating a state in which the mirror 200 is formed.

도 9a 및 도 9b를 참조하면, 패터닝된 하부 전극(185), 제1 비어 컨택(215) 및 제2 비어 컨택(220)의 상부에 제6 포토 레지스트(도시되지 않음)를 스핀 코팅 방법으로 도포한 후, 제1층(179)의 양측 지지부로부터 연장된 부분은 하부 전극(185) 보다 약간 넓은 사각형의 형상을 가지며, 이와 일체로 형성된 제1층(179)의 중앙부는 사각형의 평판의 형상을 갖도록 패터닝하여 지지층(180)을 형성한다. 즉, 도 2에 도시한 바와 같이 지지층(180)은 양측 지지부로부터 사각형 형상의 암들이 연장되고, 이러한 암들 사이에 보다 넓은 면적을 갖는 사각형 형상의 평판이 동일 평면상에서 암들과 일체로 형성된 형상을 가진다. 그리고, 제6 포토 레지스트를 제거한다. 상기와 같이 지지층(180)이 패터닝된 결과, 희생층(175)의 일부가 노출된다.9A and 9B, a sixth photoresist (not shown) is applied on the patterned lower electrode 185, the first via contact 215, and the second via contact 220 by spin coating. Afterwards, a portion extending from both support portions of the first layer 179 has a shape of a rectangle that is slightly wider than the lower electrode 185, and a central portion of the first layer 179 formed integrally therewith has a shape of a rectangular flat plate. It is patterned to have a support layer 180 is formed. That is, as shown in FIG. 2, the support layer 180 has rectangular arms extending from both support portions, and a rectangular flat plate having a wider area between the arms is formed integrally with the arms on the same plane. . Then, the sixth photoresist is removed. As a result of the patterning of the support layer 180 as described above, a portion of the sacrificial layer 175 is exposed.

노출된 희생층(175)의 상부 및 지지층(180)의 상부에 제7 포토 레지스트(도시되지 않음)를 스핀 코팅 방법으로 도포한 후, 지지층(180)의 중앙부인 사각형 형상의 평판이 노출되도록 패터닝한다. 그리고, 사각형 형상의 노출된 지지층(180)의 중앙부의 상부에 은, 백금, 또는 알루미늄 등의 반사성을 갖는 금속을 0.3∼2.0㎛ 정도의 두께로 스퍼터링 방법 또는 화학 기상 증착 방법을 이용하여 증착시킨다. 계속하여, 증착된 금속이 사각형 형상의 노출된 지지층(180)의 중앙부와 동일한 형상을 갖도록 증착된 금속을 패터닝하여 거울(200)을 형성한 후, 제7 포토 레지스트를 제거한다.After applying a seventh photoresist (not shown) on the exposed sacrificial layer 175 and the upper portion of the support layer 180 by spin coating, patterning is performed so that a rectangular flat plate, which is the center of the support layer 180, is exposed. do. In addition, a sputtering method or a chemical vapor deposition method is used to form a metal having reflective properties such as silver, platinum, or aluminum on the upper portion of the center portion of the rectangular exposed support layer 180 to a thickness of about 0.3 to 2.0 µm. By deposition. Subsequently, the deposited metal is patterned so that the deposited metal has the same shape as the center portion of the rectangular exposed support layer 180 to form the mirror 200, and then the seventh photoresist is removed.

이어서, 희생층(175)을 플루오르화 수소(HF) 증기를 사용하여 제거하여 희생층(175)의 위치에 에어 갭(225)을 형성한 후, 세정(rinse) 및 건조(dry)하여 박막형 광로 조절 장치를 완성한다.Subsequently, the sacrificial layer 175 is removed using hydrogen fluoride (HF) vapor to form an air gap 225 at the position of the sacrificial layer 175, followed by rinsing and drying to form a thin film type optical path. Complete the adjustment.

상술한 본 발명에 따른 박막형 광로 조절 장치에 있어서, 제1 신호는 액티브 매트릭스(100)에 내장된 트랜지스터, 드레인 패드(135) 및 제1 비어 컨택(215)을 통하여 하부 전극(185)에 인가된다. 동시에 제2 신호는 공통 전극선을 통하여 상부 전극((195)에 인가되어, 상부 전극(195)과 하부 전극(185) 사이에 전위차에 따른 전기장이 발생한다. 이러한 전기장에 의하여 상부 전극(195)과 하부 전극(185) 사이에 형성된 변형층(190)이 변형을 일으킨다. 변형층(190)은 발생한 전기장에 대하여 직교하는 방향으로 수축하며, 따라서, 변형층(190) 및 지지층(180)을 포함하는 액츄에이터(230)는 소정의 각도를 가지고 휘어진다. 이 때, 상부 전극(195)의 상부에 형성된 변위 측정용 압전층(196)도 함께 변형을 일으키면서 전하를 발생시키고, 발생된 전하는 상부 변위 측정 라인(198)에 흐른다. 변위 측정용 압전층(196)의 변형에 의해 발생된 전하는 제2 비어 컨택(220) 및 변위 측정용 패드(140)를 통하여 하부 변위 측정 라인(145)에 전달되고, 그 전하량을 측정하여 액츄에이터(230)의 구동 각도를 산출할 수 있다. 따라서, 발생된 전류가 적정 영역을 초과하거나 미달하는 경우, 상부 전극 및 하부 전극 사이에 적정 전압을 발생시켜 원하는 구동 각도로 액츄에이터를 구동시킬 수 있다. 그 결과 각각의 액츄에이터들의 구동 각도를 균일화할 수 있다. 광원으로부터 입사되는 광을 반사하는 거울(200)은 지지층(180)의 중앙부의 상부에 형성되어 있으므로 액츄에이터(230)와 같은 각도로 휘어진다. 이에 따라, 거울(200)은 입사되는 광을 소정의 각도로 반사하며, 반사된 광은 슬릿을 통과하여 스크린에 투영되어 화상을 맺게 된다.In the above-described thin film type optical path control device according to the present invention, the first signal is applied to the lower electrode 185 through the transistor, the drain pad 135 and the first via contact 215 embedded in the active matrix 100. . At the same time, the second signal is applied to the upper electrode 195 through the common electrode line, thereby generating an electric field according to the potential difference between the upper electrode 195 and the lower electrode 185. Due to this electric field, The strained layer 190 formed between the lower electrodes 185 causes strain. The strained layer 190 contracts in a direction perpendicular to the generated electric field, and thus includes the strained layer 190 and the support layer 180. The actuator 230 is bent at a predetermined angle, at this time, the piezoelectric layer 196 for measuring displacement formed on the upper electrode 195 also generates charge while deforming, and the generated charge is measured for upper displacement. Flows in line 198. The charge generated by the deformation of the piezoelectric layer 196 for displacement measurement is transmitted to the lower displacement measurement line 145 through the second via contact 220 and the displacement measurement pad 140, The amount of charge is measured and the actuator 230 Therefore, when the generated current exceeds or falls below the proper range, an appropriate voltage can be generated between the upper electrode and the lower electrode to drive the actuator at a desired driving angle. The driving angles of the actuators may be uniformized, and the mirror 200 reflecting the light incident from the light source may be bent at the same angle as the actuator 230 because the mirror 200 is formed above the central portion of the support layer 180. The mirror 200 reflects the incident light at a predetermined angle, and the reflected light passes through the slit to be projected onto the screen to form an image.

본 발명에 따른 박막형 광로 조절 장치 및 그 제조 방법에 의하면, 상부 전극의 상부에 변위 측정용 압전층 및 상부 변위 측정 라인을 포함하는 변위 측정 부재를 형성하고, 하부 변위 측정 라인 및 변위 측정용 패드를 액티브 매트릭스에 별도로 배선한다. 제2 비어 컨택을 통하여 변위 측정 부재를 액티브 매트릭스에 배선된 하부 변위 측정 라인이 접속된 변위 측정용 패드와 연결함으로써, 변위 측정용 압전층의 변형에 따른 전류를 측정할 수 있게 된다. 따라서, 발생된 전류가 적정 영역을 초과하거나 미달하는 경우, 상부 전극 및 하부 전극 사이에 적정 전압을 발생시켜 원하는 구동 각도로 액츄에이터를 구동시킬 수 있다.According to the thin film type optical path adjusting device and the manufacturing method thereof according to the present invention, a displacement measuring member including a piezoelectric layer for measuring displacement and an upper displacement measuring line is formed on the upper electrode, and a lower displacement measuring line and a displacement measuring pad are formed. Wire to the active matrix separately. By connecting the displacement measuring member to the displacement measuring pad connected to the lower displacement measuring line wired to the active matrix through the second via contact, the current according to the deformation of the piezoelectric layer for displacement measurement can be measured. Therefore, when the generated current exceeds or falls below the proper range, a proper voltage can be generated between the upper electrode and the lower electrode to drive the actuator at a desired driving angle.

상술한 바와 같이, 본 발명의 바람직한 실시예를 참조하여 설명하였지만 해당 기술 분야의 숙련된 당업자라면 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.As described above, although described with reference to a preferred embodiment of the present invention, those skilled in the art will be variously modified without departing from the spirit and scope of the invention described in the claims below. And can be changed.

Claims (4)

M×N 개의 트랜지스터가 내장된 액티브 매트릭스(100)의 상부에 형성되며 소오스 라인(130), 드레인(105)에 접속된 드레인 패드(135) 및 하부 변위 측정 라인(145)과, 이에 접속된 변위 측정용 패드(140)를 포함하는 제1 금속층(150);A drain pad 135 and a lower displacement measuring line 145 connected to the source line 130, the drain 105, and the displacement connected to the source line 130, the drain 105, and formed on the active matrix 100 having M × N transistors embedded therein. A first metal layer 150 including a measurement pad 140; 상기 제1 금속층(150) 및 액티브 매트릭스(100)의 상부에 형성되며, 지지층(180), 하부 전극(185), 변형층(190) 및 상부 전극(195)을 포함하는 액츄에이터(230);An actuator (230) formed on the first metal layer (150) and the active matrix (100) and including a support layer (180), a lower electrode (185), a strain layer (190), and an upper electrode (195); 상기 액츄에이터(230)의 상부에 형성되며, 변위 측정용 압전층(196) 및 상부 변위 측정 라인(198)을 포함하는 변위 측정 부재(199);A displacement measuring member (199) formed on the actuator (230) and including a piezoelectric layer (196) for measuring displacement and an upper displacement measuring line (198); 상기 하부 전극(185)과 상기 드레인 패드(135)를 연결하는 제1 비어 컨택(215);A first via contact 215 connecting the lower electrode 185 and the drain pad 135 to each other; 상기 상부 변위 측정 라인(198)과 상기 변위 측정용 패드(140)를 연결하는 제2 비어 컨택(220); 그리고A second via contact 220 connecting the upper displacement measuring line 198 and the displacement measuring pad 140 to each other; And 상기 지지층(180)의 상부에 형성된 거울(200)을 포함하는 박막형 광로 조절 장치.Thin film type optical path control device comprising a mirror (200) formed on the support layer (180). 제1항에 있어서, 상기 변위 측정용 압전층(196)은 PZT 또는 PLZT를 사용하여 형성되며, 상기 상부 변위 측정 라인(198)은 백금, 탄탈륨, 백금-탄탈륨, 알루미늄, 또는 은을 사용하여 형성되는 것을 특징으로 하는 박막형 광로 조절 장치.The piezoelectric layer 196 of claim 1, wherein the piezoelectric layer 196 for displacement measurement is formed using PZT or PLZT, and the upper displacement measurement line 198 is formed using platinum, tantalum, platinum-tantalum, aluminum, or silver. Thin film type optical path control device, characterized in that. M×N 개의 트랜지스터가 내장된 액티브 매트릭스의 상부에 제1 금속층을 적층한 후 패터닝하여 소오스 라인, 드레인에 접속된 드레인 패드 및 하부 변위 측정 라인과, 이에 접속된 변위 측정용 패드를 형성하는 단계;Stacking and patterning a first metal layer on an active matrix including M × N transistors to form a source line, a drain pad connected to a drain, and a lower displacement measuring line and a displacement measuring pad connected thereto; 상기 제1 금속층 및 액티브 매트릭스의 상부에 지지층, 하부 전극, 변형층 및 상부 전극을 포함하는 액츄에이터를 형성하는 단계;Forming an actuator on the first metal layer and the active matrix, the actuator including a support layer, a lower electrode, a strain layer, and an upper electrode; 상기 액츄에이터의 상부에 변위 측정용 압전층 및 상부 변위 측정 라인을 포함하는 변위 측정 부재를 형성하는 단계;Forming a displacement measuring member including a piezoelectric layer for displacement measurement and an upper displacement measurement line on an upper portion of the actuator; 상기 하부 전극과 상기 드레인 패드를 연결하는 제1 비어 컨택을 형성하는 단계;Forming a first via contact connecting the lower electrode and the drain pad; 상기 상부 변위 측정 라인과 상기 변위 측정용 패드를 연결하는 제2 비어 컨택을 형성하는 단계; 그리고Forming a second via contact connecting the upper displacement measuring line and the displacement measuring pad; And 상기 지지층의 상부에 거울을 형성하는 단계를 포함하는 박막형 광로 조절 장치의 제조 방법.Method of manufacturing a thin film type optical path control device comprising the step of forming a mirror on top of the support layer. 제3항에 있어서, 상기 제1 비어 컨택을 형성하는 단계 및 상기 제2 비어 컨택을 형성하는 단계는 동시에 수행되는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The method of claim 3, wherein the forming of the first via contact and the forming of the second via contact are performed simultaneously.
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