KR100227787B1 - 실리콘 미소 구조체 제조 방법 - Google Patents
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Abstract
큰 종횡비와 작은 저항 및 변형이 없는 실리콘 구조체를 표면 미세 가공 기술로 제작할 수 없었던 종래 기술의 문제점을 가운데의 두꺼운 실리콘층과 농도 조절을 위한 상하의 얇은 실리콘층으로 실리콘 다층 구조를 형성하여 박막의 상하 방향으로 불순물을 대칭으로 분포시켜 응력 구배를 제거하고, 가운데의 실리콘 박막에 잔류 응력이 존재하는 경우 상하에 주입되는 불순물의 양을 조절함으로써 기존의 응력 구배를 상쇄시켜 미소 구조체의 휨 변형을 최소화시킬 수 있는 실리콘 미소 구조체 제조 방법이 개시된다.
Description
본 발명은 실리콘 미소 구조체 제조 방법에 관한 것으로, 특히 고농도의 불순물을 첨가하여 낮은 저항의 전도체를 제작하고 불순물을 균일하게 첨가함으로써 휨(deflection) 현상이 적은 실리콘 미소 구조체 제조 방법에 관한 것이다.
종래의 실리콘 마이크로 캔티레버(cantilever)는 가속도계, 각속도계, 미소 액튜에이터(micro-actuator)등 많은 미소기전소자(microelectromechanical system; MEMS) 분야에서 기계적 동작을 구성하는 소자로서 사용되고 있으나, 종횡비(aspect ratio)가 크고, 저항이 작으며 변형이 없는 실리콘 구조체를 표면 미세 가공 기술을 이용하여 제작하기가 어렵다.
한편, 미국의 버클리 대학에서는 실리콘막에 균일한 불순물을 얻기위해 PSG 산화막을 사용하였다. 이 방법에서는 PSG 산화막은 실리콘막의 상하에 형성되며 열처리를 통하여 실리콘막의 상하 두 방향에서 동시에 불순물이 확산되어 첨가된다. 그러나 PSG 산화막은 고농도의 불순물을 첨가하기가 용이하지 못하므로 낮은 저항의 실리콘 구조체를 제조하기 힘들다. 또한, 희생층 제거에 효과적인 기술인 HF 기상(gas phase) 식각 공정을 PSG 산화막의 식각에 사용하면 잔류 물질이 형성된다는 단점을 가지고 있다.
표면 미세 가공 기술로 미소 구조물을 제작하는데 있어 중요한 제한 요소중의 하나는 박막의 잔류 응력이다. 희생층을 제거하여 구조체를 기판으로부터 띄울 때, 잔류 응력으로 인하여 구조물의 변형이 일어나므로 설계된 소자의 특성을 얻을 수 없다. 박막의 두께에 대하여 불균일한 응력으로 인한 응력 구배(stress gradient)는 캔티레버 빔에서 상하방향으로 심각한 변형을 일으킨다. 또한 전도체의 실리콘 구조물을 제조하기 위하여 불순물을 첨가할 때, 불균일한 불순물의 농도분포는 박막의 응력 구배를 야기한다. 따라서 두께가 수 마이크론이고 저항이 작은 실리콘 구조물을 제조하려면 기존의 반도체 공정과 호환성이 있는 표면 미세 가공기술로서 불순물의 농도 분포를 조절하여 응력 구배를 제거할 수 있는 기술이 필요한다.
따라서, 본 발명은 기존의 미세가공(micromachining) 기술을 이용한 구조체 제조 방법에 비해 고농도의 불순물을 첨가하여 보다 낮은 저항의 전도체를 제조하고 또한 불순물을 균일하게 첨가함으로써 휨(deflection) 현상이 보다 적은 실리콘 미소 구조체의 제조 방법을 제공하는데 그 목적이 있다.
상술한 목적을 달성하기 위한 본 발명은 실리콘 웨이퍼 상부에 TEOS 산화막을 형성한 후 TEOS 산화막의 선택된 영역을 식각하여 홀을 형성하는 단계와, 전체 구조 상부에 제1실리콘막을 형성하고 불순물을 주입하는 단계와, 상기 제1실리콘막 상부에 제2실리콘막을 형성하고 불순물을 주입하는 단계와, 상기 제2실리콘막 상부에 제3실리콘막을 형성하고 불순물을 주입하는 단계와, 상기 제3, 제2 및 제1실리콘막의 선택된 영역을 순차적으로 식각하여 상기 TEOS 산화막의 상부가 노출되도록 구조체 형상을 형성하는 단계와, 상기 TEOS 산화막을 제거하여 실리콘 미소 구조물을 기판으로부터 분리시키는 단계로 이루어진 것을 특징으로 한다.
제1도는 본 발명에 따른 실리콘 캔티레버 구조체의 개략도.
제2(a)도 내지 제2(f)도는 본 발명에 따른 표면 미세 가공(micromachining) 기술을 이용한 실리콘 미소 구조체의 제조 방법을 순서적으로 도시한 단면도.
* 도면의 주요부분에 대한 부호의 설명
1 : 실리콘 웨이퍼 2 : 열 산화막
3 : 질화막 4 : 제1실리콘막
5 : 제1TEOS 산화막 6 : 감광막
7 : 홀 8 : 제2실리콘막
9 : 제3실리콘막 10 : 제4실리콘막
11 : 제2TEOS 산화막 12 : 감광막
13 : TEOS 마스크 14 : 구조체 형상
본 발명을 첨부된 도면을 참조하여 상세히 설명하기로 한다.
제1도는 본 발명에 따른 실리콘 캔티레버 구조체의 개략도이다. 이러한 구조체 내에는 불균일한 잔류 응력으로 인한 휨 모멘트가 발생한다. 이 휨 모멘트는 구조체에 상하로 휨 변형을 발생시킨다. 이때 캔티레버 구조체의 휨 변형량(y)은 아래의 수학식으로 표현된다.
[수학식]
여기서, E는 구조체 재료의 영의 계수(Young's modulus), Mb는 휨 모멘트, L은 캔티레버 구조체의 길이, I는 관성 모멘트로 Iwt3/12와 같으며, w와 t는 각각 구조체의 너비와 두께이다.
제2(a)도 내지 제2(f)도는 본 발명의 일 실시예에 따른 표면 미세 가공(micromachining) 기술을 이용한 실리콘 미소 구조체의 제조 방법을 순서적으로 도시한 단면도이다.
제2(a)도에 도시된 바와 같이 (100) 방향성을 갖는 실리콘 웨이퍼(1)에 소자 사이의 절연을 위하여 열 산화막(2)이 성장된 후 질화막(3)이 성장된다. TEOS 산화막과 질화막 사이의 계면 반응을 억제하기 위한 확산 방지막과 전극으로 작용하는 제1실리콘막(4)이 증착되고 불순물이 주입된 후 표면 미세 가공 기술의 희생층으로 사용될 제1 TEOS 산화막(5)이 수 마이크론 두께로 증착된다.
제2(b)도에 도시된 바와 같이 실리콘 구조체와 전극 사이에 전기적 연결을 위한 홀(hole)을 형성시키기 위하여 제1TEOS 산화막(5) 상부에 감광막(photo resist)(6)이 도포된 후 리소그라피 공정을 통하여 홀 패턴이 형성된다. 이어 제1TEOS 산화막(5)의 선택된 영역에 반응성 이온 식각(reactive ion etching)이 실시되어 홀(7)이 형성된다.
제2(c)도는 전도성 실리콘 구조체를 제조하기 위하여 여러 단계의 실리콘 증착과 불순물 주입이 이루어진 후의 단면도이다. 감광막(6)을 제거한 후 얇은 제2실리콘막(8)이 증착되고 불순물이 주입된다. 다시 제3실리콘막(9)이 증착되어 불순물이 주입되고, 제4실리콘막(10)이 증착된 후에 열처리(annealing)를 통하여 불순물이 실리콘내로 확산된다.
저항이 작은 전도성 실리콘 구조체를 제조하기 위해서는 고농도의 불순물이 첨가되어야 한다. 종래의 방법으로 수 마이크론 두께의 실리콘막에 고농도의 불순물을 참가하면 불균일한 농도 분포로 인한 응력 구배가 존재하고, 이로 인한 휨 모멘트는 위의 [수학식]에서와 같이 캔티레버 구조체의 휨 변형을 야기시킨다. 이러한 단순한 열 확산에 의하여 불순물의 분포를 조절하는 것은 한계가 있으나, 다단계 주입 공정을 사용하면 고동도의 불순물을 첨가한 후에도 실리콘 구조체의 응력분포를 균일하게 유지시킬 수 있다. 실리콘 다층 구조는 제2(c)도에서와 같이 가운데의 두꺼운 실리콘층과 농도 조절을 위한 상하의 얇은 실리콘층으로 이루어지며, 박막의 상하 방향으로 불순물을 대칭으로 분포시켜 응력 구배를 제거시킬 수 있다. 또한 가운데의 실리콘 박막에 잔류 응력이 존재하는 경우 상하에 주입되는 불순물량을 조절함으로써 기존의 응력 구배를 상쇄시켜 미소 구조체의 휨 변형을 최소화시킬 수 있다.
제2(d)도에 도시된 바와 같이 실리콘막의 건식식각을 위한 마스크로 사용될 제2 TEOS 산화막(11)이 증착된 후, 감광막(12)위에 리소그라피 공정을 통하여 마스크가 형성된다. 이 마스크를 이용하여 제2TEOS 산화막(11)의 선택된 영역에 반응성 이온 식각 공정을 이용하여 TEOS 마스크(13)가 형성된다.
제2(e)도는 TEOS 마스크(13)를 이용하여 제2실리콘막(8), 제3실리콘막(9) 및 제4실리콘막(10)을 반응성 이온 식각 공정을 이용하여 구조체의 형상(14)이 만들어지고 마스크로 사용된 제2 TEOS 산화막(11)이 건식식각되어 제거된 단면도이다.
제2(f)도는 구조체 제작의 마지막 단계인 희생층 제거 공정으로서, HF 기상 식각 공정을 통하여 제1TEOS 산화막(5)이 제거되어 실리콘 미소 구조물이 기판으로부터 분리된 단면도이다.
상술한 바와 같이 본 발명에 의하면 실리콘 반도체의 집적회로 공정과 호환성이 있는 표면 미세 가공 기술을 사용하여 고농도의 불순물을 첨가하여 낮은 저항을 얻음으로써 저발열 및 고속 동작의 소자 제작이 가능하며, 응력 구배의 최소화를 통한 긴 캔티레버 구조체를 제작함으로써 고감도의 마이크로 센서를 제작할 수 있다.
Claims (3)
- 실리콘 웨이퍼 상부에 TEOS 산화막을 형성한 후 상기 TEOS 산화막의 선택된 영역을 식각하여 홀을 형성하는 단계와, 전체 구조 상부에 제1실리콘막을 형성하고 불순물을 주입하는 단계와, 상기 제1실리콘막 상부에 제2실리콘막을 형성하고 불순물을 주입하는 단계와, 상기 제2실리콘막 상부에 제3실리콘막을 형성하고 불순물을 주입하는 단계와, 상기 제3, 제2 및 제1실리콘막의 선택된 영역을 순차적으로 식각으로 상기 TEOS 산화막의 상부가 노출되도록 구조체 형상을 형성하는 단계와, 상기 TEOS 산화막을 제거하여 실리콘 미소 구조물을 기판으로부터 분리시키는 단계로 이루어진 것을 특징으로 하는 실리콘 미소 구조체 제조 방법.
- 제1항에 있어서, 상기 제1, 제2 및 제3실리콘막은 불순물의 분포 조절을 위하여 상하 대칭되도록 형성되는 것을 특징으로 하는 실리콘 미소 구조체 제조 방법.
- 제1항에 있어서, 상기 제1 및 제3실리콘막의 불순물 주입량을 조절하여 제2실리콘막을 응력구배를 상쇄시키는 것을 특징으로 하는 실리콘 미소 구조체 제조 방법.
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