KR100214553B1 - Method of making buttom lead package - Google Patents
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Abstract
본 발명은 버팀 리드 패키지의 제조 방법에 관한 것으로, 종래 기술에 의한 버텀 리드 패키지의 제조 방법은 외부의 회로와 연결되는 노출리드에 내열성이 강하고 고가인 접착 테이프를 사용하여야 하므로 생산비가 상승하고, 또 몰딩공정 후 상기 접착 테이프를 제거하여야 공정이 난이하여 생산성이 저하되는 문제점을 초래하였다. 이러한 문제점을 해결하기 위하여 본 발명은 외부의 회로 단자와 통전될 수 있도록 연결하는 노출리드부(12a')에 도포물질인 몰드 마킹 러버(14)를 도포하여 몸체를 몰딩한 후, 상기 몰드 마킹 러버(14)를 제거하여 상기 버텀 리드 패키지를 제조하므로써, 상기 몰드 마킹 러버(14)의 제거가 용이하게 되어 생산성이 향상되고, 또 상기 몰드 마킹 러버(14)의 가격이 저렴하여 생산비를 절감할 수 있는 효과가 있다.The present invention relates to a method of manufacturing a butt lead package. In the method of manufacturing a bottom lead package according to the related art, a production cost increases because an adhesive tape having a high heat resistance and high resistance is used for an exposed lead connected to an external circuit. After the molding process, the adhesive tape has to be removed, resulting in a difficulty in productivity and a decrease in productivity. In order to solve this problem, the present invention applies a mold marking rubber 14, which is a coating material, to the exposed lead portion 12a 'which is connected to an external circuit terminal so as to be energized, and then molding the body. By removing the 14 to manufacture the bottom lid package, the mold marking rubber 14 can be easily removed, thereby improving productivity, and the mold marking rubber 14 can be cheaper to reduce production costs. It has an effect.
Description
본 발명은 버텀 리드 패키지의 제조 방법에 관한 것으로, 특히 반도체 칩의 패드와 통전될 수 있도록 와이어 본딩한 노출리드에 2액상형의 몰드마킹러버를 도포한 후, 에폭시 수지와 같은 몰드물로 몰딩하므로써 상기 노출리드에 플래쉬(Flash)가 배제된 패키지를 형성할 수 있음과 아울러 생산비를 절감할 수 있도록 한 버텀 리드 패키지의 제조 방법에 관한 것이다.The present invention relates to a method of manufacturing a bottom lid package, and in particular, by applying a two-component mold marking rubber to a wire-bonded exposed lead so as to conduct electricity with a pad of a semiconductor chip, and then molding the mold with a mold such as an epoxy resin. The present invention relates to a method of manufacturing a bottom lead package that can form a package without flash on an exposed lead and reduce production costs.
일반적으로, 반도체 패키지의 하나인 버텀 리드 패키지는 상기 도1에 도시된 바와 같이, 다수개의 패드(미도시)가 형성된 반도체 칩(1)과 그 칩의 패드와 외부의 회로단자(미도시)와 연결되는 리드(2a)가 통전될 수 있도록 와이어(3)본딩되고, 상기 리드(2a)를 외부의 회로단자와 연결할 수 있도록 노출시킴과 아울러 상기 반도체 칩(1)과 와이어(3)를 외부의 파손인자로부터 보호할 수 있도록 에폭시 수지와 같은 몰드물로 몰딩된 몸체(4)가 형성되어 있다.In general, as shown in FIG. 1, the bottom lead package, which is one of the semiconductor packages, includes a semiconductor chip 1 having a plurality of pads (not shown), pads of the chip, and external circuit terminals (not shown). A
상기와 같이 구성된 버텀 리드 패키지의 제조 방법을 상기 제2도와 재3도를 참고하여 상세하게 설명하면, 다음과 같다.A method of manufacturing the bottom lead package configured as described above will be described in detail with reference to FIGS. 2 and 3 as follows.
먼저, 패턴이 형성된 상기 반도체 칩(1)의 패드와 리드프레임(2)에 형성된 리드(2a)와 통전될 수 있도록 와이어(3)본딩하고, 상기와 같이 리드프레임(2)에 다수개의 반도체 칩(1)이 와이어(3) 본딩된 리드프레임(2)에서 외부의 회로단자와 연결하는 노출리드부(2a')에 내열성이 있는 접착 테이프(5)로 붙인 다음, 하금형(6)에 상기와 같이 접착 테이프(5)가 붙여지고 반도체 칩(1)이 와이어(3) 본딩된 리드프레임(2)을 위치시킨 다음, 상금형(7)을 상기 하금형(6)에 클램핑한 후, 에폭시 수지와 같은 몰드물을 주입하여 상기 버텀 리드 패키지의 몸체(4)를 형성한다.First, the
상기와 같이 에폭시 수지와 같은 몰딩물로 몸체(4)를 형성한 버텀 리드 패키지를 상기 금형(6,7)에서 분리한 후, 상기 접착 테이프(5)를 절단하고, 상기 노출리드(2a')에 붙어 있는 상기 접착 테이프(5)를 제거하여 상기 버텀 리드 패키지를 제조하는 것이다.After separating the bottom lead package in which the
그러나, 상기와 같은 버텀 리드 패키지의 제조 방법은 외부의 회로와 연결되는 노출리드에 내열성이 강하고 고가인 접착 테이프를 사용하여야 하므로 생산비가 상승하고, 또 몰딩공정 후 상기 접착 테이프를 제거하여야 공정이 난이하여 생산성이 저하되는 문제점을 초래하였다.However, in the method of manufacturing the bottom lead package as described above, since the heat resistant and expensive adhesive tape must be used for the exposed lead connected to the external circuit, the production cost increases, and the adhesive tape must be removed after the molding process. This caused a problem that the productivity is lowered.
따라서, 본 발명의 목적은 상기의 문제점을 해결하여 생산비를 절감함과 아울러 생산성을 향상할수 있는 버텀 리드 패키지를 제공함에 있다.Accordingly, an object of the present invention is to provide a bottom lid package that can solve the above problems and reduce productivity and improve productivity.
제1도는 일반적인 버텀 리드 패키지의 종단구조를 단면도.1 is a cross-sectional view of a termination structure of a general bottom lead package.
제2도는 종래 기술에 의한 버텀 리드 패키지의 제조 방법을 도시한 설명도.2 is an explanatory diagram showing a method for manufacturing a bottom lid package according to the prior art.
제3도는 종래 기술에 의한 방법으로 만들어진 버텀 리드 패키지에서 접착 테이프를 제거하기 전의 상태를 보인 측면도.3 is a side view showing a state before removing the adhesive tape from the bottom lid package made by the method according to the prior art.
제4도는 본 발명에 의한 방법으로 반도체 칩의 패드와 리드프레임의 리드를 와이어 본딩하고, 상기 리드의 노출리드부에 도포물질을 도포한 상태를 보인 측면도.4 is a side view showing a state in which a pad of a semiconductor chip and a lead of a lead frame are wire-bonded by the method according to the present invention, and a coating material is applied to the exposed lead portion of the lead.
제5도는 노출리드부에 도포물질을 도포하기 위하여 사용하는 실크 프린트 기판의 구조를 보인 사시도.5 is a perspective view showing the structure of a silk printed substrate used to apply a coating material to the exposed lead portion.
제6도는 본 발명에 의한 방법으로 만들어진 버텀 리드 패키지의 구조를 보인 사시도.Figure 6 is a perspective view showing the structure of the bottom lid package made by the method according to the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
6 : 하금형 7 : 상금형6: lower mold 7: upper mold
11 : 반도체 칩 12 : 리드프레임11: semiconductor chip 12: lead frame
12a : 리드 12a' : 노출리드부12a:
13 : 와이어 14 : 몰드 마킹 러버13: wire 14: mold marking rubber
15 : 실크 스크린 기관 16 : 몸체15: silk screen organ 16: body
본 발명의 목적은 외부의 회로 단자와 연결할 수 있는 노출드리부를 갖는 리드와 통전될 수 있도록 반도체 칩의 패드를 와이어로 본딩하는 단계와, 상기와 같이 반도체 칩의 패드와 와이어로 본딩된 상기 리드의 노출리드부에 내열성이 강한 도포물질을 도포하는 단계와, 상기와 같이 반도체 칩의 패드와 리드가 와이어 본딩되고 노출리드부가 도포물질로 도포된 상태에서 상기 반도체 칩과 와이어를 외부의 파손인자들로부터 보호할 수 있는 몰딩물로 몸체를 만들기 위하여 금형에 장입하는 단계와, 상기 금형에 몰딩물을 주입하여 몸체를 만드는 단계와, 상기 몸체가 만들어진 상태에서 상기 금형을 분리하고 상기 노출리드부에 도포된 도포물질을 제거하는 단계로 만들어지는 것을 특징으로 하는 버텀 리드 패키지의 제조 방법에 의하여 달성된다.An object of the present invention is to bond a pad of a semiconductor chip with a wire so as to be energized with a lead having an exposed drift portion that can be connected to an external circuit terminal, and as described above of the lead bonded to the pad and the wire of the semiconductor chip Applying a coating material having a high heat resistance to the exposed lead; and as described above, the semiconductor chip and the wire may be removed from external damage factors while the pad and the lead of the semiconductor chip are wire-bonded and the exposed lead is coated with the coating material. Charging the mold to form a body with a protectable molding, injecting a molding into the mold to form a body, separating the mold in the state where the body is made, and applying the exposed lead portion It is achieved by a method of manufacturing a bottom lid package, characterized in that the step of removing the coating material.
다음은, 본 발명에 의한 버텀 리드 패키지의 제조 방법의 일실시예를 첨부된 도면에 의거하여 상세하세 설명한다.Next, an embodiment of a method of manufacturing a bottom lid package according to the present invention will be described in detail with reference to the accompanying drawings.
제4도는 본 발명에 의한 방법으로 반도체 칩의 패드와 리드프레임의 리드를 와이어 본딩하고 상기 리드의 노출리드부에 도포물질을 도포한 상태를 보인 측면도이고, 제5도는 노출리드부에 도포물질을 도포하기 위하여 사용하는 실크 프린트 기관의 구조를 보인 사시도이며, 제6도는 본 발명에 의한 방법으로 만들어진 버텀 리드 패키지의 구조를 보인 사시도이다.FIG. 4 is a side view illustrating a state in which a pad of a semiconductor chip and a lead of a lead frame are wire-bonded by the method according to the present invention and a coating material is applied to the exposed lead of the lead, and FIG. Fig. 6 is a perspective view showing the structure of a silk print organ used for application, and Fig. 6 is a perspective view showing the structure of a bottom lid package made by the method according to the present invention.
본 발명에 의한 버텀 리드 패키지의 제조 방법은 상기 제4도에 도시된 바와 같이, 패턴이 형성된 반도체 칩(11)의 패드(미도시)와 리드프레임(12)에 형성된 리드(12a)와 통전될 수 있도록 와이어(13)본딩하고, 상기와 같이 리드프레임(12)에 다수개의 반도체 칩(11)이 와이어(13)본딩된 리드프레임(12)에서 외부의 회로단자와 연결하는 노출리드부(12a)'에 내열성이 강한 도포물질의 하나인 2액상형의 몰드 마킹 러버(Mold Marking Rubber)(14)를 실크 스크린 방법으로 도포한다.In the method of manufacturing the bottom lead package according to the present invention, as shown in FIG. 4, the pad (not shown) of the
이때, 상기 실크 스크린을 하기 위하여 상기 제5도에 도시된 바와 같은 상기 노출리드부(12a')에만 상기 몰드 마킹 러버(14)가 도포될 수 있도록 그 노출리드부(12a')에 대응되는 부분만 관통된 실크 프린트 기판(15)을 형성하여 사용된다.At this time, the portion corresponding to the exposed
상기와 같이 상기 노출리드부(12a')에 몰드 마킹 러버(14)를 도포한 후, 하금형(6)에 상기 반도체 칩(11)이 와이어(13) 본딩된 리드프레임(12)을 위치시킨 다음, 상금형(7)을 상기 하금형(6)에 클램핑하여 에폭시 수지와 같은 몰드물을 주입하므로써, 상기 버텀 리드 패키지의 몸체(16)를 형성하게 된다.After applying the
상기와 같이 몸체(16)를 형성한 후, 상기 금형(6,7)을 분리하면 상기 도6에 도시된 바와 같이, 노출리드부(12a')에 몰드 마킹 러버(14)가 도포된 다수개의 버텀 리드 패키지가 형성되고, 상기의 버텀 리드 패키지는 하나하나 분리한 후, 상기 노출리드부(12a')에 도포된 몰드 마킹 러버(14)를 진공 흡착기(미도시)를 이용하여 간단하게 제거한다.After the
이때, 상기 노출리드부(12a')에 도포된 몰드 마킹 러버(14)는 상기 몰딩 공정시에 수반되는 열(170℃)에 의하여 고상의 테이프상으로 변화함과 아울러 접착력이 미미하게 되어 상기 진공 흡착기로 손쉽게 제거할 수 있게 되는 것이다.At this time, the
상기와 같이 외부의 회로 단자와 통전될 수 있도록 연결하는 노출리드부에 도포물질인 몰드 마팅 러버를 도포하여 몸체를 몰딩한 후, 상기 몰드 마킹 러버를 제거하여 상기 버텀 리드 패키지를 제조하므로써, 상기 몰드 마킹 러버의 제거가 용이하게 되어 생산성이 향상되고, 또 상기 몰드 마킹 러버의 가격이 저렴하여 생산비를 절감할 수 있는 효과가 있다.By molding a body by applying a mold marking rubber, which is a coating material, to an exposed lead portion which is connected to an external circuit terminal so as to be energized as described above, by removing the mold marking rubber to manufacture the bottom lead package, Since the marking rubber is easily removed, productivity is improved, and the mold marking rubber is inexpensive, thereby reducing the production cost.
Claims (3)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019970002580A KR100214553B1 (en) | 1997-01-29 | 1997-01-29 | Method of making buttom lead package |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019970002580A KR100214553B1 (en) | 1997-01-29 | 1997-01-29 | Method of making buttom lead package |
Publications (2)
Publication Number | Publication Date |
---|---|
KR19980066837A KR19980066837A (en) | 1998-10-15 |
KR100214553B1 true KR100214553B1 (en) | 1999-08-02 |
Family
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019970002580A KR100214553B1 (en) | 1997-01-29 | 1997-01-29 | Method of making buttom lead package |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100214553B1 (en) |
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- 1997-01-29 KR KR1019970002580A patent/KR100214553B1/en not_active IP Right Cessation
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---|---|
KR19980066837A (en) | 1998-10-15 |
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