KR100197407B1 - 전전자 교환기에 있어서 프로세서들간 통신버스구조 - Google Patents

전전자 교환기에 있어서 프로세서들간 통신버스구조 Download PDF

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Abstract

본 발명은 교환기에 있어서 주 프로세서(MP)와 주변 프로세서(PP)가 별도의 통신버스를 사용하도록 구성된 프로세서간 통신버스 구조를 제공하기 위한 것이다. 이를 위하여 본 발명에 따른 프로세서간 통신버스 구조는, 주 프로세서의 전용 노드와 게이트 웨이 전용 노드가 연결되어 있는 제 1 통신버스(210), 적어도 1개 이상의 주변 프로세서가 공유하는 제 2 통신버스(240), 제 1 통신버스(210)와 제 2 통신버스(240)간에 통신경로를 제공하기 위한 주변 프로세서용 게이트웨이 노드(230)로 구성된다. 따라서, 하위 프로세서의 장애가 상위 프로세서에 영향을 미치지 않아 신뢰성을 증대시킬 수 있다.

Description

전전자 교환기에 있어서 프로세서들간 통신버스구조
제1도는 종래의 전전자 교환기에 있어서 프로세서들간의 통신버스 구조도이고,
제2도는 본 발명에 따른 전전자 교환기에 있어서 프로세서들간의 통신버스 구조도이다.
* 도면의 주요부분에 대한 부호의 설명
200 : 주 프로세서(MP) 201 : 주 프로세서(MP)용 노드
210 : 통신버스 I 220 : 게이트웨이(GW) 노드
230 : 주변 프로세서(PP)용 게이트웨이(GW)노드
240 : 통신버스 II
250, 260, 270, 280 : 제 1 내지 제 N 주변프로세서(PP 1∼N)
본 발명은 전전자 교환기(이하 교환기라고 약함)에 있어서 프로세서들간의 통신버스구조에 관한 것으로, 특히 주 프로세서(Main Processor, 이하 MP라 약함)와 주변 프로세서(Periphery Processor, 이하 PP라 함)의 두 계층 프로세서구조를 갖는 전전자 교환기에 있어서 두 계층간의 통신경로를 개선한 통신버스 구조에 관한 것이다.
종래의 전전자 교환기의 통신버스구조는 제1도에 도시된 바와 같이 MP(100)와 PP(110, 120, 130) 및 외부 통신경로를 통해 데이타를 송수신하는 외부장치(미도시됨)가 하나의 통신버스(150)를 공유하도록 구성되어 있다. 즉, 교환기내에 구비되는 각 프로세서(100, 110, 120, 130)와 외부통신경로인 게이트 웨이(Gate-Way, 이하 GW라고 약함)당 하나의 통신 노드(Node)(101, 111, 121, 131, 140)를 할당하고, 할당된 각 노드(101, 111, 121, 131, 140)를 통신버스(150)에 접속시켜 운영한다. 노드는 프로세서간에 송수신되는 데이타를 일시 저장할 수 있는 메모리 버퍼로 구성되어 버스 중재기능에 의해 자신의 차례가 되면 통신버스(150)를 점유하여 해당 프로세서에 대한 데이타 송수신처리를 한다. 예를 들어 버스 중재에 의해 주 프로세서 노드(101)가 통신버스(150)를 점유하게 되는 경우에, MP(100)는 MP 노드(101)를 통해 통신버스(150)와 데이타를 송수신하게 된다.
이와 같이 기존의 교환기에서의 통신버스 구조는 각 프로세서와 GW별로 노드를 할당하여 통신버스(150)를 공유하는 구조로 운영됨으로써, 기능 추가로 교환기내에 구비되는 프로세서의 수가 증가될 경우에 노드 수도 함께 증가되어 하드웨어 사이즈를 증가시킬 뿐아니라 MP(100)와, GW(미도시됨)에 대한 데이타 전달지연을 초래할 수 있다. 또한, MP(100), PP(110, 120, 130), GW(미도시됨)에 대한 각 통신노드의 통신량과 특성이 상이함에도 불구하고 동일한 통신버스(150)에 연결되도록 구성됨으로 인하여, 통신량이 상대적으로 많은 MP(100), GW(미도시됨)의 경우에는 데이타 송수신시 해당 노드상의 메모리 버퍼 지연이 PP(110, 120, 130)에 비해 상대적으로 커지는 문제도 발생된다.
그리고, 하나의 통신버스(150)에 각 프로세서들에 할당된 노드가 연결되어 있어 노드중 하나만 장애를 일으켜도 다른 노드들의 통신경로에 영향을 미치게 되는데, 이와 같은 영향으로 MP(100)의 기능이 마비되는 경우에는 교환기가 정상적인 서비스를 제공하지 못하게 되는 문제도 발생된다.
따라서 본 발명의 목적은 상술한 문제점을 해결하기 위하여, 교환기에 구비되는 주변 프로세서(PP)들과 주 프로세서(MP)가 별도의 통신버스를 사용할 수 있도록 통신경로를 구성하는 전전자 교환기에 있어서 프로세서들간 통신버스구조를 제공하는데 있다.
상기 목적을 달성하기 위한 본 발명에 따른 통신 버스구조는, 상위계층인 주 프로세서와 하위계층인 주변 프로세서의 2계층 구조를 갖는 전전자 교환기의 프로세서들간의 통신버스 구조에 있어서, 외부 통신경로와의 통신을 위한 게이트웨이 노드와 적어도 1개 이상의 주 프로세서 전용 노드가 접속되어 운영되는 제 1 통신버스; 적어도 1개 이상의 주변 프로세서가 공동으로 이용하는 제 2 통신버스; 주변 프로세서들과 주 프로세서간과 주변프로세서들과 게이트웨이 노드간의 통신을 위하여 제 1 통신버스와 제 2 통신버스간에 접속되어 통신경로를 제공하는 주변프로세서 게이트웨이(PP GW) 노드를 포함하는 것을 특징으로 한다.
이하, 본 발명에 따른 실시예를 상세하게 설명하기로 한다.
제2도는 본 발명에 따른 프로세서들간의 통신버스 구조도로서, 노드기능을 내부에 구비한 제 1 내지 제 N 주변 프로세서(PP 1∼N)(250, 260, 270, 280), 제 1 내지 제 N PP(250, 260, 270, 280)가 공동으로 사용하는 통신버스 II(240), 제1도에서와 동일한 MP(200), MP노드(201), 외부통신경로(GW)와 데이타 송수신이 가능하도록 하는 GW노드(220), MP노드(201)와 GW노드(220)가 공동으로 사용하는 통신버스 I(210), 통신버스 II(240)와 통신버스 I(210)간에 통신경로를 제공하는 주변프로세서 게이트웨이(이하 PP GW라고 약함) 노드(230)로 구성된다.
이와 같이 구성된 프로세서들간의 통신버스 구조는 다음과 같이 운용된다.
먼저, MP(200)가 외부의 다른 MP(미도시됨)와 통신을 하고자 할 경우에는 MP(200)⇔MP노드(201)⇔통신버스 I(210)⇔GW노드(220)⇔외부통신경로간의 경로가 형성되어 운영된다. 이 경우 통신버스 I(210)에는 항상 3개의 통신노드(MP노드(201), GW노드(220), PP GW노드(230))만 연결되어 있으므로 PP들의 수가 증가함에 따른 데이타의 지연현상이 발생되지는 않는다. 또 통신버스 I(210)에는 항상 3개의 통신노드(201, 220, 230)만이 연결되어 있으므로 노드장애 발생 확률이 제1도에 도시된 통신버스 구조에 비해 상대적으로 감소되어 통신버스 I(210)의 신뢰성은 제1도에 도시된 통신버스(150)에 비해 우수하다.
다음 PP들(250, 260, 270, 280)간의 통신은 통신버스 II(240)를 통해서 가능하므로 통신버스 I(210)에 영향을 주지 않으며 이는 두 계층 프로세서 구조를 갖는 전전자 교환기에서 통신계층 또한 분리시킴으로서 하위계층의 장애가 상위계층에 영향을 주지 않는 모듈성을 제공해 준다.
예를 들어 제 N PP인 PP N(280)과 MP(200)간에 통신하고자 하는 경우에, PP N(280)⇔통신버스 II(240)⇔PP GW노드(230)⇔통신버스 I(210)⇔MP노드(201)⇔MP(200)간에 통신경로가 형성된다. 여기서 N은 시스템의 구성에 따라 가변적이다. 그러므로 통신버스 II(240)에는 여러개의 PP가 연결되며, PP의 장애로 통신버스 II(240)에 장애가 발생할 확률 또한 커진다. 이 경우 종래 구조에서는 MP와 GW의 통신경로가 영향을 받으나, 본 발명의 구조에서는 PP GW노드(230)에 의해 통신버스 I(210)과 통신버스 III(240)가 격리됨으로써 통신버스 II(240)의 장애가 통신버스 I(210)에 영향을 주지 않게 된다. 이는 통신버스 II(240)에 장애발생시에는 PP GW노드(230)를 통한 버스사용요구가 이루어질 수 없기 때문이다.
이상, 상술한 바와 같이 본 발명은 2 계층 제어계 구조를 갖는 전전자 교환기에서 프로세서간 통신버스도 2계층구조로 분리하여 운영함으로써, 버스구조의 모듈성이 상대적으로 우수한 이점이 있고 하위계층과 상위계층간에 사용되는 통신버스를 별도로 구비함으로 인하여 하위계층인 PP들의 장애발생이 상위계층을 이루는 MP, GW들간의 통신경로에 영향을 주지 않는 이점이 있다. 이로 인하여 전전자 교환기에서 매우 중요한 역할을 하는 상위 프로세서의 서비스가 하위계층과 장애로 인해 중단되는 일이 없어 상대적으로 시스템의 신뢰성을 증대시킬 수 있는 효과가 있다.

Claims (2)

  1. 상위계층인 주 프로세서(200)와 하위계층인 주변 프로세서(250, 260, 270, 280)의 2계층 구조를 갖는 전전자 교환기의 프로세서들간의 통신버스 구조에 있어서, 외부 통신경로와의 통신을 위한 게이트웨이 노드(220)와 적어도 1개 이상의 상기 주 프로세서(200) 전용 노드(201)가 접속되어 운영되는 제 1 통신버스(210); 적어도 1개 이상의 주변 프로세서(250, 260, 270, 280)가 공동으로 이용하는 제 2 통신버스(240); 상기 주변 프로세서들(250, 260, 270, 280)과 상기 주 프로세서(200)간과 상기 주변프로세서들(250, 260, 270, 280)과 상기 게이트웨이 노드(220)간의 통신을 위하여 제 1 통신버스(210)와 상기 제 2 통신버스(240)간에 접속되어 통신경로를 제공하는 주변프로세서 게이트웨이(PP GW노드(230))를 포함하는 것을 특징으로 하는 전전자 교환기에 있어서 프로세서들간의 통신버스 구조.
  2. 제1항에 있어서, 상기 주변프로세서들(250, 260, 270, 280)은 프로세서내에 전용 통신노드를 구비하는 것을 특징으로 하는 전전자 교환기에 있어서 프로세서들간의 통신버스구조.
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