KR0178414B1 - 패킷 변환 장치 및 방법 - Google Patents

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사또오 후미오
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Abstract

간단한 회로로 에러 전파를 억제한다. 패킷 선두 검출 회로(22)는 전송 패킷의 선두를 검출하여 검출 신호를 패킷화 회로(21)에 부여한다. 패킷화 회로(21)는 검출 신호가 주어지고, N'개의 기록 패킷 단위로 n'개의 전송 패킷을 순차적으로 배열하여 패킷화한다. 이것에 의해 N'개의 기록 패킷의 선두가 배치된다. 예약 데이터 삽입 회로(24)는 예약 데이터를 결합회로(23)에 부여하고, 결합 회로(23)는 전송 패킷이 배열되어 있지 않은 기록 패킷의 부분에 예약 데이터를 삽입하여 출력한다. 이것에 의해 에러가 발생했을 경우에도 기록 패킷을 구별하는 것으로 전송 패킷을 식별할 수 있어서 에러의 전파를 억제할 수 있다.

Description

패킷 변환 장치 및 방법
제1도는 본 발명에 의한 패킷 변환 장치의 일 실시예를 나타낸 블록도.
제2도는 제1도의 실시예의 기록 패킷을 설명하기 위한 설명도.
제3도는 제1도의 실시예의 기록 패킷을 설명하기 위한 설명도.
제4도는 제1도의 실시예의 기록 패킷을 설명하기 위한 설명도.
제5도는 본 발명의 다른 실시예를 나타낸 블록도.
제6도는 제5도중의 메모리의 구체적인 구성을 나타낸 블록도.
제7도는 본 발명의 다른 실시예를 나타낸 블록도.
제8도는 제7도의 실시예를 설명하기 위한 설명도.
제9도는 전송 패킷을 설명하기 위한 설명도.
제10도는 전송 패킷을 설명하기 위한 설명도.
제11도는 종래의 패킷 변환 장치를 나타낸 블록도.
제12도는 종래의 패킷 변환 장치를 나타낸 블록도.
제13도의 (a)~(c)는 종래예에 있어서의 기록 패킷을 설명하기 위한 설명도.
제14도~제24도의 (a) 및 (b)는 각각 본 발명의 변형예를 설명하기 위한 패킷 교환 포맷을 나타낸 설명도.
* 도면의 주요부분에 대한 부호의 설명
21 : 패킷화 회로 22 : 패킷 선두 검출 회로
23 : 결합 회로 24 : 예비 데이터 삽입 회로
본 발명은 전송 패킷을 소정의 기록 포맷으로 변환하여 기록하는 기록재생 장치에 적합한 패킷 변환 장치 및 패킷 변환 방법에 관한 것이다.
종래 데이터 통신에 있어서는 정보를 블록화하고 데이터 식별을 위한 부가 정보를 삽입하여 전송하는 패킷 통신 방식이 채용되고 있다. 디지탈 화상 전송에 있어서도 압축 화상 데이터를 패킷화하여 전송하는 것이 고려된다.
제9도 및 제10도는 전송 패킷예를 나타내는 설명도이다.
제9도는 각 패킷 m, m+1, m+2, … 를 소정의 동기 신호로 동기시키지 않고 순서대로 배열하여 전송하는 예를 나타내고 있다. 각 패킷은 각 패킷의 데이터를 식별하기 위한 헤더(H), 전송 데이터 및 각 패킷의 에러를 정정하기 위한 에러 정정용 패리티(P)로 구성된다.
이것에 대해 제10도는 각 패킷 M을 소정 단위, 예를 들면 영상 신호의 프레임 신호 등의 기준 주기 단위로 동기시켜서 전송하는 예를 나타내고 있다. 제10도에서는 1프레임을 각 라인에 대응하는 K개의 패킷으로 구성하고, 각 패킷은 헤더(H), 전송 데이터 및 에러 정정용 패리티(P)로 구성된다. 그리고 패킷 M(=1)의 헤더(H1)는 제n프레임의 K개의 패킷 전체의 데이터 식별용 헤더로 되어 있다. 또 각각의 라인 번호 M에 따라 헤더의 용량이 변화하는 일도 있다.
그런데 이들 패킷의 용량과 기록 장치에 있어서의 기록 단위가 상이한 일이 있다. 이 경우에는 패킷 데이터를 기록 포맷으로 변환하여 기록한다. 예를 들면 일본국 특개평 4-86181호 공보의 「기록 재생 장치」에서는 전송된 패킷을 VTR의 기록 포맷에 따른 기록 패킷으로 변환하여 기록하는 예가 개시되어 있다. 이 제안에 있어서의 기록 패킷은 동기 블록(싱크 블록) 단위에서, 화면 위치 정보 MBA(마크로 블록 어드레스) 및 싱크 블록의 기록개시 위치 정보 MBP(마크로 블록 포인터)를 전송 데이터에 부가한 구성을 갖는다.
제11도 및 제12도는 상기 특개평 4-86181의 기술을 설명하기 위한 블록도이며, 제13도는 기록 패킷을 설명하기 위한 설명도이다.
제11도는 제13도의 예 (a) 및 (b)의 기록 패킷을 구성하는 종래의 패킷 변환장치를 나타낸 블록도이다.
전송 패킷은 수신 회로에 의해 수신되고, 버퍼(2)를 통해 패킷회 회로(3)에 제공된다. 버퍼(2)는 후단의 데이터 처리에 있어서의 시간 맞춤을 하기 위한 것이다. 패킷화 회로(3)는 전송 패킷을 기록 포맷에 따른 패킷으로 변환하여 출력한다.
VTR의 기록 포맷은 기록 트랙을 단위로 하고 있다. 제13도는 1기록 트랙의 기록 포맷을 나타내고 있으며, 1트랙이 M'개의 패킷으로 구성되는 것을 나타내고 있다. 각 패킷은 싱크 블록(동기 블록, 싱크 단위)을 구성한다.
제13도의 (a)에서는 패킷화 회로(3)가 전송 패킷을 전송순으로 순차 배열한 예를 나타내고 있다. 즉, 이 경우에는 전송 패킷에 포함되는 헤더 및 전송 데이터가 그대로 배열된다. 패킷화 회로(3)의 출력은 에러 정정 부호화 회로(4)에 제공되며, 에러 정정 부호화 회로(4)는 각 기록 패킷별로 에러 정정용 패리티 P를 부가하여 결합 회로(5)에 출력한다. 또, ID 작성 회로(6)는 트랙 번호, 동기 번호 및 그 밖의 중요 데이터를 작성하여 ID 데이터로서 결합 회로(5)에 부여한다. 결합 회로(5)는 각 기록 패킷(싱크로 블록)의 선두에 동기 신호(SYNC)를 배치하고, 이어서 ID 데이터, 데이터 및 에러 정정용 패리티 P를 배열해서 출력하도록 한다.
또, 제13도의 (b)의 기록 패킷은 전송 패킷의 헤더와 데이터를 분리하여 배치한 것을 나타내고 있다. 이 경우에는 버퍼(2)로부터 제공된 전송 패킷 중에서 데이터는 패킷화 회로(3)에 제공되고, 헤더는 헤더 패킷화 회로(8)에 제공된다. 헤더 패킷화 회로(8)는 헤더를 패킷화하여 결합 회로(7)에 출력한다. 이 경우에는 결합 회로(5)의 출력에 헤더가 포함되어 있지 않다. 결합 회로(7)는 데이터와 헤더를 분리해서 배치하고, 기록 패킷으로서 출력한다.
그런데 제13도의 (a)에서 처럼 전송 패킷 데이터를 순차적으로 배열하는 방식, 즉 전송 패킷의 헤더 및 패리티를 포함하는 모든 데이터를 연속해서 배열하는 방식에 있어서는 에러의 전파(propagation)를 억제할 수 없다. 예를 들면 패킷의 전송 중에, 데이터에 에러가 발생했을 경우에는 에러 플래그(flag)에 의해 에러의 위치는 판정되지만, 전송 패킷의 동기 신호를 확실하게 검출할 수 없으면 복호화시에 있어서 원래의 전송 패킷으로 복구할 수 없다. 즉, 에러가 발생한 싱크 블록은 실제 데이터가 있어도 데이터가 결핍된 것과 동일한 상태로 되고, 이 싱크 블록에 대한 수정 또는 보간 등의 보정도 불가능해진다. 그리고, 동기 신호가 확실히 검출될 경우에는 에러가 발생하지 않은 데이터에서 패킷의 선두를 검출할 수는 있다.
또, 제13도의 (b)에서 처럼, 데이터와 헤더를 분리해서 배치할 경우에 있어서는 에러가 발생하게 되면 데이터의 구획이 불명확하게 된다. 그러면 가변 길이 부호 등을 채용하고 있을 경우에는 에러가 발생하고 있지 않은 데이터 부분의 개시 위치를 파악할 수 없어서 제13도의 (a)의 경우와 같이, 에러의 전파가 크다.
그래서 상술한 특개평 4-86181에서 개시된 종래의 패킷 변환 장치에 있어서는 전송 데이터로서 가변 길이 부호화 데이터가 입력되었을 경우에도, 에러 전파를 억제하는 방법을 개시하고 있다. 그리고, 상기 특개평 4-86181의 기술에 있어서는 화상 데이터를 소정 크기의 휘도 블록 및 색차 블록으로 분할하고, 다시 복수의 블록에 의해 마크로 블록을 구성하여 예측 부호화의 단위로 하고 있다.
제12도에 있어서, 수신 회로(1)에 수신된 전송 패킷은 버퍼(2)를 통해 MB(마크로 블록) 선두 검출 회로(11) 및 헤더 패킷화 회로(12)에 제공된다. MB 선두 검출 회로(11)는 전송 데이터를 데이터 패킷화 회로(13)에 제공하는 동시에, 전송 데이터에서 마크로 블록의 선두를 검출하여 마크로 블록 정보를 MBA(마크로 블록 어드레스) 작성 회로(14)에 제공한다. 데이터 패킷화 회로(13)는 데이터를 패킷화하여 MBP(마크로 블록 포인터) 작성 회로(15) 및 결합 회로(16)에 출력한다.
MBA 작성 회로(14)는 마크로 블록 정보에 의거하여 마크로 블록이 화면상의 어느 위치에 대응하는가를 나타낸 마크로 블록 어드레스(MBA)를 작성하여 결합 회로(16)에 출력한다. 또 MBP 작성 회로(15)는 마크로 블록의 싱트 블록에 있어서의 선두 위치 정보인 마크로 블록 포인터(MBP)를 작성하여 결합 회로(16)에 출력한다. 결합 회로(16)는 마크로 블록 어드레스 및 마크로 블록 포인터에 각 화면 영역에 대응하는 부호화 데이터를 배열하여 에러정정 부호화 회로(4)에 출력한다. 에러 정정 부호화 회로(4)로부터 제공된 에러 정정용 패리티 P와 ID 작성회로(6)로부터 제공된 ID 데이터는 결합 회로(17)에 배열된다. 이것에 의해 제13도의 (c)에 도시한 것처럼 1싱크 블록 단위에서 동기 신호(SYNC), ID, 마크로 블록 어드레스(MBA) 및 마크로 블록 포인터(MBP)와, 각 화면 영역에 대응한 부호화 데이터가 에러 정정용 패리티를 부가해서 배열된다. 또 헤더 패킷화 회로(12)는 헤더를 패킷화하여 결합 회로(18)에 제공하여 결합 회로(17)의 출력에 다중화한다. 이렇게 해서 기록 트랙의 데이터가 형성된다.
이처럼 상기 특개평 4-86181에서는 전송 패킷 중에 포함되는 화면 위치 정보를 추출하고, 2종류의 정보, 즉 데이터와 이 데이터의 화면에서의 위치와의 대응을 나타내는 화면 위치 정보(MBA)와, 기록 패킷에 있어서의 데이터의 위치를 나타내는 위치 정보(MBP)를 기록함으로써 에러의 전파를 억제하고 있다. 그러나, 제12도의 장치는 전송 패킷 중에 포함된 부가 정보를 추출하여 MBA, MBP를 작성하게끔 되어 있고, 회로 규모가 매우 크다고 하는 문제가 있었다.
이와 같이 상술한 종래의 패킷 변환 장치에 있어서는, 에러 전파를 억제하기 위해 전송 패킷을 기록 패킷으로 변환할 때에 전송 패킷 중에 포함된 부가 정보를 추출하여 데이터 위치 정보 및 화면 위치 정보를 작성해야 하고 회로 규모가 매우 커진다고 하는 문제점이 있었다.
본 발명은 에러 전파를 억제하는 동시에 회로 규모를 축소할 수 있는 패킷 변환 장치를 제공하는 것을 목적으로 한다.
본 발명에 의한 패킷 변환 장치는 전송 패킷의 선두를 검출하는 선두 검출 수단과, 이 선두 검출 수단의 검출 결과가 주어져서, 하나 이상의 기록 패킷 단위로 소정 개수의 상기 전송 패킷을 순차적으로 배열하여 패킷화 함으로써 상기 하나 이상의 기록 패킷 단위로 상기 소정 개수의 전송 패킷의 배열 위치를 규정하는 패킷화 수단과, 상기 하나 이상의 기록 패킷 단위에서 생기는 상기 전송 패킷이 기록되어 있지 않은 부분에 예비(豫備) 데이터를 배열하는 삽입 수단을 구비한 것이며, 또 전송 패킷을 소정 길이의 기록 패킷에 연속적으로 배열하여 패킷화하는 패킷화 수단과, 상기 기록 패킷에 있어서의 상기 전송 패킷의 선두 위치를 검출하는 선두 검출 수단과, 이 선두 검출 수단의 검출 결과에 의거하여 상기 기록 패킷상의 상기 전송 패킷의 선두 위치를 나타내는 위치 정보를 작성하는 위치 검출 수단과, 상기 위치 정보를 상기 기록 패킷의 소정 위치에 삽입하는 삽입 수단을 구비한 것이다.
본 발명에 있어서, 선두 검출 수단은 전송 패킷의 선두를 검출한다. 패킷화 수단은 검출 수단의 검출 결과에 의거하여 소정 개수의 전송 패킷을 하나 이상의 기록 패킷 단위로 순차적으로 배열하여 패킷화한다. 이것에 의해 예를 들어 하나 이상의 기록 패킷 단위의 선두에 소정 개수의 전송 패킷의 선두가 나타난다. 예비 데이터 삽입 수단은 기록 패킷 중에서 전송 패킷이 배열되어 있지 않은 부분에 더미(dummy) 데이터를 삽입하여 출력한다. 또 전송 패킷을 소정 길이의 기록 패킷에 연속해서 배열하는 경우에는 기록 패킷에서 전송 패킷의 선두 위치를 검출하고, 위치 검출 수단에 의해 기록 패킷에 있어서의 전송 패킷의 선두 위치를 나타내는 위치 정보를 작성한다. 이 위치 정보를 삽입 수단에 의해 기록 패킷의 소정 위치에 삽입하는 것으로 기록 패킷과 전송 패킷과의 대응을 파악 가능하게 한다.
이하, 도면을 참조하여 본 발명의 실시예에 대해 설명한다. 제1도는 본 발명에 의한 패킷 변환 장치의 일실시예를 나타낸 블록도이다.
수신 회로(1)에는 전송 패킷을 입력한다. 수신 회로(1)는 전송 패킷을 복조하여 버퍼(2)에 제공한다. 버퍼(2)는 복조된 전송 패킷을 일시적으로 유지하여 패킷화 회로(21) 및 패킷 선두 검출 회로(22)에 출력한다. 패킷 선두 검출 회로(22)는 전송 패킷의 헤더에 의해 전송 패킷의 선두를 검출하고 이 검출 신호를 패킷화 회로(21)에 출력한다.
본 실시예에 있어서, 패킷화 회로(21)는 전송 패킷의 선두를 나타내는 검출 신호에 의거하여, N'개의 기록 패킷 단위로 n'개의 전송 패킷을 패킷화한다. 예를 들면, 전송 패킷 길이와 기록 패킷 길이의 관계가 기록 패킷 길이 × 2 전송 패킷 길이 기록 패킷 길이일 경우에 패킷화 회로(21)는 예를 들어 N'=2, n'=1로 하여 패킷화를 한다. 패킷화 회로(21)는 전송 패킷을 그 선두로부터 순서대로 연속해서 배열한다. 따라서 이 조건에서는 2개의 기록 패킷 중에서 첫번째 기록 패킷의 전체와 두번째 기록 패킷의 앞부분에만 전송 패킷이 배열되고, 2개째의 기록 패킷의 뒷부분에는 전송 패킷이 배열되지 않는 부분이 생긴다.
패킷화 회로(21)의 출력은 결합 회로(23)에 제공된다. 결합 회로(23)에는 예비(더미) 데이터 삽입 회로(24)의 출력도 제공된다. 예비 데이터 삽입 회로(24)는 예를 들어 연속된 1 등의 예비 데이터를 출력한다. 결합 회로(23)는 소정의 일정 주기로 패킷화 회로(21)의 출력과 예비 데이터 삽입 회로(24)의 출력을 처리함으로써 두번째 기록 패킷의 뒷부분의 전송 패킷이 배열되지 않는 부분에 예비 데이터를 삽입하여 에러 정정 부호화 회로(4)에 출력한다.
에러 정정 부호화 회로(4)는 각 기록 패킷 데이터에 에러 정정용 패리티를 부가하여 결합 회로(25)에 출력한다. ID 작성 회로(6)는 각 기록 패킷의 동기 신호(SYNC) 및 ID 데이터를 작성하여 결합 회로(25)에 제공한다. 결합 회로(25)는 각 기록 패킷 단위로, 선두에 동기 신호(SYNC) 및 ID 데이터를 부가하여 기록 패킷화해서 출력한다.
다음에 이와 같이 구성된 실시예의 동작에 대해 제2도의 설명도를 참조하여 설명한다.
수신 회로(1)는 수신된 전송 패킷을 복조하여 버퍼(2)를 통해 패킷화 회로(21) 및 패킷 선두 검출 회로(22)에 출력한다. 전송 패킷의 헤더에는 패킷의 선두 위치의 데이터가 포함되어 있다. 그리고 헤더는 데이터의 화면의 위치 정보 등도 포함하는 일이 있다. 따라서, 이 경우에는 전송 패킷이 연속해서 재생되어 있으면 전송 패킷의 헤더를 추출함으로써 화면상의 위치 및 패킷에 있어서의 위치를 파악할 수도 있다. 그러나 전송 패킷의 개시 위치는 명백하지 않기 때문에 에러가 발생했을 경우에는 전송 패킷 길이가 일정하더라도 전송 패킷을 복호에 사용할 수 있다고는 할 수 없다.
이것에 대해 본 실시예에 있어서는 전송 패킷과의 대응을 일정하게 함으로써 기록 패킷을 식별하고 전송 패킷을 식별할 수 있게 하고 있다. 즉, 패킷 선두 검출 회로(22)는 버퍼(2)로부터 제공된 전송 패킷에 포함되는 헤더로부터 전송 패킷의 선두를 검출하여 검출 신호를 패킷화 회로(21)에 제공한다. 기록 패킷 길이 × 2 전송 패킷 길이 기록 패킷 길이인 것으로 하면, 패킷화 회로(21)는, 예를 들어 제2도에 도시한 것처럼, 2개의 기록 패킷 단위로 하나의 전송 패킷을 패킷화한다. 즉, 첫번째 기록 패킷(PR11,PR21,…)에는 선두로부터 전송 패킷(PT1,PT2,…)의 앞부분을 순차적으로 배열하고, 2개째의 기록 패킷(PR12,PR22,…)에는 선두로부터 전송 패킷(PT1,PT2,…)의 나머지 부분을 순차적으로 배열한다. 기록 패킷 길이 × 2 전송 패킷 길이 기록 패킷 길이이므로, 두번째 기록 패킷(PR12,PR22,…)의 뒷부분(사선으로 표시)에는 전송 패킷이 배열되지 않는 부분이 생긴다. 이러한 패킷화에 의해 n'개의 전송 패킷은 항상 N개의 기록 패킷의 소정 위치에 배열되게 되어 기록 패킷과 전송 패킷과의 대응이 명백해진다.
패킷화 회로(21)의 출력은 결합 회로(23)에 제공되고, 결합 회로(23)는 제2도에 사선으로 표시된 부분의 타이밍으로 예비 데이터 삽입 회로(24)로부터 제공된 예비 데이터를 삽입한다. 에러 정정 부호화 회로(4)는 결합 회로(23)의 출력에 에러 정정용 패리티 P를 부가하여 결합 회로(25)에 제공한다. 결합 회로(25)에는 ID 작성 회로(6)의 출력도 제공한다. 결합 회로(25)는 ID 작성 회로(6)로부터 제공된 동기 신호(SYNC) 및 ID 데이터를 제2도에 도시한 것처럼 기록 패킷의 선두에 배치하여 출력한다.
이와 같이 본 실시예에 있어서는 패킷화 회로(21)가 예를 들어 2개의 기록 패킷 단위로 하나의 전송 패킷을 패킷화하고 있다. 따라서 이 경우에는 전송 패킷의 선두가 기록 패킷 마다 하나씩 걸러 배열되게 된다. 이 때문에 에러가 발생했을 경우에도 에러로부터 복구 후의 전송 패킷을 기록 패킷의 ID에서 식별할 수 있어서 에러의 전파를 억제할 수 있다.
그리고, 상기 실시예는 전송 패킷 길이와 기록 패킷 길이의 관계에 의해 N', n'의 값을 결정하면 된다. 예를 들어 제2도의 예처럼 설정하면, 사선으로 도시한 미사용 부분이 많아질 경우에는 제3도에 도시한 것처럼 3개의 기록 패킷(PR1,PR2,PR3) 단위로 2개의 전송 패킷(PT1,PT2)을 패킷화해도 된다.
또한 상기 실시예는 전송 패킷 길이가 변화할 경우에도 대응할 수 있다. 제4도는 2종류의 길이를 갖는 전송 패킷이 전송된 예를 나타내고 있다. 제4도의 예에서 패킷화 회로(21)는 2개 기록 패킷 단위로 1개 전송 패킷을 패킷화하는 모드와, 3개 기록 패킷 단위로 1개 전송 패킷을 패킷화하는 모드를 전환하여 실행하고 있다.
제5도는 본 발명의 다른 실시예를 나타낸 블록도이다 제5도에 있어서, 제1도와 동일한 구성 요소에는 동일 부호를 붙여 설명을 생략한다.
본 실시예는 전송 패킷의 배치에 메모리를 이용한 것이다. 즉, 수신 회로(1)로부터 제공된 전송 패킷은 패킷 선두 검출 회로(22)에 제공되는 동시에 메모리(31)에도 제공된다. 메모리(31)는 N'개의 기록 패킷을 기억할 수 있는 용량을 가지고 있고, 전송 패킷 입력전에 예비 데이터를 유지하고 있다. 메모리 기록 제어회로(32)는 패킷 선두 검출 회로(22)로부터 제공된 검출 신호에 의거하여 n'개의 전송 패킷을 메모리(31)에 기록한다. 메모리 독출 제어 회로(33)는 먼저 메모리(31)에 기록되어 있는 n'개의 전송 패킷을 독출하고, 이어서 예비 데이터를 독출하여 에러 정정 부호화 회로(4)에 제공한다.
제6도는 제5도 중에서 메모리(31)의 구체적인 구성을 나타낸 블록도이다.
메모리(31)는 N'개의 기록 패킷을 기록할 수 있는 3개의 메모리(31A,31B,31C)를 가지고 있다. 이들 메모리(31A,31B,31C)에는 수신 회로(1)로부터 제공된 전송 패킷이 스위치(SW1)를 통해 제공된다. 또 메모리(31A,31B,31C)의 출력은 스위치(SW2)를 통해 이루어진다. 스위치(SW1,SW2)는 각각 메모리 기록 제어 회로(32) 및 메모리 독출 제어 회로(33)에 의해 제어된다.
다음에 이처럼 구성된 실시예의 동작에 대해 제6도를 참조하여 설명한다.
수신 회로(1)에 전송 패킷이 수신되어 패킷 선두 검출 회로(22) 및 메모리(31)에 제공된다. 전송 패킷을 메모리(31)에 기록하기 전에 메모리(31A)에는 예비 데이터를 기록해 둔다. 메모리 기록 제어 회로(32)는 패킷 선두 검출 회로(22)에서 제공하는 전송 패킷의 선두를 나타내는 검출 신호가 입력되면 스위치(SW1)로 하여금 단자 b를 선택하도록 하여 n'개의 전송 패킷을 메모리(31B)에 순차적으로 기록시킨다. 이 경우에 메모리 독출 제어 회로(33)는 스위치(SW2)로 하여금 단자 C를 선택하도록 하여 메모리(31C)에 격납되어 있는 데이터를 독출한다. 후술하는 바와 같이 이 시점에서 메모리(31C)에는 이전 타이밍의 n'개의 전송 패킷이 격납되어 있다.
메모리(31C)로부터 n'개의 전송 패킷의 독출이 종료되면 메모리 독출 제어회로(33)는 스위치(SW2)로 하여금 단자 a를 선택하도록 하고, 메모리(31A)에 기억되어 있는 예비 데이터를 독출한다. 이렇게 해서 제1도의 결합 회로(23)의 출력과 같은 기록 패킷이 얻어진다. 다음 타이밍에서는 메모리(31)에 전송 패킷을 기록하기 전에 메모리(31C)에 더미 데이터를 기록한다. 다음에 메모리 기록 제어회로(32)는 스위치(SW1)로 하여금 단자 a를 선택하도록 하고, 패킷 선두 검출 회로(22)로부터 제공된 검출 신호에 의거하여 메모리(31A)에 n'개의 전송 패킷의 기록을 개시한다. 한편, 메모리 독출 제어회로(33)는 스위치(SW2)로 하여금 단자 b를 선택하도록 하여 메모리(31B)에 격납되어 있는 이전 타이밍의 n'개의 전송 패킷을 독출한다. 이 독출이 종료되면 메모리 독출 제어 회로(33)는 스위치(SW2)로 하여금 단자 c를 선택하도록 하여, 메모리(31C)에 격납되어 있는 예비 데이터를 독출한다.
이후, 같은 동작을 반복하여 예비 데이터를 유지하고 있는 메모리, 전송 패킷이 기록되는 메모리 및 독출 메모리를 메모리(31A,31B,31C) 사이에서 시프트 시킴으로써 제1도와 같은 기록 패킷을 얻는다. 제7도는 본 발명의 다른 실시예를 나타낸 블록도이다. 제7도에 있어서 제1도와 동일한 구성요소에는 동일 부호를 붙여 설명을 생략한다.
본 실시예는 전송 패킷 선두임을 나타내는 위치 정보를 각 기록 패킷 중에 기록함으로써, 전송 패킷을 연속해서 배치한 경우에도 에러의 전파를 억제 가능하게 한 것이다.
버퍼(2)로부터 제공된 전송 패킷은 패킷화 회로(41)에 제공된다. 패킷화 회로(41)는 전송 패킷이 전송된 순서대로 연속적으로 배열하여 패킷화되어 결합 회로(44) 및 패킷 선두 검출 회로(42)에 출력한다. 패킷 선두 검출 회로(42)는 전송 패킷의 선두가 기록 패킷의 어느 위치에 배치되는가를 검출하여 검출 정보를 위치 검출 회로(43)에 제공한다. 위치 검출 회로(43)는 검출 정보에 의해, 전송 패킷의 선두위치를 기록 패킷의 선두로부터의 위치에 의해 나타내는 위치 정보를 각성하여 결합 회로(44)에 제공한다. 결합 회로(44)는 패킷화 회로(41)로부터 제공되는 기록 패킷의 선두에 위치 검출 회로(43)로부터 제공되는 위치 정보를 부가하여 에러 정정 부호화 회로(4)에 제공한다.
다음에 이처럼 구성된 실시예의 동작에 대해 제8도를 참조하여 설명한다. 제8도는 본 실시예에 있어서의 기록 패킷을 설명하기 위한 설명도이다.
버퍼(2)로부터 제공된 전송 패킷은 패킷화 회로(41)에 의해 기록 패킷의 선두부터 순차적으로 배열된다. 전송 패킷 길이가 기록 패킷 길이보다 긴 것으로 정하면 제8도에 도시한 것처럼 전송 패킷은 2개째의 기록 패킷의 중간까지 배열된다. 패킷 선두 검출 회로(42)는 제8도의 V표로 나타낸 전송 패킷 선두의 기록 패킷에 있어서의 위치를 검출한다. 이 검출 정보는 위치 검출 회로(43)에 주어지고, 위치 검출 회로(43)는 전송 패킷의 선두 위치를 기록 패킷의 선두로부터의 위치에 의해 나타낸 위치 정보(0,S1,S2,S3,S4,…)를 작성한다. 결합 회로(44)는 제8도에 도시한 것처럼 패킷화 회로(41)로부터 제공된 기록 트랙의 선두에 위치 정보를 부가해서 출력한다. 다른 동작은 제1도의 실시예와 같다. 제8도의 가장 위의 기록 패킷 및 10번째의 기록 패킷에 부가된 위치 정보(0,S7)는 전송 패킷의 선두 위치가 기록 패킷의 선두임을 나타내고 있다. 또 위치 정보 SP는 기록 패킷에 전송 패킷의 선두가 존재하지 않는 것을 나타내고 있다.
이처럼 본 실시예에 있어서는 기록 패킷마다 전송 패킷 선두의 위치 정보를 부가하고 있으므로, 기록 패킷과 전송 패킷의 대응을 용이하게 파악할 수 있다. 이 때문에 예를 들어 에러에 의해 기록 패킷이 누락되었을 경우에도, 에러복구 후의 전송 패킷의 식별이 용이해지기 때문에 VTR 수정 작업도 간단히 할 수 있다.
그리고, 본 발명은 상기 실시예에 한정되는 것은 아니며, 여러 가지 변형예를 생각할 수 있다. 이하 제14도 내지 제24도를 참조하여 그 변형예의 일부를 소개한다.
제14도는 본 발명에 관한 기록 패킷의 제1변형예를 나타낸다. 이 제1변형예에서는 전송 패킷이 113바이트로 구성되는 것으로 하고, 선두의 1바이트는 전송용 고정 패턴의 동기 신호로 한다. 도시한 바와 같이 각 기록 패킷이 90바이트 길이로 설정되고, 그 각 기록 패킷의 선두에 2개의 영역, 즉 2바이트의 기록 재생용 동기 신호와 5바이트의 ID 신호가 있다. ID 신호는 그 선두 3바이트가 기록 패킷에 관한 신호를 나타내며, 나머지 2바이트는 전송 패킷에 관한 정보를 나타내고 있다. 기록 패킷의 유효 기록 영역은 75바이트로 하고, 각 기록 패킷의 후부에 8바이트의 패리티 영역이 설정된다. 전송 패킷의 선두에 있는 전송용 동기 신호는 고정 패턴이며, 재생시에 부가하면 되므로 이것을 제거하여 전송 신호의 데이터 길이를 112바이트로 하여 기록 패킷에 기록한다.
1개의 기록 패킷 길이를 넘는 제1전송 패킷 데이터가 다음의 기록 패킷에 걸쳐서 삽입된다. 따라서 두번째의 기록 패킷에 기록되는 바이트 수는 115-75=35 바이트이다. 계속해서 다음의 전송 패킷을 기록하지만 전송 패킷 간의 경계로서 1바이트분의 예비 데이터 영역, 예컨대 더미 데이터 영역을 배치하다. 이 경계 영역에서 제2전송 패킷을 37바이트만 기록하고, 나머지 75바이트는 3번째의 기록 패킷에 기록한다.
이상과 같이 2개의 전송 패킷이 3개의 기록 패킷에 패킷 교환되어 그 선두 위치를 판별할 수 있는 상태로 된다.
제15도는 본 발명에 관한 기록 패킷의 제2변형예를 나타낸다. 이 제2변형예에서는 도시한 바와 같이 제14도의 예와 기본적으로 동등하지만 두 번째의 기록 패킷에 있었던 예비 데이터(더미 데이터)가 3번째의 기록 패킷에 배치되어 있다.
제16도는 본 발명에 관한 기록 패킷의 제3변형예를 나타낸다. 이 제3변형예에서는 도시한 바와 같이 전송 패킷의 선두에 있는 전송용 동기 신호는 고정 패턴이며 재생시에 부가하면 되므로, 이것을 제거하여 전송 신호의 데이터 길이를 112바이트로 하여 기록 패킷에 기록한다. 각 기록 패킷이 90바이트 길이로 설정되고, 그 각 기록 패킷의 선두에 2개의 영역, 즉 2바이트의 기록 재생용 동기 신호와 4바이트의 ID 신호가 있다. ID 신호는 그 선두 3바이트가 기록 패킷에 관한 신호를 나타내고, 나머지 1바이트는 전송 패킷에 관한 정보를 나타내고 있다. 1바이트의 패리티 데이터가 8바이트의 패리티 영역에 접해서 놓여 있다. 첫 번째 전송 패킷의 뒷부분에 1바이트의 예비 데이터(더미 데이터)가 배치된다.
제17도는 본 발명에 관한 기록 패킷의 제4변형예를 나타낸다. 이 제4변형예에서도, 상술한 예와 같은 수법이 사용된다. 도시한 바와 같이 각 유효 기록 패킷이 76바이트 길이로 설정되고, 그 각 기록 패킷의 선두에 2바이트의 기록 재생용 동기신호와 4바이트의 ID 신호가 있다. ID 신호는 그 선두 3바이트가 기록 패킷에 관한 신호를 나타내고, 나머지 1바이트는 전송 패킷에 관한 정보를 나타내고 있다.
1개의 기록 패킷 길이 76바이트를 넘는 36바이트의 제1전송 패킷은 제2의 기록 패킷에 걸쳐서 삽입된다. 그리고 각 전송 패킷의 뒷부분에 있는 예비 데이터(더미 데이터) 영역에 2바이트의 부가 패리트 영역이 놓여서 패킷 단위의 에러의 검출 또는 정정을 가능하게 하고 있다. 제2전송 패킷은 제2기록 패킷의 뒷부분 8바이트와 기록 패킷 74바이트 영역에 기록된다. 제2전송 패킷의 뒷부분에 있는 예비 데이터(더미 데이터) 영역에 2바이트의 부가 패리티 데이터가 배치된다.
제18도는 본 발명에 관한 기록 패킷의 제5변형예를 나타낸다. 이 제5변형예에서는 도시한 바와 같이, 제14도에 있어서의 예비 데이터(더미 데이터) 영역을 부가 전송 패킷용 ID 신호 영역에 사용하는 예를 나타내고 있다.
제19도는 본 발명에 관한 기록 패킷의 제6변형예를 나타낸다. 이 제6변형예에서는 도시한 바와 같이 각 전송 패킷이 112바이트만 기록되고, 1개의 기록 패킷 길이를 넘는 바이트 길이의 각 전송 패킷이 순차적으로 복수의 기록 패킷에 걸쳐서 삽입된다. 그리고 각 전송 패킷의 선두만 예비 데이터(더미 데이터)로 하고 바이트의 추가 ID 데이터가 배치된다.
제20도는 본 발명에 관한 기록 패킷의 제7변형예를 나타낸다. 이 제7의 변형예에서는 도시한 바와 같이, 제14도 내지 제19도의 예와는 달리 전송 패킷의 선두에 있는 전송용 동기 신호는 제거되어 있지 않다. 전송 신호의 데이터 길이를 113바이트로 하여 기록 패킷에 기록된다.
각 기록 패킷은 90바이트 길이로 설정되고, 그 각 기록 패킷의 선두에 2개의 영역, 즉 2바이트의 기록 재생용 동기 신호와 4바이트의 ID 신호가 있다. ID 신호는 그 선두 3바이트가 기록 패킷에 관한 신호를 나타내고, 나머지 1바이트는 전송 패킷에 관한 정보를 나타내고 있다. 제1기록 패킷의 유효 기록 패킷 길이 76바이트를 넘는 제1전송 패킷 데이터의 37바이트가 제2기록 패킷에 걸쳐서 삽입된다. 제2전송 패킷 데이터는 39바이트와 74바이트로 분할되어 대응하는 기록 패킷에 배치되고, 그 마지막 부분에 2바이트의 예비 데이터(더미 데이터)가 배치된다.
제21도는 본 발명에 관한 기록 패킷의 제8변형예를 나타낸다. 이 제8의 변형예에서는 제19도의 예와 같이 113바이트의 전송 데이터를 전부 기록한다. 이 제8변형예에서는 2바이트의 예비 데이터(더미 데이터)가 각 1바이트씩 전송 패킷의 뒷부분에 배치되어 전송 패킷의 패리티로서 기능한다.
제22도는 본 발명에 관한 기록 패킷의 제9변형예를 나타낸다. 이 제9변형예에서는 도시한 바와 같이 하나의 전송 패킷을 2개의 기록 패킷으로 변환하는 예를 나타낸다. 그리고 이 경우도 전송 패킷의 선두에 있는 전송용 동기 신호는 제거되어 있지 않다. 전송 신호의 데이터 길이를 113바이트로서 기록 패킷에 기록한다.
각 기록 패킷이 90바이트 길이로 설정되고, 그 각 기록 패킷의 선두에 2개의 영역, 즉 2바이트의 기록 재생용 동기 신호와 5바이트의 ID 신호가 있다. ID 신호는 그 선두 3바이트가 기록 패킷에 관한 신호를 나타내고, 나머지 2바이트는 전송 패킷에 관한 정보를 나타내고 있다. 각 기록 패킷이 75바이트 길이로 설정되고, 1바이트의 부가 ID 신호로 뒤의 제1유효 기록 패킷에 제1전송 패킷의 74바이트가 배치되고, 나머지 39바이트가 제2기록 패킷에 삽입된다. 제1전송 패킷 데이터의 종단에 36바이트의 예비 데이터(더미 데이터)가 부가된다.
제14도 내지 제22도에 도시한 상기 각 변형예는 전송 패킷 데이터 길이를 113바이트, 기록 패킷 길이를 바이트로 하고 있지만 이것에 한정되지 않으며, 다시 다음의 두가지의 변형예에 나타낸 것처럼 전송 패킷 데이터 길이 및 기록 패킷 길이의 쌍방 또는 한쪽을 용이하게 변경하여 실시할 수 있다.
제23도는 본 발명에 관한 기록 패킷의 제10변형예를 나타낸다. 이 제10변형예에서는 도시한 바와 같이 전송 패킷 데이터 길이를 MPEG 트랜스포트 패킷처럼, 188바이트로 구성하고 있다. 선두의 전송용 동기 신호는 고정 패턴으로 한다. 그리고, 기록 패킷은 제14도 내지 제20도에 도시한 예와 같이 90바이트로 구성하고 있다.
제10변형예에서는 제17도처럼 1바이트의 전송용 동기 신호를 제거하여 187바이트의 데이터를 기록하고 있다. 또 각 전송 패킷을 기록 패킷에 패킷 교환 할 때마다 예비 데이터(더미 데이터) 영역을 설정하여 여기에 부가 패리티 신호를 배치하고 있다.
도시한 바와 같이 상기 각 예와 같은 수법으로 제1전송 패킷 신호중 76바이트, 76바이트, 35바이트의 데이터가 순차적으로 기록 패킷으로 변환된다. 다음에 제2전송 패킷의 38바이트, 76바이트, 73바이트의 데이터가 제3기록 패킷에서 순차적으로 삽입된다. 제1, 제2의 전송 패킷의 뒷부분에 있는 예비 데이터(더미 데이터) 영역에서는 3바이트의 부가 패리티 신호가 생성되어 배치된다.
제24도는 본 발명에 관한 기록 패킷의 제11변형예를 나타낸다. 이 제11변형예에서는 도시한 바와 같이, 전송 패킷 데이터 길이를 MPEG 트랜스포트 패킷처럼 188바이트로 구성하고 있다. 선두의 전송용 동기 신호는 고정 패턴으로 한다. 그리고 기록 패킷은 제14도 내지 제20도에 도시한 예와 같이 90바이트로 구성하고 있다.
이 제11변형예에서는 제20도처럼 1바이트의 전송용 동기 신호를 제거하지 않고 188바이트의 전체 데이터를 기록하고 있다. 또 각 전송 패킷을 기록 패킷에 패킷 교환할 때마다 예비 데이터(더미 데이터) 영역을 설정하여 여기에 부가 패리티 신호를 배치하고 있다.
도시한 바와 같이 상기 각 예와 같은 수법으로 제1전송 패킷 신호중, 76바이트, 76바이트, 36바이트의 데이터가 순차적으로 기록 패킷에 삽입된다. 다음에 제2전송 패킷의 38바이트, 76바이트, 74바이트의 데이터가 제3기록 패킷에서 순차적으로 삽입된다. 제1, 제2의 전송 패킷의 뒷부분에 있는 예비 데이터(더미 데이터) 영역에서는 2바이트의 부가 패리티 신호가 생성되어 배치된다.
이상 설명한 바와 같이 본 발명에 의하면 에러 전파를 억제하는 동시에 회로 규모를 삭감할 수 있다고 하는 효과를 거둔다.

Claims (6)

  1. 전송 패킷의 선두를 검출하는 선두 검출 수단과, 상기 선두 검출 수단의 검출 결과에 따라 하나 이상의 기록 패킷 단위로 소정 개수의 상기 전송 패킷을 순차적으로 배열하여 패킷화 함으로써 상기 하나 이상의 기록 패킷 단위로 상기 소정 개수의 전송 패킷의 배열 위치를 규정하는 패킷화 수단과, 상기 하나 이상의 기록 패킷 단위에서 상기 전송 패킷이 기록되어 있지 않은 부분에 예비 데이터를 배열하는 삽입 수단을 구비한 것을 특징으로 하는 패킷 변환 장치.
  2. 제1항에 있어서, 상기 패킷화 수단 및 삽입 수단은 상기 하나 이상의 기록 패킷 단위를 기록할 수 있는 용량을 가지며, 상기 소정 개수의 전송 패킷 및 상기 예비 데이터의 기록과 독출을 제어함으로써 상기 예비 데이터가 삽입된 기록 패킷을 출력하는 기억 수단을 구비한 것을 특징으로 하는 패킷 변환 장치.
  3. 전송 패킷을 소정 길이의 기록 패킷에 연속적으로 배열하여 패킷화하는 패킷화 수단과, 상기 기록 패킷에서 상기 전송 패킷의 선두 위치를 검출하는 선두 검출 수단과, 상기 선두 검출 수단의 검출 결과에 따라 상기 기록 패킷에서의 상기 전송 패킷의 선두 위치를 나타내는 상기 기록 패킷의 위치 정보를 작성하는 위치 검출 수단과, 상기 위치 정보를 상기 기록 패킷의 소정 위치에 삽입하는 삽입 수단을 구비한 것을 특징으로 하는 패킷 변환 장치.
  4. 전송 패킷의 선두를 검출하는 단계와, 상기 검출 결과에 따라 하나 이상의 기록 패킷 단위로 소정 개수의 상기 전송 패킷을 순차적으로 배열하여 패킷화하는 단계와, 상기 패킷화 단계에 의해 상기 하나 이상의 기록 패킷 단위에서 상기 소정 개수의 전송 패킷의 배열 위치를 규정하는 단계와, 상기 하나 이상의 기록 패킷 단위에서 상기 전송 패킷이 기록되어 있지 않은 부분에 예비 데이터를 삽입하는 단계를 포함한 것을 특징으로 하는 패킷 변환 방법.
  5. 제4항에 있어서, 상기 패킷화 단계 및 예비 데이터 삽입 단계는 상기 하나 이상의 기록 패킷 단위를 기록할 수 있는 용량을 가지며, 상기 소정 개수의 전송 패킷 및 상기 예비 데이터의 기록과 독출을 제어함으로써 상기 예비 데이터가 삽입된 기록 패킷을 출력하는 기억 수단을 사용하여 실행되는 것을 특징으로 하는 패킷 변환 방법.
  6. 전송 패킷을 소정 길이의 기록 패킷에 연속적으로 배열하여 패킷화하는 단계와, 상기 기록 패킷에서 상기 전송 패킷의 선두 위치를 검출하는 단계와, 상기 검출 결과에 따라 상기 기록 패킷에서의 상기 전송 패킷의 선두위치를 나타내는 위치 정보를 작성하는 단계와, 상기 위치 정보를 상기 기록 패킷의 소정 위치에 삽입하는 단계를 포함한 것을 특징으로 하는 패킷 변환 방법.
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