JPWO2018066165A1 - 信号伝達回路および電力変換装置 - Google Patents
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Abstract
Description
図1は、実施の形態1による信号伝達回路1000の回路構成を示す図である。図1に示すように、信号伝達回路1000は、第1コイル11および第2コイル12を有するトランス10と、第1コイル11に接続される第1回路100と、第2コイル12に接続される第2回路200とを備える。
第1パルス変換回路110は、入力端子101から入力される入力信号INの論理値の変化に応じて送信信号VS、VRを生成して第1コイル11の第1端P1、第1コイル11の第2端P2へ出力する。第1パルス変換回路110は、入力される入力信号INがロウレベルからハイレベルに変化すると、第1コイル11の第1端P1に所定期間の幅を有するパルスを含む送信信号VSを出力する。第1パルス変換回路110は、入力信号INがハイレベルからロウレベルに変化すると、第1コイル11の第2端P2に所定期間の幅を有するパルスを含む送信信号VRを出力する。なお、第1コイル11の第1端P1と第2端P2へ出力するパルス信号は、単発もしくは複数発でも良く、第2回路200の検出回路260において入力信号INを正確に反映した出力信号OUTを出力すれば良い。
図2は、実施の形態2の電力変換装置を表わす図である。
信号伝達回路1000aの構成は、図1の信号伝達回路1000の構成と同様なので、説明は繰り返さない。また、信号伝達回路1000bの構成も、図1の信号伝達回路1000の構成と同じなので、説明は繰り返さない。
図5には、電力変換装置の交流出力端子7にグラウンドレベルから高圧電源VCCで生成される電圧レベルまでの間の交流電圧が発生した時の上アームの信号伝達回路1000aの動作が示されている。
図6は、実施の形態3による信号伝達回路2000の回路構成を示す図である。
図7は、実施の形態4による信号伝達回路3000の回路構成を示す図である。
図8は、実施の形態5による信号伝達回路4000の回路構成を示す図である。
トランス10Xは、第1コイル11Xおよび第2コイル12Xを有する。トランス10Yは、第3コイル11Yおよび第4コイル12Yを有する。
第1パルス変換回路111は、入力端子101から入力される入力信号INの立ち上がりに応じて、セット信号となる送信信号VSX、VRXを生成して第1コイル11Xの第1端子P1X、第2端子P2Xへ出力する。第1パルス変換回路111は、入力端子101から入力される入力信号INの立下りに応じて、リセット信号となる送信信号VSY、VRYを生成して第3コイル11Yの第1端子P1Y、第2端子P2Yへ出力する。
信号伝達回路4000の入力信号INと、第1パルス変換回路110から出力される送信信号VSX、VRX、VSY、VRYとが示されている。
図10は、実施の形態6による電力変換装置30の構成を表わす図である。
図11は、実施の形態6の変形例1の電力変換装置30aの構成を表わす図である。
図12は、実施の形態6の変形例2の電力変換装置30bの構成を表わす図である。
図13は、実施の形態6の変形例3の電力変換装置30cの構成を表わす図である。
図14は、実施の形態7による電力変換装置40の構成を表わす図である。
図15は、実施の形態7の変形例1の電力変換装置40aの構成を表わす図である。
図16は、実施の形態7の変形例2の電力変換装置40bの構成を表わす図である。
図17は、実施の形態7の変形例3の電力変換装置40cの構成を表わす図である。
第1パルス変換回路111は、入力端子101から入力される入力信号INの立ち上がりに応じて、セット信号となる送信信号VSX、VRXを生成して第1コイル11Xの第1端P1X、第2端P2Xへ出力する。第1パルス変換回路111は、入力端子101から入力される入力信号INの立下りに応じて、リセット信号となる送信信号VSY、VRYを生成して第3コイル11Yの第1端P1Y、第2端P2Yへ出力する。
信号伝達回路4000の入力信号INと、第1パルス変換回路111から出力される送信信号VSX、VRX、VSY、VRYとが示されている。
Claims (15)
- 第1コイルおよび第2コイルを有するトランスと、
前記第1コイルに接続され、入力される第1信号の論理値の変化に応じて前記第1コイルの第1端、および第2端への送信信号を生成して出力する第1回路と、
前記第2コイルに接続され、前記第1回路に入力される前記第1信号を反映した第2信号を生成して出力する第2回路とを備え、
前記第2回路は、
2つの入力端子が前記第2コイルの第1端、第2端に接続され、前記第1端、第2端に発生する各電圧信号を検出し、前記検出の結果に基づいて前記第2信号を出力する検出回路と、
前記第2コイルの前記第1端に順方向に接続された第1のダイオードと、逆方向に接続された第2のダイオードで構成される第1整流回路と、
前記第2コイルの前記第2端に順方向に接続された第3のダイオードと、逆方向に接続された第4のダイオードで構成される第2整流回路と、
前記第1整流回路の前記第1のダイオードおよび前記第2のダイオードのそれぞれの両端に印加する電圧と、前記第2整流回路の前記第3のダイオードおよび前記第4のダイオードのそれぞれの両端に印加する電圧を制御する制御回路とを備えた、信号伝達回路。 - 前記第1コイルの前記第1端および前記第2端への前記送信信号は、前記第1信号の論理値の1変化につき交互に1回ずつ発生される単発のパルス、もしくは連続して発生される複数のパルスを含む、請求項1記載の信号伝達回路。
- 前記制御回路は、第1制御電圧、第2制御電圧、およびバイアス電圧を出力し、
前記第1のダイオードは、カソードが前記第2コイルの前記第1端に接続され、アノードが前記制御回路の第1制御電圧を受け、
前記第2のダイオードは、アノードが前記第2コイルの前記第1端に接続され、カソードが前記制御回路の第2制御電圧を受け、
前記第3のダイオードは、カソードが前記第2コイルの前記第2端に接続され、アノードが前記制御回路の第1制御電圧を受け、
前記第4のダイオードは、アノードが前記第2コイルの前記第2端に接続され、カソードが前記制御回路の第2制御電圧を受け、
前記第1のダイオードのカソード、前記第2のダイオードのアノード、前記第3のダイオードのカソード、および前記第4のダイオードのアノードは、前記制御回路の出力抵抗を介して、前記バイアス電圧を受け、
前記第1のダイオードは、前記トランスの前記第1コイルと前記第2コイル間に生じた電位差によって前記第2コイルの前記第1端の電圧が減少する方向へ変動する場合に、変動量を抑制し、
前記第2のダイオードは、前記トランスの前記第1コイルと前記第2コイル間に生じた電位差によって、前記第2コイルの前記第1端の電圧が増大する方向へ変動する場合に、変動量を抑制し、
前記第3のダイオードは、前記トランスの前記第1コイルと前記第2コイル間に生じた電位差によって前記第2コイルの前記第2端の電圧が減少する方向へ変動する場合に、変動量を抑制し、
前記第4のダイオードは、前記トランスの前記第1コイルと前記第2コイル間に生じた電位差によって、前記第2コイルの前記第2端の電圧が増大する方向へ変動する場合に、変動量を抑制する、請求項1記載の信号伝達回路。 - 前記制御回路が、前記第1制御電圧の大きさと、前記バイアス電圧の大きさを等しくすることによって、前記第2コイルの前記第1端の電圧の減少する方向への変動量、および前記第2コイルの前記第2端の電圧の減少する方向への変動量を制御する、請求項3に記載の信号伝達回路。
- 前記制御回路が、前記第1制御電圧の大きさを、前記バイアス電圧の大きさよりも小さくすることによって、前記第2コイルの前記第1端の電圧の減少する方向への変動量、および前記第2コイルの前記第2端の電圧の減少する方向への変動量を制御する、請求項3記載の信号伝達回路。
- 前記制御回路が、前記第1制御電圧の大きさを、前記バイアス電圧の大きさよりも大きくすることによって、前記第2コイルの前記第1端の電圧の減少する方向への変動量、および前記第2コイルの前記第2端の電圧の減少する方向への変動量を制御する、請求項3記載の信号伝達回路。
- 前記制御回路が、前記第2制御電圧の大きさと、前記バイアス電圧の大きさを等しくすることによって、前記第2コイルの前記第1端の電圧の増加する方向への変動量、および前記第2コイルの前記第2端の電圧の増加する方向への変動量を制御する、請求項3記載の信号伝達回路。
- 前記制御回路が、前記第2制御電圧の大きさを、前記バイアス電圧の大きさよりも小さくすることによって、前記第2コイルの前記第1端の電圧の増加する方向への変動量、および前記第2コイルの前記第2端の電圧の増加する方向への変動量を制御する、請求項3記載の信号伝達回路。
- 前記制御回路が、前記第2制御電圧の大きさを、前記バイアス電圧の大きさよりも大きくすることによって、前記第2コイルの前記第1端の電圧の増加する方向への変動量、および前記第2コイルの前記第2端の電圧の増加する方向への変動量を制御する、請求項3記載の信号伝達回路。
- 前記第2回路は、
前記第2コイルの前記第1端に接続される第1定電流回路と、
前記第2コイルの前記第2端に接続される第2定電流回路とを備え、
前記第1の定電流回路は、前記第2コイルの前記第1端に電流を供給する第1の定電流源を含み、
前記第2の定電流回路は、前記第2コイルの前記第2端に電流を供給する第2の定電流源を含み、
前記トランスの前記第1コイルと前記第2コイル間に生じた電位差によって、前記第2コイルの前記第1端の電圧が減少する方向への変動量を前記第1のダイオードによって抑制した後、前記第1の定電流源は、前記第2コイルの前記第1端に電流を供給することによって、前記第2コイルの前記第1端の電圧が定常状態に戻るまでの時間を短縮し、
前記トランスの前記第1コイルと前記第2コイル間に生じた電位差によって、前記第2コイルの前記第2端の電圧が減少する方向への変動量を前記第3のダイオードによって抑制した後、前記第2の定電流源は、前記第2コイルの前記第2端に電流を供給することによって、前記第2コイルの前記第2端の電圧が定常状態に戻るまでの時間を短縮する、請求項3記載の信号伝達回路。 - 前記第2回路は、
前記第2コイルの前記第1端に接続される第1定電流回路と、
前記第2コイルの前記第2端に接続される第2定電流回路とを備え、
前記第1の定電流回路は、前記第2コイルの前記第1端から電流を引き抜く第3の定電流源を含み、
前記第2の定電流回路は、前記第2コイルの前記第2端から電流を引き抜く第4の定電流源を含み、
前記トランスの前記第1コイルと前記第2コイル間に生じた電位差によって、前記第2コイルの前記第1端の電圧が増大する方向への変動量を前記第2のダイオードで抑制した後、前記第3の定流源は、前記第2コイルの前記第1端から電流を引き抜くことによって、前記第2コイルの前記第1端の電圧が定常状態に戻るまでの時間を短くし、
前記トランスの前記第1コイルと前記第2コイル間に生じた電位差によって、前記第2コイルの前記第2端の電圧が増大する方向への変動量を前記第4のダイオードで抑制した後、前記第4の定流源は、前記第2コイルの前記第2端から電流を引き抜くことによって、前記第2コイルの前記第2端の電圧が定常状態に戻るまでの時間を短くする、請求項3記載の信号伝達回路。 - 第1コイルおよび第2コイルを有するトランスと、
前記第1コイルに接続され、入力される第1信号の論理値の変化に応じて前記第1コイルの第1端、および第2端への送信信号を生成して出力する第1回路と、
前記第2コイルに接続され、前記第1回路に入力される前記第1信号を反映した第2信号を生成して出力する第2回路とを備え、
前記第2回路は、
2つの入力端子が前記第2コイルの第1端、第2端に接続され、前記第1端、第2端に発生する各電圧信号を検出し、前記検出の結果に基づいて前記第2信号を出力する検出回路と、
前記第2コイルの前記第1端に順方向に接続された第1のダイオードと、逆方向に接続された第2のダイオードで構成される第1整流回路と、
前記第1整流回路の前記第1のダイオードおよび前記第2のダイオードのそれぞれの両端に印加する電圧を制御する制御回路とを備え、
前記第2コイルの前記第2端が基準電源に接続される、信号伝達回路。 - 第1コイルおよび第2コイルを有する第1のトランスと、
第3コイルおよび第4コイルを有する第2のトランスと、
前記第1コイルに接続され、入力される第1信号の立ち上がりに応じて前記第1コイルの第1端、および第2端への第1の送信信号を生成して出力し、かつ前記第3コイルに接続され、入力される第1信号の立下りに応じて前記第3コイルの第1端、および第2端への第2の送信信号を生成して出力する第1回路と、
前記第2コイルおよび前記第4コイルに接続され、前記第1回路に入力される前記第1信号を反映した第2信号を生成して出力する第2回路とを備え、
前記第2回路は、
2つの入力端子が前記第2コイルの第1端、第2端に接続され、前記第1端、第2端に発生する各電圧信号を検出し、前記検出の結果に基づいてセット信号を出力する第1の検出回路と、
2つの入力端子が前記第4コイルの第1端、第2端に接続され、前記第1端、第2端に発生する各電圧信号を検出し、前記検出の結果に基づいてリセット信号を出力する第2の検出回路と、
前記第1の検出回路からの前記セット信号を受けるセット端子と、前記第2の検出回路からの前記リセット信号を受けるリセット端子とを有し、前記第1回路に入力される前記第1信号を反映した第2信号を出力するラッチ回路と、
前記第2コイルの前記第1端に順方向に接続された第1のダイオードと、逆方向に接続された第2のダイオードで構成される第1整流回路と、
前記第2コイルの前記第2端に順方向に接続された第3のダイオードと、逆方向に接続された第4のダイオードで構成される第2整流回路と、
前記第4コイルの前記第1端に順方向に接続された第5のダイオードと、逆方向に接続された第6のダイオードで構成される第3整流回路と、
前記第4コイルの前記第2端に順方向に接続された第7のダイオードと、逆方向に接続された第8のダイオードで構成される第4整流回路と、
前記第1整流回路の前記第1のダイオードおよび前記第2のダイオードのそれぞれの両端に印加する電圧と、前記第2整流回路の前記第3のダイオードおよび前記第4のダイオードのそれぞれの両端に印加する電圧を制御する第1の制御回路と、
前記第3整流回路の前記第5のダイオードおよび前記第6のダイオードのそれぞれの両端に印加する電圧と、前記第4整流回路の前記第7のダイオードおよび前記第8のダイオードのそれぞれの両端に印加する電圧を制御する第2の制御回路とを備えた、信号伝達回路。 - パワー半導体スイッチング素子と、
前記パワー半導体スイッチング素子を駆動するドライバ部と、
前記パワー半導体スイッチング素子を制御する制御信号を生成する制御装置と、
請求項1〜請求項12のいずれか1項に記載の信号伝達回路とを備え、
前記信号伝達回路は、前記制御装置と前記ドライバ部との間に設けられ、前記制御装置と前記ドライバ部とを絶縁し、
前記信号伝達回路は、前記制御装置からの前記制御信号を前記第1信号として受けて、前記第2信号を出力信号として前記ドライバ部に出力する、電力変換装置。 - パワー半導体スイッチング素子と、
前記パワー半導体スイッチング素子を駆動するドライバ部と、
前記パワー半導体スイッチング素子を制御する制御信号を生成する制御装置と、
前記パワー半導体スイッチング素子の異常状態を検出する異常検出部と、
第1信号伝達回路として、請求項1〜請求項12のいずれか1項に記載の信号伝達回路と、
第2信号伝達回路として、請求項1〜請求項12のいずれか1項に記載の信号伝達回路とを備え、
前記第1信号伝達回路は、前記制御装置と前記ドライバ部との間に設けられ、前記制御装置と前記ドライバ部とを絶縁し、
前記第1信号伝達回路は、前記制御装置からの前記制御信号を受けて、出力信号として前記ドライバ部に出力し、
前記第2信号伝達回路は、前記制御装置と前記異常検出部との間に接続され、前記制御装置と前記異常検出部とを絶縁し、
前記第2信号伝達回路は、前記異常検出部から出力される異常検出信号を受けて、出力信号として前記制御装置に出力する、電力変換装置。
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