JPS6452381U - - Google Patents
Info
- Publication number
- JPS6452381U JPS6452381U JP14902387U JP14902387U JPS6452381U JP S6452381 U JPS6452381 U JP S6452381U JP 14902387 U JP14902387 U JP 14902387U JP 14902387 U JP14902387 U JP 14902387U JP S6452381 U JPS6452381 U JP S6452381U
- Authority
- JP
- Japan
- Prior art keywords
- terminal
- output
- signal
- processing circuit
- signal processing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
- 239000003990 capacitor Substances 0.000 description 1
- 238000009499 grossing Methods 0.000 description 1
- 125000006850 spacer group Chemical group 0.000 description 1
- 230000000087 stabilizing effect Effects 0.000 description 1
Description
第１図は本考案の構成ブロツク図、第２図は本
考案の実施に用いた切り換え式回路図例、第３図
は本考案の実施に用いたミキサー式回路図例、第
４図は本考案に用いるスイツチケース、第５図は
トグルスイツチをケースに取り付けた図、第６図
はジヤツクをケースに取り付けた図、第７図は基
板をケースに取り付けた図、第８図はプツシユオ
ンスイツチをケースに取り付けた図、第９図は本
考案の内部図例である。 図において、１と２７はジヤツク、２と３２は
プラグ、３はコンセントプラグ、４と３８はケー
ス、５は基板、６はトランス、７はトグルスイツ
チ、８と９と２５と２８と２９はビス、１０〜２
２と７６と７７は電線、２３と２４と３３はコー
ドブツシユ、２６と３９〜４１はナツト、３０と
３１はスペーサ、３４はプツシユオンスイツチ、
３５はトランジスタ、３６はダイオード、３７と
４９〜５２はコンデンサ、４２はスイツチ、４３
は信号処理回路のブロツク、４４はタイマ回路の
ブロツク、４５は整流、平滑回路のブロツク、４
６は安定化電圧回路のブロツク、４７と４８は、
ナンドゲート、５３は、スピーカー、５４はＬＭ
３８６Ｎという集積回路、５５と５６は可変抵抗
器、５７〜６３と７１〜７５は抵抗素子、６４〜
６８は、インバータ、６９と７０は、アナログス
イツチである。
考案の実施に用いた切り換え式回路図例、第３図
は本考案の実施に用いたミキサー式回路図例、第
４図は本考案に用いるスイツチケース、第５図は
トグルスイツチをケースに取り付けた図、第６図
はジヤツクをケースに取り付けた図、第７図は基
板をケースに取り付けた図、第８図はプツシユオ
ンスイツチをケースに取り付けた図、第９図は本
考案の内部図例である。 図において、１と２７はジヤツク、２と３２は
プラグ、３はコンセントプラグ、４と３８はケー
ス、５は基板、６はトランス、７はトグルスイツ
チ、８と９と２５と２８と２９はビス、１０〜２
２と７６と７７は電線、２３と２４と３３はコー
ドブツシユ、２６と３９〜４１はナツト、３０と
３１はスペーサ、３４はプツシユオンスイツチ、
３５はトランジスタ、３６はダイオード、３７と
４９〜５２はコンデンサ、４２はスイツチ、４３
は信号処理回路のブロツク、４４はタイマ回路の
ブロツク、４５は整流、平滑回路のブロツク、４
６は安定化電圧回路のブロツク、４７と４８は、
ナンドゲート、５３は、スピーカー、５４はＬＭ
３８６Ｎという集積回路、５５と５６は可変抵抗
器、５７〜６３と７１〜７５は抵抗素子、６４〜
６８は、インバータ、６９と７０は、アナログス
イツチである。
Claims (1)
- 【実用新案登録請求の範囲】 呼び出すため、スイツチ４２を動作させた時に
得られる有効と、みなされる信号を入力端子であ
るｄ端子に入力したら、時間を、延ばして、出力
端子であるｅ端子から有効の出力信号を、出力す
るタイマ回路４４の入力端子であるｄ端子を、コ
ネクタの端子であるｆ端子に、つなげ、そのコネ
クタを、ケース４に、取り付ける。 入力端子であるａ端子と、出力端子であるｃ端
子と、制御する端子であるｂ端子を最低、有する
信号処理回路４３を使い、その制御する端子であ
るｂ端子に、処理する信号である前記、タイマ回
路４４の出力端子であるｅ端子から出力される有
効の出力信号を、入力した時、前記、信号処理回
路４３の入力端子であるａ端子から入力される信
号に、なんらかの影響を与えて、出力端子である
ｃ端子から出力信号を、出力する信号処理回路４
３の制御する端子であるｂ端子に、前記、タイマ
回路４４の出力端子であるｅ端子を、つなげる。 前記、信号処理回路４３の出力端子であるｃ端
子を、コネクタの端子であるｈ端子に、つなげる
。 以上からなることを特徴とする装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14902387U JPS6452381U (ja) | 1987-09-26 | 1987-09-26 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14902387U JPS6452381U (ja) | 1987-09-26 | 1987-09-26 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6452381U true JPS6452381U (ja) | 1989-03-31 |
Family
ID=31420870
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14902387U Pending JPS6452381U (ja) | 1987-09-26 | 1987-09-26 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6452381U (ja) |
-
1987
- 1987-09-26 JP JP14902387U patent/JPS6452381U/ja active Pending
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