JPS639693B2 - - Google Patents
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- JPS639693B2 JPS639693B2 JP55139678A JP13967880A JPS639693B2 JP S639693 B2 JPS639693 B2 JP S639693B2 JP 55139678 A JP55139678 A JP 55139678A JP 13967880 A JP13967880 A JP 13967880A JP S639693 B2 JPS639693 B2 JP S639693B2
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- JP
- Japan
- Prior art keywords
- circuit
- transmitting
- time
- burst signal
- control circuit
- Prior art date
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- Expired
Links
- 230000000295 complement effect Effects 0.000 claims description 5
- 230000005540 biological transmission Effects 0.000 description 14
- 238000010586 diagram Methods 0.000 description 6
- 238000006243 chemical reaction Methods 0.000 description 3
- 230000010355 oscillation Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B7/00—Radio transmission systems, i.e. using radiation field
- H04B7/24—Radio transmission systems, i.e. using radiation field for communication between two or more posts
- H04B7/26—Radio transmission systems, i.e. using radiation field for communication between two or more posts at least one of which is mobile
- H04B7/2643—Radio transmission systems, i.e. using radiation field for communication between two or more posts at least one of which is mobile using time-division multiple access [TDMA]
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D30/00—Reducing energy consumption in communication networks
- Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
- Small-Scale Networks (AREA)
- Mobile Radio Communication Systems (AREA)
Description
【発明の詳細な説明】
本発明は時分割多重無線通信用送信装置の電源
消費電力の経済化に関する。
消費電力の経済化に関する。
電池電源で動作する無線装置は、自局の送信タ
イミング以外には電源を停止して、電池の消耗を
防ぐ方式が広く知られている。しかし、近年デイ
ジタル制御された時分割多重無線通信方式では、
１個の移動局が送信を許容されるタイムスロツト
の長さは約１ミリ秒である。このような送信タイ
ムスロツトの短い方式では、一般に電源回路の時
定数の方が長くなるので、電池消耗を防ぐため
に、その都度電源を停止していたのでは、適切な
タイミングで、送信を行うことができない。
イミング以外には電源を停止して、電池の消耗を
防ぐ方式が広く知られている。しかし、近年デイ
ジタル制御された時分割多重無線通信方式では、
１個の移動局が送信を許容されるタイムスロツト
の長さは約１ミリ秒である。このような送信タイ
ムスロツトの短い方式では、一般に電源回路の時
定数の方が長くなるので、電池消耗を防ぐため
に、その都度電源を停止していたのでは、適切な
タイミングで、送信を行うことができない。
本発明は、このような高速の送信タイミング制
御を必要とする無線送信装置について、自局の送
信タイミング以外の時間の電源電力消費を経済化
するための装置を提供することを目的とする。
御を必要とする無線送信装置について、自局の送
信タイミング以外の時間の電源電力消費を経済化
するための装置を提供することを目的とする。
本発明は、同一の周波数のデイジタル信号を送
受信することのできる複数の無線局を含み、各無
線局はそれぞれ順に割当てられる時間にバースト
信号を送信するように制御される時分割多重無線
通信用送信装置において、この送信装置の変調回
路および上記バースト信号の送信時にこの変調回
路を制御する制御回路に、上記バースト信号の送
信時に限り動作用のクロツク信号を供給するよう
に構成されたことを特徴とする。
受信することのできる複数の無線局を含み、各無
線局はそれぞれ順に割当てられる時間にバースト
信号を送信するように制御される時分割多重無線
通信用送信装置において、この送信装置の変調回
路および上記バースト信号の送信時にこの変調回
路を制御する制御回路に、上記バースト信号の送
信時に限り動作用のクロツク信号を供給するよう
に構成されたことを特徴とする。
このとき、変調回路および制御回路は相補
MOS回路により構成されることが好ましい。
MOS回路により構成されることが好ましい。
すなわち、本発明はデイジタル回路、特に相補
モス回路によるデイジタル回路は、動作用クロツ
クが供給されない状態では、電源電圧を供給して
いても、その消費電流が極めて小さい性質を利用
するもので、バースト信号の送信時のみに動作す
ることが必要である回路には、バースト信号送信
時以外の時間には、動作用クロツクの供給を停止
するよう構成することを特徴とする。
モス回路によるデイジタル回路は、動作用クロツ
クが供給されない状態では、電源電圧を供給して
いても、その消費電流が極めて小さい性質を利用
するもので、バースト信号の送信時のみに動作す
ることが必要である回路には、バースト信号送信
時以外の時間には、動作用クロツクの供給を停止
するよう構成することを特徴とする。
実施例図面により詳しく説明する。
第１図は本発明実施例方式の構成図である。複
数の子局１〜５は移動無線局であり、親局１と同
一の周波数のデイジタル信号を送受することがで
きるように構成されている。
数の子局１〜５は移動無線局であり、親局１と同
一の周波数のデイジタル信号を送受することがで
きるように構成されている。
第２図はその動作タイミング図で、各子局１〜
５および親局６は、それぞれ順に割当てられる時
間CH1〜CH5およびCH6に、バースト信号を送信
するように制御される。このとき、１個のタイム
スロツトTSは約１ミリ秒であり、各タイムスロ
ツト間のガードタイムGTは約10マイクロ秒であ
る。実施例では、各バースト信号には、
323.2kb／ｓのデイジタル信号を送信する。
５および親局６は、それぞれ順に割当てられる時
間CH1〜CH5およびCH6に、バースト信号を送信
するように制御される。このとき、１個のタイム
スロツトTSは約１ミリ秒であり、各タイムスロ
ツト間のガードタイムGTは約10マイクロ秒であ
る。実施例では、各バースト信号には、
323.2kb／ｓのデイジタル信号を送信する。
第３図は本発明実施例送信装置のブロツク構成
図である。アナログ入力信号は端子１１に入力さ
れ、AD変換回路１２でデイジタル信号（実施例
では64kb／ｓの連続信号）に変換される。この
出力は、デイジタル信号を多重化するためのメモ
リ１３に与えられる。このメモリ１３からは、上
述の自局に割当てられたタイムスロツトに、デイ
ジタル信号がバースト信号（323.2kb／ｓ）が送
出される。これは変調回路１５で無線信号に変調
される。この変調回路１５はデイジタル回路で構
成される。この出力は開閉回路１６を介して、送
信回路１７からアンテナ１８に無線信号として送
出される。
図である。アナログ入力信号は端子１１に入力さ
れ、AD変換回路１２でデイジタル信号（実施例
では64kb／ｓの連続信号）に変換される。この
出力は、デイジタル信号を多重化するためのメモ
リ１３に与えられる。このメモリ１３からは、上
述の自局に割当てられたタイムスロツトに、デイ
ジタル信号がバースト信号（323.2kb／ｓ）が送
出される。これは変調回路１５で無線信号に変調
される。この変調回路１５はデイジタル回路で構
成される。この出力は開閉回路１６を介して、送
信回路１７からアンテナ１８に無線信号として送
出される。
ここで、AD変換回路１２およびメモリ１３の
書込は、制御回路２０により制御される。またこ
の制御回路２０により、送信タイミングが制御さ
れる。その送信タイミング制御信号は、アンド回
路２１および開閉回路１６の制御入力に与えられ
る。アンド回路２１の他方の入力には動作用のク
ロツク発振回路２２が接続され、その出力は、変
調回路１５およびこの変調回路１５を制御する制
御回路２３に与えられている。
書込は、制御回路２０により制御される。またこ
の制御回路２０により、送信タイミングが制御さ
れる。その送信タイミング制御信号は、アンド回
路２１および開閉回路１６の制御入力に与えられ
る。アンド回路２１の他方の入力には動作用のク
ロツク発振回路２２が接続され、その出力は、変
調回路１５およびこの変調回路１５を制御する制
御回路２３に与えられている。
この制御回路２３は、上述の自局の送信タイム
スロツトでのみ動作するもので、上記323.2kb／
ｓの変調を行うに十分なクロツク速度を持つ。メ
モリ１３の読出出力はこの制御回路２３により制
御される。
スロツトでのみ動作するもので、上記323.2kb／
ｓの変調を行うに十分なクロツク速度を持つ。メ
モリ１３の読出出力はこの制御回路２３により制
御される。
このように構成された装置では、ゲート回路２
１が自局の送信タイムスロツトの時間にアクテイ
ブになり、この時間に限つて、制御回路２３およ
び変調回路１５に、動作用のクロツク信号が与え
られる。この時に変調回路１５が動作して、開閉
回路１６が閉じ、送信出力が送信回路１７からア
ンテナ１８に送出される。１回の動作時間は、前
述のように約１ミリ秒であり、その許容時間誤差
は数マイクロ秒である。この間各回路の電源は連
続的に供給されている。
１が自局の送信タイムスロツトの時間にアクテイ
ブになり、この時間に限つて、制御回路２３およ
び変調回路１５に、動作用のクロツク信号が与え
られる。この時に変調回路１５が動作して、開閉
回路１６が閉じ、送信出力が送信回路１７からア
ンテナ１８に送出される。１回の動作時間は、前
述のように約１ミリ秒であり、その許容時間誤差
は数マイクロ秒である。この間各回路の電源は連
続的に供給されている。
このような動作を行うことにより、制御回路２
３、変調回路１５およびメモリ１３の読出側は、
自局の送信タイムスロツトの時間のみ動作し、他
の時間は動作しない。これらの回路に電源が連続
的に供給されていても、動作用のクロツクが供給
されない限り、その消費電力は僅かであり、全体
として消費電力が経済化される。
３、変調回路１５およびメモリ１３の読出側は、
自局の送信タイムスロツトの時間のみ動作し、他
の時間は動作しない。これらの回路に電源が連続
的に供給されていても、動作用のクロツクが供給
されない限り、その消費電力は僅かであり、全体
として消費電力が経済化される。
特に、第３図で一点鎖線で囲む回路は、相補
MOS回路で構成することが好ましい。相補MOS
回路では、動作クロツクのない時間の消費電力
は、動作クロツクの与えられている時間の消費電
力の約1000分の１である。
MOS回路で構成することが好ましい。相補MOS
回路では、動作クロツクのない時間の消費電力
は、動作クロツクの与えられている時間の消費電
力の約1000分の１である。
以上述べたように、本発明の回路では、動作用
のクロツクの供給を送信タイミングに同期させる
ことにより、デイジタル回路の電力消費を低減さ
せる。しかも、各デイジタル回路には電源が連続
的に供給されているので、電源回路の時定数によ
り動作の起動が遅れるようなことがなく、デイジ
タル回路の本来の性能まで、高連動作に追従する
ことができる優れた効果がある。
のクロツクの供給を送信タイミングに同期させる
ことにより、デイジタル回路の電力消費を低減さ
せる。しかも、各デイジタル回路には電源が連続
的に供給されているので、電源回路の時定数によ
り動作の起動が遅れるようなことがなく、デイジ
タル回路の本来の性能まで、高連動作に追従する
ことができる優れた効果がある。
第１図は本発明を実施する無線方式の一例を示
す図、第２図はその動作タイミング図。第３図は
本発明実施例装置のブロツク構成図。 １〜５…子局、６…親局、１１…アナログ入
力、１２…AD変換回路、１３…メモリ、１５…
変調回路、１６…開閉回路、１７…送信回路、１
８…アンテナ、２０…制御回路、２１…アンド回
路、２２…発振回路、２３…制御回路。
す図、第２図はその動作タイミング図。第３図は
本発明実施例装置のブロツク構成図。 １〜５…子局、６…親局、１１…アナログ入
力、１２…AD変換回路、１３…メモリ、１５…
変調回路、１６…開閉回路、１７…送信回路、１
８…アンテナ、２０…制御回路、２１…アンド回
路、２２…発振回路、２３…制御回路。
Claims (1)
- 【特許請求の範囲】 １ 同一の周波数のデジタル信号を送受信するこ
とのできる複数の無線局に配置され、その複数の
無線局はそれぞれ順に割当てられる時間にバース
ト信号を送信するように制御される時分割多重無
線通信用送信装置において、 この送信装置の変調回路および上記バースト信
号の送信時にこの変調回路を制御する制御回路
に、上記バースト信号の送信時に限り動作用のク
ロツク信号を供給する手段を備えた ことを特徴とする時分割多重無線通信用送信装
置。 ２ 変調回路および制御回路が相補MOS回路に
より構成された特許請求の範囲第１項記載の時分
割多重無線通信用送信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55139678A JPS5763925A (en) | 1980-10-06 | 1980-10-06 | Transmitter for time-division multiplex radio communication |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55139678A JPS5763925A (en) | 1980-10-06 | 1980-10-06 | Transmitter for time-division multiplex radio communication |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5763925A JPS5763925A (en) | 1982-04-17 |
| JPS639693B2 true JPS639693B2 (ja) | 1988-03-01 |
Family
ID=15250867
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55139678A Granted JPS5763925A (en) | 1980-10-06 | 1980-10-06 | Transmitter for time-division multiplex radio communication |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5763925A (ja) |
Families Citing this family (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5986934A (ja) * | 1982-11-10 | 1984-05-19 | Nec Corp | 時分割多重化装置 |
| JPS59117342A (ja) * | 1982-12-23 | 1984-07-06 | Nec Corp | 多重通信方式 |
| JPS6225523A (ja) * | 1985-07-25 | 1987-02-03 | Nec Corp | 無線通信方式 |
| FR2599202A1 (fr) * | 1986-05-23 | 1987-11-27 | Girard Patrick | Procede et systeme de communication a plusieurs postes fonctionnant en emetteur et en recepteur travaillant sur une seule frequence |
| US5241542A (en) * | 1991-08-23 | 1993-08-31 | International Business Machines Corporation | Battery efficient operation of scheduled access protocol |
| GB2322042B (en) | 1997-02-05 | 2002-02-06 | Ericsson Telefon Ab L M | Radio architecture |
| DE19961138C2 (de) * | 1999-12-17 | 2001-11-22 | Siemens Ag | Multiport-RAM-Speichervorrichtung |
| US6775254B1 (en) * | 2000-11-09 | 2004-08-10 | Qualcomm Incorporated | Method and apparatus for multiplexing high-speed packet data transmission with voice/data transmission |
-
1980
- 1980-10-06 JP JP55139678A patent/JPS5763925A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5763925A (en) | 1982-04-17 |
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