JPS6383834U - - Google Patents

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JPS6383834U
JPS6383834U JP17742286U JP17742286U JPS6383834U JP S6383834 U JPS6383834 U JP S6383834U JP 17742286 U JP17742286 U JP 17742286U JP 17742286 U JP17742286 U JP 17742286U JP S6383834 U JPS6383834 U JP S6383834U
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JP
Japan
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circuit
transistor
output
output transistor
gate
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JP17742286U
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【図面の簡単な説明】
第１図はこの考案の一実施例によるＣＭＯＳ回
路を示す回路図、第２図はこの考案の他の実施例
によるＣＭＯＳ回路を示す回路図、第３図はこの
考案の最も簡単な回路構成を示す回路図、第４図
は従来のＣＭＯＳ回路の一例を示す回路図である
。 図において、１は高電位電源Ｖｃｃ、２はＧＮ
Ｄ、３は低電位電源ＶＥＥ、Ｐ１はＰチヤネルＭ
ＯＳトランジスタ、Ｎ１，Ｎ２，Ｎ３，Ｎ４はＮ
チヤネルＭＯＳトランジスタ、Ａは入力端子、Ｂ
は出力端子、Ｃｏｕｔは出力容量、Ｌ１はインダ
クタンス成分である。なお図中同一符号は同一又
は相当部分を示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) ２つのＭＯＳトランジスタからなる出力ト
    ランジスタ回路を有するＣＭＯＳ回路において、 上記出力トランジスタ回路の出力端子とアース
    より低電位の電源との間に、直列接続された第１
    、第２のＮチヤネルＭＯＳトランジスタを備え、 該第１のトランジスタのゲートは上記出力端子
    に接続され、 上記第１、第２のトランジスタのバルクは上記
    低電位の電源に接続され、 上記第２のトランジスタのゲートは上記出力ト
    ランジスタ回路の入力端子に接続されていること
    を特徴とするＣＭＯＳ回路。 (2) 上記出力トランジスタ回路は、２つのＮチ
    ヤネルＭＯＳトランジスタからなるものであり、
    上記第２のＮチヤネルＭＯＳトランジスタのゲー
    トは反転回路を介して上記出力トランジスタ回路
    の入力端子に接続されていることを特徴とする実
    用新案登録請求の範囲第１項記載のＣＭＯＳ回路
    。 (3) 上記出力トランジスタ回路を構成するアー
    ス側トランジスタは、そのゲートが遅延回路を介
    して上記出力トランジスタ回路の入力端子に接続
    されていることを特徴とする実用新案登録請求の
    範囲第１項又は第２項記載のＣＭＯＳ回路。
JP17742286U 1986-11-18 1986-11-18 Pending JPS6383834U (ja)

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JP17742286U JPS6383834U (ja) 1986-11-18 1986-11-18

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JPS6383834U true JPS6383834U (ja) 1988-06-01

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JP17742286U Pending JPS6383834U (ja) 1986-11-18 1986-11-18

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