JPS6347116Y2 - - Google Patents
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- Publication number
- JPS6347116Y2 JPS6347116Y2 JP10974183U JP10974183U JPS6347116Y2 JP S6347116 Y2 JPS6347116 Y2 JP S6347116Y2 JP 10974183 U JP10974183 U JP 10974183U JP 10974183 U JP10974183 U JP 10974183U JP S6347116 Y2 JPS6347116 Y2 JP S6347116Y2
- Authority
- JP
- Japan
- Prior art keywords
- output
- circuit
- dropout
- delayed
- switch
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 230000003111 delayed effect Effects 0.000 claims description 16
- 238000001514 detection method Methods 0.000 claims description 14
- 230000001934 delay Effects 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 8
- 230000000694 effects Effects 0.000 description 3
Landscapes
- Television Signal Processing For Recording (AREA)
Description
【考案の詳細な説明】
(イ) 産業上の利用分野
本考案は映像信号のドロツプアウト補償回路の
改良に関する。
改良に関する。
(ロ) 従来技術
ビデオテープレコーダ等の映像信号再生装置
は、ドロツプアウト発生時に映像信号の類似性を
利用して1H遅延出力を補完するドロツプアウト
補償回路を設けている。
は、ドロツプアウト発生時に映像信号の類似性を
利用して1H遅延出力を補完するドロツプアウト
補償回路を設けている。
第１図は、従来のドロツプアウト補償回路のブ
ロツク図を、また第２図は、同要部波形説明図を
それぞれ顕わしている。両図より明らかな様に、
再生FM映像信号はドロツプアウト検出回路１と
FM復調回路２に入力される。前記ドロツプアウ
ト検出回路１は、再生FM映像信号が所定レベル
以下となつたとき、ドロツプアウト検出出力Ｂを
発する。また前記FM復調回路２からは、ドロツ
プアウトを有する復調出力Ａが導出される。第１
スイツチS1はこの復調出力Ａとその遅延出力と
を入力しており、ドロツプアウト検出出力Ｂにて
遅延出力を選択する。またこの第１スイツチ出力
ＣはCCDを可とする1H遅延回路３に入力され、
スイツチ出力Ｃを1H遅延して前記第１スイツチ
S1にフイードバツクしている。
ロツク図を、また第２図は、同要部波形説明図を
それぞれ顕わしている。両図より明らかな様に、
再生FM映像信号はドロツプアウト検出回路１と
FM復調回路２に入力される。前記ドロツプアウ
ト検出回路１は、再生FM映像信号が所定レベル
以下となつたとき、ドロツプアウト検出出力Ｂを
発する。また前記FM復調回路２からは、ドロツ
プアウトを有する復調出力Ａが導出される。第１
スイツチS1はこの復調出力Ａとその遅延出力と
を入力しており、ドロツプアウト検出出力Ｂにて
遅延出力を選択する。またこの第１スイツチ出力
ＣはCCDを可とする1H遅延回路３に入力され、
スイツチ出力Ｃを1H遅延して前記第１スイツチ
S1にフイードバツクしている。
よつて、上述する従来例では、第１スイツチ出
力を遅延してフイードバツクするため、1H以上
のドロツプアウトに対しても補償効果がある。し
かし、斬る従来回路より得られるドロツプアウト
補償出力（第２図Ｃ）は、ドロツプアウト補償の
直前にノイズを含むことが知られており、完全な
補償ができなかつた。この原因は、エンベロープ
検波によるドロツプアウト検出出力の発生タイミ
ングが約0.7〜0.8μsec遅れるためである。
力を遅延してフイードバツクするため、1H以上
のドロツプアウトに対しても補償効果がある。し
かし、斬る従来回路より得られるドロツプアウト
補償出力（第２図Ｃ）は、ドロツプアウト補償の
直前にノイズを含むことが知られており、完全な
補償ができなかつた。この原因は、エンベロープ
検波によるドロツプアウト検出出力の発生タイミ
ングが約0.7〜0.8μsec遅れるためである。
(ハ) 考案の目的
そこで、本考案は、ドロツプアウト検出出力に
先んじてドロツプアウト補償を為すドロツプアウ
ト補償回路を提案するものである。
先んじてドロツプアウト補償を為すドロツプアウ
ト補償回路を提案するものである。
(ニ) 考案の構成
本考案は、従来のドロツプアウト補償回路に対
し、ドロツプアウト検出出力の発生タイミングを
1H弱遅延し終了タイミングを1H遅延する遅延パ
ルス発生回路と、第１スイツチ出力と1H遅延出
力とを入力とを入力とし前記遅延パルスにて前記
第１スイツチ出力を選択する第２スイツチ回路と
を設けることを特徴とする。
し、ドロツプアウト検出出力の発生タイミングを
1H弱遅延し終了タイミングを1H遅延する遅延パ
ルス発生回路と、第１スイツチ出力と1H遅延出
力とを入力とを入力とし前記遅延パルスにて前記
第１スイツチ出力を選択する第２スイツチ回路と
を設けることを特徴とする。
(ホ) 実施例
以下、本考案を図示せる一実施例に従い説明す
る。第３図及び第４図は本実施例の回路ブロツク
図と波形説明図であり第１図と第３図、第２図と
第４図には共通要素が多いためこれら各共通要素
に付いては図番を共通にして説明を割愛し、特徴
部分のみ説明する。
る。第３図及び第４図は本実施例の回路ブロツク
図と波形説明図であり第１図と第３図、第２図と
第４図には共通要素が多いためこれら各共通要素
に付いては図番を共通にして説明を割愛し、特徴
部分のみ説明する。
本実施例は、第４図に図示する1H遅延出力Ｄ
に着目するときノイズ発生直前に第１スイツチ出
力Ｃを選択すれば良いことに鑑みドロツプアウト
検出出力Ｂの立上りを1Hより僅か短かいτ1（＝
63.5μsec）だけ遅延しドロツプアウト検出出力Ｂ
の立下りを頂度τ2（＝64.556μsec）だけ遅延パル
スＥを形成している。この遅延パルスＥは遅延パ
ルス発生回路４より導出される。1H遅延出力Ｄ
と第１スイツチ出力Ｃとを入力とする第２スイツ
チング回路Ｓ２は、この遅延パルスＥを制御入力
としており、出力発生期間中第１スイツチング出
力Ｃを選択する。よつて、第２スイツチング出力
Ｆからはドロツプアウト補償直前に生ずるノイズ
が解消される。但しドロツプアウトが1H以上に
及ぶとき、２番目（1H後）以後のノイズを除く
ことはできないが、通常1H以上のドロツプアウ
トの発生頻度は低く、使用上ほとんど問題がな
い。
に着目するときノイズ発生直前に第１スイツチ出
力Ｃを選択すれば良いことに鑑みドロツプアウト
検出出力Ｂの立上りを1Hより僅か短かいτ1（＝
63.5μsec）だけ遅延しドロツプアウト検出出力Ｂ
の立下りを頂度τ2（＝64.556μsec）だけ遅延パル
スＥを形成している。この遅延パルスＥは遅延パ
ルス発生回路４より導出される。1H遅延出力Ｄ
と第１スイツチ出力Ｃとを入力とする第２スイツ
チング回路Ｓ２は、この遅延パルスＥを制御入力
としており、出力発生期間中第１スイツチング出
力Ｃを選択する。よつて、第２スイツチング出力
Ｆからはドロツプアウト補償直前に生ずるノイズ
が解消される。但しドロツプアウトが1H以上に
及ぶとき、２番目（1H後）以後のノイズを除く
ことはできないが、通常1H以上のドロツプアウ
トの発生頻度は低く、使用上ほとんど問題がな
い。
また、本実施例も、従来例同様1H遅延回路を
CCDにて構成しているが、その他映像信号帯域
を遅延せしめ有る様な遅延素子であれば、何でも
良い。更に、本実施例中のスイツチＳ１，Ｓ２
は、何れもアナログスイツチで構成されており、
スイツチングノイズはほとんどない。
CCDにて構成しているが、その他映像信号帯域
を遅延せしめ有る様な遅延素子であれば、何でも
良い。更に、本実施例中のスイツチＳ１，Ｓ２
は、何れもアナログスイツチで構成されており、
スイツチングノイズはほとんどない。
(ヘ) 考案の効果
よつて、本考案によれば、1H遅延出力と第１
スイツチ出力とを切換えるため、ノイズが軽減さ
れその効果は大である。
スイツチ出力とを切換えるため、ノイズが軽減さ
れその効果は大である。
第１図は従来例の回路ブロツク図、第２図は同
要部波形説明図、第３図は本考案の一実施例回路
の回路ブロツク図、第４図は同要部波形説明図を
それぞれ顕わす。 主な図番の説明、１……ドロツプアウト検出回
路、２……FM復調回路、３……1H遅延回路、
４……遅延パルス発生回路、Ｓ１……第１スイツ
チ、Ｓ２……第２スイツチ。
要部波形説明図、第３図は本考案の一実施例回路
の回路ブロツク図、第４図は同要部波形説明図を
それぞれ顕わす。 主な図番の説明、１……ドロツプアウト検出回
路、２……FM復調回路、３……1H遅延回路、
４……遅延パルス発生回路、Ｓ１……第１スイツ
チ、Ｓ２……第２スイツチ。
Claims (1)
- 再生FM映像信号よりドロツプアウトを検出す
るドロツプアウト検出回路と、再生FM映像信号
を復調するFM復調回路と、該FM復調出力とそ
の1H遅延出力を入力とし前記ドロツプアウト検
出力にて前記1H遅延出力を選択する第１スイツ
チと、該第１スイツチ出力を1H遅延する遅延回
路と、前記ドロツプアウト検出出力の発生タイミ
ングより1H弱遅れ終了タイミングより1H遅れる
遅延パルスを導出する遅延パルス発生回路と、前
記第１スイツチ出力と前記1H遅延出力とを入力
とし前記遅延パルスにて前記第１スイツチ出力を
選択する第２スイツチ回路とを設けて成るドロツ
プアウト補償回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10974183U JPS6019276U (ja) | 1983-07-14 | 1983-07-14 | ドロツプアウト補償回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10974183U JPS6019276U (ja) | 1983-07-14 | 1983-07-14 | ドロツプアウト補償回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6019276U JPS6019276U (ja) | 1985-02-09 |
| JPS6347116Y2 true JPS6347116Y2 (ja) | 1988-12-06 |
Family
ID=30255515
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10974183U Granted JPS6019276U (ja) | 1983-07-14 | 1983-07-14 | ドロツプアウト補償回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6019276U (ja) |
-
1983
- 1983-07-14 JP JP10974183U patent/JPS6019276U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6019276U (ja) | 1985-02-09 |
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