JPS6333210U - - Google Patents

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JPS6333210U
JPS6333210U JP12582786U JP12582786U JPS6333210U JP S6333210 U JPS6333210 U JP S6333210U JP 12582786 U JP12582786 U JP 12582786U JP 12582786 U JP12582786 U JP 12582786U JP S6333210 U JPS6333210 U JP S6333210U
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JP
Japan
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transistor
emitter
whose base
currents
transistors
Prior art date
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JP12582786U
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  • Control Of Amplification And Gain Control (AREA)
  • Amplifiers (AREA)

Description

【図面の簡単な説明】
第1図は本考案のブロツク図、第2図は本考案
の一実施例の回路図、第3図は従来例の回路図、
第4図は従来例の等価回路図。 1,7:入力端子、3,8:出力端子、5:電
流ミラー回路、6:電流電圧変換回路、9:演算
増幅器。

Claims (1)

    【実用新案登録請求の範囲】
  1. ベースを入力端子とした第1のトランジスタと
    ベースを出力端子に接続すると共に、そのエミツ
    タを前記第1のトランジスタのエミツタに接続し
    た第2のトランジスタと、ベースを前記入力端子
    と同一の端子に接続した第3のトランジスタと、
    ベースを接地しそのエミツタを前記第3のトラン
    ジスタのエミツタに接続した第4のトランジスタ
    と、前記第1、第2のトランジスタと第3、第4
    のトランジスタそれぞれのエミツタ対を独立した
    2つの電流源に接続し、第2、第4のトランジス
    タのコレクタを結合して電流ミラー回路の入力に
    接続し、第1、第3のトランジスタのコレクタを
    接続して電流ミラー回路の出力に接続し、またそ
    の点を入力とし、出力を出力端子に接続した電流
    電圧変換回路とからなり、前記第1、第2のトラ
    ンジスタを駆動する電流源と、第3、第4のトラ
    ンジスタを駆動する電流源の2つの電流源の電流
    を制御し、その電流化によつて電圧利得を制御す
    ることを特徴とする負帰還増幅器。
JP12582786U 1986-08-20 1986-08-20 Pending JPS6333210U (ja)

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JP12582786U JPS6333210U (ja) 1986-08-20 1986-08-20

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JP12582786U JPS6333210U (ja) 1986-08-20 1986-08-20

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JPS6333210U true JPS6333210U (ja) 1988-03-03

Family

ID=31019064

Family Applications (1)

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JP12582786U Pending JPS6333210U (ja) 1986-08-20 1986-08-20

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