JPS6331450U - - Google Patents

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JPS6331450U
JPS6331450U JP12465186U JP12465186U JPS6331450U JP S6331450 U JPS6331450 U JP S6331450U JP 12465186 U JP12465186 U JP 12465186U JP 12465186 U JP12465186 U JP 12465186U JP S6331450 U JPS6331450 U JP S6331450U
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JP
Japan
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signal
memory element
level
signal lines
microprocessor
Prior art date
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Application number
JP12465186U
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English (en)
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Publication date
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  • Static Random-Access Memory (AREA)
  • Techniques For Improving Reliability Of Storages (AREA)

Description

【図面の簡単な説明】
第1図はこの考案の一実施例によるマイクロコ
ンピユータシステムのブロツク接続図、第2図は
同じく動作を示すフローチヤート、第3図は他の
実施例を示す要部のブロツク接続図、第4図は他
の応用例を示す要部のブロツク接続図、第5図は
従来のマイクロコンピユータシステムのブロツク
接続図である。 1はマイクロプロセツサ、2はメモリ素子、5
はチツプ選択回路、6はチツプ選択信号線、7は
書き込み信号線、13,14はトランジスタ、1
7,18はプルアツプ抵抗、P,Pは出力ポ
ート。なお、図中、同一符号は同一または相当部
分を示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) マイクロプロセツサ、メモリ素子およびこ
    のメモリ素子に対するデータの書き込み時に、上
    記マイクロプロセツサにより上記メモリ素子へ予
    め定めたハイレベルまたはローレベルの活性信号
    を伝送する信号線を具備したマイクロコンピユー
    タシステムにおいて、上記信号線は上記メモリ素
    子のチツプ選択信号および書き込み信号を上記活
    性信号としてそれぞれ独自に伝送するように各別
    に設けられ、これらの各信号線の途中に上記マイ
    クロプロセツサの出力に従つてオンとなるスイツ
    チング素子が接続され、このスイツチング素子の
    オン時に、上記メモリ素子側の上記各信号線をロ
    ーレベルまたはハイレベルの非活性信号レベルに
    保持するようにしたことを特徴とするマイクロコ
    ンピユータシステム。 (2) スイツチング素子がトランジスタであるこ
    とを特徴とする実用新案登録請求の範囲第1項記
    載のマイクロコンピユータシステム。
JP12465186U 1986-08-15 1986-08-15 Pending JPS6331450U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP12465186U JPS6331450U (ja) 1986-08-15 1986-08-15

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP12465186U JPS6331450U (ja) 1986-08-15 1986-08-15

Publications (1)

Publication Number Publication Date
JPS6331450U true JPS6331450U (ja) 1988-03-01

Family

ID=31016863

Family Applications (1)

Application Number Title Priority Date Filing Date
JP12465186U Pending JPS6331450U (ja) 1986-08-15 1986-08-15

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