JPS6323418A - Output circuit - Google Patents

Output circuit

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Publication number
JPS6323418A
JPS6323418A JP61167686A JP16768686A JPS6323418A JP S6323418 A JPS6323418 A JP S6323418A JP 61167686 A JP61167686 A JP 61167686A JP 16768686 A JP16768686 A JP 16768686A JP S6323418 A JPS6323418 A JP S6323418A
Authority
JP
Japan
Prior art keywords
transistor
base
output terminal
resistor
collector
Prior art date
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Pending
Application number
JP61167686A
Other languages
Japanese (ja)
Inventor
Yukio Washio
鷲尾 幸夫
Naoyuki Kato
直之 加藤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
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Publication of JPS6323418A publication Critical patent/JPS6323418A/en
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Abstract

PURPOSE:To obtain a stable output waveform even with a high power voltage by adding an oscillation preventing resistor to a base of the 4th transistor (TR). CONSTITUTION:The oscillation preventing resistor 11 is inserted between a TR 4 and a point 10. In the presence of a through-current flowing from a power supply 7 to a ground 8, the current flows from the emitter of the TR 4 to the base, but since the resistor 11 exists, the potential at the point 10 does not rise. Thus, TRs 1, 2 in the turn-off state from the turn-on are not turned on again, no oscillation is caused and a stable output waveform is obtained.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、出力回路のうち、特に電源電圧が高い出力
回路に関するものである。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to output circuits, particularly output circuits with a high power supply voltage.

〔従来の技術〕[Conventional technology]

第2図は従来の出力回路を示す図である。この図におい
て、1は出力端子9へ流れ出す電流をドライブするNP
N )ランジスタ(第1トランジスタ)、2はNPNト
ランジスタ1へそのベース電流を供給するためのNPN
 トランジスタ(第2トランジスタ)、3は出力端子9
から流れ込む電流をドライブするNPN)ランジスタ(
第3トランジスタ)、4はNPNトランジスタ3へその
ベース電流を供給するPNP )ランジスタ(第4トラ
ンジスタ)である、また5は、NPN )ランジスタ2
及びPNP l−ランジスタ4をオンまたはオフさせる
ためのNPN )ランジスタ(第5トランジスタ)であ
り、そのコレクタと電源7との間には定を流源6が設け
られている。なお12.13は抵抗、8はグランドであ
る。
FIG. 2 is a diagram showing a conventional output circuit. In this figure, 1 is the NP that drives the current flowing to the output terminal 9.
N ) transistor (first transistor), 2 is an NPN transistor for supplying its base current to NPN transistor 1
Transistor (second transistor), 3 is output terminal 9
NPN) transistor (which drives the current flowing from
4 is a PNP transistor (fourth transistor) which supplies its base current to the NPN transistor 3; 5 is an NPN transistor 2;
and PNP l- transistor (fifth transistor) for turning on or off the transistor 4, and a constant current source 6 is provided between its collector and the power supply 7. Note that 12 and 13 are resistors, and 8 is a ground.

次に動作について説明する。ここでトランジスタ5のベ
ースに“L”から“Hlとなる信号が入力され、該トラ
ンジスタ5がオフからオンになる場合を考える。トラン
ジスタ5がオフの状態では、点10の電位は電源7を位
にほぼ近いので、トランジスタ2及び1がオンとなり出
力端子9の電位は′″H”となる。この状態ではトラン
ジスタ3゜4は共にオフである。
Next, the operation will be explained. Let us now consider the case where a signal from "L" to "Hl" is input to the base of transistor 5, and transistor 5 is turned from off to on. When transistor 5 is off, the potential at point 10 is Therefore, transistors 2 and 1 are turned on, and the potential of output terminal 9 becomes ``H''. In this state, transistors 3 and 4 are both turned off.

トランジスタ5がオフからオンの状態に変化すると、ト
ランジスタ1.2はオンからオフの状態へトランジスタ
3.4はオフからオンの状態へとそれぞれ変化する。し
かし、トランジスタ2とトランジスタ4とではそのスイ
ッチングスピードが異なるために、トランジスタ1が完
全にオフしきらないうちに、トランジスタ3がオン状態
になる。
When transistor 5 changes from off to on, transistor 1.2 changes from on to off, and transistor 3.4 changes from off to on. However, since transistors 2 and 4 have different switching speeds, transistor 3 is turned on before transistor 1 is completely turned off.

ここでは、特に電源電圧の高い(! 30 M)出力回
路を考えているので、この時、電源7からグランド8へ
向って非常に大きな貫通電流が瞬間的に流れる。この大
きな電流は、トランジスタ4からトランジスタ5を通っ
ても流れるが、トランジスタ5は、大電流に対してはド
ライブ能力のないトランジスタを用いるのが普通である
ので、点10の電位は、トランジスタ5がオンしたこと
によって下がっていたのであるが、この大電流のために
再び上がってしまう。このため、オンからオフへなりか
けていたトランジスタ1,2も再びオンの状態へと戻っ
てしまう。
Here, we are considering an output circuit with a particularly high power supply voltage (! 30 M), so at this time, a very large through current momentarily flows from the power supply 7 to the ground 8. This large current also flows from transistor 4 to transistor 5, but since transistor 5 is normally a transistor that does not have the ability to drive large currents, the potential at point 10 is It had dropped when it was turned on, but it rose again due to this large current. Therefore, the transistors 1 and 2, which were about to turn off from on, also return to the on state.

ここで、出力端子9より点10の方が電位力上高(なる
とトランジスタ3.4はオフの状態になり本トランジス
タ1.2がオン状態になろうとするが、トランジスタ5
はオンされているためににランジスタ4がオンしこれに
より再びトランジスタ1.3に貫通電流が流れることと
なる。
Here, the potential force at point 10 is higher than that at output terminal 9 (then transistor 3.4 is turned off and transistor 1.2 is about to be turned on, but transistor 5
Since transistor 4 is turned on, transistor 4 is turned on, and as a result, a through current flows through transistor 1.3 again.

以後このくり返しにより、出力端子9の波形を見ると、
トランジスタ5がオン状態の間、つまり出力端子9が“
L゛の間は発振してしまう。第3図にこの場合の従来の
出力回路の端子9の波形を示している。
After repeating this process, looking at the waveform at output terminal 9, we get
While the transistor 5 is on, that is, the output terminal 9 is “
It oscillates during L. FIG. 3 shows the waveform at terminal 9 of the conventional output circuit in this case.

(発明が解決しようとする問題点3 以上のように、従来の出力回路では、電源電圧の高い場
合、出力波形の“L”の箇所で発振してしまうという問
題点があった。
(Problem to be Solved by the Invention 3) As described above, the conventional output circuit has a problem in that when the power supply voltage is high, oscillation occurs at the "L" portion of the output waveform.

この発明は、上記のような問題点を解消するためになさ
れたもので、を源電圧の高い場合においても、安定した
出力波形が得られる出力回路を得ることを目的としてい
る。
The present invention has been made to solve the above-mentioned problems, and aims to provide an output circuit that can provide a stable output waveform even when the source voltage is high.

〔問題点を解決するための手段〕[Means for solving problems]

この発明に係る出力回路は、トランジスタ4と点10と
の間に発振防止用抵抗11を挿入したもめである。
The output circuit according to the present invention is a circuit in which an oscillation prevention resistor 11 is inserted between the transistor 4 and the point 10.

〔作用〕[Effect]

出力端子が“L”の場合に、従来回路では電源電圧が高
いと発振してしまったが、この発明に岩いては、発振防
止用抵抗11を加えたことによって、貫通電流がトラン
ジスタ4に流れたとしても点10の電位は上昇しないの
で〜発振しなくなる。
When the output terminal is "L", the conventional circuit would oscillate if the power supply voltage was high, but in this invention, by adding the oscillation prevention resistor 11, a through current flows to the transistor 4. Even if it were, the potential at point 10 would not rise, so oscillation would no longer occur.

〔実施例〕〔Example〕

以下、この発明の一実施例を図について説明する。第1
図は本発明の一実施例による出力回路を示し、図におい
て、第2図と同一符号は同一のものを示す、11は点1
0の電位の上昇を防ぐために設けられた発振防止用抵抗
である。
An embodiment of the present invention will be described below with reference to the drawings. 1st
The figure shows an output circuit according to an embodiment of the present invention. In the figure, the same reference numerals as in FIG.
This is an oscillation prevention resistor provided to prevent the zero potential from rising.

次に作用効果について説明する。Next, the effects will be explained.

この回路において、電源7からグランド8へ貫通電流が
流れた場合を考える。電流はトランジスタ4のエミッタ
からベースへ抜けて流れるが、抵抗11があるために点
10の電位は上がらない。
Consider the case where a through current flows from the power supply 7 to the ground 8 in this circuit. Current flows from the emitter to the base of transistor 4, but because of the presence of resistor 11, the potential at point 10 does not rise.

従ってオンからオフ状態になっているトランジスタ1.
2が再びオンになるということがなく、発振は起こらな
い。
Therefore, the transistor 1. which has changed from on to off state.
2 is never turned on again and no oscillation occurs.

〔発明の効果〕〔Effect of the invention〕

以上のように、この発明に係る出力回路によれば、第4
トランジスタのベース側に発振防止用抵抗を追加したの
で、電源電圧の高い回路においても発振せず、安定した
出力波形を得られる効果がある。
As described above, according to the output circuit according to the present invention, the fourth
Since an oscillation prevention resistor is added to the base side of the transistor, oscillation does not occur even in circuits with high power supply voltages, and a stable output waveform can be obtained.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明の一実施例による出力回路を示す図、
第2図は従来の出力回路を示す図、第3図は従来の出力
回路の出力波形を示す図である。 図において、1〜5は第1〜第5トランジスタ、6は定
電流源、7は電源、8はグランド、9は出力端子、11
は発振防止用抵抗、12.13は抵抗である。 なお図中同一符号は同−又は相当部分を示す。
FIG. 1 is a diagram showing an output circuit according to an embodiment of the present invention;
FIG. 2 is a diagram showing a conventional output circuit, and FIG. 3 is a diagram showing an output waveform of the conventional output circuit. In the figure, 1 to 5 are first to fifth transistors, 6 is a constant current source, 7 is a power supply, 8 is a ground, 9 is an output terminal, and 11
is a resistor for preventing oscillation, and 12.13 is a resistor. Note that the same reference numerals in the figures indicate the same or equivalent parts.

Claims (1)

【特許請求の範囲】[Claims] (1)電源にコレクタが出力端子にエミッタが接続され
出力端子へ流れ出す電流をドライブするNPN型の第1
トランジスタと、 電源にコレクタが接続されエミッタが該第1トランジス
タのベースに接続されるとともに抵抗を介して上記出力
端子に接続され該第1トランジスタのベース電流を供給
するNPN型の第2トランジスタと、 上記出力端子にコレクタが接続されエミッタが接地され
出力端子から流れ込む電流をドライブするNPN型の第
3トランジスタと、 該第3トランジスタのコレクタにエミッタが接続されコ
レクタが該第3トランジスタのベースに接続されるとと
もに抵抗を介して接地され該第3トランジスタのベース
電流を供給するPNP型の第4トランジスタと、 上記第2、第4トランジスタのベース電流を供給する定
電流源と、 上記第2及び第4トランジスタのベースにコレクタが接
続されエミッタが接地されベースに前段からの信号が入
力されるNPN型の第5トランジスタと、 上記第4トランジスタのベースと上記第5トランジスタ
のコレクタとの間に設けられ上記出力端子が“H”から
“L”へ変化した時に本出力回路が発振するのを防止す
る発振防止用抵抗とを備えたことを特徴とする出力回路
(1) The first NPN type whose collector is connected to the power supply and whose emitter is connected to the output terminal drives the current flowing to the output terminal.
a second NPN transistor whose collector is connected to a power supply and whose emitter is connected to the base of the first transistor and to the output terminal via a resistor to supply the base current of the first transistor; a third NPN transistor whose collector is connected to the output terminal and whose emitter is grounded to drive a current flowing from the output terminal; an emitter is connected to the collector of the third transistor and the collector is connected to the base of the third transistor; a PNP-type fourth transistor that is grounded through a resistor and supplies the base current of the third transistor; a constant current source that supplies the base current of the second and fourth transistors; a fifth transistor of NPN type, the collector of which is connected to the base of the transistor, the emitter of which is grounded, and the signal from the previous stage is input to the base; An output circuit comprising an oscillation prevention resistor that prevents the output circuit from oscillating when the output terminal changes from "H" to "L".
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