JPS63206009A - 電圧制御発振回路 - Google Patents
電圧制御発振回路Info
- Publication number
- JPS63206009A JPS63206009A JP3880387A JP3880387A JPS63206009A JP S63206009 A JPS63206009 A JP S63206009A JP 3880387 A JP3880387 A JP 3880387A JP 3880387 A JP3880387 A JP 3880387A JP S63206009 A JPS63206009 A JP S63206009A
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- JP
- Japan
- Prior art keywords
- inductor
- oscillation
- circuit
- fet
- microstrip line
- Prior art date
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- Pending
Links
- 230000010355 oscillation Effects 0.000 title claims abstract description 35
- 239000003990 capacitor Substances 0.000 abstract description 12
- 230000000903 blocking effect Effects 0.000 abstract description 3
- 230000006866 deterioration Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 2
- 208000024891 symptom Diseases 0.000 description 1
Landscapes
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
「産業上の利用分野」
本発明は、無線機等に使用される電圧制御発振回路に係
り、特に共振回路のインダクタとしてマイクロストリッ
プラインを採用した場合における高温時の動作の安定化
を図った電圧制御発振回路に関するものである。
り、特に共振回路のインダクタとしてマイクロストリッ
プラインを採用した場合における高温時の動作の安定化
を図った電圧制御発振回路に関するものである。
「従来の技術」
マイクロストリップラインをインダクタとして使用した
従来の発振回路について、FETによるゲート接地のク
ラップ形電圧制御発振回路を例として第4図に基づき説
明すると、(1)は発振回路の主体となるFETで、こ
のF E T (1)のゲートは接地され、ソースとド
レンには発振のためコンデンサ(2) (3) (4)
が結合されるとともに、インダクタとしてのマイクロス
トリップライン(5)が結合されている。また、制御電
圧端子(6)には側路コンデンサ(7)と抵抗(8)を
介して周波数制御用の可変容量ダイオード(9)が結合
され、さらに直流阻止コンデンサ(10)を介して前記
マイクロストリップライ”ン(5)に結合されている。
従来の発振回路について、FETによるゲート接地のク
ラップ形電圧制御発振回路を例として第4図に基づき説
明すると、(1)は発振回路の主体となるFETで、こ
のF E T (1)のゲートは接地され、ソースとド
レンには発振のためコンデンサ(2) (3) (4)
が結合されるとともに、インダクタとしてのマイクロス
トリップライン(5)が結合されている。また、制御電
圧端子(6)には側路コンデンサ(7)と抵抗(8)を
介して周波数制御用の可変容量ダイオード(9)が結合
され、さらに直流阻止コンデンサ(10)を介して前記
マイクロストリップライ”ン(5)に結合されている。
電源端子(11)は高周波チョークコイル(12)を介
してF E T (1)のドレンに結合され、また、前
記F E T (1)のソースはバイアス抵抗(13)
と直流阻止用コンデンサ(14)を介して出力端子(1
5)に結合されている。(16)は側路コンデンサであ
る。
してF E T (1)のドレンに結合され、また、前
記F E T (1)のソースはバイアス抵抗(13)
と直流阻止用コンデンサ(14)を介して出力端子(1
5)に結合されている。(16)は側路コンデンサであ
る。
このような電圧制御発振回路においては、インダクタ(
5)としてQの高い空心コイルを用いる方が側帯波雑音
の点から有利であるが、振動によりS/N比が劣化し易
いという欠点がある。そのため、従来はこの種のインダ
クタ(5)としてマイクロストリップラインが用いられ
ていた。
5)としてQの高い空心コイルを用いる方が側帯波雑音
の点から有利であるが、振動によりS/N比が劣化し易
いという欠点がある。そのため、従来はこの種のインダ
クタ(5)としてマイクロストリップラインが用いられ
ていた。
「発明が解決しようとする問題点」
発振のためのインダクタとしてマイクロストリップライ
ンを用いた発振回路では、共振回路のQが低くなるため
、高温での能動素子のパラメータの変化により発振条件
が悪化したとき発振出力の急激な低下や発振停止の状態
となり易いという問題があった。FET(1)のドレン
とマイクロストリップライン(5)との間のコンデン−
+J−(4)の容量を大きくとると、この症状はよくな
る。しかし、側帯波雑音1周波数安定度か劣化するとい
う問題があった。
ンを用いた発振回路では、共振回路のQが低くなるため
、高温での能動素子のパラメータの変化により発振条件
が悪化したとき発振出力の急激な低下や発振停止の状態
となり易いという問題があった。FET(1)のドレン
とマイクロストリップライン(5)との間のコンデン−
+J−(4)の容量を大きくとると、この症状はよくな
る。しかし、側帯波雑音1周波数安定度か劣化するとい
う問題があった。
「問題点を解決するための手段」
本発明は上述のような高温での発振出力の低下や停止が
起りにくく、かつ側帯波雑音が少なく、周波数安定度の
すぐれた回路を供給するためになされたもので、マイク
ロストリップラインを共振回路のインダクタとして使用
してなる電圧制御発振回路において、能動素子と帰還回
路との間にインダクタを挿入してなるものである。
起りにくく、かつ側帯波雑音が少なく、周波数安定度の
すぐれた回路を供給するためになされたもので、マイク
ロストリップラインを共振回路のインダクタとして使用
してなる電圧制御発振回路において、能動素子と帰還回
路との間にインダクタを挿入してなるものである。
「作用」
能動素子と帰還回路との間にインダクタを挿入すると、
この挿入されたインダクタの作用により高温においても
発振条件を維持されて能動素子のパラメータ変化によっ
て起こる発振停止が防止される。
この挿入されたインダクタの作用により高温においても
発振条件を維持されて能動素子のパラメータ変化によっ
て起こる発振停止が防止される。
「実施例」
以下、本発明の一実施例を図面に基づき説明する。
第1図は本発明の基本的回路で能動素子としてFET(
1)を用い、このF E T (1)のドレンとソース
間にコンデンサ(3)を挿入し、ソースと接地間にコン
デンサ(2)を挿入し、ドレンと接地間にコンデンサ(
4)とマイクロストリップライン(5)との直列回路を
挿入してクラップ形発振回路を構成し。
1)を用い、このF E T (1)のドレンとソース
間にコンデンサ(3)を挿入し、ソースと接地間にコン
デンサ(2)を挿入し、ドレンと接地間にコンデンサ(
4)とマイクロストリップライン(5)との直列回路を
挿入してクラップ形発振回路を構成し。
さらに1本発明ではこの発振回路のF E T (1)
のゲートと接地間に、空心コイルまたはマイクロストリ
ップラインからなるインダクタ(17)を挿入してなる
ものである。具体的には第2図に示すように、第4図の
従来回路と同一回路において、FET(1)のゲートと
接地間にインダクタ(17)を挿入してなるものである
。
のゲートと接地間に、空心コイルまたはマイクロストリ
ップラインからなるインダクタ(17)を挿入してなる
ものである。具体的には第2図に示すように、第4図の
従来回路と同一回路において、FET(1)のゲートと
接地間にインダクタ(17)を挿入してなるものである
。
このような構成において、制御電圧端子(6)からの制
御電圧が可変容量ダイオード(9)に印加されるとその
容量が変化して共振条件が変化し発振周波数が変化する
。FET(1)のゲートに接続されたインダクタ(17
)は、高温においても発振条件を維持できるようにし、
F E T (1)のパラメータ変化によっておこる発
振停止を防止する。
御電圧が可変容量ダイオード(9)に印加されるとその
容量が変化して共振条件が変化し発振周波数が変化する
。FET(1)のゲートに接続されたインダクタ(17
)は、高温においても発振条件を維持できるようにし、
F E T (1)のパラメータ変化によっておこる発
振停止を防止する。
つぎに、第3図は能動素子としてトランジスタ(1)を
用いた他の実施例を示し、本発明によるインダクタ(1
7)はこのトランジスタ(1)のベースに挿入してなる
ものである。その作用は第2図の場合と略同様である。
用いた他の実施例を示し、本発明によるインダクタ(1
7)はこのトランジスタ(1)のベースに挿入してなる
ものである。その作用は第2図の場合と略同様である。
「発明の効果」
本発明は上述のように構成したので、Qの低いマイクロ
ストリップラインからなるインダクタを用いても高温に
て安定した発振をし、また1発振停止防止のコンデンサ
のクラップ容量を小さくできるため、側帯波雑音、周波
数安定度のすぐれたものが得られるという効果を有する
。
ストリップラインからなるインダクタを用いても高温に
て安定した発振をし、また1発振停止防止のコンデンサ
のクラップ容量を小さくできるため、側帯波雑音、周波
数安定度のすぐれたものが得られるという効果を有する
。
第1図は本発明による電圧制御発振回路の基本回路図、
第2図は、能動素子としてFETを用いた本発明による
電圧制御発振回路図、第3図は能動素子としてトランジ
スタを用いた本発明による電圧制御発振回路図、第4図
は従来の電圧制御発振回路図である。 (1)・・・能動素子(FETまたはトランジスタ)、
(2)(3) (4)・・・発振用コンデンサ、(5)
・・・発振用インダクタ、(17)・・・インダクタ。 出願人 株式会社富士通ゼネラル 第 1 図 第 3 図
第2図は、能動素子としてFETを用いた本発明による
電圧制御発振回路図、第3図は能動素子としてトランジ
スタを用いた本発明による電圧制御発振回路図、第4図
は従来の電圧制御発振回路図である。 (1)・・・能動素子(FETまたはトランジスタ)、
(2)(3) (4)・・・発振用コンデンサ、(5)
・・・発振用インダクタ、(17)・・・インダクタ。 出願人 株式会社富士通ゼネラル 第 1 図 第 3 図
Claims (3)
- (1)マイクロストリップラインを共振回路のインダク
タとして使用してなる電圧制御発振回路において、能動
素子と帰還回路との間にインダクタを挿入してなること
を特徴とする電圧制御発振回路。 - (2)能動素子はFETからなり、このFETのゲート
と接地間にインダクタを挿入してなる特許請求の範囲第
1項記載の電圧制御発振回路。 - (3)能動素子はトランジスタからなり、このトランジ
スタのベースと接地間にインダクタを挿入してなる特許
請求の範囲第1項記載の電圧制御発振回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3880387A JPS63206009A (ja) | 1987-02-20 | 1987-02-20 | 電圧制御発振回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3880387A JPS63206009A (ja) | 1987-02-20 | 1987-02-20 | 電圧制御発振回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63206009A true JPS63206009A (ja) | 1988-08-25 |
Family
ID=12535452
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3880387A Pending JPS63206009A (ja) | 1987-02-20 | 1987-02-20 | 電圧制御発振回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63206009A (ja) |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54140859A (en) * | 1978-04-25 | 1979-11-01 | Fujitsu Ltd | Microwave phase synchronous oscillator |
JPS5673906A (en) * | 1979-11-20 | 1981-06-19 | Fujitsu Ltd | Microwave oscillator |
JPS6193707A (ja) * | 1984-10-12 | 1986-05-12 | Nec Corp | モノリシツクマイクロ波発振器 |
-
1987
- 1987-02-20 JP JP3880387A patent/JPS63206009A/ja active Pending
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54140859A (en) * | 1978-04-25 | 1979-11-01 | Fujitsu Ltd | Microwave phase synchronous oscillator |
JPS5673906A (en) * | 1979-11-20 | 1981-06-19 | Fujitsu Ltd | Microwave oscillator |
JPS6193707A (ja) * | 1984-10-12 | 1986-05-12 | Nec Corp | モノリシツクマイクロ波発振器 |
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