JPS63173916U - - Google Patents

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JPS63173916U
JPS63173916U JP6542287U JP6542287U JPS63173916U JP S63173916 U JPS63173916 U JP S63173916U JP 6542287 U JP6542287 U JP 6542287U JP 6542287 U JP6542287 U JP 6542287U JP S63173916 U JPS63173916 U JP S63173916U
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JP
Japan
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electrode pattern
insulating
sides
layers
insulating layer
Prior art date
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Pending
Application number
JP6542287U
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Description

【図面の簡単な説明】
第1図a,bおよび第2図a,bは本考案の一
実施例を示す平面構成図、第3図a,b第1図お
よび第2図の側面図、第4図a,bは従来例を示
す平面構成図、第4図cは第4図a,bの側面図
である。 8……第3の電極パターン、9,19……グラ
ンドパターン、70……第1の電極パターン、7
2……第2の電極パターン、A……基板、d
…一方のフレキシブルプリント板、d……他方
のフレキシブルプリント板。

Claims (1)

    【実用新案登録請求の範囲】
  1. 絶縁基板を中心の絶縁層とこの両側に層状に設
    けた外側の絶縁層とで構成し、この絶縁基板の両
    側の絶縁層のそれぞれの内側にグランドパターン
    を形成し、前記外側の絶縁層の一方の外側面を2
    つの領域に区分して各領域に所定の電極パターン
    を設けるとともに、外側の他方の絶縁層の外側面
    には全体的に連続した電極パターンを設け、前記
    両側絶縁層の外側面にそれぞれ形成された各電極
    パターンを直列接続したことを特徴とする分布定
    数型遅延素子。
JP6542287U 1987-04-30 1987-04-30 Pending JPS63173916U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP6542287U JPS63173916U (ja) 1987-04-30 1987-04-30

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Application Number Priority Date Filing Date Title
JP6542287U JPS63173916U (ja) 1987-04-30 1987-04-30

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Publication Number Publication Date
JPS63173916U true JPS63173916U (ja) 1988-11-11

Family

ID=30902479

Family Applications (1)

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JP6542287U Pending JPS63173916U (ja) 1987-04-30 1987-04-30

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JP (1) JPS63173916U (ja)

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