JPS63164730A - デ−タ伝送システム - Google Patents
デ−タ伝送システムInfo
- Publication number
- JPS63164730A JPS63164730A JP31210786A JP31210786A JPS63164730A JP S63164730 A JPS63164730 A JP S63164730A JP 31210786 A JP31210786 A JP 31210786A JP 31210786 A JP31210786 A JP 31210786A JP S63164730 A JPS63164730 A JP S63164730A
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- JP
- Japan
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- slave
- master
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- Granted
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- 230000005540 biological transmission Effects 0.000 title claims abstract description 39
- 238000001514 detection method Methods 0.000 claims abstract description 8
- 230000007257 malfunction Effects 0.000 abstract description 7
- 238000010586 diagram Methods 0.000 description 4
- 230000005856 abnormality Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 230000008054 signal transmission Effects 0.000 description 1
- 238000012795 verification Methods 0.000 description 1
Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、マスター側及びスレーブ側のそれぞれの入力
データをそれぞれ相手側へ送信するデータ伝送システム
に関する。
データをそれぞれ相手側へ送信するデータ伝送システム
に関する。
従来の技術
従来のデータ伝送システムを第２図を用いて説明する。
第２図は、従来のデータ伝送システムの一例を示すブロ
ック図の一部である。１はスイッチで、このスイッチ１
のオン・オフ状態をスレーブ側の入力データとして、こ
の入力データをスレーブ側エンコード部２でコード化す
る。このコード化データをスレーブ側送信部３を通して
マスター側受信部４へ送信する。このマスター側受信部
４ヤ受信されたデータは、マスター側デコード部６で解
読され、マスター側システムの制御に用いる制御データ
（本例では、電源１９に接続された負荷７を制御するト
ライアック８のゲート信号）を生成するマスター側制御
データ生成部６に送られる。
ック図の一部である。１はスイッチで、このスイッチ１
のオン・オフ状態をスレーブ側の入力データとして、こ
の入力データをスレーブ側エンコード部２でコード化す
る。このコード化データをスレーブ側送信部３を通して
マスター側受信部４へ送信する。このマスター側受信部
４ヤ受信されたデータは、マスター側デコード部６で解
読され、マスター側システムの制御に用いる制御データ
（本例では、電源１９に接続された負荷７を制御するト
ライアック８のゲート信号）を生成するマスター側制御
データ生成部６に送られる。
また一方、マスター側受信部４で受信されたデータは、
マスター側送信部９を通してスレーブ側受信部１０に返
送し、一致検出部１１において送信データと受信データ
の一致検出を行なう。
マスター側送信部９を通してスレーブ側受信部１０に返
送し、一致検出部１１において送信データと受信データ
の一致検出を行なう。
以上の構成によって一致検出時には、スレーブ側システ
ムＢの制御に用いる制御データ（本例では、電源２ｏに
接続されｆｃＬ Ｅ Ｄ １２を点滅させるトランジス
タ１３のベース信号。又、１４は電流制限用の抵抗であ
る。）を生成し、不一致検出時には、マスター側システ
ム人へマスター側システム人をリセットするリセット信
号を送信すると共に、スレーブ側システムＢの前記全ブ
ロックをリセットする。この様に返送照合方式を用いる
事によりマスター側システムムとスレーブ側システム８
間の伝送路１６の故障及びノイズによるデータの誤りが
検出できると共にスレーブ側システムＢから見れば一致
検出時には、マスター側システム人が正しい動作をして
いると判断できると共に、マスター側システム人の制御
データの生成と同期してスレーブ側システムＢの制御デ
ータを生成することができる。
ムＢの制御に用いる制御データ（本例では、電源２ｏに
接続されｆｃＬ Ｅ Ｄ １２を点滅させるトランジス
タ１３のベース信号。又、１４は電流制限用の抵抗であ
る。）を生成し、不一致検出時には、マスター側システ
ム人へマスター側システム人をリセットするリセット信
号を送信すると共に、スレーブ側システムＢの前記全ブ
ロックをリセットする。この様に返送照合方式を用いる
事によりマスター側システムムとスレーブ側システム８
間の伝送路１６の故障及びノイズによるデータの誤りが
検出できると共にスレーブ側システムＢから見れば一致
検出時には、マスター側システム人が正しい動作をして
いると判断できると共に、マスター側システム人の制御
データの生成と同期してスレーブ側システムＢの制御デ
ータを生成することができる。
発明が解決しようとする問題点
しかしながら、上記構成においては、マスター側システ
ムムの入力データをスレーブ側システムＢへ送信する場
合、伝送路におけるノイズ等によるデータの誤ｉチェッ
クするためには第１図のマスター側システムムとスレー
ブ側システムＢを全く入れかえたデータ伝送システムを
追加するか、片側の伝送路におけるノイズ等によるデー
タの誤りをチェックするためには少なくとも第３図のシ
ステムを追加する必要がある。すなわち、マスター側入
力データ（本例ではスイッチ１８のオン・オフ状Ｕ）を
コード化するマスター側エンコード部１６のデータをマ
スター側送信部９を通じ伝送路１６を介してスレーブ側
受信部に送られスレーブ側システムの制御データが生成
される。
ムムの入力データをスレーブ側システムＢへ送信する場
合、伝送路におけるノイズ等によるデータの誤ｉチェッ
クするためには第１図のマスター側システムムとスレー
ブ側システムＢを全く入れかえたデータ伝送システムを
追加するか、片側の伝送路におけるノイズ等によるデー
タの誤りをチェックするためには少なくとも第３図のシ
ステムを追加する必要がある。すなわち、マスター側入
力データ（本例ではスイッチ１８のオン・オフ状Ｕ）を
コード化するマスター側エンコード部１６のデータをマ
スター側送信部９を通じ伝送路１６を介してスレーブ側
受信部に送られスレーブ側システムの制御データが生成
される。
マタ、マスター側システム人のマスタｍ個テコード部５
及びマスター側制御データ生成部６とスレーブ側システ
ムＢのスレーブ側デコード部２及び一致検出部１１がそ
れぞれマイクロコンピュータ（以下マイコレと言う）を
中心として構成されている場合においては、マイコンの
暴走及び誤動作の検出が困難である。
及びマスター側制御データ生成部６とスレーブ側システ
ムＢのスレーブ側デコード部２及び一致検出部１１がそ
れぞれマイクロコンピュータ（以下マイコレと言う）を
中心として構成されている場合においては、マイコンの
暴走及び誤動作の検出が困難である。
以上の様に、従来のデータ伝送システムではスレーブ側
及びマスター側のそれぞれの入力データを相手側へ送信
し、各制御データの生成を同期をとって行なうには、３
本以上の伝送路を用いるか、一つの伝送路を時間的に分
割して送受信する等、非常に複雑なシステムとなる共に
、マスター側システム人及ヒスレーフ側システムＢのマ
イコンの暴走及び誤動作の検出が困難であるという欠点
を有していた。
及びマスター側のそれぞれの入力データを相手側へ送信
し、各制御データの生成を同期をとって行なうには、３
本以上の伝送路を用いるか、一つの伝送路を時間的に分
割して送受信する等、非常に複雑なシステムとなる共に
、マスター側システム人及ヒスレーフ側システムＢのマ
イコンの暴走及び誤動作の検出が困難であるという欠点
を有していた。
そこで本発明は、スレーブ側及びマスター側のそれぞれ
の入力データを相手側へ送信し、各制御データの生成を
同期して行なうと共にスレーブ側送信内容とスレーブ側
受信データの解読データの一致検出を行なうことによシ
暴走・誤動作のない信号伝送システムを提供するもので
ある。
の入力データを相手側へ送信し、各制御データの生成を
同期して行なうと共にスレーブ側送信内容とスレーブ側
受信データの解読データの一致検出を行なうことによシ
暴走・誤動作のない信号伝送システムを提供するもので
ある。
問題点を解決するための手段
そして前記問題点を解決する本発明の技術的な手段はマ
スター側デコード部による解読データから生成した返送
データを含むマスター側の入力データをコード化するマ
スター側エンコード部と、スレーブ側受信部で受信した
受信データを解読するスレーブ側デコード部を設け、こ
の解読結果とスレーブ側送信内容の一致検出を行なう一
致検出部で不一致検出時には、ヤスター側へマスター側
システムをリセットするリセット信号をスレーブ側送信
部を介して送ると共にスレーブ側の前記全ブロックをリ
セットするリセット部を備えたものである。
スター側デコード部による解読データから生成した返送
データを含むマスター側の入力データをコード化するマ
スター側エンコード部と、スレーブ側受信部で受信した
受信データを解読するスレーブ側デコード部を設け、こ
の解読結果とスレーブ側送信内容の一致検出を行なう一
致検出部で不一致検出時には、ヤスター側へマスター側
システムをリセットするリセット信号をスレーブ側送信
部を介して送ると共にスレーブ側の前記全ブロックをリ
セットするリセット部を備えたものである。
作用
この技術的手段による作用は次の様になる。
すなわち、スレーブ側受信部で受信データをスレーブ側
デコード部で解読し、この解読結果とスレープ側送信内
容の一致検出を行なうことによって、スレーブ側システ
ムの制御に用いる制御データの生成とマスター側システ
ムの制御に用いる制御データの生成との同期をとること
が可能となる１また、スレーブ側送信内容とスレーブ側
受信データの解読データの一致検出を行なう事によって
信号経路全体のチェックを行なう事ができ、異常時（不
一致検出時）には、これを認識でき伝送路におけるノイ
ズ等によるデータの誤り及びマスター側及びスレーブ側
システムのマイコンの暴走・誤動作が検出できデータ伝
送システム全体が暴走や誤動作を行なわない様に、スレ
ーブ側よりマスター側ヘリセット部からスレーブ側送信
部を介してリセット信号を送信すると共に、大レープ側
自身もリセット部からの信号で全ブロックをリセットす
ることができる。
デコード部で解読し、この解読結果とスレープ側送信内
容の一致検出を行なうことによって、スレーブ側システ
ムの制御に用いる制御データの生成とマスター側システ
ムの制御に用いる制御データの生成との同期をとること
が可能となる１また、スレーブ側送信内容とスレーブ側
受信データの解読データの一致検出を行なう事によって
信号経路全体のチェックを行なう事ができ、異常時（不
一致検出時）には、これを認識でき伝送路におけるノイ
ズ等によるデータの誤り及びマスター側及びスレーブ側
システムのマイコンの暴走・誤動作が検出できデータ伝
送システム全体が暴走や誤動作を行なわない様に、スレ
ーブ側よりマスター側ヘリセット部からスレーブ側送信
部を介してリセット信号を送信すると共に、大レープ側
自身もリセット部からの信号で全ブロックをリセットす
ることができる。
実施例
第１図は本発明のデータ伝送システムの一実施例を示す
ブロック図である。第１図において第２図、第３図と同
一物については同一番号を付与している０スイツチ１の
オン・オフ状態を入力データとしてスレーブ側エンコー
ド部２へ入力し、この入力データをコード化する。そし
てこのコード、 化データをスレーブ側送信部３及び
伝送路１６を介してマスター側受信部４へ送られる。マ
スター側受信部４で受信されたデータはマスター側デコ
ード部６で解読され、この解読データはマスター側制御
データ生成部６へ送られ負荷７の制御を行なうトライア
ック８０制御データが生成される。
ブロック図である。第１図において第２図、第３図と同
一物については同一番号を付与している０スイツチ１の
オン・オフ状態を入力データとしてスレーブ側エンコー
ド部２へ入力し、この入力データをコード化する。そし
てこのコード、 化データをスレーブ側送信部３及び
伝送路１６を介してマスター側受信部４へ送られる。マ
スター側受信部４で受信されたデータはマスター側デコ
ード部６で解読され、この解読データはマスター側制御
データ生成部６へ送られ負荷７の制御を行なうトライア
ック８０制御データが生成される。
また、マスター側デコード部６での解読データは、マス
ター側エンコード部１６へ送られ、前記解読データより
生成された返送データとスイッチ１８のオン・オフ状態
を入力データを含めてマスター側の送信データとしてコ
ード化される。このマスター側送信データはマスター側
送信部９と伝送路１６を介してスレーブ側受信部１ｏへ
送られる。
ター側エンコード部１６へ送られ、前記解読データより
生成された返送データとスイッチ１８のオン・オフ状態
を入力データを含めてマスター側の送信データとしてコ
ード化される。このマスター側送信データはマスター側
送信部９と伝送路１６を介してスレーブ側受信部１ｏへ
送られる。
スレーブ側受信部１０で受信されたデータはスレーブ側
デコード部１７へ送られ、ここで解読される。この解読
結果とスレーブ側送信内容であるスレーブ側エンコード
部２がらの信号を一致検出部１１で一致検出を行なう。
デコード部１７へ送られ、ここで解読される。この解読
結果とスレーブ側送信内容であるスレーブ側エンコード
部２がらの信号を一致検出部１１で一致検出を行なう。
そして、一致検出時、ＬＲＤ１２’ｚ抵抗１４を介して
点滅させるトランジスタ１３に対して、スレーブ側シス
テムＣの制御データであるベース信号を生成する。また
、不一致検出時には、スレーブ側送信部３よりマスター
側へマスター側ンステムＤｉリセットするリセット信号
をスレーブ側送信部３を介してリセット部２１より送信
すると共にスレーブ側システムＣの前記全ブロックをリ
セット部２１がらの信号でリセットする。
点滅させるトランジスタ１３に対して、スレーブ側シス
テムＣの制御データであるベース信号を生成する。また
、不一致検出時には、スレーブ側送信部３よりマスター
側へマスター側ンステムＤｉリセットするリセット信号
をスレーブ側送信部３を介してリセット部２１より送信
すると共にスレーブ側システムＣの前記全ブロックをリ
セット部２１がらの信号でリセットする。
発明の効果
この様にマスター側の解読データから生成した返送デー
タを含むマスター側の入力データをコード化するマスタ
ー側エンコード部と、スレーブ側受信部での受信データ
を解読するスレーブ側デコード部を設け、この解読結果
とスレーブ側送信内容の一致検出を行ない、一致検出時
にはスレーブ側システムの制御データを生成することに
より簡単なシステムでスレーブ側とマスター側の制御デ
ータの生成の同期を容易にとることができる０また伝送
路におけるノイズ等によるデータの誤りやマスター側及
ヒスレーフ側システムのマイコンの暴走及び誤動作時に
は不一致検出することとなり、リセット部を設けること
によりマスター側へマスター側システムをリセットする
リセット信号をスレーブ側出力部を介してリセット部よ
り送信すると共に、リセット部からの信号でスレーブ側
の前記全ブロックをリセットすることにより、スレーブ
側エンコード部、スレーブ側送信部、伝送路。
タを含むマスター側の入力データをコード化するマスタ
ー側エンコード部と、スレーブ側受信部での受信データ
を解読するスレーブ側デコード部を設け、この解読結果
とスレーブ側送信内容の一致検出を行ない、一致検出時
にはスレーブ側システムの制御データを生成することに
より簡単なシステムでスレーブ側とマスター側の制御デ
ータの生成の同期を容易にとることができる０また伝送
路におけるノイズ等によるデータの誤りやマスター側及
ヒスレーフ側システムのマイコンの暴走及び誤動作時に
は不一致検出することとなり、リセット部を設けること
によりマスター側へマスター側システムをリセットする
リセット信号をスレーブ側出力部を介してリセット部よ
り送信すると共に、リセット部からの信号でスレーブ側
の前記全ブロックをリセットすることにより、スレーブ
側エンコード部、スレーブ側送信部、伝送路。
ｆｆスター側受信部、マスター側テコード部、マスター
側エンコード部、マスター側送信部、スレーブ側受信部
、スレーブ側デコード部、一致検出部等の信号経路全体
のチェックを行なうことができ、不一致検出時等の異常
時には、これを認識でき、データ伝送システム全体の暴
走、誤動作を防止する仁とができる。即ち、マスター側
システムとスレーブ側システムの同期を確認しながら動
作する簡単で非常に信頼性の高いデータ伝送システムを
提供するものである。
側エンコード部、マスター側送信部、スレーブ側受信部
、スレーブ側デコード部、一致検出部等の信号経路全体
のチェックを行なうことができ、不一致検出時等の異常
時には、これを認識でき、データ伝送システム全体の暴
走、誤動作を防止する仁とができる。即ち、マスター側
システムとスレーブ側システムの同期を確認しながら動
作する簡単で非常に信頼性の高いデータ伝送システムを
提供するものである。
第１図は本発明の一実施例のデータ伝送システムのブロ
ック図、第２図及び第３図は従来のデータ伝送システム
のブロック図である０ ２・・・・・・スレーブ側エンコード部、３・・・・・
・スレーブ側送信部、４・・・・・・マスター側受信部
、６・・・・・・マスター側デコード部、６・・・・・
・マスター側制御データ生成部、９・・・・・・マスタ
ー側送信部、１０・・・・・・スレーブ側受信部、１１
・・・・・・一致検出部、１６・・・・・・マスター側
エンコード部、１７・・・・・・スレ−７’側７’コー
ド部、２１・・・・・・リセット部。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名口−
−−−一−−−−−−コ
ック図、第２図及び第３図は従来のデータ伝送システム
のブロック図である０ ２・・・・・・スレーブ側エンコード部、３・・・・・
・スレーブ側送信部、４・・・・・・マスター側受信部
、６・・・・・・マスター側デコード部、６・・・・・
・マスター側制御データ生成部、９・・・・・・マスタ
ー側送信部、１０・・・・・・スレーブ側受信部、１１
・・・・・・一致検出部、１６・・・・・・マスター側
エンコード部、１７・・・・・・スレ−７’側７’コー
ド部、２１・・・・・・リセット部。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名口−
−−−一−−−−−−コ
Claims (1)
- スレーブ側の入力データをコード化するスレーブ側エン
コード部と、このコード化データを送信するスレーブ側
送信部と、このデータを受信するマスター側受信部と、
この受信データを解読するマスター側デコード部とこの
解読データによりマスター側システムの制御に用いる制
御データを生成するマスター側制御データ生成部と、前
記解読データから生成した返送データを含むマスター側
の入力データをコード化するマスター側エンコード部と
、このコード化データをスレーブ側へ送信するマスター
側送信部と、この送信データを受信するスレーブ側受信
部と、この受信データを解読するスレーブ側デコード部
と、この解読結果とスレーブ側送信内容の一致検出を行
なう一致検出部とを有し、一致検出時には、スレーブ側
システムの制御に用いる制御データを生成し、不一致検
出時には、マスター側へマスター側システムをリセット
するリセット信号を送信をスレーブ側送信部を介して送
ると共にスレーブ側の前記全ブロックをリセットするリ
セット部を設けたデータ伝送システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61312107A JPH0716184B2 (ja) | 1986-12-26 | 1986-12-26 | デ−タ伝送システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61312107A JPH0716184B2 (ja) | 1986-12-26 | 1986-12-26 | デ−タ伝送システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63164730A true JPS63164730A (ja) | 1988-07-08 |
| JPH0716184B2 JPH0716184B2 (ja) | 1995-02-22 |
Family
ID=18025321
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61312107A Expired - Lifetime JPH0716184B2 (ja) | 1986-12-26 | 1986-12-26 | デ−タ伝送システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0716184B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP2869150A1 (de) * | 2013-10-31 | 2015-05-06 | Siemens Aktiengesellschaft | Anordnung zur seriellen Datenübertragung und Verfahren zum Betrieb |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5829238A (ja) * | 1981-08-14 | 1983-02-21 | Matsushita Electric Works Ltd | 伝送誤りデ−タ除去装置 |
| JPS5983430A (ja) * | 1982-11-05 | 1984-05-14 | Toshiba Corp | シリアル伝送回路 |
-
1986
- 1986-12-26 JP JP61312107A patent/JPH0716184B2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5829238A (ja) * | 1981-08-14 | 1983-02-21 | Matsushita Electric Works Ltd | 伝送誤りデ−タ除去装置 |
| JPS5983430A (ja) * | 1982-11-05 | 1984-05-14 | Toshiba Corp | シリアル伝送回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP2869150A1 (de) * | 2013-10-31 | 2015-05-06 | Siemens Aktiengesellschaft | Anordnung zur seriellen Datenübertragung und Verfahren zum Betrieb |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0716184B2 (ja) | 1995-02-22 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |