JPS63155510U - - Google Patents

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JPS63155510U
JPS63155510U JP4777787U JP4777787U JPS63155510U JP S63155510 U JPS63155510 U JP S63155510U JP 4777787 U JP4777787 U JP 4777787U JP 4777787 U JP4777787 U JP 4777787U JP S63155510 U JPS63155510 U JP S63155510U
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JP
Japan
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timer
data
zero cross
phase control
zero
Prior art date
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Pending
Application number
JP4777787U
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English (en)
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Publication date
Application filed filed Critical
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Publication of JPS63155510U publication Critical patent/JPS63155510U/ja
Pending legal-status Critical Current

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Landscapes

  • Control Of Voltage And Current In General (AREA)
  • Control Of Electrical Variables (AREA)

Description

【図面の簡単な説明】
第１図は本考案を示すブロツク図、第２図は本
考案を応用した複写機の一例を示す断面図、第３
図は同複写機の電気回路を示すブロツク図、第４
図は同電気回路における主制御ユニツトの概略動
作を示すフローチヤート、第５ａ〜第５ｃ図は同
電気回路におけるランプ・ヒータ・操作ボード制
御ユニツトの構成を示すブロツク図、第６ａ図〜
第６ｆ図は同ランプ・ヒータ・操作ボード制御ユ
ニツトのマイコン処理フローを示すフローチヤー
ト、第７図は従来装置と本考案を説明するための
図である。 １０１…トリガー信号をオフさせる手段、１０
２…タイマ、１０３…タイマにデータをセツトす
る手段。

Claims (1)

  1. 【実用新案登録請求の範囲】 １ 交流入力のゼロクロスをゼロクロス検出手段
    で検出してこのゼロクロス検出手段からのゼロク
    ロス信号により、負荷を制御するデータをタイマ
    にセツトし、該タイマをスタートさせて該タイマ
    が所定値になつた時に位相制御素子をトリガー信
    号でトリガーし、負荷に供給する電力を制御する
    デジタル位相制御装置において、上記トリガー信
    号を上記位相制御素子をトリガーするに十分な時
    間が経過した後にオフする手段と、上記ゼロクロ
    スの検出時には第１の制御データをタイマにセツ
    トし該タイマが上記所定値になつた時には第２の
    制御データを該タイマにセツトする手段とを有し
    、ゼロクロス信号の欠落時には上記第２の制御デ
    ータに基づいて制御することを特徴とするデジタ
    ル位相制御装置。 ２ ゼロクロス信号が所定時間連続して欠落した
    場合は強制的にタイマをストツプする手段を付加
    させたことを特徴とする実用新案登録請求の範囲
    第１項記載のデジタル位相制御装置。
JP4777787U 1987-03-31 1987-03-31 Pending JPS63155510U (ja)

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JP4777787U JPS63155510U (ja) 1987-03-31 1987-03-31

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Application Number Priority Date Filing Date Title
JP4777787U JPS63155510U (ja) 1987-03-31 1987-03-31

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JPS63155510U true JPS63155510U (ja) 1988-10-12

Family

ID=30868703

Family Applications (1)

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JP4777787U Pending JPS63155510U (ja) 1987-03-31 1987-03-31

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