JPS63130823U - - Google Patents

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JPS63130823U
JPS63130823U JP2332687U JP2332687U JPS63130823U JP S63130823 U JPS63130823 U JP S63130823U JP 2332687 U JP2332687 U JP 2332687U JP 2332687 U JP2332687 U JP 2332687U JP S63130823 U JPS63130823 U JP S63130823U
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JP
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power supply
memory
main power
voltage
certain value
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【図面の簡単な説明】
第１図ないし第５図は本考案に係るメモリーバ
ツクアツプ電源回路の具体的実施例を示し、第１
図は全体概略ブロツク回路構成図、第２図はその
詳細回路構成図、第３図はその各部における信号
波形のタイミングチヤートであり、第４図は別実
施例の詳細回路構成図、第５図はその要部におけ
る信号波形のタイミングチヤートである。そして
、第６図および第７図は、本考案の技術的背景な
らびに従来技術の問題点を説明するためのもので
あつて、夫々、従来構成のメモリーバツクアツプ
電源回路の回路構成図を示している。 Ｍ……メモリー、ＥＯ……主電源、Ｖ……主電
源ＥＯの電圧、ＶＯ……一定値（一定検出レベル
）、ＥＢ……バツクアツプ用電源、Ｘ……書き込
み禁止／許容手段。

Claims (1)

  1. 【実用新案登録請求の範囲】 メモリーに対する主電源の電圧が一定値よりも
    低下したときに、そのメモリーに対する供給電源
    を前記主電源からバツクアツプ用電源に可逆的に
    切り換えるように構成されているメモリーバツク
    アツプ電源回路において、 前記主電源の電圧が一定値よりも低下したとき
    には直ちに前記メモリーに対するデータの書き込
    みを禁止する一方、前記主電源の電圧が一定値以
    上に上昇したときにはその一定時間経過後に前記
    メモリーに対するデータの書き込みを許容する手
    段を設けてあることを特徴とするメモリーバツク
    アツプ電源回路。
JP2332687U 1987-02-18 1987-02-18 Pending JPS63130823U (ja)

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JP2332687U JPS63130823U (ja) 1987-02-18 1987-02-18

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JPS63130823U true JPS63130823U (ja) 1988-08-26

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6072012A (ja) * 1983-09-28 1985-04-24 Toshiba Corp メモリのバッテリバックアップ回路
JPS61122766A (ja) * 1984-11-20 1986-06-10 Oki Electric Ind Co Ltd メモリバツクアツプ用電源監視回路
JPS61283939A (ja) * 1985-06-11 1986-12-13 Nec Corp メモリ保護回路

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6072012A (ja) * 1983-09-28 1985-04-24 Toshiba Corp メモリのバッテリバックアップ回路
JPS61122766A (ja) * 1984-11-20 1986-06-10 Oki Electric Ind Co Ltd メモリバツクアツプ用電源監視回路
JPS61283939A (ja) * 1985-06-11 1986-12-13 Nec Corp メモリ保護回路

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