JPS63120426U - - Google Patents

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JPS63120426U
JPS63120426U JP1161187U JP1161187U JPS63120426U JP S63120426 U JPS63120426 U JP S63120426U JP 1161187 U JP1161187 U JP 1161187U JP 1161187 U JP1161187 U JP 1161187U JP S63120426 U JPS63120426 U JP S63120426U
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JP
Japan
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circuit
output signal
sample
conversion
input
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Description

【図面の簡単な説明】
第１図は、この考案の一実施例によるＡ／Ｄ変
換装置を示す構成図、第２図は従来のＡ／Ｄ変換
装置を示す構成図である。 図において、１は入力端子、２は第１のサンプ
ルホールド回路、３は第１のＡ／Ｄ変換回路、４
は第１のラツチ回路、５は上位ビツト出力端子、
６はＤ／Ａ変換回路、７は演算増幅回路、８は第
２のＡ／Ｄ変換回路、９は第２のラツチ回路、１
０は下位ピツト出力端子、１１はタイミング回路
、１２はアナログスイツチ回路、１３は第２のサ
ンプルホールド回路、１４はタイミング回路であ
る。 なお、各図中同一符号は同一、又は相当部分を
示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 外部装置から入力されるアナログ信号を入力と
    する第１のサンプルホールド回路と、上記第１の
    サンプルホールド回路の出力信号と、第２のサン
    プルホールド回路の出力信号とを切り換える２入
    力１出力のアナログスイツチ回路と、上記アナロ
    グスイツチ回路の出力信号を入力とするＡ／Ｄ変
    換回路と、上記Ａ／Ｄ変換回路の出力信号に接続
    した第１のラツチ回路と、上記Ａ／Ｄ変換回路の
    出力信号に接続した第２のラツチ回路と、上記Ａ
    ／Ｄ変換回路の出力信号を入力とするＤ／Ａ変換
    回路と、上記Ｄ／Ａ変換回路の出力信号を一方の
    入力端子に接続し、上記アナログスイツチ回路の
    出力信号をもう一方の入力端子に接続した演算増
    幅回路、上記演算増幅回路の出力信号を入力とし
    た上記第２のサンプルホールド回路と、上記第１
    のサンプルホールド回路と上記第２のサンプルホ
    ールド回路と上記サンプルホールド回路と上記ア
    ナログスイツチ回路と上記第１のラツチ回路と上
    記第２のラツチ回路にそれぞれ接続したタイミン
    グ回路を備えたＡ／Ｄ変換装置。
JP1161187U 1987-01-29 1987-01-29 Pending JPS63120426U (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0426229A (ja) * 1990-05-22 1992-01-29 Nec Corp 直並列型アナログ／ディジタル変換器
JP2002043941A (ja) * 2000-07-27 2002-02-08 Hamamatsu Photonics Kk Ａ／ｄ変換装置および固体撮像装置
JP2005109643A (ja) * 2003-09-29 2005-04-21 Fujio Kurokawa Ａ／ｄ変換回路、制御装置および絶縁型ａ／ｄ変換装置

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