JPS63114140A - 半導体製造方法 - Google Patents
半導体製造方法Info
- Publication number
- JPS63114140A JPS63114140A JP61260432A JP26043286A JPS63114140A JP S63114140 A JPS63114140 A JP S63114140A JP 61260432 A JP61260432 A JP 61260432A JP 26043286 A JP26043286 A JP 26043286A JP S63114140 A JPS63114140 A JP S63114140A
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- JP
- Japan
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- semiconductor
- voltage
- wafer
- capacitor
- probe
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- Pending
Links
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Landscapes
- Testing Of Individual Semiconductor Devices (AREA)
- Testing Or Measuring Of Semiconductors Or The Like (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
血粟上■肌工公立
本発明は、半導体ウェーハに形成した半導体素子の静?
1!耐圧を測定して素子の特性を選別する半導体製造方
法に関するものである。
1!耐圧を測定して素子の特性を選別する半導体製造方
法に関するものである。
皿米皇狡丘
半導体ウェーハの製造工程において不純物拡散工程を経
て半導体素子を形成した後、各半導体素子の特性がウェ
ーハ状態のままでチェックされる。上記特性チェックを
行うに際しては、第2図に示すように、半導体ウェーハ
(1)の素子形成面にプローブ(2)の測子を当ててウ
ェーハに給電し素子毎に特性をチェyりして、特性不良
の素子領域に傷(3)を付ける等して選別するようにし
ている。
て半導体素子を形成した後、各半導体素子の特性がウェ
ーハ状態のままでチェックされる。上記特性チェックを
行うに際しては、第2図に示すように、半導体ウェーハ
(1)の素子形成面にプローブ(2)の測子を当ててウ
ェーハに給電し素子毎に特性をチェyりして、特性不良
の素子領域に傷(3)を付ける等して選別するようにし
ている。
(°シよゝと る
ところで、上述したウェーハ状態における半導体素子の
特性チェックを行うに際し、素子に印加される電圧は最
大定格値程度の低電圧を印加するようにしている。その
ため、ユーザでの使用時に数100、数1000(V)
の静電気が加わったりすると、容易に静電破壊するもの
が出てくることがあった。
特性チェックを行うに際し、素子に印加される電圧は最
大定格値程度の低電圧を印加するようにしている。その
ため、ユーザでの使用時に数100、数1000(V)
の静電気が加わったりすると、容易に静電破壊するもの
が出てくることがあった。
口・占 1゛ るための
本発明は、半導体ウェーハに形成した半導体素子に対し
てペレット細分割前に最大定格以上の電圧を印加して静
電耐圧を測定し、上記素子の良否を判別するようにした
ことを特徴とする。
てペレット細分割前に最大定格以上の電圧を印加して静
電耐圧を測定し、上記素子の良否を判別するようにした
ことを特徴とする。
■
ウェーハ状態のままで半導体素子に最大定格以上の電圧
を印加して静電耐圧を測定し、静電破壊したものを除去
する。
を印加して静電耐圧を測定し、静電破壊したものを除去
する。
裏立皿
本発明に係る半導体製造方法を第1図を参照して以下説
明する0図において(4)は素子が形成されている半導
体ウェーハ、(5)は測定用プローブ、(C)はプロー
ブ(5)に接続されて半導体ウェーハ(4)に電圧を印
加するコンデンサ、(E)はコンデンサ(C)を充電す
る直流電源、(S)はコンデンサ(C)の充放電を切り
換えるスイッチ、例えば電子リレーである。
明する0図において(4)は素子が形成されている半導
体ウェーハ、(5)は測定用プローブ、(C)はプロー
ブ(5)に接続されて半導体ウェーハ(4)に電圧を印
加するコンデンサ、(E)はコンデンサ(C)を充電す
る直流電源、(S)はコンデンサ(C)の充放電を切り
換えるスイッチ、例えば電子リレーである。
上記構成に基づき本発明の動作を次に示す。
まず、スイッチ(S)を電源(E)側に切り換えてコン
デンサ(C)を充電する。この時、充電電圧は、半導体
ウェーハ(4)に形成されている素子の最大定格値以上
でなければならず、例えば最大定格値が数10(V)の
バイポーラICでは、Co−敗10〜1000 (p
F) 、Eo −100〜200(V)に設定される1
次に、半導体素子が形成された半導体ウェーハ(4)の
素子の全ビンと接地ビンにプローブ(5)を当てると共
にスイッチ(S)をプローブ(5)側に切り換えると、
コンデンサCC’lに放電しプローブ(5)を介してウ
ェーハ上の素子に瞬間的に電源(E)の電圧が加わる。
デンサ(C)を充電する。この時、充電電圧は、半導体
ウェーハ(4)に形成されている素子の最大定格値以上
でなければならず、例えば最大定格値が数10(V)の
バイポーラICでは、Co−敗10〜1000 (p
F) 、Eo −100〜200(V)に設定される1
次に、半導体素子が形成された半導体ウェーハ(4)の
素子の全ビンと接地ビンにプローブ(5)を当てると共
にスイッチ(S)をプローブ(5)側に切り換えると、
コンデンサCC’lに放電しプローブ(5)を介してウ
ェーハ上の素子に瞬間的に電源(E)の電圧が加わる。
上記コンデンサ(C)の充放電をウェーハの全素子につ
いて各素子毎に10回位繰り返すと、予め静電破壊し易
いものは破壊する。上記静電耐圧の測定は、半導体つ工
−ハの不純物拡散工程を経た半導体素子形成後で従来の
ウェーハ状態のままの特性チェックの前に行われ、この
段階で静電破壊したものに印をつけて区別を可能にして
おく。
いて各素子毎に10回位繰り返すと、予め静電破壊し易
いものは破壊する。上記静電耐圧の測定は、半導体つ工
−ハの不純物拡散工程を経た半導体素子形成後で従来の
ウェーハ状態のままの特性チェックの前に行われ、この
段階で静電破壊したものに印をつけて区別を可能にして
おく。
コンデンサ(C)の容量及び電源(E)の電圧は素子の
種類、例えばバイポーラICであるか、MO3ICであ
るかによって異なるため、予めこれらの値をパラメータ
として素子の!ii¥ji毎に好適値を設定しておく。
種類、例えばバイポーラICであるか、MO3ICであ
るかによって異なるため、予めこれらの値をパラメータ
として素子の!ii¥ji毎に好適値を設定しておく。
MO3ICではもともと静電耐圧が低いため保護用ダイ
オードが内蔵されているが、このダイオードの良、不良
が判別できる。
オードが内蔵されているが、このダイオードの良、不良
が判別できる。
光1Fと開展
本発明によれば、半導体ウェーハに形成した半導体素子
についてウェーハ状態のまま特性チェックを行う前に静
電耐圧を測定し素子の良否を判別するようにしたから、
静電耐圧が十分大きいものだけを利用することができる
。
についてウェーハ状態のまま特性チェックを行う前に静
電耐圧を測定し素子の良否を判別するようにしたから、
静電耐圧が十分大きいものだけを利用することができる
。
第1図は本発明による半導体素子の良否を判別する方法
を示す回路図、第2図は半導体ウェーハとその特性チェ
ック用プローブの斜視図である。 (4) −半導体ウェーハ、 (5)−測定用プローブ、 (C)・−・電圧印加用コンデンサ。 第1図
を示す回路図、第2図は半導体ウェーハとその特性チェ
ック用プローブの斜視図である。 (4) −半導体ウェーハ、 (5)−測定用プローブ、 (C)・−・電圧印加用コンデンサ。 第1図
Claims (1)
- (1)半導体ウェーハに形成した半導体素子に対しペレ
ット細分割前に最大定格以上の電圧を印加して静電耐圧
を測定し、上記素子の良否を判別するようにしたことを
特徴とする半導体製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61260432A JPS63114140A (ja) | 1986-10-30 | 1986-10-30 | 半導体製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61260432A JPS63114140A (ja) | 1986-10-30 | 1986-10-30 | 半導体製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63114140A true JPS63114140A (ja) | 1988-05-19 |
Family
ID=17347852
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61260432A Pending JPS63114140A (ja) | 1986-10-30 | 1986-10-30 | 半導体製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63114140A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2014175643A (ja) * | 2013-03-13 | 2014-09-22 | Sharp Corp | 半導体トランジスタのテスト方法 |
-
1986
- 1986-10-30 JP JP61260432A patent/JPS63114140A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2014175643A (ja) * | 2013-03-13 | 2014-09-22 | Sharp Corp | 半導体トランジスタのテスト方法 |
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