JPS63105572A - Resolution conversion device - Google Patents
Resolution conversion deviceInfo
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- JPS63105572A JPS63105572A JP61251107A JP25110786A JPS63105572A JP S63105572 A JPS63105572 A JP S63105572A JP 61251107 A JP61251107 A JP 61251107A JP 25110786 A JP25110786 A JP 25110786A JP S63105572 A JPS63105572 A JP S63105572A
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- counter
- address
- image
- output
- selector
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- 238000010586 diagram Methods 0.000 description 7
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- Storing Facsimile Image Data (AREA)
- Editing Of Facsimile Originals (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、ディジタル画像の解像度を実時間で変換する
解像度変換装置に関する。DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a resolution conversion device for converting the resolution of a digital image in real time.
従来の技術
従来、この種の解像度変換装置は第4図に示すように、
画像メモリ11に蓄積された原画像のディジタルデータ
は、拡大縮小回路12により縦横の解像度が変換されて
拡大又は縮小され、拡大縮小回路12からの画像データ
がバッファメモリ13によリ一時的に格納され、バッフ
ァメモリ13の画像データが、トクトクロノクでアドレ
スカウンタ14により指定されるアドレスにより、シー
ケンシャルな画像信号として出力されるように構成され
ている。BACKGROUND OF THE INVENTION Conventionally, this type of resolution conversion device has been used as shown in FIG.
The digital data of the original image stored in the image memory 11 is enlarged or reduced by converting the vertical and horizontal resolution by the enlarging/reducing circuit 12, and the image data from the enlarging/reducing circuit 12 is temporarily stored in the buffer memory 13. The image data in the buffer memory 13 is configured to be outputted as a sequential image signal according to the address specified by the address counter 14 on a clockwise basis.
発明が解決しようとする問題点
しかしながら、かかる構成にあっては、画像メモリ11
のデータを読み出して拡大又は縮小し、・・ノファメモ
リ13により一時蓄積した後パラレル−シリアル変換す
るために、画像メモリ11のディジタル画像の解像度を
実時間で変換することができないという問題点がある。Problems to be Solved by the Invention However, in such a configuration, the image memory 11
The problem is that the resolution of the digital image in the image memory 11 cannot be converted in real time because the data is read out, enlarged or reduced, temporarily stored in the Nofa memory 13, and then converted from parallel to serial.
本発明は上記問題点に鑑み、実時間でディジタル画像の
解像度を変換することができる解像度変換装置を提供す
ることを目的とする。SUMMARY OF THE INVENTION In view of the above problems, it is an object of the present invention to provide a resolution conversion device that can convert the resolution of a digital image in real time.
問題点を解決するための手段
本発明は上記問題点を解決するために、画像メモリに記
憶された画像データを画素毎に繰り返して読み出すよう
に構成したことを特徴とする。Means for Solving the Problems In order to solve the above problems, the present invention is characterized in that the image data stored in the image memory is repeatedly read out for each pixel.
作 用
本発明は上記構成により、画像メモリの画像データの各
画素が繰り返して読み出すために、実時間でディジタル
画像の解像度を変換することができる。Operation According to the present invention, the resolution of a digital image can be converted in real time because each pixel of image data in the image memory is repeatedly read out with the above-described configuration.
実施例
以下1図面を参照して本発明の詳細な説明する。第1図
は1本発明に係る解像度変換装置の一実施例を示すブロ
ック図、第2図は、第1図のアドレスカウンタ及びセレ
クタの動作説明図、第3図は、画像データの解像度変換
を示す説明図である。EXAMPLES The present invention will be described in detail below with reference to one drawing. FIG. 1 is a block diagram showing an embodiment of the resolution conversion device according to the present invention, FIG. 2 is an explanatory diagram of the operation of the address counter and selector in FIG. 1, and FIG. FIG.
第1図において、1は、後述する画像メモリ5に記憶さ
れた画像データの主走査方向をX倍に拡大するためにト
ッドクロックをX分周するX進カウンタ、2は、X進カ
ウンタ1からのクロックにより画像の主走査方向(ドツ
ト数N)の位置を指定するためのドツトカウンタであり
、トットカウ/り2はN進カウンタである。In FIG. 1, 1 is an X-ary counter that divides the tod clock by X in order to enlarge the main scanning direction of image data stored in the image memory 5, which will be described later, by X times, and 2 is an X-ary counter 1. This is a dot counter for specifying the position of the image in the main scanning direction (the number of dots N) using the clock, and the tot counter/2 is an N-ary counter.
才た、31.32・・・3.はそれぞれ、画像メモリ5
の画像データの副走査方向をy倍に拡大するために画像
メモリ5のアドレスを指定するためのアドレスカウンタ
、4は、アドレスカウンタ31.3□・・・3.の出力
を選択するセレクタ、5は、原画像のディジタルデータ
が蓄積された画像メモリである。Saita, 31.32...3. are respectively image memory 5
An address counter 4 designates an address in the image memory 5 for enlarging the image data in the sub-scanning direction by y times. Address counters 31.3□...3. A selector 5 for selecting the output of is an image memory in which digital data of the original image is stored.
次に、上記構成に係る実施例の動作を、画像メモリ6の
画像データの主走査方向のドツト数Nが16個であって
横(主走査方向)及び縦(副走査方向)をそれぞれ2倍
に拡大する場合を例にして説明する。この場合、X進カ
ウンタ1は2進カウンタ、ドツトカウンタ2は16進カ
ウンタ、アドレスカウンタ3】、32・・・3.は2個
である。Next, the operation of the embodiment according to the above configuration will be explained when the number N of dots in the main scanning direction of the image data in the image memory 6 is 16, and the horizontal (main scanning direction) and vertical (sub scanning direction) are each doubled. An example will be explained in which the image is enlarged to . In this case, the X-ary counter 1 is a binary counter, the dot counter 2 is a hexadecimal counter, and the address counters 3], 32...3 . is 2 pieces.
上記例の構成において、トノ]・クロックは2進のカウ
ンタ1により2分周され、2分周されたクロックは16
進のドツトカウンタ2.第1のアドレスカウンタ3Iを
介してセレクタ4に出力され、セレクタ4により第1の
アドレスカウンタ31の出力が選択されて、画像メモリ
5の画像データの最初のラインのアドレスを指定スる。In the configuration of the above example, the clock is divided by two by the binary counter 1, and the clock divided by two is 16
Dot counter 2. The output is output to the selector 4 via the first address counter 3I, and the selector 4 selects the output of the first address counter 31 to designate the address of the first line of image data in the image memory 5.
トッドクロックは2分周されているために、画像メモリ
5の画像データの最初のラインのデータは、同一アドレ
スのデータが2ドツ]・ずつ繰り返して出力され、した
がって主走査方向が2倍に拡大される。Since the tod clock is divided by 2, the first line of image data in the image memory 5 is repeatedly output as 2 dots of data at the same address, and therefore the main scanning direction is doubled. be done.
次いで、ドツトカウンタ2が2分周されたクロックを1
6個カウントするとりセットされ、2分周されたクロッ
クが第2のアドレスカウンタ32に出力され、セレクタ
4により第2のアI・レスカウンタ32の出力が選択さ
れて、画像メモリ6の画像データの最初のラインのアド
レスを再度指定する。Next, dot counter 2 divides the frequency divided by 2 into 1.
The clock is set to count 6, and the frequency divided by 2 is output to the second address counter 32. The selector 4 selects the output of the second AI/res counter 32, and the image data in the image memory 6 is output. Specify the address of the first line again.
したがって、第2図に示すように、画像メモリ6の画像
データの最初のラインのデータが同様に、2ドツトずつ
繰り返して出力され、したがって副走査方向が2倍に拡
大される。Therefore, as shown in FIG. 2, the data of the first line of image data in the image memory 6 is similarly output repeatedly two dots at a time, so that the sub-scanning direction is doubled.
次に、画像メモリ5の第2のライン以降の画像データが
同様に、主走査方向及び副走査方向共2個ずつ繰り返し
て読み出され、シーケンシャルな画信号として出力され
る。Next, the image data of the second line and subsequent lines of the image memory 5 are similarly read out repeatedly two by two in both the main scanning direction and the sub-scanning direction, and are output as sequential image signals.
したがって、第3図に示すように、画像メモリ6の縦横
2×2の4画素a、b、c、dはそれぞれ、縦横4×4
の16画素(の同一画素)に拡大される。Therefore, as shown in FIG. 3, the four pixels a, b, c, and d of the image memory 6 are
is enlarged to 16 pixels (the same pixels).
以上説明したように、上記実施例によれば、ドツトクロ
JりをX分周することにより主走査方向をX倍に拡大す
ることができ、またアドレスカウンタ3I、32・・・
3.を選択して同一ラインをy回繰り返して読み出すこ
とにより副走査方向をy倍に拡大することができる。As explained above, according to the above embodiment, the main scanning direction can be expanded by a factor of X by dividing the dot black by X, and the address counters 3I, 32, . . .
3. By selecting and reading the same line y times repeatedly, the sub-scanning direction can be enlarged by y times.
発明の詳細
な説明したように、本発明は、画像メモリに記憶された
画像データを画素毎に繰り返して読み出すように構成し
たので、実時間でディジタル画像の解像度を変換するこ
とができる。DETAILED DESCRIPTION OF THE INVENTION As described in detail, the present invention is configured to read out image data stored in an image memory repeatedly for each pixel, so that the resolution of a digital image can be converted in real time.
第1図は、本発明に係る解像度変換装置の一実施例を示
すブロック図、第2図は、第1図のアドレスカウンタ及
びセレクタの動作説明図、第3図は、画像データの解像
度変換を示す説明図、第4図は、従来例を示すブロック
図である。
1・・・N進カウンタ、2・・・ドツトカウンタ、31
.32・・・3.・・アドレスカウンタ、4・・・セレ
クタ、5・・・画像メモリ。
第1図
第2図
v*c、wつJ(3r)2151515− 15EマQ
3/]/・−・7障つウyズ−+2) 000 ・・
Oレフ】口==】口151515・・・I5「[乙石=
=□主鷹奮方向 回FIG. 1 is a block diagram showing an embodiment of the resolution conversion device according to the present invention, FIG. 2 is an explanatory diagram of the operation of the address counter and selector shown in FIG. 1, and FIG. 3 is a diagram showing resolution conversion of image data. The explanatory diagram shown in FIG. 4 is a block diagram showing a conventional example. 1... N-ary counter, 2... Dot counter, 31
.. 32...3. ...Address counter, 4...Selector, 5...Image memory. Figure 1 Figure 2 v * c, w J (3r) 2151515- 15E MaQ
3/]/・-・7 Obstacle Whis-+2) 000 ・・
O Ref] Mouth==] Mouth 151515...I5 "[Otsuishi=
=□Main direction times
Claims (1)
て読み出すことを特徴とする解像度変換装置。A resolution conversion device characterized in that image data stored in an image memory is repeatedly read out for each pixel.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61251107A JPS63105572A (en) | 1986-10-22 | 1986-10-22 | Resolution conversion device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61251107A JPS63105572A (en) | 1986-10-22 | 1986-10-22 | Resolution conversion device |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63105572A true JPS63105572A (en) | 1988-05-10 |
Family
ID=17217750
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61251107A Pending JPS63105572A (en) | 1986-10-22 | 1986-10-22 | Resolution conversion device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63105572A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH054381A (en) * | 1990-11-26 | 1993-01-14 | Sharp Corp | Image recording device |
JP2017027082A (en) * | 2005-03-31 | 2017-02-02 | 株式会社半導体エネルギー研究所 | Display device |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5451423A (en) * | 1977-09-30 | 1979-04-23 | Toshiba Corp | Picture display unit |
JPS6067990A (en) * | 1983-09-24 | 1985-04-18 | 富士通株式会社 | Picture information processor having density converting function |
JPS6326070A (en) * | 1986-07-17 | 1988-02-03 | Fuji Xerox Co Ltd | Picture processor |
-
1986
- 1986-10-22 JP JP61251107A patent/JPS63105572A/en active Pending
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS6326070A (en) * | 1986-07-17 | 1988-02-03 | Fuji Xerox Co Ltd | Picture processor |
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JP2017027082A (en) * | 2005-03-31 | 2017-02-02 | 株式会社半導体エネルギー研究所 | Display device |
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