JPS6294019A - スイッチング回路 - Google Patents
スイッチング回路Info
- Publication number
- JPS6294019A JPS6294019A JP60233439A JP23343985A JPS6294019A JP S6294019 A JPS6294019 A JP S6294019A JP 60233439 A JP60233439 A JP 60233439A JP 23343985 A JP23343985 A JP 23343985A JP S6294019 A JPS6294019 A JP S6294019A
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- JP
- Japan
- Prior art keywords
- current
- output
- transistor
- base
- constant
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/60—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors
- H03K17/615—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors in a Darlington configuration
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- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（以下、余白）
３、発明の＋ｉｌ細な説明
［ｌｒ業にの利用分野］
禾ｉ；？５明は、入力信号に応じて出７Ｊ ｌ−ランシ
ス々の導通、し、や断を制御するスイ・ノヂング回路に
関するものである。
ス々の導通、し、や断を制御するスイ・ノヂング回路に
関するものである。
［従来の技術１
従来のスイッチング回路の一例を第３図に）Ｔ＼す。こ
こで、定電流源Ｃ５を制御する入力トランジスタＱｌは
、その人力信号Ｖｉｎの大Ｓさににじて、出力トランジ
スタＱ２の開閉を制御している。今、入力信号Ｖｉｎが
ローレベルであるとすると、出力トランジスタＱ２は導
通し、出力電流■０が流れている。
こで、定電流源Ｃ５を制御する入力トランジスタＱｌは
、その人力信号Ｖｉｎの大Ｓさににじて、出力トランジ
スタＱ２の開閉を制御している。今、入力信号Ｖｉｎが
ローレベルであるとすると、出力トランジスタＱ２は導
通し、出力電流■０が流れている。
一般に、 ｌ−ランジスタのコレ′アタ電ｆ！、Ｉｃ
が大きくなると、第４図にイ＼ずように、コし・行々・
Ｊ−ミンク間の飽和電圧訃９（ｓａｔ）も増えてい（。
が大きくなると、第４図にイ＼ずように、コし・行々・
Ｊ−ミンク間の飽和電圧訃９（ｓａｔ）も増えてい（。
従って、第３図の回路においで、出力電流■０が小さい
ときには、出力トランジスタＱ２のコレクタに現われる
出力１１を圧Ｖｏは低く、］・千二′パ、パスタＱ３の
みが導通して、１・丑〉・・ゾスタＱ４はシ、２壱断状
態にある６従って、この時の出力トランジスタＱ２のベ
ース電流Ｉｓは、定電流源Ｃ８から取り出され、トラン
ジスタＱ３より供給される定電流■１だけとなる。
ときには、出力トランジスタＱ２のコレクタに現われる
出力１１を圧Ｖｏは低く、］・千二′パ、パスタＱ３の
みが導通して、１・丑〉・・ゾスタＱ４はシ、２壱断状
態にある６従って、この時の出力トランジスタＱ２のベ
ース電流Ｉｓは、定電流源Ｃ８から取り出され、トラン
ジスタＱ３より供給される定電流■１だけとなる。
次に、出力電流Ｉｏが大きくなってくると、トランジス
タＱ２の電流増幅率には制限があるため、ベース電流Ｉ
Ｂが定電流■１だけでは出力電流ＩＯを流し切れなくな
ってくる。その時、出力電圧Ｖ。
タＱ２の電流増幅率には制限があるため、ベース電流Ｉ
Ｂが定電流■１だけでは出力電流ＩＯを流し切れなくな
ってくる。その時、出力電圧Ｖ。
は−［−昇してくるので、トランジスタＱ４が導通し、
ペース電１ｉＩｓがトランジスタＱ４からも供給され１
出力電流■０に対して適当なベース電流となったところ
で出力電圧ｖＯは一定値に落ち着く。
ペース電１ｉＩｓがトランジスタＱ４からも供給され１
出力電流■０に対して適当なベース電流となったところ
で出力電圧ｖＯは一定値に落ち着く。
以上の動作を、出力電流■０に対する回路の消費電流Ｉ
ｃｅの関係で示すと、第５図のようになる。
ｃｅの関係で示すと、第５図のようになる。
すなわち、このスイッチング回路は、出力電流が小さい
時には、無駄な消費電流を省き、出力電流が大きくなっ
て行くにつれて消費電流を増やして行こうとするもので
あった。
時には、無駄な消費電流を省き、出力電流が大きくなっ
て行くにつれて消費電流を増やして行こうとするもので
あった。
ところが、このスイッチング回路においては、第５図に
示すように、出力電流ＩＯが増加するのにつれて消費電
流１ｃｃも増加してしまい、１．たがって、低消費電流
化に相反するという欠ｃ、旬があった。
示すように、出力電流ＩＯが増加するのにつれて消費電
流１ｃｃも増加してしまい、１．たがって、低消費電流
化に相反するという欠ｃ、旬があった。
［発明が解決しようとする問題点コ
そこで、本発明の目的は、上述の欠点を除去し、出力電
流が増加しても消費電流は増加することなく略々一定に
保たれるように構成したスイッチング回路を提供するこ
とにある。
流が増加しても消費電流は増加することなく略々一定に
保たれるように構成したスイッチング回路を提供するこ
とにある。
［問題点を解決するための手段］
このような目的を達成するために、本発明は、定電流源
を制御する入力トランジスタと、出力トランジスタと、
ダーリントン接続されたトランジスタとを具え、ダーリ
ントン接続されたｉ・ランジスタのコレクタに相当する
部分を出力トランジスタのコレクタに接続し、ダーリン
トン接続されたトランジスタのベースに相当する部分を
定電流源に接続し、ダーリントン接続されたトランジス
タのエミッタに相当する部分を出力トランジスタのベー
スに接続したことを特徴とする。
を制御する入力トランジスタと、出力トランジスタと、
ダーリントン接続されたトランジスタとを具え、ダーリ
ントン接続されたｉ・ランジスタのコレクタに相当する
部分を出力トランジスタのコレクタに接続し、ダーリン
トン接続されたトランジスタのベースに相当する部分を
定電流源に接続し、ダーリントン接続されたトランジス
タのエミッタに相当する部分を出力トランジスタのベー
スに接続したことを特徴とする。
［作用］
未発明によれば、入力トランジスタと出力トランジスタ
との間にダーリントン接続トランジスタを配否すること
により、出力トランジスタに対するベース電流を、定電
流源にのみ頼ることなく、負荷電流からも供給するよう
に構成したので、出力電流の大きさが変化しても消費電
流は略々一定に保たれ、以て出力電流が増大しても低消
費電力化を達成できる。
との間にダーリントン接続トランジスタを配否すること
により、出力トランジスタに対するベース電流を、定電
流源にのみ頼ることなく、負荷電流からも供給するよう
に構成したので、出力電流の大きさが変化しても消費電
流は略々一定に保たれ、以て出力電流が増大しても低消
費電力化を達成できる。
［実施例コ
以下に、図面を参照して本発明の詳細な説明する。
本発明の一実施例を第１図に示す、ここで、第３図示の
従来回路と同様の機能部分については同一の記号を付し
である。第１図の回路における第３図の回路との相違点
は、トランジスタＱ３およびＱ４を取り除き、ダーリン
トン接続のトランジスタＱ５およびＱ６を設けた点であ
る。すなわち、トランジスタ Ｑ５のエミッタを出力ト
ランジスタＱ２のコレクタに、同ベースをトランジスタ
Ｑ６のコレクタにおよび同コレクタを出力トランジスタ
Ｑ２のベースに接続し、トランジスタ Ｑ６のベース
を入力トランジスタＱ１のコレクタに、同エミッタを出
力トランジスタＱ２のベースに接お°ｄする。
従来回路と同様の機能部分については同一の記号を付し
である。第１図の回路における第３図の回路との相違点
は、トランジスタＱ３およびＱ４を取り除き、ダーリン
トン接続のトランジスタＱ５およびＱ６を設けた点であ
る。すなわち、トランジスタ Ｑ５のエミッタを出力ト
ランジスタＱ２のコレクタに、同ベースをトランジスタ
Ｑ６のコレクタにおよび同コレクタを出力トランジスタ
Ｑ２のベースに接続し、トランジスタ Ｑ６のベース
を入力トランジスタＱ１のコレクタに、同エミッタを出
力トランジスタＱ２のベースに接お°ｄする。
次に、第１図の回路の動作原理について説明する。
出力電流ＩＯが小さいときには、トランジスタＱ８のベ
ースに定電流源Ｃ５からの定電流■１が流れ、これによ
り出力トランジスタＱ２に対してベース電流１Ｂを供給
することになる。一方、出力電流Ｉｏが大きくなってく
ると、出力トランジスタＱ２の飽和電圧が上昇し、トラ
ンジスタＱ５が導通することになる。
ースに定電流源Ｃ５からの定電流■１が流れ、これによ
り出力トランジスタＱ２に対してベース電流１Ｂを供給
することになる。一方、出力電流Ｉｏが大きくなってく
ると、出力トランジスタＱ２の飽和電圧が上昇し、トラ
ンジスタＱ５が導通することになる。
従って、この第１図示のスイッチング回路においては、
出力電流■０が大きくなったときには、出力トランジス
タＱ２に対するベース電流が、導通状態のトランジスタ
Ｑ５により負荷電流Ｉｏからも供給されるので、第２図
に示すように、消費電流Ｉｃｅは略々一定であり、出力
電流ｌＯの大きさに拘わらず一定となり、以て低消費電
流化を達成できる。
出力電流■０が大きくなったときには、出力トランジス
タＱ２に対するベース電流が、導通状態のトランジスタ
Ｑ５により負荷電流Ｉｏからも供給されるので、第２図
に示すように、消費電流Ｉｃｅは略々一定であり、出力
電流ｌＯの大きさに拘わらず一定となり、以て低消費電
流化を達成できる。
「発明の効果］
以Ｊ二から明らかなように、未発明によれば、入力トラ
ンジスタと出力トランジスタとの間にダーリントン接続
トランジスタを配置することにより、出力トランジスタ
に対するベース電流を、定電流源にのみ頼ることなく、
負荷電流からも供給するように構成したので、出力電流
の大きさが変化しても消費′ｒＬ流は略々一定に保たれ
、以て出力電流が増大しても低消費電力化を達成できる
。
ンジスタと出力トランジスタとの間にダーリントン接続
トランジスタを配置することにより、出力トランジスタ
に対するベース電流を、定電流源にのみ頼ることなく、
負荷電流からも供給するように構成したので、出力電流
の大きさが変化しても消費′ｒＬ流は略々一定に保たれ
、以て出力電流が増大しても低消費電力化を達成できる
。
第１図は本発明の一実施例を示す回路図、第２図はその
出力電流特性図。 第３図は従来のスイッチング回路の一例を示す回路図、 第４図はトランジスタのＩ ｃ −ＶｃＧ（＃ｆ）特性
図、第５図は従来の出力電流特性図である。 Ｑｌ・・・入力トランジスタ、 Ｑ２・・・出力トランジスタ、 Ｑ５．Ｑｆ３・・・ダーリントン接続トランジスタ。 ＣＳ・・・定゛市流源。 ７１−昼明芙柵今Ｊの■訃１コ 斗布ε日１・ゐＩ↑さ出力室ンへ持↑主図第２図 出ｆｙｅシｈ■。 ９カー≠１のＪニプフ１にン清〒、１−１＋コ＝５第５
図
出力電流特性図。 第３図は従来のスイッチング回路の一例を示す回路図、 第４図はトランジスタのＩ ｃ −ＶｃＧ（＃ｆ）特性
図、第５図は従来の出力電流特性図である。 Ｑｌ・・・入力トランジスタ、 Ｑ２・・・出力トランジスタ、 Ｑ５．Ｑｆ３・・・ダーリントン接続トランジスタ。 ＣＳ・・・定゛市流源。 ７１−昼明芙柵今Ｊの■訃１コ 斗布ε日１・ゐＩ↑さ出力室ンへ持↑主図第２図 出ｆｙｅシｈ■。 ９カー≠１のＪニプフ１にン清〒、１−１＋コ＝５第５
図
Claims (1)
- 定電流源を制御する入力トランジスタと、出力トランジ
スタと、ダーリントン接続されたトランジスタとを具え
、該ダーリントン接続されたトランジスタのコレクタに
相当する部分を前記出力トランジスタのコレクタに接続
し、前記ダーリントン接続されたトランジスタのベース
に相当する部分を前記定電流源に接続し、前記ダーリン
トン接続されたトランジスタのエミッタに相当する部分
を前記出力トランジスタのベースに接続したことを特徴
とするスイッチング回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60233439A JPS6294019A (ja) | 1985-10-21 | 1985-10-21 | スイッチング回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60233439A JPS6294019A (ja) | 1985-10-21 | 1985-10-21 | スイッチング回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6294019A true JPS6294019A (ja) | 1987-04-30 |
| JPH0476537B2 JPH0476537B2 (ja) | 1992-12-03 |
Family
ID=16955058
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60233439A Granted JPS6294019A (ja) | 1985-10-21 | 1985-10-21 | スイッチング回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6294019A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58500922A (ja) * | 1981-06-15 | 1983-06-02 | ロ−ベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング | ダーリントントランジスタ回路 |
-
1985
- 1985-10-21 JP JP60233439A patent/JPS6294019A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58500922A (ja) * | 1981-06-15 | 1983-06-02 | ロ−ベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング | ダーリントントランジスタ回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0476537B2 (ja) | 1992-12-03 |
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