JPS626774Y2 - - Google Patents

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JPS626774Y2
JPS626774Y2 JP1978154916U JP15491678U JPS626774Y2 JP S626774 Y2 JPS626774 Y2 JP S626774Y2 JP 1978154916 U JP1978154916 U JP 1978154916U JP 15491678 U JP15491678 U JP 15491678U JP S626774 Y2 JPS626774 Y2 JP S626774Y2
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resistor
diode
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diodes
signal
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  • Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
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Description

【考案の詳細な説明】 本考案は例えばVTR(ビデオテープレコー
ダ)の再生信号中に含まれるノイズ成分を除去す
るのに用いられるダイオードスライス回路に関す
る。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a diode slicing circuit used to remove noise components contained in a reproduced signal of a VTR (video tape recorder), for example.

第1図は、従来のノイズ除去回路を示す。入力
端子1には、VTRの再生信号が復調されてなる
ビデオ信号S1が供給される。ビデオ信号S1には、
第2図Aに示すようにノイズ成分が含まれてい
る。ビデオ信号S1がローパスフイルタ2及びハイ
パスフイルタ3に供給され、ローパスフイルタ2
からは、第2図Bに示すようにノイズ成分を含ま
ず且つなまつた波形の信号S2が発生し、ハイパス
フイルタ3からは、同図Cに示すようにレベル変
化の急激な部分で生じたオーバーシユート及びア
ンダーシユートにノイズ成分が重畳した信号S3
発生する。この信号S3が破線で囲んで示すダイオ
ードスライス回路4に供給されることによつて、
0〔V〕を中心とする±Vfの範囲を越えるレベ
ルの信号S3′のみがダイオードスライス回路4か
ら取り出される。この信号S3′はノイズ成分を含
まず、加算器5により信号S2及びS3′を加算する
ことにより、出力端子6に第2図Dに示すように
ノイズ成分の除去されたビデオ信号S4を得ること
ができる。
FIG. 1 shows a conventional noise removal circuit. The input terminal 1 is supplied with a video signal S1 obtained by demodulating a reproduced signal from a VTR. Video signal S 1 has
As shown in FIG. 2A, noise components are included. The video signal S1 is supplied to a low pass filter 2 and a high pass filter 3, and the low pass filter 2
As shown in Figure 2B, a signal S2 with a rounded waveform and no noise component is generated from the high-pass filter 3, and as shown in Figure 2C, a signal S2 is generated at a rapid level change portion. A signal S3 is generated in which a noise component is superimposed on the overshoot and undershoot. By supplying this signal S3 to the diode slice circuit 4 shown surrounded by a broken line,
Only the signal S 3 ' with a level exceeding the range of ±Vf centered on 0 [V] is taken out from the diode slice circuit 4. This signal S 3 ′ does not contain any noise components, and by adding the signals S 2 and S 3 ′ by the adder 5, the video signal S 3 from which the noise components have been removed is output to the output terminal 6 as shown in FIG. 2D. You can get 4 .

ダイオードスライス回路4は、互いに逆方向に
接続された2個のダイオード7a,7bと、コン
デンサ8,9と、抵抗器10とで構成されてお
り、スライスレベル±VfのVfは、ダイオード7
a,7bの順方向電圧降下であり、シリコンダイ
オードの場合で0.7〔V〕、シヨツトキーダイオー
ドの場合で0.4〔V〕程度である。ところで、上
述のようなノイズ除去回路において、単にノイズ
成分を除くことだけを考えれば、ダイオードスラ
イス回路4のスライスレベルが大きくても良い
が、その結果、失なわれるビデオ信号の高域成分
が大きくなり、得られる出力ビデオ信号S4の波形
が原波形と異なつてしまう。このような考慮に基
いて定められたスライスレベルが−26〔dB〕前
後であるとすると、シリコンダイオードを用いた
場合には、ダイオードスライス回路4に対する入
力ビデオ信号のレベルを±Vf×20=±14V=28
〔Vp-p〕のように大きくしなければならず、シヨ
ツトキーダイオードを用いた場合でも、入力ビデ
オ信号を16〔Vp-p〕のように大きくしなければ
ならない。しかし、このような大レベルの信号を
扱うことは、電源として高い電圧のものを使用し
なければならず、特にIC化する場合では、実現
が困難である。
The diode slice circuit 4 includes two diodes 7a and 7b connected in opposite directions, capacitors 8 and 9, and a resistor 10.
This is the forward voltage drop between a and 7b, which is approximately 0.7 [V] in the case of a silicon diode and 0.4 [V] in the case of a Schottky diode. By the way, in the above-described noise removal circuit, the slice level of the diode slice circuit 4 may be large if only the noise components are removed, but as a result, the high-frequency components of the video signal that are lost are large. As a result, the waveform of the resulting output video signal S4 differs from the original waveform. Assuming that the slice level determined based on such considerations is around -26 [dB], when silicon diodes are used, the level of the input video signal to the diode slice circuit 4 is ±Vf × 20 = ± 14V=28
[V pp ], and even if a Schottky diode is used, the input video signal must be as large as 16 [V pp ]. However, handling such large-level signals requires the use of a high-voltage power supply, which is difficult to implement, especially when integrated into an IC.

本考案は、かかる従来のダイオードスライス回
路の欠点を除去したものである。
The present invention eliminates the drawbacks of such conventional diode slice circuits.

以下、第3図を参照して本考案の一実施例につ
いて説明する。第3図において、11は正の直流
電圧(+Vcc)の与えられる電源端子を示し、こ
の電源端子11及び接地間に可変抵抗器12と抵
抗器13,14,15との直列回路が挿入され
る。この可変抵抗器12及び抵抗器13の接続点
がコンデンサ16を介して接地される。また、抵
抗器13及び14の第1の接続点17と抵抗器1
4及び15の第2の接続点18との夫々がコンデ
ンサ19a及び19bを介して入力端子20と接
続される。更に、接続点17及び18と出力端子
21との夫々の間に互いに逆方向でもつてダイオ
ード22a及び22bが挿入される。ダイオード
22a及び22bとしては、シリコンダイオー
ド、シヨツトキーダイオード等を使用することが
できる。
An embodiment of the present invention will be described below with reference to FIG. In FIG. 3, 11 indicates a power supply terminal to which a positive DC voltage (+Vcc) is applied, and a series circuit of a variable resistor 12 and resistors 13, 14, and 15 is inserted between this power supply terminal 11 and the ground. . A connection point between the variable resistor 12 and the resistor 13 is grounded via a capacitor 16. Also, the first connection point 17 of the resistors 13 and 14 and the resistor 1
4 and 15 are connected to the input terminal 20 via capacitors 19a and 19b, respectively. Further, diodes 22a and 22b are inserted between the connection points 17 and 18 and the output terminal 21, respectively, in opposite directions. As the diodes 22a and 22b, silicon diodes, Schottky diodes, etc. can be used.

上述の構成において、可変抵抗器12の抵抗値
をR12、抵抗器13,14,15の値を夫々R13
R14,R15とすると、抵抗器14の両端電圧(接続
点17及び18間の電位差)E14は E14=R14・Vcc/R12+R13+R14+R
となる。入力端子20から一例として正弦波電圧
が加えられたとすると、第4図に示すように、接
続点17及び18の夫々に互いの直流電位がE14
の差を有する正弦波電圧Ea及びEbが現れる。こ
の電位差E14は、各抵抗器の値を選定することに
よつてダイオード22a及び22bの夫々の順方
向電圧降下Vfa及びVfbに対して〔0<E14<(Vf
+Vfb)〕の条件を満足するものとされている。
かかる正弦波電圧Ea及びEbがダイオード22a
及び22bに供給されることにより、そのV−I
特性23a及び23bによつて斜線部分が出力さ
れ、出力端子21に出力電圧E0を取り出すこと
ができる。
In the above configuration, the resistance value of the variable resistor 12 is R 12 , and the values of the resistors 13, 14, and 15 are R 13 , respectively.
Assuming R 14 and R 15 , the voltage across the resistor 14 (potential difference between connection points 17 and 18) E 14 is E 14 = R 14 · Vcc/R 12 + R 13 + R 14 + R 1
It becomes 5 . As an example, if a sinusoidal voltage is applied from the input terminal 20, as shown in FIG .
Sinusoidal voltages Ea and Eb appear with a difference of . This potential difference E 14 can be determined by selecting the value of each resistor so that [0<E 14 <( V f
a + V fb )].
These sinusoidal voltages Ea and Eb are connected to the diode 22a.
and 22b, so that its V-I
The shaded portion is output according to the characteristics 23a and 23b, and the output voltage E 0 can be taken out to the output terminal 21.

上述の説明から理解されるように、本考案に依
れば、可変抵抗器12の値R12を可変することに
よつて電圧E14を変え、これによつてスライスレ
ベルを〔0〜(Vfa+Vfb)〕の範囲で任意のもの
に設定することができる。従つてスライスレベル
を(±Vf)より小さいものにでき、冒頭に述べ
たように充分レベルの小なるノイズ成分を除去す
る場合に使用して好適である。また、単にスライ
スレベルを小さくするだけであれば、可変抵抗器
12及びコンデンサ16を設けない構成として抵
抗器13,14,15の何れかの値を変えれば良
い。しかし、抵抗器13,14,15には、信号
成分が流れているために、これらの何れかを可変
抵抗器として外部から調整可能とすると、信号成
分が流れるリード線が長くなり、信号成分の劣化
が生じたり、他の回路への妨害が発生したりす
る。本考案に依れば、コンデンサ16を接続して
いるので、信号成分はバイパスされ、可変抵抗器
12には直流成分しか流れず、可変抵抗器12を
リード線で離れた位置においても何等影響はな
い。
As can be understood from the above description, according to the present invention, the voltage E 14 is varied by varying the value R 12 of the variable resistor 12, thereby changing the slice level from [0 to (V fa + V fb )]. Therefore, the slice level can be made smaller than (±Vf), and as mentioned at the beginning, it is suitable for use when removing sufficiently low level noise components. Furthermore, if the slice level is simply to be reduced, the value of any one of the resistors 13, 14, and 15 may be changed without providing the variable resistor 12 and the capacitor 16. However, since signal components flow through the resistors 13, 14, and 15, if any of these were made externally adjustable as a variable resistor, the lead wires through which the signal components would flow would become long, and the signal components would be Degradation or interference with other circuits may occur. According to the present invention, since the capacitor 16 is connected, the signal component is bypassed, and only the DC component flows through the variable resistor 12, so that there is no influence at all even when the variable resistor 12 is separated by a lead wire. do not have.

また、スライスレベルが小さい場合には特に2
つのダイオード22a,22bのスライスレベル
が正負対称であることが重要であるが、本考案に
おいては、出力端21と接続点17及び18との
間に、直接、ダイオード22a及び22bが接続
されているので、これらダイオード22a及び2
2bが同特性であれば抵抗14の両端電圧E14
これら2つのダイオードによつて分圧され、出力
端21のDCレベルは常に(V17+V18)/2(V17
及びV18は接続点17及び18の電圧)となる。
したがつて、ダイオード22a及び22bのスラ
イスレベルは、抵抗13,14,15に抵抗値の
誤差があつても常に正負対称にすることができ
る。
In addition, especially when the slice level is small,
It is important that the slice levels of the two diodes 22a and 22b are symmetrical in positive and negative directions, but in the present invention, the diodes 22a and 22b are directly connected between the output end 21 and the connection points 17 and 18. Therefore, these diodes 22a and 2
2b have the same characteristics, the voltage E 14 across the resistor 14 is divided by these two diodes, and the DC level at the output terminal 21 is always (V 17 +V 18 )/2 (V 17
and V 18 is the voltage at connection points 17 and 18).
Therefore, the slice levels of the diodes 22a and 22b can always be made symmetrical in positive and negative directions even if there are errors in the resistance values of the resistors 13, 14, and 15.

また、本考案においては、入力端子20と2つ
のダイオード22a,22bは夫々コンデンサ1
9a,19bを介して接続され直流カツトされて
いるため、入力端子20の直流レベルと接続点1
7,18の直流レベルは関係づける必要はなく、
抵抗13,14,15の値はダイオードに対する
バイアス値のみを考慮すればよいので抵抗値の設
定が容易である。
In addition, in the present invention, the input terminal 20 and the two diodes 22a and 22b are each connected to a capacitor 1.
9a, 19b and DC cut, the DC level of input terminal 20 and connection point 1
There is no need to relate the DC levels of 7 and 18.
The resistance values of the resistors 13, 14, and 15 can be easily set because only the bias values for the diodes need to be considered.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のノイズ除去回路の構成を示す接
続図、第2図はその説明に用いる各部波形図、第
3図は、本考案の一実施例の接続図、第4図はそ
の動作説明に用いる線図である。 12は可変抵抗器、17は第1の接続点、18
は第2の接続点、19a,19bは第1及び第2
のコンデンサ、20は入力端子、21は出力端
子、22a,22bは第1及び第2のダイオード
である。
Fig. 1 is a connection diagram showing the configuration of a conventional noise removal circuit, Fig. 2 is a waveform diagram of each part used for its explanation, Fig. 3 is a connection diagram of an embodiment of the present invention, and Fig. 4 is an explanation of its operation. FIG. 12 is a variable resistor, 17 is a first connection point, 18
is the second connection point, 19a and 19b are the first and second connection points.
20 is an input terminal, 21 is an output terminal, and 22a and 22b are first and second diodes.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 直流電源の一端11が可変抵抗器12、第1の
抵抗13、第2の抵抗14及び第3の抵抗15と
順次接続される直列回路を介して上記直流電源の
他端に接続され、上記可変抵抗器12及び第1の
抵抗13の接続点がコンデンサ16を介して上記
直流電源の他端と接続され、上記第1の抵抗13
及び第2の抵抗14の第1の接続点17と上記第
2の抵抗14及び第3の抵抗15の第2の接続点
18との夫々が第1及び第2のコンデンサ19
a,19bを介して入力端20と接続され、上記
第1の接続点17が第1のダイオード22aのア
ノードに接続され、この第1のダイオード22a
のカソードが第2のダイオード22bのアノード
に接続され、この第2のダイオード22bのカソ
ードが上記第2の接続点18に接続され、上記第
1のダイオード22aのカソードと上記第2のダ
イオード22bのアノードとの接続点が出力端2
1に接続されてなるダイオードスライス回路。
One end 11 of the DC power source is connected to the other end of the DC power source via a series circuit connected in sequence to a variable resistor 12, a first resistor 13, a second resistor 14, and a third resistor 15. A connection point between the resistor 12 and the first resistor 13 is connected to the other end of the DC power supply via a capacitor 16, and the first resistor 13 is connected to the other end of the DC power supply through the capacitor 16.
The first connection point 17 of the second resistor 14 and the second connection point 18 of the second resistor 14 and third resistor 15 are connected to the first and second capacitors 19, respectively.
a, 19b, and the first connection point 17 is connected to the anode of the first diode 22a.
The cathode of the second diode 22b is connected to the anode of the second diode 22b, the cathode of the second diode 22b is connected to the second connection point 18, and the cathode of the first diode 22a and the second diode 22b are connected to each other. The connection point with the anode is output end 2
A diode slice circuit connected to 1.
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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS53113428A (en) * 1977-03-15 1978-10-03 Mitsubishi Electric Corp Noise rejecting circuit

Patent Citations (1)

* Cited by examiner, † Cited by third party
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JPS53113428A (en) * 1977-03-15 1978-10-03 Mitsubishi Electric Corp Noise rejecting circuit

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