JPS6262363U - - Google Patents

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JPS6262363U
JPS6262363U JP15071785U JP15071785U JPS6262363U JP S6262363 U JPS6262363 U JP S6262363U JP 15071785 U JP15071785 U JP 15071785U JP 15071785 U JP15071785 U JP 15071785U JP S6262363 U JPS6262363 U JP S6262363U
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JP15071785U
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【図面の簡単な説明】
第１図はこの考案に係る入出力インターフエー
スの概略構成を示すブロツク図である。 １……一時的記憶手段、２……第一のバツフア
、３……第二のバツフア、４……内部の中央演算
処理装置、６……外部のマイクロコンピユータシ
ステム。

Claims (1)

  1. 【実用新案登録請求の範囲】 １ 内部に設けた中央演算処理装置と、その書き
    込み、読み出し状態を把握して、これを一時的に
    記憶保持する一時的記憶手段と、 上記記憶手段の状態を外部のマイクロコンピユ
    ータシステムに連絡し、このマイクロコンピユー
    タシステムの書き込み、読み出しの状態を示す１
    データ分のビツトを一時的に貯え、上記記憶手段
    の状態を元に戻す第一のバツフアと、 上記一時的記憶手段の状態に従つて上記内部の
    演算処理装置と上記外部のマイクロコンピユータ
    システムとの各１データ分のビツトを一時的に貯
    えてから相互に入出力する第二のバツフアとを備
    えたことを特徴とする入出力インターフエース。 ２ 一時的記憶手段がフリツプフロツプ回路で構
    成され、そのフリツプフロツプ回路は外部のマイ
    クロコンピユータシステムの書き込みデータ用と
    読み出しデータ用とに対応配置されている実用新
    案登録請求の範囲第１項記載の入出力インターフ
    エース。 ３ 第一のバツフア及び第二のバツフアが１デー
    タ分のビツト信号を次の１データ分のビツト信号
    の出入りが行なわれる段階になるまで貯えるラツ
    チ回路を含んで構成されている実用新案登録請求
    の範囲第１項記載に入出力インターフエース。
JP15071785U 1985-10-01 1985-10-01 Pending JPS6262363U (ja)

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JP15071785U JPS6262363U (ja) 1985-10-01 1985-10-01

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JP15071785U JPS6262363U (ja) 1985-10-01 1985-10-01

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JPS6262363U true JPS6262363U (ja) 1987-04-17

Family

ID=31067111

Family Applications (1)

Application Number Title Priority Date Filing Date
JP15071785U Pending JPS6262363U (ja) 1985-10-01 1985-10-01

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