JPS622532A - InGaAsイオン注入導電層の熱処理方法 - Google Patents

InGaAsイオン注入導電層の熱処理方法

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JPS622532A
JPS622532A JP14097585A JP14097585A JPS622532A JP S622532 A JPS622532 A JP S622532A JP 14097585 A JP14097585 A JP 14097585A JP 14097585 A JP14097585 A JP 14097585A JP S622532 A JPS622532 A JP S622532A
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JP
Japan
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carrier concentration
temperature
conductive layer
ingaas
annealing temperature
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Application number
JP14097585A
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English (en)
Inventor
Toshiharu Ozawa
小澤 敏晴
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NEC Corp
Original Assignee
NEC Corp
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Publication date
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Publication of JPS622532A publication Critical patent/JPS622532A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明はInGaA3イオン注入導電層の形成方法に関
し、特に注入された不純物を電気的に活性化するための
熱処理方法、更に詳しくは熱処理温度に関するものであ
る。
(従来技術とその問題点) InQaAs層へイオン注入を施し注入層の電気的活性
化をはかるための熱処理方法については、以下に述べる
ようないくつかの報告がみられる。即ち、ジャパニーズ
響ジャーナルーオブ―アプライド・フィツクス(Jap
anese Journal  ofApplid P
hysics )e第21巻(1982年)の431頁
においては、アニール温度500℃から700℃を57
巻(1985年)の351頁にお−では、アニール温度
600℃から750℃を用いてアニールし得られた導電
層に関する電気的測定結果が報告されている。これ等の
報告では、いずれも抵抗加熱方式を用いておりランプ加
熱方式を用いたアニールでの電気的測定結果は報告され
ていない。
ラングアニール方法を用いることにより抵抗加熱方式を
用いてアニールするよりも短時間の熱処理ですみかつ急
峻なキャリア濃度分布が得られることはGaAs基板で
のイオン注入導電層形成には適していることは周知のと
お夕であるがInGaAs層でのイオン注入導電層形成
に関するアニール条件については全く不明である。
(発明の目的) 本発明の目的は、以上の点を考慮しエロGaAsイオン
注入層の熱処理温度の最適化をはかり注入層の電気的活
性化を向上せしめかつ急峻なキャリア濃度分布が得られ
る新規な導電層形成方法を提供することにある。
(発明の構成) 本発明のInGaAsイオン注入導電層の形成方法は%
 InGaAs層にイオン注入後熱処理を施しInQ 
a A Sイオン注入導電層を形成する方法においてラ
ンプ炉を用いて、630℃から81Q℃の範囲の温度に
て熱処理することを特徴として構成される。
(発明の作用・原理) 本発明は、InGaASnGa性入導電層をランプ炉を
用いて630℃から81O℃の範囲の温度にて熱処理す
ることにより、高い活性化率と急峻なキャリア濃度分布
が達成し得る左いう新規な実験結果に根ざしている。
(発明の構成) 本発明のInGaAsイオン注入導電層の形成方法は、
InGaAs層にイオン注入後熱処理を施しInGaA
sイオン注入導電層を形成する方法においてランプ炉を
用いて630℃から810℃の範囲の温度にて熱処理す
ることにより、高い活性化率を達成しかつ急峻なキャリ
ア濃度分布が容易に得ることが出来うる新規な実験結果
に根ざしている。
(実施例) 以下本発明の実施例について図面を参照して詳細に説明
する。
81図は本発明の実施例を示す、熱処理温度を変化させ
アニールされた導電層のシートキャリア濃度結果を示し
た図である。
即ち、 InGaA、s層に81をイオンエネルギーI
 QQKeV、  ドース量3.OXlo(m  の条
件で室温にて注入した試料をランプ炉を用いて窒素雰囲
気中にて560℃から900℃の範囲で5秒間アニール
を行った場合のそれぞれの試料のシートキャリア濃度の
測定結果を示したものである。図から明らかなようにア
ニール温度を560°から上昇させて行くとシートキャ
リア濃度は上昇してアニール温度630℃で2.56 
X 10”を示し温度をさらに上げてもアニール温度8
10℃までほぼ一定のキャリア濃度値を示す。得られた
キャリア濃度から活性化率を算出するとアニール温度6
30℃の場合85チアニ一ル温度810℃の場合81チ
と高活性化率が得られる。
第2図・第3図及び第4図は本発明の詳細な説明するた
めに深さ方向のキャリア濃度分布を示した図である。
第2図では、 InGaAs層にSビをイオンエネルギ
ー100KeV、  ドーxfi 3.OX 10’″
イ1の条件にて注入した試料をランプ炉を用いて窒素雰
囲気中にて630℃の温度で5秒間アニールを行った場
合の試料の深さ方向のキャリア濃度分布の測定結果を示
したものである。第3図は、82図と同様に7工−ル温
度だけを810℃に変えた場合の試料の深さ方向のキャ
リア濃度分布の測定結果を示したものである。#14図
では、InGaAs層にSi”、Hイオンエネルギー3
0KeV、  ドースt 1.Ox IQ ” Gr;
r”o)条件にて注入した試料をランプ炉を用いて窒素
雰囲気中にて700℃の温度で5秒間アニールを行った
場合の試料の深さ方向のキャリア濃度分布の測定結果を
示したものである。これ等の図から明らかなように深さ
方向のキャリア濃度分布はL8S理論に大変良く一致し
たものが得られている。
以上述べたように、本発明の方法を用いた場合活性化率
の増大がけかれかつ急峻なキャリア濃度分布が容易に得
られる。
(発明の効果) 以上から明らかな様K、InGaAsのイオン注入層を
ランプ炉を用いて630℃から810℃の範囲内の温度
にてアニールすることKより導電層の高活性化とキャリ
ア濃度分布の急峻化が容易に達成される。
【図面の簡単な説明】
第1図は本発明の詳細な説明するためにア二一層温度を
560℃から900℃の範囲で変化させた場合に得られ
るシートキャリア濃度を示す図である。 第2図は本発明の詳細な説明するためにイオン注入条件
として3i+“をイオンエネルギー100KeV、 ト
” −xi 3.Q x 10”clrL−”の条件で
注入した試料を630℃の温度で5秒間アニールした場
合の深さ方向のキャリアm変分布を示す図である。 第3図は本発明の詳細な説明するためにイオン注入条件
としてSビをイオンエネルギー100KeV 、  ド
ースJ13.OX 10” cm−1の条件で注入した
試料を810℃の温度で5秒間アニールした場合の深さ
方向のキャリア濃度分布を示す図である。 第4図は本発明の詳細な説明するためにイオン注入条件
としてs H(−をイオンエネルギー3QKeVドース
量1.Ox 1014art−”の条件で注入した試料
を700℃の温度で5秒間アニールした場合の深さ方向
のキャリア鐘度分布を示す図である。 第1図 アニール温度 第2図 深さくμm) 第3図 床  さ

Claims (1)

    【特許請求の範囲】
  1. InGaAsにイオン注入層を形成後熱処理を施しIn
    GaAs半導体素子のイオン注入導電層を形成する方法
    において、前記熱処理をランプ炉を用いて熱処理温度を
    630℃から810℃の範囲内の温度にて行うことを特
    徴とするInGaAsイオン注入導電層の形成方法。
JP14097585A 1985-06-27 1985-06-27 InGaAsイオン注入導電層の熱処理方法 Pending JPS622532A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5658001A (en) * 1979-10-18 1981-05-20 Kao Corp Disposable diaper
US5294557A (en) * 1991-08-26 1994-03-15 The United States Of America As Represented By The Secretary Of The Navy Implanting impurities in semiconductors and semiconductor implanted with impurities
CN109103082A (zh) * 2018-08-06 2018-12-28 上海华虹宏力半导体制造有限公司 浮栅的制作方法和分裂栅闪存

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5658001A (en) * 1979-10-18 1981-05-20 Kao Corp Disposable diaper
JPS6314081B2 (ja) * 1979-10-18 1988-03-29 Kao Corp
US5294557A (en) * 1991-08-26 1994-03-15 The United States Of America As Represented By The Secretary Of The Navy Implanting impurities in semiconductors and semiconductor implanted with impurities
CN109103082A (zh) * 2018-08-06 2018-12-28 上海华虹宏力半导体制造有限公司 浮栅的制作方法和分裂栅闪存
CN109103082B (zh) * 2018-08-06 2020-09-11 上海华虹宏力半导体制造有限公司 浮栅的制作方法和分裂栅闪存

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