JPS62164499U - - Google Patents

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JPS62164499U
JPS62164499U JP18308585U JP18308585U JPS62164499U JP S62164499 U JPS62164499 U JP S62164499U JP 18308585 U JP18308585 U JP 18308585U JP 18308585 U JP18308585 U JP 18308585U JP S62164499 U JPS62164499 U JP S62164499U
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JP
Japan
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circuit
delay circuit
output
signal
delay
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JP18308585U
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Description

【図面の簡単な説明】
第１図はこの考案の一実施例を示すブロツク線
図、第２図はスピーカ配置を示す図である。 図面において、１は入力端子、２〜７は出力端
子、８〜１０は遅延回路、１１はマトリクスであ
る。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) モノラルな音響信号を疑似ステレオ信号と
    して再生する回路であつて、前記音響信号の入力
    端子と、この入力端子に直接的に接続され、聴取
    点に対し前面に位置しかつ１対の間隔をおいて配
    置された前面スピーカに接続するための第１出力
    端子と、前記入力端子に接続され、前記音響信号
    を所定の時間遅らせる第１遅延回路と、この第１
    遅延回路の出力側に接続され、前記聴取点に対し
    左右側方に位置する１対の側部スピーカのいずれ
    か一方に接続するための第２出力端子と、それぞ
    れが前記第１遅延回路と同じ遅延時間を有する直
    列接続された第２および第３遅延回路と、この第
    ３遅延回路の出力側に接続され、前記側部スピー
    カの他方に接続するための第３出力端子とを有す
    ることを特徴とする疑似ステレオ再生回路。 (2) 実用新案登録請求の範囲第１項において、
    前記第１遅延回路と、前記第３遅延回路の各出力
    側にその入力側が接続され、それぞれの出力信号
    を左右のステレオ信号に分割するマトリクスと、
    このマトリクスからの右チヤンネル信号および左
    チヤンネル信号を前記聴取点に対して後方にかつ
    間隔をおいて位置する１対の後部スピーカにそれ
    ぞれ接続する第４および第５出力端子とを更に有
    することを特徴とする疑似ステレオ再生回路。
JP18308585U 1985-11-29 1985-11-29 Pending JPS62164499U (ja)

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JP18308585U JPS62164499U (ja) 1985-11-29 1985-11-29

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JPS62164499U true JPS62164499U (ja) 1987-10-19

Family

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Family Applications (1)

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JP18308585U Pending JPS62164499U (ja) 1985-11-29 1985-11-29

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5124242U (ja) * 1974-08-10 1976-02-23

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5124242U (ja) * 1974-08-10 1976-02-23

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