JPS62145439A - 障害情報収集方式 - Google Patents

障害情報収集方式

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Publication number
JPS62145439A
JPS62145439A JP60287152A JP28715285A JPS62145439A JP S62145439 A JPS62145439 A JP S62145439A JP 60287152 A JP60287152 A JP 60287152A JP 28715285 A JP28715285 A JP 28715285A JP S62145439 A JPS62145439 A JP S62145439A
Authority
JP
Japan
Prior art keywords
fault
parallel
serial
fault information
register
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60287152A
Other languages
English (en)
Inventor
Tatsuhiko Nakagawa
中川 達彦
Toshiyuki Nishina
仁科 俊之
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
NEC Miyagi Ltd
Original Assignee
NEC Corp
NEC Miyagi Ltd
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Filing date
Publication date
Application filed by NEC Corp, NEC Miyagi Ltd filed Critical NEC Corp
Priority to JP60287152A priority Critical patent/JPS62145439A/ja
Publication of JPS62145439A publication Critical patent/JPS62145439A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/22Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing
    • G06F11/2205Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing using arrangements specific to the hardware being tested
    • G06F11/2236Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing using arrangements specific to the hardware being tested to test CPU or processors

Landscapes

  • Engineering & Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Debugging And Monitoring (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は複数のユニットから構成されるシステムの障害
信号を障害監視ユニットに収集する障害情報収集方式に
関する。
(従来の技術) 複数のユニットから構成されるシステムの障害l検出す
る九め、システム内で発生する6監−視項目ごとの障害
の有無χ示す障害信号ン収集する障害監視ユニットが設
置されている。
従来の障害情報収集方式は1つの障害情報に対し1本の
障害情報送出ラインが割り当てられ、これらのすべての
障害情報ラインン障害監視ユニットに集中しており、障
害監視ユニット上のアラーム処理マイクロプロセッサに
取り込んでい友。
(発明が解決しようとする問題点) その九め、障害監視ユニットの障害検出ポイントが増加
した場合にはそれに伴ない信号ラインの増加も必要とな
る。
また、各々の障害情報は障害検出ポイントからの時々刻
々変化する生データである之め、−瞬の障害が発生して
もアラーム処理マイクロプロセッサが他の障害検出ポイ
ントン検索中であれば、その障讐発生ン見逃すという欠
点がある。
本発明の目的は各ユニットと障害監視ユニット′間ケ結
ぶデータ転送回線は障害検出ポイントの多少に拘わらず
一本で済み、しかも、すべての障害を見落すことなく検
出することができる障害情報収集方式ン提供することに
ある。
(問題点を解決するための手段) 前記目的ン達成するために本発明による障害情報収集方
式はシステムヶ構成する複数6ユニツトの障害情報を障
害監視ユニットに収集する障害情報収集方式において、
前記ユニットには多数の障害検出ポイントの障害の有無
χ示す障害信号χ並列に取り人nて一時保持し、直列に
出力するパラレルインシリアルアウトシフトレジスタン
設け、前記障害監視ユニットには、送られて′@tデー
タY直列に取り入れ、並列に出力するシリアルインパラ
レルシフトレジスタン設け、前記パラレルインシリアル
アウトシフトレジスタとシリアルインパラレルシフトレ
ジスタに同一クロックを供給することにより前記データ
乞シリアルに転送するように構成しである。
(実施例) 以下、図面χ参照して本発明暑さらに詳しく説明する。
第1図は本発明による障害情報収集方式の実施例を示す
図である。
本図は障害監視ユニットにシステムのユニットY 1 
@接続し九個である。ユニット110は各項目別に障害
検出ポイン) 111 、112があり、それぞれ障害
の有無を示す障害情報が時々刻々と出力される。各障害
検出ポイン) 111.112はパラレルインシリアル
アウトレジスタ113に接続されており、パラレルイン
シリアルアウトレジスタ113は障害検出ポイン) 1
11.112の情@ン並列的に取入れ保持する。
一万、障害監視ユニット114はシリアルインパラレル
アウトシフトレジスタ115 )k有しており、シリア
ルインパラレルアウトシフトレジスタ115ハ、パラレ
ルインシリアルアウトシフトレジスタ113と、シリア
ル障害情報データ線104と障害情報転送りロック線1
03とによって接続されている。シリアルインパラレル
アウトシフトレジスタ115の出力はアラーム処理マイ
クロプロセッサ116に接続されている・ アラーム処理マイクロプロセッサ116は障害情報転送
りロック103ヲ出力することにより、パラレルインシ
リアルアウトシフトレジスタ113に入力保持されてい
る障害情報を順次シリアルインパラレルアウトシフトレ
ジスタ115に転送させる。
アラーム処理マイクロプロセッサ116はすべての障害
情報が転送完了した後、再生障害情報105.1067
取込み、アラーム処理1行なう。
(発明の効果) 以上、詳しく説明したように本発明は障害検出ポイント
を有するユニットと障害監視ユニットとの間の障害情報
転送にパラレルインシリアルアウトシフトレジスタおよ
びシリアルインパラレルアウトシフトレジスタン用い、
障害情報収集ンシリアル転送するので、障害情報数の多
少にかかわらず、データとクロックの2本のラインで障
害情報収集が行なえるとともに、障害情報は−Hシフト
レジスタ内に保持されるので、−瞬の障害ももれなく検
出できる効果がある。
【図面の簡単な説明】
第1図は本発明による障害情報収集方式の実施例を示す
図である。 101・・・障害情報  102・・・障害情報103
・・・障害情報転送りロック 104・・・シリアル障害情報データ 105・・・再生障害情報 106・・・再生障害情報
111)・・・ユニット  111・・・障害検出ポイ
ント112…障害検出ポイント 113…ハラレルインシリアルアウトシフトレジスタ 114・・・障害監視ユニット 115・・・シリアルインパラレルアウトシフトレジス

Claims (1)

    【特許請求の範囲】
  1. システムを構成する複数のユニットの障害情報を障害監
    視ユニットに収集する障害情報収集方式において、前記
    ユニットには、多数の障害検出ポイントの障害の有無を
    示す障害信号を並列に取り入れて一時保持し、直列に出
    力するパラレルインシリアルアウトシフトレジスタを設
    け、前記障害監視ユニットには、送られてきたデータを
    直列に取り入れ、並列に出力するシリアルインパラレル
    シフトレジスタを設け、前記パラレルインシリアルアウ
    トシフトレジスタとシリアルインパラレルシフトレジス
    タに同一クロックを供給することにより前記データをシ
    リアルに転送することを特徴とする障害情報収集方式。
JP60287152A 1985-12-20 1985-12-20 障害情報収集方式 Pending JPS62145439A (ja)

Priority Applications (1)

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JP60287152A JPS62145439A (ja) 1985-12-20 1985-12-20 障害情報収集方式

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Application Number Priority Date Filing Date Title
JP60287152A JPS62145439A (ja) 1985-12-20 1985-12-20 障害情報収集方式

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Publication Number Publication Date
JPS62145439A true JPS62145439A (ja) 1987-06-29

Family

ID=17713746

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60287152A Pending JPS62145439A (ja) 1985-12-20 1985-12-20 障害情報収集方式

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