JPS6212744B2 - - Google Patents
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- JPS6212744B2 JPS6212744B2 JP56017393A JP1739381A JPS6212744B2 JP S6212744 B2 JPS6212744 B2 JP S6212744B2 JP 56017393 A JP56017393 A JP 56017393A JP 1739381 A JP1739381 A JP 1739381A JP S6212744 B2 JPS6212744 B2 JP S6212744B2
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- JP
- Japan
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- voltage
- converter
- circuit
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- pulse width
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- 238000006243 chemical reaction Methods 0.000 claims description 18
- 239000003990 capacitor Substances 0.000 claims description 8
- 230000003321 amplification Effects 0.000 claims description 6
- 238000003199 nucleic acid amplification method Methods 0.000 claims description 6
- 230000003111 delayed effect Effects 0.000 claims 1
- 238000009499 grossing Methods 0.000 description 3
- 230000008901 benefit Effects 0.000 description 2
- 230000001052 transient effect Effects 0.000 description 2
- 230000007547 defect Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 230000007257 malfunction Effects 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of dc power input into dc power output
- H02M3/22—Conversion of dc power input into dc power output with intermediate conversion into ac
- H02M3/24—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters
- H02M3/28—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac
Description
【発明の詳細な説明】
本発明はDC―DCコンバータの起動時における
突入電流の立上りと出力電圧の立上りをなだらか
にするためのソフトスタート制御回路に関する。
突入電流の立上りと出力電圧の立上りをなだらか
にするためのソフトスタート制御回路に関する。
従来のDC―DCコンバータにおいては、起動時
に出力側に接続されている平滑回路のコンデンサ
を充電するための大きな突入電流が入力端で見ら
れる。この突入電流は、衛星搭載用蓄電池のよう
にDC―DCコンバータが接続される一次電源の電
流容量が少ない場合に問題を引き起こす。すなわ
ち、DC―DCコンバータへの突入電流によつて一
次電源の電圧が瞬時に低下し、その一次電源に接
続されて動作している機器が動作異常、もしくは
動作不能の状態になる。これを防ぐためには、こ
の突入電流によるも電圧低下のないよう、予め容
量の大きな一次電源を用意しておかねばならな
い。それによつて、衛星搭載用のごとく好ましく
ない重量と容積の増大を招くという不都合があつ
た。また、従来のDC―DCコンバータにおいて
は、起動時にその出力電圧が急峻に立上り、場合
によつては電圧の立上り時に平滑回路の共振によ
るリンギングを生ずることがある。その結果、
DC―DCコンバータに接続される負荷によつては
急峻な出力電圧の立上りによつて損傷を蒙ると言
う欠陥があつた。
に出力側に接続されている平滑回路のコンデンサ
を充電するための大きな突入電流が入力端で見ら
れる。この突入電流は、衛星搭載用蓄電池のよう
にDC―DCコンバータが接続される一次電源の電
流容量が少ない場合に問題を引き起こす。すなわ
ち、DC―DCコンバータへの突入電流によつて一
次電源の電圧が瞬時に低下し、その一次電源に接
続されて動作している機器が動作異常、もしくは
動作不能の状態になる。これを防ぐためには、こ
の突入電流によるも電圧低下のないよう、予め容
量の大きな一次電源を用意しておかねばならな
い。それによつて、衛星搭載用のごとく好ましく
ない重量と容積の増大を招くという不都合があつ
た。また、従来のDC―DCコンバータにおいて
は、起動時にその出力電圧が急峻に立上り、場合
によつては電圧の立上り時に平滑回路の共振によ
るリンギングを生ずることがある。その結果、
DC―DCコンバータに接続される負荷によつては
急峻な出力電圧の立上りによつて損傷を蒙ると言
う欠陥があつた。
本発明の目的は、上記の問題を解決し、DC―
DCコンバータの起動時における入力端の突入電
流の立上りと出力端の出力電圧の立上りをなだら
かにすることのできるDC―DCコンバータのソフ
トスタート制御回路を提供することにある。
DCコンバータの起動時における入力端の突入電
流の立上りと出力端の出力電圧の立上りをなだら
かにすることのできるDC―DCコンバータのソフ
トスタート制御回路を提供することにある。
本発明の他の目的は、DC―DCコンバータの起
動時に、簡単な回路構成で確実にソフトスタート
が行えるDC―DCコンバータのソフタスタート制
御回路を提供することにある。
動時に、簡単な回路構成で確実にソフトスタート
が行えるDC―DCコンバータのソフタスタート制
御回路を提供することにある。
本発明によれば、DC―DCコンバータの出力電
圧の誤差信号をうけて基準電圧と比較する誤差増
幅回路と、該誤差増幅回路の出力と前記DC―DC
コンバータ内で発生する三角波電圧とをうけて、
前記DC―DCコンバータのパワースイツチング素
子を制御する電圧―パルス幅変換回路とを有する
DC―DCコンバータの制御回路において、前記
DC―DCコンバータ内の補助電源から与えられ
る。“オン”電圧を時間的に遅延する回路と、誤
遅延回路の出力側に直列に接続された抵抗および
コンデンサからなる時定数回路とを設けると共に
該遅延回路の出力を前記誤差増幅回路の電源端子
に接続し、更に、該時定数回路における抵抗とコ
ンデンサの直列接続点と前記誤差増幅回路の出力
が与えられる前記電圧―パルス幅変換回路の入力
側との間に電圧制限用のダイオードを接続したこ
とを特徴とするDC―DCコンバータのソフトスタ
ート制御回路が得られる。
圧の誤差信号をうけて基準電圧と比較する誤差増
幅回路と、該誤差増幅回路の出力と前記DC―DC
コンバータ内で発生する三角波電圧とをうけて、
前記DC―DCコンバータのパワースイツチング素
子を制御する電圧―パルス幅変換回路とを有する
DC―DCコンバータの制御回路において、前記
DC―DCコンバータ内の補助電源から与えられ
る。“オン”電圧を時間的に遅延する回路と、誤
遅延回路の出力側に直列に接続された抵抗および
コンデンサからなる時定数回路とを設けると共に
該遅延回路の出力を前記誤差増幅回路の電源端子
に接続し、更に、該時定数回路における抵抗とコ
ンデンサの直列接続点と前記誤差増幅回路の出力
が与えられる前記電圧―パルス幅変換回路の入力
側との間に電圧制限用のダイオードを接続したこ
とを特徴とするDC―DCコンバータのソフトスタ
ート制御回路が得られる。
次に、本発明によるソフトスタート制御回路に
ついて図面を参照して詳細に説明する。
ついて図面を参照して詳細に説明する。
第１図は本発明による実施例の回路を示したも
のである。この例において、誤差増幅回路１は端
子２に入力される図示されていないDC―DCコン
バータの出力電圧の誤差信号をうけてこれを基準
電池３の電圧と比較する。電圧―パルス幅変換回
路４は誤差増幅回路１の出力と端子５に入力され
るDC―DCコンバータ内で発生する三角波とをう
けて、両者を比較し、端子６にDC―DCコンバー
タの出力電圧に応じたパルスを出力する。時間遅
延回路７は端子８と９に加えられたDC―DCコン
バータの補助電源電圧を、DC―DCコンバータを
起動後電圧―パルス幅変換回路が完全に動作可能
状態に立上るまでの一定の時間遅延の後に出力側
に導出するものである。抵抗１０とコンデンサ１
１は時定数回路を形成し、時間遅延回路７の出力
側に接続されている。そして、抵抗１０とコンデ
ンサ１１の接続点と電圧―パルス幅変換回路４の
誤差増幅回路１出力側入力端との間には抵抗１２
を介して電圧制限用ダイオード１３が接続されて
いる。なお、誤差増幅回路１の動作用電源電圧は
時間遅延回路１０の出力側から供給されている。
のである。この例において、誤差増幅回路１は端
子２に入力される図示されていないDC―DCコン
バータの出力電圧の誤差信号をうけてこれを基準
電池３の電圧と比較する。電圧―パルス幅変換回
路４は誤差増幅回路１の出力と端子５に入力され
るDC―DCコンバータ内で発生する三角波とをう
けて、両者を比較し、端子６にDC―DCコンバー
タの出力電圧に応じたパルスを出力する。時間遅
延回路７は端子８と９に加えられたDC―DCコン
バータの補助電源電圧を、DC―DCコンバータを
起動後電圧―パルス幅変換回路が完全に動作可能
状態に立上るまでの一定の時間遅延の後に出力側
に導出するものである。抵抗１０とコンデンサ１
１は時定数回路を形成し、時間遅延回路７の出力
側に接続されている。そして、抵抗１０とコンデ
ンサ１１の接続点と電圧―パルス幅変換回路４の
誤差増幅回路１出力側入力端との間には抵抗１２
を介して電圧制限用ダイオード１３が接続されて
いる。なお、誤差増幅回路１の動作用電源電圧は
時間遅延回路１０の出力側から供給されている。
いま、DC―DCコンバータの起動によつて、補
助電源から端子８とリターン端子９に電圧が印加
されると、電圧―パルス幅変換回路４は動作を開
始する。同時に、この回路の反転入力端子に加え
られた三角波の入力信号は立上がるが、非反転入
力端子は接地電位に近い状態にあるために、出力
端子６には制御パルスが現われない。一方、電圧
―パルス幅変換回路４が動作状態に立上がつた
後、時間遅延回路７を経て供給されるDC電圧と
時定数回路１０，１１の作用によつて、電圧―パ
ルス幅変換回路４の非反転入力端子の電位は接地
電位から徐々に立上がつてくる。この時の電圧―
パルス幅変換回路４の動作波形を示すと、第２図
ａ，ｂおよびｃのグラフのようになる。第２図ａ
は電圧―パルス幅変換回路４の反転入力端子およ
び非反転入力端子に与えられる２つの入力信号波
形を示し、同図ｂは、電圧―パルス幅変換回路４
において上記２つの入力信号の電圧比較により得
られる出力側のパルス信号波形を示す。この図に
見られるように、DC―DCコンバータ起動時にお
ける電圧―パルス幅変換回路４の直流バイアス電
圧が過渡状態にある期間（時間遅延回路７の遅延
時間）においては、誤差増幅回路１の出力は断と
なつているので、この過渡状態の期間に端子６に
誤パルスが発生することはない。換言すると、端
子５から入力される三角波の直流バイアス電圧が
ほぼ定常状態に達してから、端子６の出力信号が
現われる。この端子６に現われる出力信号波形
は、確実に、最初パルス幅が狭く、徐々にパルス
幅が広くなつてくる。従つて、このパルス信号に
よりDC―DCコンバータのパワースイツチング素
子を開閉すれば、DC―DCコンバータの出力電圧
は第２図ｃに見られるように徐々に立上がつてく
る。かくして、起動時におけるDC―DCコンバー
タへの入力電流を徐々に立上がらせることができ
る。
助電源から端子８とリターン端子９に電圧が印加
されると、電圧―パルス幅変換回路４は動作を開
始する。同時に、この回路の反転入力端子に加え
られた三角波の入力信号は立上がるが、非反転入
力端子は接地電位に近い状態にあるために、出力
端子６には制御パルスが現われない。一方、電圧
―パルス幅変換回路４が動作状態に立上がつた
後、時間遅延回路７を経て供給されるDC電圧と
時定数回路１０，１１の作用によつて、電圧―パ
ルス幅変換回路４の非反転入力端子の電位は接地
電位から徐々に立上がつてくる。この時の電圧―
パルス幅変換回路４の動作波形を示すと、第２図
ａ，ｂおよびｃのグラフのようになる。第２図ａ
は電圧―パルス幅変換回路４の反転入力端子およ
び非反転入力端子に与えられる２つの入力信号波
形を示し、同図ｂは、電圧―パルス幅変換回路４
において上記２つの入力信号の電圧比較により得
られる出力側のパルス信号波形を示す。この図に
見られるように、DC―DCコンバータ起動時にお
ける電圧―パルス幅変換回路４の直流バイアス電
圧が過渡状態にある期間（時間遅延回路７の遅延
時間）においては、誤差増幅回路１の出力は断と
なつているので、この過渡状態の期間に端子６に
誤パルスが発生することはない。換言すると、端
子５から入力される三角波の直流バイアス電圧が
ほぼ定常状態に達してから、端子６の出力信号が
現われる。この端子６に現われる出力信号波形
は、確実に、最初パルス幅が狭く、徐々にパルス
幅が広くなつてくる。従つて、このパルス信号に
よりDC―DCコンバータのパワースイツチング素
子を開閉すれば、DC―DCコンバータの出力電圧
は第２図ｃに見られるように徐々に立上がつてく
る。かくして、起動時におけるDC―DCコンバー
タへの入力電流を徐々に立上がらせることができ
る。
又、誤差増幅回路１と電圧―パルス幅変換回路
４の電源ライン間に時間遅延回路７が挿入されて
いるので、DC―DCコンバータを起動、すなわち
補助電源から端子８とリターン端子９に電圧を印
加すれば、後は自動的にDC―DCコンバータのソ
フトスタートを確実に動作させることができる。
４の電源ライン間に時間遅延回路７が挿入されて
いるので、DC―DCコンバータを起動、すなわち
補助電源から端子８とリターン端子９に電圧を印
加すれば、後は自動的にDC―DCコンバータのソ
フトスタートを確実に動作させることができる。
なお、ダイオード１３はDC―DCコンバータの
出力電圧が立上つた時点で、時定数回路１０，１
１における電圧の上昇を無効にするために挿入さ
れており、予め決められた値に制限された動作特
性をもつよう選定されている。これによつて、
DC―DCコンバータの出力電圧が立上つたのち
は、ソフトスタート機能は切りはなされ、誤差増
幅回路１を介しての制御動作に移る。
出力電圧が立上つた時点で、時定数回路１０，１
１における電圧の上昇を無効にするために挿入さ
れており、予め決められた値に制限された動作特
性をもつよう選定されている。これによつて、
DC―DCコンバータの出力電圧が立上つたのち
は、ソフトスタート機能は切りはなされ、誤差増
幅回路１を介しての制御動作に移る。
以上の説明により明らかなように、本発明によ
るソフトスタート制御回路をDC―DCコンバータ
に適用することにより、一次電源の電流容量が小
さい場合でも、起動時の一次電圧の低下を減少さ
せることができる。このことは、例えば、衛星搭
載用機器を設計する場合、DC―DCコンバータへ
の供給用を含む衛星バス電源を小形、かつ軽量に
設計できるという利点が得られる。また、従来の
ようなDC―DCコンバータへの起動時における突
入電流がなくなつたことにより、出力電圧の急峻
な上昇も生じないから、負荷された回路の損傷も
考える必要がなくなつた点で得られる効果は大き
い。
るソフトスタート制御回路をDC―DCコンバータ
に適用することにより、一次電源の電流容量が小
さい場合でも、起動時の一次電圧の低下を減少さ
せることができる。このことは、例えば、衛星搭
載用機器を設計する場合、DC―DCコンバータへ
の供給用を含む衛星バス電源を小形、かつ軽量に
設計できるという利点が得られる。また、従来の
ようなDC―DCコンバータへの起動時における突
入電流がなくなつたことにより、出力電圧の急峻
な上昇も生じないから、負荷された回路の損傷も
考える必要がなくなつた点で得られる効果は大き
い。
更に、誤差増幅回路と電圧―パルス幅変換回路
の電源ライン間に時間遅延回路が挿入されている
ので、DC―DCコンバータを起動するだけで、後
は自動的にDC―DCコンバータのソフトスタート
を確実に動作さることができる。
の電源ライン間に時間遅延回路が挿入されている
ので、DC―DCコンバータを起動するだけで、後
は自動的にDC―DCコンバータのソフトスタート
を確実に動作さることができる。
第１図は本発明による実施例の構成を示す回路
図、第２図ａは電圧―パルス幅変換回路の２つの
入力信号波形を示すグラフ、第２図ｂは電圧―パ
ルス幅変換回路の出力信号波形を示すグラフ、第
２図ｃはDC―DCコンバータの出力電圧の立上り
波形を示すグラフである。 図において、１は誤差増幅回路、２は誤差信号
入力端子、３は基準電池、４は電圧―パルス幅変
換回路、５は三角波入力端子、６は制御信号出力
端子、７は時間遅延回路、８は電源入力端子、９
は電源入力リターン端子、１０，１２は抵抗、１
１はコンデンサ、１３はダイオードである。
図、第２図ａは電圧―パルス幅変換回路の２つの
入力信号波形を示すグラフ、第２図ｂは電圧―パ
ルス幅変換回路の出力信号波形を示すグラフ、第
２図ｃはDC―DCコンバータの出力電圧の立上り
波形を示すグラフである。 図において、１は誤差増幅回路、２は誤差信号
入力端子、３は基準電池、４は電圧―パルス幅変
換回路、５は三角波入力端子、６は制御信号出力
端子、７は時間遅延回路、８は電源入力端子、９
は電源入力リターン端子、１０，１２は抵抗、１
１はコンデンサ、１３はダイオードである。
Claims (1)
- １ DC―DCコンバータの出力電圧の誤差信号を
うけて基準電圧と比較する誤差増幅回路と、該誤
差増幅回路の出力と前記DC―DCコンバータ内で
発生する三角波電圧とをうけて、前記DC―DCコ
ンバータのパワースイツチング素子を制御する電
圧―パルス幅変換回路とを有するDC―DCコンバ
ータの制御回路において、前記DC―DCコンバー
タ内の補助電源から与えられる“オン”電圧を時
間的に遅延する回路と、該遅延回路の出力側に直
列に接続された抵抗およびコンデンサからなる時
定数回路とを設けると共に該遅延回路の出力を前
記誤差増幅回路の電源端子に接続し、更に、該時
定数回路における抵抗とコンデンサの直列接続点
と前記誤差増幅回路の出力が与えられる前記電圧
―パルス幅変換回路の入力側との間に電圧制限用
のダイオードを接続したことを特徴とするDC―
DCコンバータのソフトスタート制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1739381A JPS57132762A (en) | 1981-02-10 | 1981-02-10 | Soft start control circuit for dc/dc converter |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1739381A JPS57132762A (en) | 1981-02-10 | 1981-02-10 | Soft start control circuit for dc/dc converter |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57132762A JPS57132762A (en) | 1982-08-17 |
| JPS6212744B2 true JPS6212744B2 (ja) | 1987-03-20 |
Family
ID=11942750
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1739381A Granted JPS57132762A (en) | 1981-02-10 | 1981-02-10 | Soft start control circuit for dc/dc converter |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57132762A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59149780A (ja) * | 1983-02-09 | 1984-08-27 | Toshiba Corp | モ−タ駆動装置 |
| JPS62196068A (ja) * | 1986-02-21 | 1987-08-29 | Nec Corp | 電源回路 |
| US5264782A (en) * | 1992-08-10 | 1993-11-23 | International Business Machines Corporation | Dropout recovery circuit |
| JP3405871B2 (ja) * | 1995-11-28 | 2003-05-12 | 富士通株式会社 | 直流−直流変換制御回路および直流−直流変換装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5216650A (en) * | 1975-07-29 | 1977-02-08 | Toshiba Corp | Pulse width control circuit |
-
1981
- 1981-02-10 JP JP1739381A patent/JPS57132762A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5216650A (en) * | 1975-07-29 | 1977-02-08 | Toshiba Corp | Pulse width control circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57132762A (en) | 1982-08-17 |
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