JPS6178301U - - Google Patents
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- Publication number
- JPS6178301U JPS6178301U JP16134584U JP16134584U JPS6178301U JP S6178301 U JPS6178301 U JP S6178301U JP 16134584 U JP16134584 U JP 16134584U JP 16134584 U JP16134584 U JP 16134584U JP S6178301 U JPS6178301 U JP S6178301U
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- JP
- Japan
- Prior art keywords
- data
- output
- load control
- prohibited
- control data
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- Pending
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- 238000001514 detection method Methods 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Safety Devices In Control Systems (AREA)
- Programmable Controllers (AREA)
Description
第１図は本考案一実施例の回路図、第２図は従
来例の回路図である。 １はプログラムメモリ、２はＣＰＵ、３は入力
ポート、４は出力ポート、５は禁止データ設定回
路、６は一致検出回路である。
来例の回路図である。 １はプログラムメモリ、２はＣＰＵ、３は入力
ポート、４は出力ポート、５は禁止データ設定回
路、６は一致検出回路である。
Claims (1)
- シーケンス制御用プログラムが書き込まれたプ
ログラムメモリと、入力ポートを介して入力され
る入力データおよびプログラムメモリから読出さ
れたプログラムに基いて複数の負荷制御データを
形成して出力ポートを介して出力するＣＰＵとよ
りなるシーケンスコントローラにおいて、同時出
力を禁止すべき負荷制御データを設定する禁止デ
ータ設定回路を設けるとともに、出力ポートを介
して出力される負荷データと禁止データ設定回路
に設定された負荷制御データとの一致を検出する
一致検出回路を設け、一致検出回路出力が得られ
たときに負荷制御データの出力を阻止せしめて成
るシーケンスコントローラ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16134584U JPS6178301U (ja) | 1984-10-25 | 1984-10-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16134584U JPS6178301U (ja) | 1984-10-25 | 1984-10-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6178301U true JPS6178301U (ja) | 1986-05-26 |
Family
ID=30719251
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16134584U Pending JPS6178301U (ja) | 1984-10-25 | 1984-10-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6178301U (ja) |
-
1984
- 1984-10-25 JP JP16134584U patent/JPS6178301U/ja active Pending
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