JPS6130291B2 - - Google Patents
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- JPS6130291B2 JPS6130291B2 JP59061332A JP6133284A JPS6130291B2 JP S6130291 B2 JPS6130291 B2 JP S6130291B2 JP 59061332 A JP59061332 A JP 59061332A JP 6133284 A JP6133284 A JP 6133284A JP S6130291 B2 JPS6130291 B2 JP S6130291B2
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- 239000004065 semiconductor Substances 0.000 claims description 7
- 239000000758 substrate Substances 0.000 claims description 5
- 230000015572 biosynthetic process Effects 0.000 claims description 3
- 238000006243 chemical reaction Methods 0.000 description 6
- 238000001514 detection method Methods 0.000 description 5
- 238000010586 diagram Methods 0.000 description 4
- 239000003990 capacitor Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
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- Analogue/Digital Conversion (AREA)
Description
【発明の詳細な説明】
近来、各種装置の制御を行うにあたり、半導体
マイクロ・コンピユーターを用いたることが主流
になつて来ている。然しマイクロ・コンピユータ
ー・システムは全てが“１”か“０”かの２値に
よるデジタル処理なので、装置制御において必然
的に生ずる光電変換又は磁気変換又は熱電変換さ
れたアナログ的な電気量はマイクロ・コンピユー
ター外部で半導体リニア集積回路並びにトランジ
スター抵抗、コンデンサ、コイル等のデイスクリ
ート部品を用いて回路構成をしなければならなか
つた。従つて、取り扱うアナログ量が多ければ多
い程、部品点数が多くなり、マイクロ・コンピユ
ーターを採用して高集積化し、信頼性を上げ、コ
ストを下げようとする効果が薄れる結果になつて
しまう。
マイクロ・コンピユーターを用いたることが主流
になつて来ている。然しマイクロ・コンピユータ
ー・システムは全てが“１”か“０”かの２値に
よるデジタル処理なので、装置制御において必然
的に生ずる光電変換又は磁気変換又は熱電変換さ
れたアナログ的な電気量はマイクロ・コンピユー
ター外部で半導体リニア集積回路並びにトランジ
スター抵抗、コンデンサ、コイル等のデイスクリ
ート部品を用いて回路構成をしなければならなか
つた。従つて、取り扱うアナログ量が多ければ多
い程、部品点数が多くなり、マイクロ・コンピユ
ーターを採用して高集積化し、信頼性を上げ、コ
ストを下げようとする効果が薄れる結果になつて
しまう。
特に像形成装置、例えば複写機は、複写シーケ
ンスに従つて所定の複数のアナログデータ（例え
ば原稿濃度データ、トナー濃度データ、定着器の
温度データ等）を必要なタイミングで順次入力
し、入力したデータに基づいて複写動作を行う。
しかしながら、従来の複写機では複数のアナログ
データを処理するための回路が各データ毎に設け
られていたために複写機の構成が非常に複雑にな
つてしまうという欠点があつた。
ンスに従つて所定の複数のアナログデータ（例え
ば原稿濃度データ、トナー濃度データ、定着器の
温度データ等）を必要なタイミングで順次入力
し、入力したデータに基づいて複写動作を行う。
しかしながら、従来の複写機では複数のアナログ
データを処理するための回路が各データ毎に設け
られていたために複写機の構成が非常に複雑にな
つてしまうという欠点があつた。
本発明の目的は、上述従来例の欠点を除去する
とともに、原稿に応じて像形成する像形成手段、
像形成に係る複数のアナログデータを入力するた
めのアナログ入力ポート、前記アナログ入力ポー
トからの複数のアナログデータの入力選択を行う
アナログスイツチ、前記アナログスイツチによつ
て選択されたアナログデータをデジタルデータに
変換する変換器、デジタルデータを入力する為の
所定ビツトからなる複数のデジタル入力ポート、
デジタルデータを処理するためのプログラムを格
納をしたプログラムメモリとデータ処理を行うた
めにデータを一時的に記憶する一時記憶メモリを
含み、前記プログラムメモリのプログラムに従つ
てデータを処理するデータ処理手段、前記デジタ
ル入力ポートから前記記憶メモリにデータを送る
為のバスライン、前記プログラムメモリのプログ
ラムに従つて前記アナログスイツチと前記変換器
にバスラインを介さずに直接動作指示信号を出力
するインストラクシヨンデコーダを有し、前記ア
ナログスイツチ、前記変換器、前記デジタル入力
ポート、前記アナログ入力ポート、前記データ処
理手段を１つの半導体基板上に設けるとともに、
前記インストラクシヨンデコーダによつて前記ア
ナログスイツチを制御し、複数のアナログデータ
の一つを選択し、選択されたアナログデータを前
記変換器によつてデジタルデータに変換し、前記
インストラクシヨンデコーダの指示信号に従つて
前記変換器によつて変換されたデジタルデータを
前記入力ポートを介さずにバスラインから前記記
憶メモリに送ることを特徴とする像形成装置を提
供することにある。
とともに、原稿に応じて像形成する像形成手段、
像形成に係る複数のアナログデータを入力するた
めのアナログ入力ポート、前記アナログ入力ポー
トからの複数のアナログデータの入力選択を行う
アナログスイツチ、前記アナログスイツチによつ
て選択されたアナログデータをデジタルデータに
変換する変換器、デジタルデータを入力する為の
所定ビツトからなる複数のデジタル入力ポート、
デジタルデータを処理するためのプログラムを格
納をしたプログラムメモリとデータ処理を行うた
めにデータを一時的に記憶する一時記憶メモリを
含み、前記プログラムメモリのプログラムに従つ
てデータを処理するデータ処理手段、前記デジタ
ル入力ポートから前記記憶メモリにデータを送る
為のバスライン、前記プログラムメモリのプログ
ラムに従つて前記アナログスイツチと前記変換器
にバスラインを介さずに直接動作指示信号を出力
するインストラクシヨンデコーダを有し、前記ア
ナログスイツチ、前記変換器、前記デジタル入力
ポート、前記アナログ入力ポート、前記データ処
理手段を１つの半導体基板上に設けるとともに、
前記インストラクシヨンデコーダによつて前記ア
ナログスイツチを制御し、複数のアナログデータ
の一つを選択し、選択されたアナログデータを前
記変換器によつてデジタルデータに変換し、前記
インストラクシヨンデコーダの指示信号に従つて
前記変換器によつて変換されたデジタルデータを
前記入力ポートを介さずにバスラインから前記記
憶メモリに送ることを特徴とする像形成装置を提
供することにある。
以下図面を参照して本発明の一実施例について
説明する。
説明する。
第１図は、一枚の半導体基板の上にマイクロ・
コンピユーター回路、Ａ−Ｄ変換器、アナログス
イツチを実装した１個の大規模集積回路（以下
LSIと略）を示すものであり、点線で囲繞した部
分３２がLSIを示すものである。
コンピユーター回路、Ａ−Ｄ変換器、アナログス
イツチを実装した１個の大規模集積回路（以下
LSIと略）を示すものであり、点線で囲繞した部
分３２がLSIを示すものである。
第１図は分解能４ビツトのＡ−Ｄ変換器３０を
LSI内部に有しているものであるが、この４ビツ
トの出力はマイクロ・コンピユーター部（μ
COM−43 日本電気株式会社製により構成され
ているものとする）のデータバス３１に接続す
る。分解能が４ビツトということは取り扱うアナ
ログ信号の最大値10Vとすると、10V×1/2４まで
判別できることを意味する。
LSI内部に有しているものであるが、この４ビツ
トの出力はマイクロ・コンピユーター部（μ
COM−43 日本電気株式会社製により構成され
ているものとする）のデータバス３１に接続す
る。分解能が４ビツトということは取り扱うアナ
ログ信号の最大値10Vとすると、10V×1/2４まで
判別できることを意味する。
又外部からアナログ信号１，２，３を印加する
為の端子Ａ１，Ａ２，Ａ３は夫々アナログスイツ
チ１５，１６，１７に接続し、このアナログスイ
ツチの出力は夫々前記Ａ−Ｄ変換器３０に印加し
て成るものである。
為の端子Ａ１，Ａ２，Ａ３は夫々アナログスイツ
チ１５，１６，１７に接続し、このアナログスイ
ツチの出力は夫々前記Ａ−Ｄ変換器３０に印加し
て成るものである。
かかるアナログスイツチ１５，１６，１７及び
Ａ−Ｄ変換器３０からの変換出力の導出は、信号
線Ｃ１，Ｃ２，Ｃ３，Ｃ４を介してROM内に格
納されている命令をインストラクシヨンデコーダ
IDでデコードして制御する如く構成されている
ものである。
Ａ−Ｄ変換器３０からの変換出力の導出は、信号
線Ｃ１，Ｃ２，Ｃ３，Ｃ４を介してROM内に格
納されている命令をインストラクシヨンデコーダ
IDでデコードして制御する如く構成されている
ものである。
従つて、マイクロ・コンピユーターの命令の種
類はマイクロ・コンピユーター部の制御命令の他
に、更に、(a)アナログスイツチ１５をONして端
子Ａ１上のアナログ信号１をＡ−Ｄ変換器３０に
読み込め。(b)アナログスイツチ１６をONして端
子Ａ２上のアナログ信号２をＡ−Ｄ変換器３０に
読め込め。(c)アナログスイツチ１７をONして端
子３上のアナログ信号をＡ−Ｄ変換器３０に読め
込め。(d)Ａ−Ｄ変換器３０の内容をAccへ読み込
め。と言う４種類の命令が追加されることにな
る。
類はマイクロ・コンピユーター部の制御命令の他
に、更に、(a)アナログスイツチ１５をONして端
子Ａ１上のアナログ信号１をＡ−Ｄ変換器３０に
読み込め。(b)アナログスイツチ１６をONして端
子Ａ２上のアナログ信号２をＡ−Ｄ変換器３０に
読め込め。(c)アナログスイツチ１７をONして端
子３上のアナログ信号をＡ−Ｄ変換器３０に読め
込め。(d)Ａ−Ｄ変換器３０の内容をAccへ読み込
め。と言う４種類の命令が追加されることにな
る。
かかる命令は命令コードで空いているコードを
用いることができるものであるので、上記μ
COM−43の場合は、上記(a)の命令コードとして
11010000を用い、上記(b)の命令コードとして
11010001を用い、上記(c)の命令コードとして
11010010を用い、上記(d)の命令コードとして
11010011を用いることができる。
用いることができるものであるので、上記μ
COM−43の場合は、上記(a)の命令コードとして
11010000を用い、上記(b)の命令コードとして
11010001を用い、上記(c)の命令コードとして
11010010を用い、上記(d)の命令コードとして
11010011を用いることができる。
従つて、インストラクシヨンデコーダIDの一
部を例えば、第２図の如く構成しておくならば
ROMから読み出して命令コードは信号線Ｌ１〜
Ｌ８に印加されるものであるので、前記命令コー
ド(a)がROMから読み出されたときは信号線Ｃ１
上にのみ高レベル信号“Ｈ”が導入されて（他の
信号線には低レベル“Ｌ”が導出される）アナロ
グスイツチ１５がONとなり、前記命令コード(b)
がROMから読み出されたときは信号線Ｃ２上に
のみ信号Ｈが導出されてアナログスイツチ１６が
ONとなり、前記命令コード(c)がROMから読み出
されたときは信号線Ｃ３上にのみ信号Ｈが導出さ
れてアナログスイツチ１７がONとなり、前記命
令コード(d)がROMから読み出されたときは信号
線Ｃ４上にのみ信号Ｈが導出されてＡ−Ｄ変換さ
れたデジタル信号がAccに読み込まれる。
部を例えば、第２図の如く構成しておくならば
ROMから読み出して命令コードは信号線Ｌ１〜
Ｌ８に印加されるものであるので、前記命令コー
ド(a)がROMから読み出されたときは信号線Ｃ１
上にのみ高レベル信号“Ｈ”が導入されて（他の
信号線には低レベル“Ｌ”が導出される）アナロ
グスイツチ１５がONとなり、前記命令コード(b)
がROMから読み出されたときは信号線Ｃ２上に
のみ信号Ｈが導出されてアナログスイツチ１６が
ONとなり、前記命令コード(c)がROMから読み出
されたときは信号線Ｃ３上にのみ信号Ｈが導出さ
れてアナログスイツチ１７がONとなり、前記命
令コード(d)がROMから読み出されたときは信号
線Ｃ４上にのみ信号Ｈが導出されてＡ−Ｄ変換さ
れたデジタル信号がAccに読み込まれる。
従つて、ROMの100番地に(a)の命令コード
11010000を格納しておき。101番地に(d)の命令コ
ード00101100を格納しておくならば、PCにより
100番地を指示して命令を実行し、次に101番地を
指示して命令を実行することにより、端子Ａ１上
のアナログ信号１を４ビツトのデジタル信号に変
換してAccに読み込むことができ、同様にして端
子Ａ２，Ａ３に印加されているアナログ信号も２
つのステツプを経ることによりAccにデジタル信
号として読み込むことができるものである。
11010000を格納しておき。101番地に(d)の命令コ
ード00101100を格納しておくならば、PCにより
100番地を指示して命令を実行し、次に101番地を
指示して命令を実行することにより、端子Ａ１上
のアナログ信号１を４ビツトのデジタル信号に変
換してAccに読み込むことができ、同様にして端
子Ａ２，Ａ３に印加されているアナログ信号も２
つのステツプを経ることによりAccにデジタル信
号として読み込むことができるものである。
前記アナログスイツチ１５，１６，１７は、例
えば、第３図に示す如き回路により構成できるも
のである。
えば、第３図に示す如き回路により構成できるも
のである。
即ち、Ｑ１，Ｑ３はＰ−channel MOSトラン
ジスタ、Ｑ２，Ｑ４はＮ−channel MOSトラン
ジスタより成るものであるので、コントロール端
子２６の相対的電圧レベルが“Ｌ”（低レベル）
のときトランジスタＱ１がONし、トランジスタ
Ｑ２がOFFし、信号線２７の電圧は“Ｈ”（高レ
ベル）となるので、トランジスタＱ３はOFFに
なり、端子２６が“Ｌ”であるのでトランジスタ
Ｑ４もOFFする。
ジスタ、Ｑ２，Ｑ４はＮ−channel MOSトラン
ジスタより成るものであるので、コントロール端
子２６の相対的電圧レベルが“Ｌ”（低レベル）
のときトランジスタＱ１がONし、トランジスタ
Ｑ２がOFFし、信号線２７の電圧は“Ｈ”（高レ
ベル）となるので、トランジスタＱ３はOFFに
なり、端子２６が“Ｌ”であるのでトランジスタ
Ｑ４もOFFする。
従つて入力端子２８にあるアナログ信号は出力
端子２９に転送されない。一方端子２６を“Ｈ”
レベルにするとトランジスタＱ１がOFF、トラ
ンジスタＱ２がONするので、信号線２７は
“Ｌ”レベルになり、トランジスタＱ３がONにな
り、トランジスタＱ４もONし、端子２８にある
アナログ信号は端子２９へ転送される。
端子２９に転送されない。一方端子２６を“Ｈ”
レベルにするとトランジスタＱ１がOFF、トラ
ンジスタＱ２がONするので、信号線２７は
“Ｌ”レベルになり、トランジスタＱ３がONにな
り、トランジスタＱ４もONし、端子２８にある
アナログ信号は端子２９へ転送される。
従つて、入力端子２８にあるアナログ信号は出
力端子２９に転送されるものである。
力端子２９に転送されるものである。
かかるアナログスイツチ、Ａ−Ｄ変換器、マイ
クロ・コンピユーターのいずれもMOS FET構造
より成るもので、一枚の半導体基板の上にマイク
ロ・コンピユーター回路、Ａ−Ｄ変換器、アナロ
グスイツチを実装した１個の大規模集積回路を構
成することができる。
クロ・コンピユーターのいずれもMOS FET構造
より成るもので、一枚の半導体基板の上にマイク
ロ・コンピユーター回路、Ａ−Ｄ変換器、アナロ
グスイツチを実装した１個の大規模集積回路を構
成することができる。
第４図は第１図に示したLSIを複写装置の制御
部として用いた実施例を示すものであり、LSI３
２の端子Ａ１には原稿パツクグランド濃度検知ユ
ニツト３３を構成しているランプ３７とcds３４
の内、該cds３４の端子電圧を印加し、端子Ａ２
にはトナー濃度検知ユニツト３５を構成している
ランプ３８とcds３６の内の該cds３６の端子電
圧を印加し、端子Ａ３には定着器のヒーター温度
を検出する検出用サーミスタ３７′の端子電圧を
印加するものである。
部として用いた実施例を示すものであり、LSI３
２の端子Ａ１には原稿パツクグランド濃度検知ユ
ニツト３３を構成しているランプ３７とcds３４
の内、該cds３４の端子電圧を印加し、端子Ａ２
にはトナー濃度検知ユニツト３５を構成している
ランプ３８とcds３６の内の該cds３６の端子電
圧を印加し、端子Ａ３には定着器のヒーター温度
を検出する検出用サーミスタ３７′の端子電圧を
印加するものである。
この様に複数のアナログ信号をLSI３２に印加
しておいても、かかるアナログ信号を順次読み込
んでアナログ信号に変換し、必要なる処理をした
後制御信号を導出することができるものである。
しておいても、かかるアナログ信号を順次読み込
んでアナログ信号に変換し、必要なる処理をした
後制御信号を導出することができるものである。
第５図は、第４図に示した如き制御部を内蔵し
た複写装置４０の外観図を示すものであり、複写
装置の本体４１の上図に不図示の原稿台を設け、
この原稿台の上には軸４２を中心として揺動自在
に原稿押え４３を配置し、この原稿押え４３の手
前には複写枚数をセツトするキーボード４４及び
コピースタートボタン４５を配置して成る。な
お、４６は給紙カセツトであり、４７は複写完了
紙排出トレイである。
た複写装置４０の外観図を示すものであり、複写
装置の本体４１の上図に不図示の原稿台を設け、
この原稿台の上には軸４２を中心として揺動自在
に原稿押え４３を配置し、この原稿押え４３の手
前には複写枚数をセツトするキーボード４４及び
コピースタートボタン４５を配置して成る。な
お、４６は給紙カセツトであり、４７は複写完了
紙排出トレイである。
かかる本体４１の角部４８の一部には三角形の
切欠き４９を設けるこの切欠き４９は第６図に示
す如く上板５０、下板５１、立板５２より成るも
のであり、上板５０の一部には透光部５３を設け
て、この透光部５３の切欠き４９と反対位置には
受光素子であるところの前記cds３４を固定す
る。一方下板５１の前記透光部５３と対向するー
部には透光部５４を設け、この透光部５４の切欠
き４９と反対位置には発光素子であるところの前
記ランプ３７を固定する。
切欠き４９を設けるこの切欠き４９は第６図に示
す如く上板５０、下板５１、立板５２より成るも
のであり、上板５０の一部には透光部５３を設け
て、この透光部５３の切欠き４９と反対位置には
受光素子であるところの前記cds３４を固定す
る。一方下板５１の前記透光部５３と対向するー
部には透光部５４を設け、この透光部５４の切欠
き４９と反対位置には発光素子であるところの前
記ランプ３７を固定する。
従つて、ランプ３７から出射した光はcds３４
に到達する如く構成されているものであるが、こ
の切欠き４９に原稿５５を挿入するならば、cds
３４からは原稿５５を透過した光量に応じた出力
信号を得ることができるものである。
に到達する如く構成されているものであるが、こ
の切欠き４９に原稿５５を挿入するならば、cds
３４からは原稿５５を透過した光量に応じた出力
信号を得ることができるものである。
要するに原稿のバツクグランドを知ることがで
きるものであるので、かかる検知ユニツトの出力
により、原稿のバツクグランドに応じて該複写装
置の制御を行なうことができるものである。
きるものであるので、かかる検知ユニツトの出力
により、原稿のバツクグランドに応じて該複写装
置の制御を行なうことができるものである。
なお、前記立板５２の一部にはスイツチ５６の
検出子５７を延出しておき、前記原稿５５が、切
欠き４９に挿入されてこの検出子５７を矢印Ｔ方
向に押圧することにより、前記スイツチ５６が
ONとなる如く構成しておくならば、このスイツ
チ５６のON出力をトリガー信号としてcds３４
の出力をデジタル信号に変換することもできるも
のである。この場合は例えば前記スイツチ５６の
ON出力により第１図に示したROMの100番地を
指示すればよいものである。
検出子５７を延出しておき、前記原稿５５が、切
欠き４９に挿入されてこの検出子５７を矢印Ｔ方
向に押圧することにより、前記スイツチ５６が
ONとなる如く構成しておくならば、このスイツ
チ５６のON出力をトリガー信号としてcds３４
の出力をデジタル信号に変換することもできるも
のである。この場合は例えば前記スイツチ５６の
ON出力により第１図に示したROMの100番地を
指示すればよいものである。
以上の様に本発明によれば一つのアナログデジ
タル変換器とデータ処理手段を接続したシステム
により、像形成に係る複数のアナログデータを順
次入力して処理し、しかもそのシステムを一個の
半導体基板上に設けたので像形成装置の構成が非
常に簡単になる。
タル変換器とデータ処理手段を接続したシステム
により、像形成に係る複数のアナログデータを順
次入力して処理し、しかもそのシステムを一個の
半導体基板上に設けたので像形成装置の構成が非
常に簡単になる。
又、更にアナログスイツチとアナログデジタル
変換器への動作指示をインストラクシヨンデコー
ダによつてバスラインを介さずに直接行うので、
Ａ／Ｄ変換のタイミングを正確に設定することが
できる。しかも、かかる構成によりＡ／Ｄ変換の
指示の最中もバスラインを他の処理に用いること
ができるので、バスラインを有効に使用すること
ができる。
変換器への動作指示をインストラクシヨンデコー
ダによつてバスラインを介さずに直接行うので、
Ａ／Ｄ変換のタイミングを正確に設定することが
できる。しかも、かかる構成によりＡ／Ｄ変換の
指示の最中もバスラインを他の処理に用いること
ができるので、バスラインを有効に使用すること
ができる。
又、本発明によればＡ／Ｄ変換器によつて変換
されたデジタルデータをデジタル入力ポートを介
さずにバスラインから一時記憶メモリに送るの
で、更に構成を簡単にすることが出来る。
されたデジタルデータをデジタル入力ポートを介
さずにバスラインから一時記憶メモリに送るの
で、更に構成を簡単にすることが出来る。
第１図は本実施例のLSIを示した回路図、第２
図は第１図の一部を詳細に示す回路図、第３図は
第１図に用いたスイツチを示す回路図、第４図は
第１図のLSIを複写装置の制御部として用いた回
路図、第５図は本発明を適用した複写装置の外観
図、そして第６図Ａ，Ｂは本発明に適用し得るバ
ツクグランド濃度検知ユニツトを示す斜視図及び
Ｂ−B′断面図である。 ここで３２はマイクロ・コンピユーター、１
５，１６，１７はスイツチ、３０はＡ−Ｄ変換器
である。
図は第１図の一部を詳細に示す回路図、第３図は
第１図に用いたスイツチを示す回路図、第４図は
第１図のLSIを複写装置の制御部として用いた回
路図、第５図は本発明を適用した複写装置の外観
図、そして第６図Ａ，Ｂは本発明に適用し得るバ
ツクグランド濃度検知ユニツトを示す斜視図及び
Ｂ−B′断面図である。 ここで３２はマイクロ・コンピユーター、１
５，１６，１７はスイツチ、３０はＡ−Ｄ変換器
である。
Claims (1)
- 【特許請求の範囲】 １ 原稿に応じて像形成する像形成手段、 像形成に係る複数のアナログデータを入力する
ためのアナログ入力ポート、 前記アナログ入力ポートからの複数のアナログ
データの入力選択を行うアナログスイツチ、 前記アナログスイツチによつて選択されたアナ
ログデータをデジタルデータに変換する変換器、 デジタルデータを入力する為の所定ビツトから
なる複数のデジタル入力ポート、 デジタルデータを処理するためのプログラムを
格納したプログラムメモリとデータ処理を行うた
めにデータを一時的に記憶する一時記憶メモリを
含み、前記プログラムメモリのプログラムに従つ
てデータを処理するデータ処理手段、 前記デジタル入力ポートから前記記憶メモリに
データを送る為のバスライン、 前記プログラムメモリのプログラムに従つて前
記アナログスイツチと前記変換器にバスラインを
介さずに直接動作指示信号を出力するインストラ
クシヨンデコーダを有し、 前記アナログスイツチ、前記変換器、前記デジ
タル入力ポート、前記アナログ入力ポート、前記
データ処理手段を１つの半導体基板上に設けると
ともに、 前記インストラクシヨンデコーダによつて前記
アナログスイツチを制御し、複数のアナログデー
タの一つを選択し、選択されたアナログデータを
前記変換器によつてデジタルデータに変換し、前
記インストラクシヨンデコーダの指示信号に従つ
て前記変換器によつて変換されたデジタルデータ
を前記入力ポートを介さずにバスラインから前記
記憶メモリに送ることを特徴とする像形成装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6133284A JPS6063632A (ja) | 1984-03-28 | 1984-03-28 | 像形成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6133284A JPS6063632A (ja) | 1984-03-28 | 1984-03-28 | 像形成装置 |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3412377A Division JPS53118962A (en) | 1977-03-28 | 1977-03-28 | Analog-to-digital converting unit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6063632A JPS6063632A (ja) | 1985-04-12 |
| JPS6130291B2 true JPS6130291B2 (ja) | 1986-07-12 |
Family
ID=13168074
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6133284A Granted JPS6063632A (ja) | 1984-03-28 | 1984-03-28 | 像形成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6063632A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS636785U (ja) * | 1986-07-01 | 1988-01-18 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6288431A (ja) * | 1985-10-14 | 1987-04-22 | Nec Corp | Ａ／ｄコンバ−タ |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4845841A (ja) * | 1971-10-15 | 1973-06-30 | ||
| US3876106A (en) * | 1973-10-01 | 1975-04-08 | Eastman Kodak Co | Toner concentration monitoring apparatus utilizing programmable digital computer |
| JPS511047A (ja) * | 1974-06-21 | 1976-01-07 | Nippon Denso Co | Intafueesukairo |
| JPS513547A (ja) * | 1974-06-26 | 1976-01-13 | Nippon Denso Co | Intafueesukairo |
-
1984
- 1984-03-28 JP JP6133284A patent/JPS6063632A/ja active Granted
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4845841A (ja) * | 1971-10-15 | 1973-06-30 | ||
| US3876106A (en) * | 1973-10-01 | 1975-04-08 | Eastman Kodak Co | Toner concentration monitoring apparatus utilizing programmable digital computer |
| JPS511047A (ja) * | 1974-06-21 | 1976-01-07 | Nippon Denso Co | Intafueesukairo |
| JPS513547A (ja) * | 1974-06-26 | 1976-01-13 | Nippon Denso Co | Intafueesukairo |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS636785U (ja) * | 1986-07-01 | 1988-01-18 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6063632A (ja) | 1985-04-12 |
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