JPS61292959A - イメ−ジセンサの製造方法 - Google Patents
イメ−ジセンサの製造方法Info
- Publication number
- JPS61292959A JPS61292959A JP60135310A JP13531085A JPS61292959A JP S61292959 A JPS61292959 A JP S61292959A JP 60135310 A JP60135310 A JP 60135310A JP 13531085 A JP13531085 A JP 13531085A JP S61292959 A JPS61292959 A JP S61292959A
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- amorphous semiconductor
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は基板上に多数の光電変換素子を配列して構成さ
れるイメージセンサの製造方法に係り、特に隣接する光
電変換素子相互間のリーク電流を効果的に低減させたイ
メージセンサの製造方法に関する。
れるイメージセンサの製造方法に係り、特に隣接する光
電変換素子相互間のリーク電流を効果的に低減させたイ
メージセンサの製造方法に関する。
ファクシミリ、OCR,’1子1111Wi4管等にお
いて、原稿上の画像の読取りに用いられるイメージセン
サとして従来より各種のものが知られているが、特に原
稿幅と同一の読取り長を有する長尺型−次元イメージセ
ンサが注目され、その研究・開発が精力的に進められて
いる。このようなイメージセンサに対し、特に最近では
高解像度の読取りを可能とするために、光電変換素子の
配列の高密度化の要求が高まっている。
いて、原稿上の画像の読取りに用いられるイメージセン
サとして従来より各種のものが知られているが、特に原
稿幅と同一の読取り長を有する長尺型−次元イメージセ
ンサが注目され、その研究・開発が精力的に進められて
いる。このようなイメージセンサに対し、特に最近では
高解像度の読取りを可能とするために、光電変換素子の
配列の高密度化の要求が高まっている。
イメージセンサにおける光電変換素子の特性のうち、高
密度センサでは解像度が特に重要な因子の一つである。
密度センサでは解像度が特に重要な因子の一つである。
ところが、従来のイメージセンサでは高密度化に伴い隣
接する光電変換素子の電極間に生じるリーク電流の信号
電流に対する比率が大きくなり、それが解像度向上を妨
げる要因となっていた。この問題をさらに詳しく説明す
る。
接する光電変換素子の電極間に生じるリーク電流の信号
電流に対する比率が大きくなり、それが解像度向上を妨
げる要因となっていた。この問題をさらに詳しく説明す
る。
上記したような長尺型イメージセンサにおいては、一般
に第2図に示されるように基板1上に配列形成される複
数個の光電変換素子は、各光電変換素子毎に分割形成さ
れたOrのような金属材料からなる個別電極2と、各光
電変換素子に共通のITOのような透明導電膜からなる
共通′IM極4とで水素化アモルファスシリコン(a−
8i :H)膜等のアモルファス半導体膜3を挟んで構
成されるサンドインチ構造がとられる。この構造のイメ
ージセンサにおいて、光入射に基いて各光電変換素子を
流れる光電流1pは、アモルファス半導体113と共通
電極4との界面で形成されるポテンシャル・バリヤによ
って流れる方向性を持った信号電流1cのほかに、隣接
する個別電極間の電位差によって流れる、方向性を持た
ないリーク電流ILとが存在し、このリーク電流がイメ
ージセンサの解像度を低下させる。
に第2図に示されるように基板1上に配列形成される複
数個の光電変換素子は、各光電変換素子毎に分割形成さ
れたOrのような金属材料からなる個別電極2と、各光
電変換素子に共通のITOのような透明導電膜からなる
共通′IM極4とで水素化アモルファスシリコン(a−
8i :H)膜等のアモルファス半導体膜3を挟んで構
成されるサンドインチ構造がとられる。この構造のイメ
ージセンサにおいて、光入射に基いて各光電変換素子を
流れる光電流1pは、アモルファス半導体113と共通
電極4との界面で形成されるポテンシャル・バリヤによ
って流れる方向性を持った信号電流1cのほかに、隣接
する個別電極間の電位差によって流れる、方向性を持た
ないリーク電流ILとが存在し、このリーク電流がイメ
ージセンサの解像度を低下させる。
具体的なデータの一例として上述した構造、すなわちI
TO/a−8i : H/Crなる構造の光電変換素子
を有するイメージセンサにおける光電流Ipと信@電流
1cとの比(I p / ] c )と、隣接する個別
電極間の電位差との関係を、2iM1〜24/Mの各密
度のイメージセンサについて測定した結果を第4図に示
す。測定は、20℃の下で照射光の照度を100ルクス
として行なった。
TO/a−8i : H/Crなる構造の光電変換素子
を有するイメージセンサにおける光電流Ipと信@電流
1cとの比(I p / ] c )と、隣接する個別
電極間の電位差との関係を、2iM1〜24/Mの各密
度のイメージセンサについて測定した結果を第4図に示
す。測定は、20℃の下で照射光の照度を100ルクス
として行なった。
この第4図のデータによれば、隣接する個別電極間の電
位差が0.5V存在した場合、信号電流に対するリーク
電流の比率は密度が8/sのもので30%、16ai+
のちので約120%であり、高密度化の限界は8/履で
あることがわかる。従って、8/履以上の高密度イメー
ジセンサでは、なんらかのリーク電流抑制手段が必要と
なる。
位差が0.5V存在した場合、信号電流に対するリーク
電流の比率は密度が8/sのもので30%、16ai+
のちので約120%であり、高密度化の限界は8/履で
あることがわかる。従って、8/履以上の高密度イメー
ジセンサでは、なんらかのリーク電流抑制手段が必要と
なる。
このリーク電流抑制手段として、従来より(1)光電変
換膜に高抵抗膜を使用する。
換膜に高抵抗膜を使用する。
(2) 隣接する光電変換素子相互間の領域への不要
な入射光を遮断するための遮光膜を設ける。
な入射光を遮断するための遮光膜を設ける。
(a 光電変換素子相互間を分離する。
等の方法が考えられている。しかしながら、(1)の方
法は光電変換膜のj!質、特にμτ(キャリア移動度X
キャリア寿命)に悪影響を及ぼし、光応答性、帯域特性
等を低下させるという問題がある。
法は光電変換膜のj!質、特にμτ(キャリア移動度X
キャリア寿命)に悪影響を及ぼし、光応答性、帯域特性
等を低下させるという問題がある。
また、(2) (31の方法は高精度の位置合せが必要
で、ざらに真空プロセスが必要であることから、イメー
ジセンサの高密度化に伴って製造コストが増大するとい
う欠点があった。
で、ざらに真空プロセスが必要であることから、イメー
ジセンサの高密度化に伴って製造コストが増大するとい
う欠点があった。
本発明の目的は、従来のリーク電流抑制手段に見られる
ような弊害を伴うことなく、高密度化した場合に問題と
なる隣接する光電変換素子間のリーク電流を効果的に低
減できるイメージセンサの製造方法を提供することにあ
る。
ような弊害を伴うことなく、高密度化した場合に問題と
なる隣接する光電変換素子間のリーク電流を効果的に低
減できるイメージセンサの製造方法を提供することにあ
る。
本発明は上記目的を達成するため、セラミック基板上に
、複数の分割された不透明金属材料からなる個別電極と
、透明導電膜からなる共通電極とでアモルファス半導体
膜を挟んで構成された複数の光電変換素子を配列して構
成されるイメ−ジセンサを製造するに当り、セラミック
基板の光電変換素子配列面と反対側の面上に所定の光源
からの光を照射することにより、アモルファス半導体膜
の光電変換素子相互間領域を高抵抗化する工程を有する
ことを特徴とする。
、複数の分割された不透明金属材料からなる個別電極と
、透明導電膜からなる共通電極とでアモルファス半導体
膜を挟んで構成された複数の光電変換素子を配列して構
成されるイメ−ジセンサを製造するに当り、セラミック
基板の光電変換素子配列面と反対側の面上に所定の光源
からの光を照射することにより、アモルファス半導体膜
の光電変換素子相互間領域を高抵抗化する工程を有する
ことを特徴とする。
すなわち、a−8i:H1!のようなアモルファス半導
体膜をある程度以上の光量2時間で露光すると、露光し
た領域の抵抗値が増大する。この現象は、ステイツク・
ロンスキ(S taebler−W ronski)効
果(光劣化効果ともいう)として知られている。これは
一般に好ましくない現像とされているが、本発明はこの
効果を積極的に利用して、アモルファス半導体膜におけ
る信号電流に寄与しない不要部分、即ち光電変換素子の
相互間の部分を選択的に高抵抗化さゼることにより、リ
ーク電流を減少させるようにしたものである。
体膜をある程度以上の光量2時間で露光すると、露光し
た領域の抵抗値が増大する。この現象は、ステイツク・
ロンスキ(S taebler−W ronski)効
果(光劣化効果ともいう)として知られている。これは
一般に好ましくない現像とされているが、本発明はこの
効果を積極的に利用して、アモルファス半導体膜におけ
る信号電流に寄与しない不要部分、即ち光電変換素子の
相互間の部分を選択的に高抵抗化さゼることにより、リ
ーク電流を減少させるようにしたものである。
また、本発明ではアモルファス半導体膜の光電変換素子
相互間の領域を高抵抗化するための露光をセラミック基
板を通して、個別電極をマスクとして行なう関係から、
露光のための光源としては、セラミック基板を良く透過
する赤外領域の光、すなわちフォトンエネルギーが0.
5〜2.0[eV]の光を発光するものが好適である。
相互間の領域を高抵抗化するための露光をセラミック基
板を通して、個別電極をマスクとして行なう関係から、
露光のための光源としては、セラミック基板を良く透過
する赤外領域の光、すなわちフォトンエネルギーが0.
5〜2.0[eV]の光を発光するものが好適である。
本発明によれば、隣接する光電変換素子間に流れるリー
ク電流を効果的に、即ちリーク電流抑制手段を用いない
場合に比べて1/10以下に低減させることができ、高
密度でありながらリーク電流の掻めて小さい高性能のイ
メージセンサを実現することができる。
ク電流を効果的に、即ちリーク電流抑制手段を用いない
場合に比べて1/10以下に低減させることができ、高
密度でありながらリーク電流の掻めて小さい高性能のイ
メージセンサを実現することができる。
また、本発明は不透明金属材料である個別電極をマスク
として露光することにより、アモルファス半導体膜の不
要部分のみを選択的に高抵抗化する方法であるため、光
電変換膜自体に^抵抗膜を使用する従来方法に見られる
ような性能劣化を伴なうことがない。
として露光することにより、アモルファス半導体膜の不
要部分のみを選択的に高抵抗化する方法であるため、光
電変換膜自体に^抵抗膜を使用する従来方法に見られる
ような性能劣化を伴なうことがない。
さらに、本発明の方法は露光工程のみでリーク電流の抑
制が可能であり、遮光膜ヤ素子分離によりリーク電流を
抑制する方法と異なり煩雑な位置合せや真空プロセスが
不要であるため、製造コストが低く抑えられる。
制が可能であり、遮光膜ヤ素子分離によりリーク電流を
抑制する方法と異なり煩雑な位置合せや真空プロセスが
不要であるため、製造コストが低く抑えられる。
第1図(a)〜(f)は本発明の一実施例に係るイメー
ジセンサの製造工程を示す断面図である。
ジセンサの製造工程を示す断面図である。
本実施例においては、まずアルミナ等のセラミック基板
1上にCrのような不透明金属材料からなる個別電極2
を形成する。個別電極2の形成は、例えばセラミック基
板1を清浄化した後、蒸着法またはスパッタリング法等
により第1図(a)に示すようにCr112’を300
0人程度0膜厚に被着し、次いで第1図(b)に示すよ
うにPEP工程でバターニングすることによって行なわ
れる。
1上にCrのような不透明金属材料からなる個別電極2
を形成する。個別電極2の形成は、例えばセラミック基
板1を清浄化した後、蒸着法またはスパッタリング法等
により第1図(a)に示すようにCr112’を300
0人程度0膜厚に被着し、次いで第1図(b)に示すよ
うにPEP工程でバターニングすることによって行なわ
れる。
次に、第1図(C)に示すように、個別電極2を全体的
に覆うように帯状のアモルファス半導体膜3、例えば水
素化アモルファスシリコン(a−8i:f−1)lIを
プラズマCVD法等により形成する。次に、第1図(d
)に示すように少なくともアモルファス半導体膜3上に
位置するように、[TOのような透明導N躾からなる共
通1mIfI4をスパッタリング法等により形成する。
に覆うように帯状のアモルファス半導体膜3、例えば水
素化アモルファスシリコン(a−8i:f−1)lIを
プラズマCVD法等により形成する。次に、第1図(d
)に示すように少なくともアモルファス半導体膜3上に
位置するように、[TOのような透明導N躾からなる共
通1mIfI4をスパッタリング法等により形成する。
次に、弄瀧工程(100℃以上の熱プロセス)が全て終
了した後、第1図(e)に示すようにセラミック基板1
の裏面側、即ち光電変換素子配列面と反対側の面上に光
を照射する。この場合、光源としてはフォトンエネルギ
ーが0.5〜2.0[eV]の光、つまり主として赤外
領域の光を発光するもの(例えばタングステンランプ)
が望ましく、このような光はセラミック基板1を比較的
容易に透過する。また、この光の照度は20万ルクス、
照射時間は5時間とした。このような光照射によりアモ
ルファス半導体plA3のうち個別M極2によって遮ら
れない領域、即ち光電変換素子間の領域を露光する。従
って、この工程により第1図(f)に示されるように、
アモルファス半導体II! 3の露光された領域が選択
的に高抵抗層3′ となる。
了した後、第1図(e)に示すようにセラミック基板1
の裏面側、即ち光電変換素子配列面と反対側の面上に光
を照射する。この場合、光源としてはフォトンエネルギ
ーが0.5〜2.0[eV]の光、つまり主として赤外
領域の光を発光するもの(例えばタングステンランプ)
が望ましく、このような光はセラミック基板1を比較的
容易に透過する。また、この光の照度は20万ルクス、
照射時間は5時間とした。このような光照射によりアモ
ルファス半導体plA3のうち個別M極2によって遮ら
れない領域、即ち光電変換素子間の領域を露光する。従
って、この工程により第1図(f)に示されるように、
アモルファス半導体II! 3の露光された領域が選択
的に高抵抗層3′ となる。
第2図はこのようにして得られるイメージセンサの構造
を示したもので、第1図と相対応する部分に同一符号を
付しである。なお、図中の記号5の部分は必ずしも必要
なものではないが1.透明導電膜からなる共通電極4の
電気抵抗を下げて、ここでの電圧ドロップを小さくする
ためのcrm等からなる補助共通電極であり、通常、個
別電極2と同時に形成される。
を示したもので、第1図と相対応する部分に同一符号を
付しである。なお、図中の記号5の部分は必ずしも必要
なものではないが1.透明導電膜からなる共通電極4の
電気抵抗を下げて、ここでの電圧ドロップを小さくする
ためのcrm等からなる補助共通電極であり、通常、個
別電極2と同時に形成される。
第3図は上述した本発明によるイメージセンサの製造工
程において、光電変換素子の配列密度を8/mとし、ま
た第1図(e)の工程における光照射をタングステンラ
ンプを使用して照度40万ルクスで行なった場合の光照
射時間tと、イメージセンサのリーク1!流ILと信号
m流1cとの比の関係を測定した結果を示したものであ
る。この結果から推測されるように、照射光はアルミナ
セラミック基板1で強度が減衰されながらも、前述した
ステイブラ・ロンスキ効果を生じるのに十分な強度でア
モルファス半導体II 3に達し、光電変換素子間の領
域の高抵抗化を実現していることが理解されよう。なお
、この条件では光照射の効果は約1時間の光照射で飽和
値の90%程度に達している。
程において、光電変換素子の配列密度を8/mとし、ま
た第1図(e)の工程における光照射をタングステンラ
ンプを使用して照度40万ルクスで行なった場合の光照
射時間tと、イメージセンサのリーク1!流ILと信号
m流1cとの比の関係を測定した結果を示したものであ
る。この結果から推測されるように、照射光はアルミナ
セラミック基板1で強度が減衰されながらも、前述した
ステイブラ・ロンスキ効果を生じるのに十分な強度でア
モルファス半導体II 3に達し、光電変換素子間の領
域の高抵抗化を実現していることが理解されよう。なお
、この条件では光照射の効果は約1時間の光照射で飽和
値の90%程度に達している。
このように、本発明の方法を実施すれば、隣接する光電
変換素子間のリーク電流を115〜1/10程度にまで
抑制することができるので、8 / m以上の高密度イ
メージセンサの高解像度化に極めて有効である。
変換素子間のリーク電流を115〜1/10程度にまで
抑制することができるので、8 / m以上の高密度イ
メージセンサの高解像度化に極めて有効である。
なお、本発明はその要旨を逸脱しない範囲で種々変形し
て実施することが可能であり、例えば上記実−例ではア
モルファス半導体膜としてa−8i:H膜を示したが、
光照射によって前述したステイツク・ロンスキ効果を生
じるような材料であればよく、a−8i:Hに代えてa
−8iC:H,a−8i :F、a−Ge:H等を用い
ることもできる。要するに半導体元素としてSi、Ge
等のIv族元素から選択した少なくとも1種を含み、さ
らに膜中のダングリング・ボンドとしてH,Fから選択
した少なくとも1種を含むアモルファス半導体膜であれ
ば本発明を適用できる。また、アモルファス半導体膜に
含まれるHlF等の成分の比率は、10〜40[at、
%]程度が適当である。
て実施することが可能であり、例えば上記実−例ではア
モルファス半導体膜としてa−8i:H膜を示したが、
光照射によって前述したステイツク・ロンスキ効果を生
じるような材料であればよく、a−8i:Hに代えてa
−8iC:H,a−8i :F、a−Ge:H等を用い
ることもできる。要するに半導体元素としてSi、Ge
等のIv族元素から選択した少なくとも1種を含み、さ
らに膜中のダングリング・ボンドとしてH,Fから選択
した少なくとも1種を含むアモルファス半導体膜であれ
ば本発明を適用できる。また、アモルファス半導体膜に
含まれるHlF等の成分の比率は、10〜40[at、
%]程度が適当である。
第1図(a)〜(f)は本発明の一実施例に係るイメー
ジセンサの製造方法を説明するための工程図、第2図(
a)(b)は同実施例の製造方法によって得られるイメ
ージセンサの構造を示す平面図およびA−A断面図、第
3図は同実施例における光照射時間と、イメージセンサ
のリーク電流ILと信@ll流1cとの比の関係を測定
した結果を示す図、第4図は従来法によって得られたイ
メージセンサにおける光電流と信号m流との比と隣接す
る個別電極間の電位差との関係をイメージセンサの密度
を種々変えて測定した結果を示す図である。 1・・・セラミック基板、2・・・不透明金属材料から
なる個別電極、3・・・アモルファス半導体膜、3′・
・・高抵抗層、4・・・透明導1!躾からなる共通電極
。 出願人代理人 弁理士 鈴江武彦 第1図 第2図 が、9、材叶閏t 晒円〕
ジセンサの製造方法を説明するための工程図、第2図(
a)(b)は同実施例の製造方法によって得られるイメ
ージセンサの構造を示す平面図およびA−A断面図、第
3図は同実施例における光照射時間と、イメージセンサ
のリーク電流ILと信@ll流1cとの比の関係を測定
した結果を示す図、第4図は従来法によって得られたイ
メージセンサにおける光電流と信号m流との比と隣接す
る個別電極間の電位差との関係をイメージセンサの密度
を種々変えて測定した結果を示す図である。 1・・・セラミック基板、2・・・不透明金属材料から
なる個別電極、3・・・アモルファス半導体膜、3′・
・・高抵抗層、4・・・透明導1!躾からなる共通電極
。 出願人代理人 弁理士 鈴江武彦 第1図 第2図 が、9、材叶閏t 晒円〕
Claims (2)
- (1)セラミック基板上に、複数の分割された不透明金
属材料からなる個別電極と、透明導電膜からなる共通電
極とでアモルファス半導体膜を挟んで構成された複数の
光電変換素子を配列して構成されるイメージセンサを製
造する方法において、前記セラミック基板の前記光電変
換素子配列面と反対側の面上に所定の光源からの光を照
射することにより、前記アモルファス半導体膜の前記光
電変換素子相互間の領域を高抵抗化する工程を有するこ
とを特徴とするイメージセンサの製造方法。 - (2)前記光源としてフォトンエネルギーが0.5〜2
.0[eV]の光を発光するものを使用することを特徴
とする特許請求の範囲第1項記載のイメージセンサの製
造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60135310A JPS61292959A (ja) | 1985-06-21 | 1985-06-21 | イメ−ジセンサの製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60135310A JPS61292959A (ja) | 1985-06-21 | 1985-06-21 | イメ−ジセンサの製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61292959A true JPS61292959A (ja) | 1986-12-23 |
Family
ID=15148736
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60135310A Pending JPS61292959A (ja) | 1985-06-21 | 1985-06-21 | イメ−ジセンサの製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61292959A (ja) |
-
1985
- 1985-06-21 JP JP60135310A patent/JPS61292959A/ja active Pending
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