JPS6127617A - Laminated capacitor - Google Patents
Laminated capacitorInfo
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- JPS6127617A JPS6127617A JP4314285A JP4314285A JPS6127617A JP S6127617 A JPS6127617 A JP S6127617A JP 4314285 A JP4314285 A JP 4314285A JP 4314285 A JP4314285 A JP 4314285A JP S6127617 A JPS6127617 A JP S6127617A
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- capacitors
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】 産業上の利用分野 本発明は複数のコンデンサを一体に内蔵する積i・ 層コンデンサに関するものである。[Detailed description of the invention] Industrial applications The present invention provides a product i- It concerns layer capacitors.
従来の技術
例えばスーパーヘテロゲイン、受信機のアンテナ同調回
路と局部発振回路との間で互いに結合が起こると、その
周波数が近い場合には、引込み現象が起こったり発振電
圧がアンテナ回路を介して不要輻射として外部に輻射さ
れ妨害となったシする不都合があった。このため従来は
上記のような回路同志は物理的な空間を隔てて配置した
り、一方の回路をシールド板で覆ったりして互いの結合
を避けていたが、このような構成では小型化に限度があ
った。一方回路の小型化の手段として、複合部品を用い
ることが一般に行なわれている。例えば積層コンデンサ
などでは、複数個の同程度の容量値のコンデンサであれ
ば、極板面積がほぼ同じであるから、一体構造で作製す
ることが可能である。Conventional technology For example, in superhetero gain, when mutual coupling occurs between the receiver's antenna tuning circuit and local oscillation circuit, if their frequencies are close, a pull-in phenomenon occurs and the oscillation voltage is unnecessary via the antenna circuit. This had the disadvantage of being radiated to the outside and causing interference. For this reason, in the past, the circuits described above were placed apart from each other by physical space, or one circuit was covered with a shield plate to avoid coupling with each other, but such a configuration made it difficult to downsize. There was a limit. On the other hand, as a means of downsizing circuits, it is common practice to use composite components. For example, in the case of a multilayer capacitor, if a plurality of capacitors have the same capacitance value, the plate areas are approximately the same, so it is possible to manufacture them as an integral structure.
発明が解決しようとする問題点
しかしながら、上記のような回路にそれぞれ接続される
コンデンサを一体化すれば、必ず回路量結合が起こり、
小型化のだめに複合された積層コンデンサを用いること
ができなかった。Problems to be Solved by the Invention However, if the capacitors connected to each of the above circuits are integrated, circuit amount coupling will inevitably occur.
Due to miniaturization, it was not possible to use a composite multilayer capacitor.
本発明は、互いのコンデンサ間の結合容量を非常に小さ
くして各コンデンサが接続された異なる回路間の結合を
抑えることを目的とするものである。An object of the present invention is to minimize coupling capacitance between capacitors to suppress coupling between different circuits to which each capacitor is connected.
問題点を解決するだめの手段
上記の問題を解決するため、本発明の積層コンデンサは
、複数のコンデンサを一体に内蔵する積層コンデンサ圀
おいて、一方のコンデンサのホット側の電極層と他方の
コンデンサのアース側の電極層とを同一面上に印刷形成
したことを特徴とするものである。Means for Solving the Problems In order to solve the above problems, the multilayer capacitor of the present invention is a multilayer capacitor in which a plurality of capacitors are integrated, and the electrode layer on the hot side of one capacitor is connected to the electrode layer on the hot side of the other capacitor. This is characterized in that the electrode layer on the earth side is printed on the same surface as the electrode layer on the ground side.
作 用
本発明は、上記した構成により、互いにシールド効果を
有し相互間の結合容量を小さくした積層コンデンサを実
現することができるものである。According to the present invention, with the above-described configuration, it is possible to realize a multilayer capacitor that has a mutual shielding effect and reduces mutual coupling capacitance.
実施例
以下本発明の実施例を図面にもとづいて説明する。第1
図は本実施例の回路図であシ、コンデンサC1,C2は
端子A、Dがホット側に、端子B。EXAMPLES Hereinafter, examples of the present invention will be described based on the drawings. 1st
The figure is a circuit diagram of this embodiment, and terminals A and D of capacitors C1 and C2 are on the hot side, and terminal B is on the hot side.
Eがアース側に接続されるものである。第2図は本実施
例の正面図、第3図は第2図M−M’線による断面上面
図である。1は誘電体層、2x、3xは電極層、4は誘
電体層、2V + 3 yは電極層、6は誘電体層であ
り、順次印刷により形成する。E is connected to the ground side. FIG. 2 is a front view of this embodiment, and FIG. 3 is a cross-sectional top view taken along line MM' in FIG. 1 is a dielectric layer, 2x and 3x are electrode layers, 4 is a dielectric layer, 2V + 3 y is an electrode layer, and 6 is a dielectric layer, which are sequentially formed by printing.
上記各電極層は一部を端面にまで導出してあシ、この部
分に導電体を設けることにより端子を形成する。そして
電極層2x、2yによシコンデンサC1を、電極層3x
、3yによりコンデンサC2が、形成される。A portion of each of the electrode layers is led out to the end face, and a terminal is formed by providing a conductor in this portion. Then, the capacitor C1 is placed on the electrode layers 2x and 2y, and the electrode layer 3x
, 3y form a capacitor C2.
上記実施例では、同一面にある電極層2x、3χにはそ
れぞれ端子A、Eが接続される。ここで第1図に示すよ
うに端子Aはホット側に接続され、端子Eはアース側に
接続されるものである。また他の一面にある電極層2y
、3yはそれぞれアース接続の端子B、ホット接続の端
子りに接続されている。In the above embodiment, the terminals A and E are connected to the electrode layers 2x and 3χ on the same surface, respectively. Here, as shown in FIG. 1, terminal A is connected to the hot side, and terminal E is connected to the ground side. Also, the electrode layer 2y on the other side
, 3y are connected to the ground connection terminal B and the hot connection terminal B, respectively.
上記の構成によれば、たとえ大きな誘電体材料を用いて
も、アース側に接続された電極層2 V r3xが互い
にシールド効果を有するだめに、電極層2x、3y(極
子A、D)間の結合容量は極めて小さく、端子A、Dが
それぞれ接続される別系統の回路間の結合を抑えること
が可能となる。According to the above configuration, even if a large dielectric material is used, in order for the electrode layers 2Vr3x connected to the ground side to have a shielding effect from each other, The coupling capacitance is extremely small, making it possible to suppress coupling between circuits of different systems to which the terminals A and D are respectively connected.
なお図示のよ゛うに、アース側に接続される電極層2y
、3xの形状を、他の電極層2x 、、3yよシも大と
なすことによシ、端子A、D間の結合容量をよシ小さく
できるとともに、印刷工程での位置精度の誤差を吸収し
容量のばらつきを小さくすることができる。In addition, as shown in the figure, the electrode layer 2y connected to the ground side
, 3x is larger than the other electrode layers 2x, , 3y, the coupling capacitance between terminals A and D can be further reduced, and errors in positional accuracy in the printing process can be absorbed. Therefore, variations in capacitance can be reduced.
発明の効果
以上のように本発明の積層コンデンサによれば、一方の
コンデンサのホット側の電極層と他方のコンデンサのア
ース側の電極層とを同一面上に印刷形成したことにより
、互いのコンデンサ間の結合容量を小さくして、各コン
デンサが接続された異なる回路間の結合を抑えることが
可能となシ、すなわちこれらの回路を小型化する上で大
きく寄与するものである。Effects of the Invention As described above, according to the multilayer capacitor of the present invention, the hot-side electrode layer of one capacitor and the ground-side electrode layer of the other capacitor are printed and formed on the same surface, so that they can be easily connected to each other. This makes it possible to reduce the coupling capacitance between capacitors and suppress coupling between different circuits to which each capacitor is connected, which greatly contributes to miniaturizing these circuits.
第1図は本発明の積層コンデンサの一実施例の回路図、
第2図は本実施例の正面図、第3図は第2図M−M’線
による断面上面図である。
1・・・・・・誘電体層、2 ! 、 27 、3 x
、 3 y・・川・電極層、4,5・・・・・・誘電
体層、A、B、C,D・・・・・・端子。
代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図
A f)
第21!1
第3WJFIG. 1 is a circuit diagram of an embodiment of a multilayer capacitor of the present invention,
FIG. 2 is a front view of this embodiment, and FIG. 3 is a cross-sectional top view taken along line MM' in FIG. 1...Dielectric layer, 2! , 27, 3x
, 3 y... river/electrode layer, 4, 5... dielectric layer, A, B, C, D... terminal. Name of agent: Patent attorney Toshio Nakao and 1 other person No. 1
Figure A f) 21st!1 3rd WJ
Claims (1)
いて、一方のコンデンサのホット側の電極層と他方のコ
ンデンサのアース側の電極層とを同一面上に印刷形成し
たことを特徴とする積層コンデンサ。A multilayer capacitor that integrates a plurality of capacitors, characterized in that a hot side electrode layer of one capacitor and a ground side electrode layer of the other capacitor are printed on the same surface.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4314285A JPS6127617A (en) | 1985-03-05 | 1985-03-05 | Laminated capacitor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4314285A JPS6127617A (en) | 1985-03-05 | 1985-03-05 | Laminated capacitor |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6127617A true JPS6127617A (en) | 1986-02-07 |
JPH0440850B2 JPH0440850B2 (en) | 1992-07-06 |
Family
ID=12655583
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4314285A Granted JPS6127617A (en) | 1985-03-05 | 1985-03-05 | Laminated capacitor |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6127617A (en) |
-
1985
- 1985-03-05 JP JP4314285A patent/JPS6127617A/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPH0440850B2 (en) | 1992-07-06 |
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