JPS6127052A - 螢光表示管 - Google Patents

螢光表示管

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Publication number
JPS6127052A
JPS6127052A JP14603684A JP14603684A JPS6127052A JP S6127052 A JPS6127052 A JP S6127052A JP 14603684 A JP14603684 A JP 14603684A JP 14603684 A JP14603684 A JP 14603684A JP S6127052 A JPS6127052 A JP S6127052A
Authority
JP
Japan
Prior art keywords
display
silicon chip
display section
column
leads
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP14603684A
Other languages
English (en)
Inventor
Sashiro Kamimura
佐四郎 上村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Noritake Itron Corp
Original Assignee
Ise Electronics Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ise Electronics Corp filed Critical Ise Electronics Corp
Priority to JP14603684A priority Critical patent/JPS6127052A/ja
Publication of JPS6127052A publication Critical patent/JPS6127052A/ja
Pending legal-status Critical Current

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  • Cathode-Ray Tubes And Fluorescent Screens For Display (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 ごの発明は、漢字または複雑な図形の表示を行なう螢光
表示管に関するものである。
〔従来技術〕
従来、漢字または複雑な図形を表示する螢光表示管は、
24X24画素を有する表示部と、外部から供給される
信号を解読して発光させるべき画素を指定する信号処理
回路とを1つの半導体基板に実装したものを1つの表示
区画とし、この表示区画をガラス基板上に必要数並べた
ものを陽極としている。そして、個々の表示区画に、必
要な信号を供給することによって複数の漢字からなる情
報、または複雑な図形の表示を行なっている。
第1図は1個の表示区画の回路を示す回路図であシ、1
は24X24画素を有する表示部、2はローデコーダ、
3はコラムデコーダであシ、ローデコーダ2およびコラ
ムデコーダ3は信号処理回路を構成している。コラムデ
コーダ3は入力データコントロール回路31.I10回
路32、コラム選択回路33、ゲート回路348〜34
e1ノ(ワーダウン回路35から構成されている。表示
部1は縦24個、横24個の画素で構成されているので
、これらの画素の選択を行なうだめの接続線は第2図に
示すように直交して配設することになる。
第2図において4.〜4nはローリード5.〜5nはコ
ラムリードであシ、これらは図示しない絶縁層を挾んで
直交している。
第3図は第1図に示す1つの表示区画を半導体基板に実
装したものの平面図である。同図において6はシリコン
チップであり、第1図の回路部品はこのシリコンチップ
6の上に実装することになるが、ローリード41〜4n
およびコラムリード5、〜5nは第2図のように直交し
ているので、これらのリードを選択するローデコーダ2
およびコラムデコーダ3はこれらのリードの延長方向に
配設するのが最も配置が容易であシ、第3図に示すよう
に直交させて配設することになる。71〜7B+8、〜
8nは外部回路とシリコンチップとの接続を行なうため
のポンディングパッドである。
このように構成された表示区画を用いた螢光表示管は、
各表示区画毎に供給されるローデータ、コラムデータが
ポンディングパッド71〜7..8゜〜8nを介してロ
ーデコーダ2およびコラムデコーダ3に供給され、ここ
で解読された結果に対応して発光すべき画素が選択され
る。そして、図示     ′しない陰極から放射され
た電子が選択された画素に射突し、その部分か゛発光す
る。
しかしながら、このように構成された表示区画を有する
従来の螢光表示管は、ローデコーダおよびコラムデコー
ダを直交させて配設させる必要があるため表示部の配設
場所はシリコンチップの一方に片寄ってしまい、複数の
表示区画を並べて文字または図形の表示を行なう場合、
文字と文字あるいは図形と図形の表示間隔が開きすぎ、
不自然な表示になるという欠点を有していた。
〔発明の目的および構成〕
したがってこの発明の目的は、複数の文字または図形の
表示を行なう場合、適当な表示間隔とした表示を行ない
、自然な表示を行なうことができる螢光表示管を提供す
ることにある。
このような目的を達成するためにこの発明は、信号処理
回路を一方の辺と、この辺に対向する辺にそれぞれ配設
したものである。以下、実施例を示す図面を用いてこの
発明の詳細な説明する。
〔実施例〕
第4図はこの発明に用いた表示区画の一実施例を示す平
面図である。この表示区画はシリコンチップ8の一方の
辺にローデコーダ2およびポンディ/グパツド7.〜7
nが配設され、この辺と対向する辺にコラムデコーダ3
とポンディングパッド8、〜8nが配設され、表示部1
がシリコンチップ6の中央に配置されている。しかし、
表示部1は第20に示すような直支配列しプヒローリー
ド41〜4n、51〜5nによって画素が選択される横
進であるため、水平方向に配置されたローリード4□〜
柿の向きを垂直方向に変えてローデコーダ2に接続する
必要がある。
第5図はローリード41〜4nとローデコーダ2とを接
続する手段を示す図である。同図において、ローリード
4.〜4Hsコラムリード51〜5n祉前述したように
絶縁層を挾んで直交しているが、このうちコラムリード
5.〜5nが設けられている面と同一面にコラムリード
と隣接させてローリード引出用リードe、〜9nを設け
る。そして、このローリード引出用リード81〜9nの
一端でローリード41〜4nと直交する部分にスルーホ
ール10を設け、ローリード41〜4nとローリード引
出用リード91〜9nをそれぞれ接続し、ローリード引
出用リード8.〜8nの他端はローデコーダ2に接続す
る。このように構成することによって、ローリード4重
〜4nは、ローリード引出用リード9.〜9nを介して
ローデコーダ2と接続される。このため表示区画は一対
の対向辺にだけローデコーダ2、コラムデコーダ3、ポ
ンディングパッド71〜1fie 81〜8nがそれぞ
れ設けられ、他の1対の対向辺には部品を設ける必要が
なくなるので、表示部1をシリコンチップ6の中央部に
配置でき、表示区画を複数並べた場合でも前記他の対向
辺方向に文字と文字また′紘図形と図形を接近して表示
できる。
〔発明の効果〕
以上説明したようにこの発明に係る螢光表示管は、文字
または図形を表示する表示区画内の信号処理回路を一方
の辺と、その辺と対向する辺にそれぞれ設けたものであ
るから、表示部は表示区画内の中央部に配設することが
でき、表示区画を信号処理回路の設けていない方向に複
数並べた場合でも文字と文字または図形と図形を接近し
て表示でき、自然な表示が行なえるという効果を有する
【図面の簡単な説明】
第1図は1つの表示区画を表わす回路図、第2図は従来
の表示区画に設けられているローリードおよびコラムリ
ードの配置を示す配置図、第3図線従来の表示区画の部
品配置を示す平面図、第4図はこの発明に用いる表示区
画の部品配置を示す平面図、第5図はこの発明釦用いる
表示区画に用いられるローリードおよびコラムリードの
配置を示す配置図である。 1・・・φ表示ns 2・・・吻ローデコーダ、3・・
0・コラムリ−ド、41〜4n・・争・ローリード、5
、〜5n・・・eコラムリード、6−・・・シリコンチ
ップ、7t〜7n、81〜g n a・す・ポンディン
グパッドs  93〜9n・φ9・ローリード引出用リ
ード、10・・−・スルーホール。 筑2図 らA3図 第5 濱4図

Claims (1)

    【特許請求の範囲】
  1. ロー入力端子とコラム入力端子のそれぞれに対応して設
    けた信号処理回路およびこの信号処理回路で処理した信
    号を表示する表示部を同一チップ上に有し、ロー入力端
    子とコラム入力端子に供給される信号に対応した表示を
    行なう表示区画を複数隣接させて配設した螢光表示管に
    おいて、表示区画はロー入力端子から供給される信号を
    処理する信号処理回路をチップの一方の辺に配置し、こ
    の辺と対向する辺にコラム入力端子から供給される信号
    を処理する信号処理回路を配置した構造であることを特
    徴とする螢光表示管。
JP14603684A 1984-07-16 1984-07-16 螢光表示管 Pending JPS6127052A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP14603684A JPS6127052A (ja) 1984-07-16 1984-07-16 螢光表示管

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP14603684A JPS6127052A (ja) 1984-07-16 1984-07-16 螢光表示管

Publications (1)

Publication Number Publication Date
JPS6127052A true JPS6127052A (ja) 1986-02-06

Family

ID=15398654

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14603684A Pending JPS6127052A (ja) 1984-07-16 1984-07-16 螢光表示管

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JP (1) JPS6127052A (ja)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5496357A (en) * 1977-11-14 1979-07-30 Wagner Electric Corp Integration indicator and method of producing same

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5496357A (en) * 1977-11-14 1979-07-30 Wagner Electric Corp Integration indicator and method of producing same

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