JPS61237455A - モ−ルド電気部品 - Google Patents
モ−ルド電気部品Info
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- JPS61237455A JPS61237455A JP8002885A JP8002885A JPS61237455A JP S61237455 A JPS61237455 A JP S61237455A JP 8002885 A JP8002885 A JP 8002885A JP 8002885 A JP8002885 A JP 8002885A JP S61237455 A JPS61237455 A JP S61237455A
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- resin
- chip
- resin layer
- frame
- molded
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
- H01L23/3135—Double encapsulation or coating and encapsulation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
- H01L2224/48247—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
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- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はモールド電気部品に関するものであって、各種
のモールド高周波デバイスに適用して最適なものである
。
のモールド高周波デバイスに適用して最適なものである
。
本発明は、モールド電気部品において、半導体チップを
第1の樹脂層と第2の樹脂層とで封止することにより、
高周波特性を向上させることを可能にしたものである。
第1の樹脂層と第2の樹脂層とで封止することにより、
高周波特性を向上させることを可能にしたものである。
近時、一般家庭向けの直接衛星放送が始まったのに伴い
、従来は通信工業分野における技術であったマイクロ波
技術が民生機器に導入され始めている。この場合、衛星
から発射されている12Gllzの信号を受信する低雑
音コンバータを構成するキーデバイスのひとつがGaA
s F E Tである。
、従来は通信工業分野における技術であったマイクロ波
技術が民生機器に導入され始めている。この場合、衛星
から発射されている12Gllzの信号を受信する低雑
音コンバータを構成するキーデバイスのひとつがGaA
s F E Tである。
一般家庭用として用いる場合にこのデバイスに要求され
ていることは、特性が良好であることと共に廉価である
ことである。
ていることは、特性が良好であることと共に廉価である
ことである。
ところで、従来、マイクロ波帯で使われている低雑音G
aAs F E Tのパッケージは、セラミックパッ
ケージが主流である。ところが、一般にこのセラミック
パッケージよりもプラスチックモールドパッケージの方
が量産性に優れているため、マイクロ波帯で低雑音Ga
As F E Tのプラスチックモールドパッケージ
化が可能になればデバイスの低廉化及びシステムの低廉
化に大きく役立つことになる。
aAs F E Tのパッケージは、セラミックパッ
ケージが主流である。ところが、一般にこのセラミック
パッケージよりもプラスチックモールドパッケージの方
が量産性に優れているため、マイクロ波帯で低雑音Ga
As F E Tのプラスチックモールドパッケージ
化が可能になればデバイスの低廉化及びシステムの低廉
化に大きく役立つことになる。
しかしながら、GaAs F E Tをプラスチック
モールド化した場合、モールドに通常用いられているエ
ポキシ樹脂のマイクロ波帯における誘電率が大きいため
、樹脂による寄生容量、特にドレインからゲートへの帰
還容1tcdfが大きく、従って高周波特性が悪かった
。
モールド化した場合、モールドに通常用いられているエ
ポキシ樹脂のマイクロ波帯における誘電率が大きいため
、樹脂による寄生容量、特にドレインからゲートへの帰
還容1tcdfが大きく、従って高周波特性が悪かった
。
本発明者らは、この欠点を是正するため、近時、内部リ
ードフレームパターンを改善してCdgを低減すること
により高周波特性を従来よりも改善したが、未だ満足す
べき良好な高周波特性を得ることはできなかった。
ードフレームパターンを改善してCdgを低減すること
により高周波特性を従来よりも改善したが、未だ満足す
べき良好な高周波特性を得ることはできなかった。
なお本発明に関連する先行文献として特公昭45−40
739号公報が挙げられ、この文献には半導体チップを
エポキシ、フェノール等の樹脂で封止した後、この樹脂
の外側にさらに樹脂を設けた構造のモールドICが開示
されている。
739号公報が挙げられ、この文献には半導体チップを
エポキシ、フェノール等の樹脂で封止した後、この樹脂
の外側にさらに樹脂を設けた構造のモールドICが開示
されている。
〔発明が解決しようとする問題点〕
本発明は、上述の問題にかんがみ、従来のモールドGa
As F E T等が有する上述のような欠点を是正
したモールド電気部品を提供することを目的とする。
As F E T等が有する上述のような欠点を是正
したモールド電気部品を提供することを目的とする。
c問題点を解決するための手段〕
本発明者は、モールドGaAs F E Tにおける
C1を減少させるためには、■半導体チップの内部パタ
ーンの工夫、■リードフレームパターンの最適化、■充
填樹脂の高周波特性の改善、■樹脂の充填方法の改善、
■中空モールド化等が考えられるが、このうち特に■、
■が有効であることに着目し、これらについて鋭意研究
した結果本発明に至ったものである。
C1を減少させるためには、■半導体チップの内部パタ
ーンの工夫、■リードフレームパターンの最適化、■充
填樹脂の高周波特性の改善、■樹脂の充填方法の改善、
■中空モールド化等が考えられるが、このうち特に■、
■が有効であることに着目し、これらについて鋭意研究
した結果本発明に至ったものである。
すなわち、本発明に係るモールド電気部品は、半導体チ
ップ(例えばGaAsチップ1)と、この半導体チップ
を封止する第1の樹脂層(例えばテフロン系のBT樹脂
9)と、この第1の樹脂層の外側に設けられている第2
の樹脂層(例えばエポキシ樹脂10)とをそれぞれ具備
し、上記第1の樹脂層の誘電率が上記第2の樹脂層の誘
電率よりも小さいことを特徴とする。
ップ(例えばGaAsチップ1)と、この半導体チップ
を封止する第1の樹脂層(例えばテフロン系のBT樹脂
9)と、この第1の樹脂層の外側に設けられている第2
の樹脂層(例えばエポキシ樹脂10)とをそれぞれ具備
し、上記第1の樹脂層の誘電率が上記第2の樹脂層の誘
電率よりも小さいことを特徴とする。
このように構成することによって、樹脂による寄生容量
を低減することが可能である。
を低減することが可能である。
以下本発明に係るモールド電気部品をモールドGaAs
F E Tに適用した一実施例につき図面を参照し
ながら説明する。
F E Tに適用した一実施例につき図面を参照し
ながら説明する。
第1A図及び第1B図に示すように、本実施例によるモ
ールドGaAs F E Tにおし)ては、GaAs
FETが形成されているGaAsチップ1がマウントさ
れたリードフレーム2の両側にこれと同一平面上かつ対
称的にリードフレーム3.4が設けられ、GaAsチッ
プIのソースパッド(図示せず)とり一ドフレーム2と
がボンディングワイヤ5,6により、GaAsチップl
のゲートパッド(図示せず)とリードフレーム3とがボ
ンディングワイヤ7により、GaAsチップ1のドレイ
ンパッド(図示せず)とリードフレーム4とがボンディ
ングワイヤ8によりそれぞれ接続されている。そしてこ
れらのGaAsチップ1、ボンディングワイヤ5〜8、
リードフレーム2の中央部及びリードフレーム3,4の
一端部が、下表に示すように低誘電率樹脂であるテフロ
ン系のBT樹脂(ビスマレイミド・トリアジン・レジン
、三菱瓦斯化学株式会社の商品名)9により角形の外形
にモールドされ、さらにこのBT樹脂9の外側がエポキ
シ樹脂(例えばMP−10)10により、BT樹脂9と
同じく角形の外形にモールドされている。なおこのエポ
キシ樹脂10のモールド時には、BT樹脂9のモールド
時よりも大きな型を用いる。
ールドGaAs F E Tにおし)ては、GaAs
FETが形成されているGaAsチップ1がマウントさ
れたリードフレーム2の両側にこれと同一平面上かつ対
称的にリードフレーム3.4が設けられ、GaAsチッ
プIのソースパッド(図示せず)とり一ドフレーム2と
がボンディングワイヤ5,6により、GaAsチップl
のゲートパッド(図示せず)とリードフレーム3とがボ
ンディングワイヤ7により、GaAsチップ1のドレイ
ンパッド(図示せず)とリードフレーム4とがボンディ
ングワイヤ8によりそれぞれ接続されている。そしてこ
れらのGaAsチップ1、ボンディングワイヤ5〜8、
リードフレーム2の中央部及びリードフレーム3,4の
一端部が、下表に示すように低誘電率樹脂であるテフロ
ン系のBT樹脂(ビスマレイミド・トリアジン・レジン
、三菱瓦斯化学株式会社の商品名)9により角形の外形
にモールドされ、さらにこのBT樹脂9の外側がエポキ
シ樹脂(例えばMP−10)10により、BT樹脂9と
同じく角形の外形にモールドされている。なおこのエポ
キシ樹脂10のモールド時には、BT樹脂9のモールド
時よりも大きな型を用いる。
1 MHzにおける誘電特性
(BT樹脂のデータは三菱瓦斯化学株式会社技術資料に
よる) 上述の実施例によれば、GaAsチップlをBT樹脂9
でモールドし、さらにこのBT樹脂9の外側にエポキシ
樹脂10を設けているので次のような利点がある。すな
わち、BT樹脂9は上記の表に示したように誘電率8が
3.0と従来用いられているエポキシ樹脂に比べて小さ
いので、帰還容量Ca、が小さく、従って高周波特性が
良好なモールドGaAs F E Tを得ることがで
きる。
よる) 上述の実施例によれば、GaAsチップlをBT樹脂9
でモールドし、さらにこのBT樹脂9の外側にエポキシ
樹脂10を設けているので次のような利点がある。すな
わち、BT樹脂9は上記の表に示したように誘電率8が
3.0と従来用いられているエポキシ樹脂に比べて小さ
いので、帰還容量Ca、が小さく、従って高周波特性が
良好なモールドGaAs F E Tを得ることがで
きる。
またBT樹脂9自身はリードフレーム材料との密着性が
良好でないが、このBT樹脂9の外側にリードフレーム
材料との密着性が良好なエポキシ樹脂10を設けている
ので、これによりBT樹脂9が有する上述の欠点を補う
ことができ、従ってモールドGaAs F E T全
体として見れば耐湿性等の信転性が向上すると共に、樹
脂とリードフレーム2〜4との機械的接着強度が高くな
る。なおエポキシ樹脂lOの誘電率は上記の表で示され
るようにBT樹脂9の誘電率に比べてかなり大きいが、
Cd、はGaAsチップ1の近傍に存在するBT樹脂9
によって殆ど決定されてしまうので、これはCdg増加
の原因には殆どならない。
良好でないが、このBT樹脂9の外側にリードフレーム
材料との密着性が良好なエポキシ樹脂10を設けている
ので、これによりBT樹脂9が有する上述の欠点を補う
ことができ、従ってモールドGaAs F E T全
体として見れば耐湿性等の信転性が向上すると共に、樹
脂とリードフレーム2〜4との機械的接着強度が高くな
る。なおエポキシ樹脂lOの誘電率は上記の表で示され
るようにBT樹脂9の誘電率に比べてかなり大きいが、
Cd、はGaAsチップ1の近傍に存在するBT樹脂9
によって殆ど決定されてしまうので、これはCdg増加
の原因には殆どならない。
以上本発明の一実施例につき説明したが、本発明は上述
の実施例に限定されるものではなく、本発明の技術的思
想に基づく種々の変形が可能である。例えば、上述の実
施例においてはモールド後のBT樹脂9及びエポキシ樹
脂10の外形を角形としたが、必要に応じて例えば円形
の外形にしてもよい。また上述の実施例においては第1
の樹脂層をBT樹脂9で構成し、第2の樹脂層をエポキ
シ樹脂lOで構成したが、これに限定されるものではな
く、第1の樹脂層の誘電率が第2の樹脂層の誘電率より
も小さければ必要に応じて種々の樹脂材料を用いること
ができる。例えば、第1の樹脂層をシリコーン樹脂で構
成してもよい。
の実施例に限定されるものではなく、本発明の技術的思
想に基づく種々の変形が可能である。例えば、上述の実
施例においてはモールド後のBT樹脂9及びエポキシ樹
脂10の外形を角形としたが、必要に応じて例えば円形
の外形にしてもよい。また上述の実施例においては第1
の樹脂層をBT樹脂9で構成し、第2の樹脂層をエポキ
シ樹脂lOで構成したが、これに限定されるものではな
く、第1の樹脂層の誘電率が第2の樹脂層の誘電率より
も小さければ必要に応じて種々の樹脂材料を用いること
ができる。例えば、第1の樹脂層をシリコーン樹脂で構
成してもよい。
なお上述の実施例においては、本発明をモールドGaA
s F E Tに適用した場合につき説明したが、他
の種類のモールド電気部品にも本発明を適用することが
可能である。
s F E Tに適用した場合につき説明したが、他
の種類のモールド電気部品にも本発明を適用することが
可能である。
本発明に係るモールド電気部品によれば、モールド用の
樹脂に起因する寄生容量を低減することが可能であり、
従って高周波特性を良好にすることが可能である。
樹脂に起因する寄生容量を低減することが可能であり、
従って高周波特性を良好にすることが可能である。
第1A図及び第1B図はそれぞれ本発明の一実施例によ
るモールドGaAs F E Tを示す平面図及びそ
のI−1線の断面図である。 なお図面に用いた符号において、 1・−=−・−・・・・−・−GaAsチップ2.3.
4・・・・・−・・・−リードフレーム9・−−−−−
−−−一・−−−−−−−・BT樹脂10−−−−−−
−−・−−−−−一・エポキシ樹脂である。
るモールドGaAs F E Tを示す平面図及びそ
のI−1線の断面図である。 なお図面に用いた符号において、 1・−=−・−・・・・−・−GaAsチップ2.3.
4・・・・・−・・・−リードフレーム9・−−−−−
−−−一・−−−−−−−・BT樹脂10−−−−−−
−−・−−−−−一・エポキシ樹脂である。
Claims (1)
- 【特許請求の範囲】 半導体チップと、 この半導体チップを封止する第1の樹脂層と、この第1
の樹脂層の外側に設けられている第2の樹脂層とをそれ
ぞれ具備し、 上記第1の樹脂層の誘電率が上記第2の樹脂層の誘電率
よりも小さいことを特徴とするモールド電気部品。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8002885A JPS61237455A (ja) | 1985-04-15 | 1985-04-15 | モ−ルド電気部品 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8002885A JPS61237455A (ja) | 1985-04-15 | 1985-04-15 | モ−ルド電気部品 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61237455A true JPS61237455A (ja) | 1986-10-22 |
Family
ID=13706819
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8002885A Pending JPS61237455A (ja) | 1985-04-15 | 1985-04-15 | モ−ルド電気部品 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61237455A (ja) |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH04137753A (ja) * | 1990-09-28 | 1992-05-12 | Sanyo Electric Co Ltd | 高周波半導体装置 |
US5889232A (en) * | 1996-05-14 | 1999-03-30 | Nec Corporation | Ultrahigh-frequency electronic component |
WO2002015423A1 (fr) * | 2000-08-17 | 2002-02-21 | Hitachi, Ltd. | Module d'emetteur et de recepteur |
US8063476B2 (en) | 2007-12-04 | 2011-11-22 | Elpida Memory, Inc. | Semiconductor device |
JPWO2013175690A1 (ja) * | 2012-05-25 | 2016-01-12 | パナソニックIpマネジメント株式会社 | 高周波増幅回路 |
US20190311962A1 (en) * | 2018-04-10 | 2019-10-10 | Bae Systems Information And Electronic Systems Integration Inc. | Heterogeneous integrated circuits with integrated covers |
-
1985
- 1985-04-15 JP JP8002885A patent/JPS61237455A/ja active Pending
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH04137753A (ja) * | 1990-09-28 | 1992-05-12 | Sanyo Electric Co Ltd | 高周波半導体装置 |
US5889232A (en) * | 1996-05-14 | 1999-03-30 | Nec Corporation | Ultrahigh-frequency electronic component |
US5970322A (en) * | 1996-05-14 | 1999-10-19 | Nec Corporation | Ultrahigh-frequency electronic component and method of manufacturing the same |
WO2002015423A1 (fr) * | 2000-08-17 | 2002-02-21 | Hitachi, Ltd. | Module d'emetteur et de recepteur |
US8063476B2 (en) | 2007-12-04 | 2011-11-22 | Elpida Memory, Inc. | Semiconductor device |
JPWO2013175690A1 (ja) * | 2012-05-25 | 2016-01-12 | パナソニックIpマネジメント株式会社 | 高周波増幅回路 |
US20190311962A1 (en) * | 2018-04-10 | 2019-10-10 | Bae Systems Information And Electronic Systems Integration Inc. | Heterogeneous integrated circuits with integrated covers |
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